| Message ID | 20241108022703.1877171-3-pengfei.li_1@nxp.com (mailing list archive) |
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| Series | Add i.MX91 platform support | expand |
Hi, thanks for putting me on CC. Am Freitag, 8. November 2024, 03:27:02 CET schrieb Pengfei Li: > The i.MX 91 family features an Arm Cortex-A55 running at up to > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > along with a rich set of peripherals targeting medical, industrial > and consumer IoT market segments. > > The design of the i.MX91 platform is very similar to i.MX93. > The mainly difference between i.MX91 and i.MX93 is as follows: > - i.MX91 removed some clocks and modified the names of some clocks. > - i.MX91 only has one A core > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > Reviewed-by: Frank Li <Frank.Li@nxp.com> > --- > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > 2 files changed, 836 insertions(+) > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > new file mode 100644 > index 000000000000..bc58ce2102b2 > --- /dev/null > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h FWIW this is a 1:1 copy from downstream kernel > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > new file mode 100644 > index 000000000000..a9f4c1fe61cc > --- /dev/null > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > @@ -0,0 +1,66 @@ > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > +/* > + * Copyright 2024 NXP > + */ > + > +#include "imx91-pinfunc.h" > +#include "imx93.dtsi" > + > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > + cooling-device = > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > +}; > + > +&clk { > + compatible = "fsl,imx91-ccm"; > +}; > + > +&eqos { > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > + <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; Is it just me or is the alignment of new lines not matching? > +}; > + > +&fec { > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > + <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET2_REGULAR>, > + <&clk IMX93_CLK_DUMMY>; > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET2_REGULAR>; > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; Here as well: Is it just me or is the alignment of new lines not matching? > + assigned-clock-rates = <100000000>, <250000000>; > +}; > + > +&i3c1 { > + clocks = <&clk IMX93_CLK_BUS_AON>, > + <&clk IMX93_CLK_I3C1_GATE>, > + <&clk IMX93_CLK_DUMMY>; > +}; > + > +&i3c2 { > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > + <&clk IMX93_CLK_I3C2_GATE>, > + <&clk IMX93_CLK_DUMMY>; > +}; > + > +&tmu { > + status = "disabled"; Why does the TMU needs to be disabled instead of deleted? > +}; > + > +/* i.MX91 only has one A core */ > +/delete-node/ &A55_1; > + > +/* i.MX91 not has cm33 */ > +/delete-node/ &cm33; > + > +/* i.MX91 not has power-domain@44461800 */ > +/delete-node/ &mlmix; > Shouldn't the following node also be removed? * mipi_csi * dsi * lvds_bridge * lcdif_to_dsi * lcdif_to_ldb Also in downstream kernel IMX91_CLK_MEDIA_AXI, which is IMX93_CLK_MEDIA_AXI upstream, is set to 200 MHz. Is this applicable here as well? Best regards, Alexander
Am Donnerstag, 7. November 2024, 13:49:50 CET schrieb Alexander Stein: > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > new file mode 100644 > > index 000000000000..a9f4c1fe61cc > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > @@ -0,0 +1,66 @@ > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#include "imx91-pinfunc.h" > > +#include "imx93.dtsi" > > + > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > + cooling-device = > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > +}; > > + > > +&clk { > > + compatible = "fsl,imx91-ccm"; > > +}; > > + > > +&eqos { > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > Is it just me or is the alignment of new lines not matching? > > > > +}; > > + > > +&fec { > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > + <&clk IMX93_CLK_DUMMY>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > Here as well: Is it just me or is the alignment of new lines not matching? > > > + assigned-clock-rates = <100000000>, <250000000>; > > +}; > > + > > +&i3c1 { > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > + <&clk IMX93_CLK_I3C1_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&i3c2 { > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > + <&clk IMX93_CLK_I3C2_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&tmu { > > + status = "disabled"; > > Why does the TMU needs to be disabled instead of deleted? > > > +}; > > + > > +/* i.MX91 only has one A core */ > > +/delete-node/ &A55_1; > > + > > +/* i.MX91 not has cm33 */ > > +/delete-node/ &cm33; > > + > > +/* i.MX91 not has power-domain@44461800 */ > > +/delete-node/ &mlmix; > > > > Shouldn't the following node also be removed? > * mipi_csi > * dsi > * lvds_bridge > * lcdif_to_dsi > * lcdif_to_ldb Add mu1 and mu2 to that list. Best regards, Alexander
On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > The i.MX 91 family features an Arm Cortex-A55 running at up to > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > along with a rich set of peripherals targeting medical, industrial > and consumer IoT market segments. > > The design of the i.MX91 platform is very similar to i.MX93. > The mainly difference between i.MX91 and i.MX93 is as follows: > - i.MX91 removed some clocks and modified the names of some clocks. > - i.MX91 only has one A core - pinmux change > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > Reviewed-by: Frank Li <Frank.Li@nxp.com> > --- > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > 2 files changed, 836 insertions(+) > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > new file mode 100644 > index 000000000000..bc58ce2102b2 > --- /dev/null > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > @@ -0,0 +1,770 @@ > +/* SPDX-License-Identifier: (GPL-2.0+ OR MIT) */ > +/* > + * Copyright 2024 NXP > + */ > + > +#ifndef __DTS_IMX91_PINFUNC_H > +#define __DTS_IMX91_PINFUNC_H > + > +/* > + * The pin function ID is a tuple of > + * <mux_reg conf_reg input_reg mux_mode input_val> > + */ > +#define MX91_PAD_DAP_TDI__JTAG_MUX_TDI 0x0000 0x01B0 0x03D8 0x00 0x00 > +#define MX91_PAD_DAP_TDI__MQS2_LEFT 0x0000 0x01B0 0x0000 0x01 0x00 > +#define MX91_PAD_DAP_TDI__CAN2_TX 0x0000 0x01B0 0x0000 0x03 0x00 > +#define MX91_PAD_DAP_TDI__FLEXIO2_FLEXIO30 0x0000 0x01B0 0x0000 0x04 0x00 > +#define MX91_PAD_DAP_TDI__GPIO3_IO28 0x0000 0x01B0 0x0000 0x05 0x00 > +#define MX91_PAD_DAP_TDI__LPUART5_RX 0x0000 0x01B0 0x0488 0x06 0x00 work with tools team to generate low case hex value next time. > + > +#define MX91_PAD_DAP_TMS_SWDIO__JTAG_MUX_TMS 0x0004 0x01B4 0x03DC 0x00 0x00 > +#define MX91_PAD_DAP_TMS_SWDIO__FLEXIO2_FLEXIO31 0x0004 0x01B4 0x0000 0x04 0x00 > +#define MX91_PAD_DAP_TMS_SWDIO__GPIO3_IO29 0x0004 0x01B4 0x0000 0x05 0x00 > +#define MX91_PAD_DAP_TMS_SWDIO__LPUART5_RTS_B 0x0004 0x01B4 0x0000 0x06 0x00 > + > +#define MX91_PAD_DAP_TCLK_SWCLK__JTAG_MUX_TCK 0x0008 0x01B8 0x03D4 0x00 0x00 > +#define MX91_PAD_DAP_TCLK_SWCLK__FLEXIO1_FLEXIO30 0x0008 0x01B8 0x0000 0x04 0x00 > +#define MX91_PAD_DAP_TCLK_SWCLK__GPIO3_IO30 0x0008 0x01B8 0x0000 0x05 0x00 > +#define MX91_PAD_DAP_TCLK_SWCLK__LPUART5_CTS_B 0x0008 0x01B8 0x0484 0x06 0x00 > + > +#define MX91_PAD_DAP_TDO_TRACESWO__JTAG_MUX_TDO 0x000C 0x01BC 0x0000 0x00 0x00 > +#define MX91_PAD_DAP_TDO_TRACESWO__MQS2_RIGHT 0x000C 0x01BC 0x0000 0x01 0x00 > +#define MX91_PAD_DAP_TDO_TRACESWO__CAN2_RX 0x000C 0x01BC 0x0364 0x03 0x00 > +#define MX91_PAD_DAP_TDO_TRACESWO__FLEXIO1_FLEXIO31 0x000C 0x01BC 0x0000 0x04 0x00 > +#define MX91_PAD_DAP_TDO_TRACESWO__GPIO3_IO31 0x000C 0x01BC 0x0000 0x05 0x00 > +#define MX91_PAD_DAP_TDO_TRACESWO__LPUART5_TX 0x000C 0x01BC 0x048C 0x06 0x00 > + > +#define MX91_PAD_GPIO_IO00__GPIO2_IO0 0x0010 0x01C0 0x0000 0x00 0x00 > +#define MX91_PAD_GPIO_IO00__LPI2C3_SDA 0x0010 0x01C0 0x03F4 0x01 0x00 > +#define MX91_PAD_GPIO_IO00__MEDIAMIX_CAM_CLK 0x0010 0x01C0 0x04BC 0x02 0x00 > +#define MX91_PAD_GPIO_IO00__MEDIAMIX_DISP_CLK 0x0010 0x01C0 0x0000 0x03 0x00 > +#define MX91_PAD_GPIO_IO00__LPSPI6_PCS0 0x0010 0x01C0 0x0000 0x04 0x00 > +#define MX91_PAD_GPIO_IO00__LPUART5_TX 0x0010 0x01C0 0x048C 0x05 0x01 > +#define MX91_PAD_GPIO_IO00__LPI2C5_SDA 0x0010 0x01C0 0x0404 0x06 0x00 > +#define MX91_PAD_GPIO_IO00__FLEXIO1_FLEXIO0 0x0010 0x01C0 0x036C 0x07 0x00 > + > +#define MX91_PAD_GPIO_IO01__GPIO2_IO1 0x0014 0x01C4 0x0000 0x00 0x00 > +#define MX91_PAD_GPIO_IO01__LPI2C3_SCL 0x0014 0x01C4 0x03F0 0x01 0x00 > +#define MX91_PAD_GPIO_IO01__MEDIAMIX_CAM_DATA0 0x0014 0x01C4 0x0490 0x02 0x00 > +#define MX91_PAD_GPIO_IO01__MEDIAMIX_DISP_DE 0x0014 0x01C4 0x0000 0x03 0x00 > +#define MX91_PAD_GPIO_IO01__LPSPI6_SIN 0x0014 0x01C4 0x0000 0x04 0x00 > +#define MX91_PAD_GPIO_IO01__LPUART5_RX 0x0014 0x01C4 0x0488 0x05 0x01 > +#define MX91_PAD_GPIO_IO01__LPI2C5_SCL 0x0014 0x01C4 0x0400 0x06 0x00 > +#define MX91_PAD_GPIO_IO01__FLEXIO1_FLEXIO1 0x0014 0x01C4 0x0370 0x07 0x00 > + > +#define MX91_PAD_GPIO_IO02__GPIO2_IO2 0x0018 0x01C8 0x0000 0x00 0x00 > +#define MX91_PAD_GPIO_IO02__LPI2C4_SDA 0x0018 0x01C8 0x03FC 0x01 0x00 > +#define MX91_PAD_GPIO_IO02__MEDIAMIX_CAM_VSYNC 0x0018 0x01C8 0x04C0 0x02 0x00 > +#define MX91_PAD_GPIO_IO02__MEDIAMIX_DISP_VSYNC 0x0018 0x01C8 0x0000 0x03 0x00 > +#define MX91_PAD_GPIO_IO02__LPSPI6_SOUT 0x0018 0x01C8 0x0000 0x04 0x00 > +#define MX91_PAD_GPIO_IO02__LPUART5_CTS_B 0x0018 0x01C8 0x0484 0x05 0x01 > +#define MX91_PAD_GPIO_IO02__LPI2C6_SDA 0x0018 0x01C8 0x040C 0x06 0x00 > +#define MX91_PAD_GPIO_IO02__FLEXIO1_FLEXIO2 0x0018 0x01C8 0x0374 0x07 0x00 > + > +#define MX91_PAD_GPIO_IO03__GPIO2_IO3 0x001C 0x01CC 0x0000 0x00 0x00 > +#define MX91_PAD_GPIO_IO03__LPI2C4_SCL 0x001C 0x01CC 0x03F8 0x01 0x00 > +#define MX91_PAD_GPIO_IO03__MEDIAMIX_CAM_HSYNC 0x001C 0x01CC 0x04B8 0x02 0x00 > +#define MX91_PAD_GPIO_IO03__MEDIAMIX_DISP_HSYNC 0x001C 0x01CC 0x0000 0x03 0x00 > +#define MX91_PAD_GPIO_IO03__LPSPI6_SCK 0x001C 0x01CC 0x0000 0x04 0x00 > +#define MX91_PAD_GPIO_IO03__LPUART5_RTS_B 0x001C 0x01CC 0x0000 0x05 0x00 > +#define MX91_PAD_GPIO_IO03__LPI2C6_SCL 0x001C 0x01CC 0x0408 0x06 0x00 > +#define MX91_PAD_GPIO_IO03__FLEXIO1_FLEXIO3 0x001C 0x01CC 0x0378 0x07 0x00 > + > +#define MX91_PAD_GPIO_IO04__GPIO2_IO4 0x0020 0x01D0 0x0000 0x00 0x00 > +#define MX91_PAD_GPIO_IO04__TPM3_CH0 0x0020 0x01D0 0x0000 0x01 0x00 > +#define MX91_PAD_GPIO_IO04__PDM_CLK 0x0020 0x01D0 0x0000 0x02 0x00 > +#define MX91_PAD_GPIO_IO04__MEDIAMIX_DISP_DATA0 0x0020 0x01D0 0x0000 0x03 0x00 > +#define MX91_PAD_GPIO_IO04__LPSPI7_PCS0 0x0020 0x01D0 0x0000 0x04 0x00 > +#define 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Frank > -- > 2.34.1 >
On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > The i.MX 91 family features an Arm Cortex-A55 running at up to > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > along with a rich set of peripherals targeting medical, industrial > and consumer IoT market segments. > > The design of the i.MX91 platform is very similar to i.MX93. > The mainly difference between i.MX91 and i.MX93 is as follows: > - i.MX91 removed some clocks and modified the names of some clocks. > - i.MX91 only has one A core > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > Reviewed-by: Frank Li <Frank.Li@nxp.com> > --- > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > 2 files changed, 836 insertions(+) > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > new file mode 100644 > index 000000000000..bc58ce2102b2 > --- /dev/null > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > @@ -0,0 +1,770 @@ > +/* SPDX-License-Identifier: (GPL-2.0+ OR MIT) */ > +/* > + * Copyright 2024 NXP > + */ > + > +#ifndef __DTS_IMX91_PINFUNC_H > +#define __DTS_IMX91_PINFUNC_H > + > +/* > + * The pin function ID is a tuple of > + * <mux_reg conf_reg input_reg mux_mode input_val> > + */ > +#define MX91_PAD_DAP_TDI__JTAG_MUX_TDI 0x0000 0x01B0 0x03D8 0x00 0x00 > +#define MX91_PAD_DAP_TDI__MQS2_LEFT 0x0000 0x01B0 0x0000 0x01 0x00 > +#define MX91_PAD_DAP_TDI__CAN2_TX 0x0000 0x01B0 0x0000 0x03 0x00 > +#define MX91_PAD_DAP_TDI__FLEXIO2_FLEXIO30 0x0000 0x01B0 0x0000 0x04 0x00 > +#define MX91_PAD_DAP_TDI__GPIO3_IO28 0x0000 0x01B0 0x0000 0x05 0x00 > +#define MX91_PAD_DAP_TDI__LPUART5_RX 0x0000 0x01B0 0x0488 0x06 0x00 > + > +#define MX91_PAD_DAP_TMS_SWDIO__JTAG_MUX_TMS 0x0004 0x01B4 0x03DC 0x00 0x00 > +#define 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MX91_PAD_UART1_TXD__TPM1_CH1 0x0184 0x0334 0x0000 0x03 0x00 > +#define MX91_PAD_UART1_TXD__GPIO1_IO5 0x0184 0x0334 0x0000 0x05 0x00 > + > +#define MX91_PAD_UART2_RXD__LPUART2_RX 0x0188 0x0338 0x0464 0x00 0x01 > +#define MX91_PAD_UART2_RXD__LPUART1_CTS_B 0x0188 0x0338 0x0454 0x01 0x01 > +#define MX91_PAD_UART2_RXD__LPSPI2_SOUT 0x0188 0x0338 0x0444 0x02 0x02 > +#define MX91_PAD_UART2_RXD__TPM1_CH2 0x0188 0x0338 0x0000 0x03 0x00 > +#define MX91_PAD_UART2_RXD__SAI1_MCLK 0x0188 0x0338 0x04D4 0x04 0x00 > +#define MX91_PAD_UART2_RXD__GPIO1_IO6 0x0188 0x0338 0x0000 0x05 0x00 > + > +#define MX91_PAD_UART2_TXD__LPUART2_TX 0x018C 0x033C 0x0468 0x00 0x01 > +#define MX91_PAD_UART2_TXD__LPUART1_RTS_B 0x018C 0x033C 0x0000 0x01 0x00 > +#define MX91_PAD_UART2_TXD__LPSPI2_SCK 0x018C 0x033C 0x043C 0x02 0x02 > +#define MX91_PAD_UART2_TXD__TPM1_CH3 0x018C 0x033C 0x0000 0x03 0x00 > +#define MX91_PAD_UART2_TXD__GPIO1_IO7 0x018C 0x033C 0x0000 0x05 0x00 > +#define MX91_PAD_UART2_TXD__SAI3_TX_SYNC 0x018C 0x033C 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+#define MX91_PAD_SAI1_RXD0__LPSPI1_SOUT 0x01A8 0x0358 0x0430 0x02 0x01 > +#define MX91_PAD_SAI1_RXD0__LPUART2_DSR_B 0x01A8 0x0358 0x0000 0x03 0x00 > +#define MX91_PAD_SAI1_RXD0__MQS1_RIGHT 0x01A8 0x0358 0x0000 0x04 0x00 > +#define MX91_PAD_SAI1_RXD0__GPIO1_IO14 0x01A8 0x0358 0x0000 0x05 0x00 > + > +#define MX91_PAD_WDOG_ANY__WDOG1_WDOG_ANY 0x01AC 0x035C 0x0000 0x00 0x00 > +#define MX91_PAD_WDOG_ANY__GPIO1_IO15 0x01AC 0x035C 0x0000 0x05 0x00 > +#endif /* __DTS_IMX91_PINFUNC_H */ > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > new file mode 100644 > index 000000000000..a9f4c1fe61cc > --- /dev/null > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > @@ -0,0 +1,66 @@ > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > +/* > + * Copyright 2024 NXP > + */ > + > +#include "imx91-pinfunc.h" > +#include "imx93.dtsi" > + > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > + cooling-device = > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > 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<&clk IMX93_CLK_BUS_AON>, > + <&clk IMX93_CLK_I3C1_GATE>, > + <&clk IMX93_CLK_DUMMY>; > +}; > + > +&i3c2 { > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > + <&clk IMX93_CLK_I3C2_GATE>, > + <&clk IMX93_CLK_DUMMY>; > +}; > + > +&tmu { > + status = "disabled"; > +}; please order nodes. You can try https://github.com/lznuaa/dt-format > + > +/* i.MX91 only has one A core */ > +/delete-node/ &A55_1; > + > +/* i.MX91 not has cm33 */ > +/delete-node/ &cm33; > + > +/* i.MX91 not has power-domain@44461800 */ > +/delete-node/ &mlmix; > -- > 2.34.1 >
Hi Frank, Am Donnerstag, 7. November 2024, 16:06:26 CET schrieb Frank Li: > On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > along with a rich set of peripherals targeting medical, industrial > > and consumer IoT market segments. > > > > The design of the i.MX91 platform is very similar to i.MX93. > > The mainly difference between i.MX91 and i.MX93 is as follows: > > - i.MX91 removed some clocks and modified the names of some clocks. > > - i.MX91 only has one A core > > - pinmux change > > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > --- > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > 2 files changed, 836 insertions(+) > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > [snip] > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > new file mode 100644 > > index 000000000000..a9f4c1fe61cc > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > @@ -0,0 +1,66 @@ > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#include "imx91-pinfunc.h" > > +#include "imx93.dtsi" > > + > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > + cooling-device = > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > +}; > > + > > +&clk { > > + compatible = "fsl,imx91-ccm"; > > +}; > > + > > +&eqos { > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > +}; > > + > > +&fec { > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > + <&clk IMX93_CLK_DUMMY>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > + assigned-clock-rates = <100000000>, <250000000>; > > +}; > > + > > +&i3c1 { > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > + <&clk IMX93_CLK_I3C1_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&i3c2 { > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > + <&clk IMX93_CLK_I3C2_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&tmu { > > + status = "disabled"; > > +}; > > + > > +/* i.MX91 only has one A core */ > > +/delete-node/ &A55_1; > > + > > +/* i.MX91 not has cm33 */ > > +/delete-node/ &cm33; > > + > > +/* i.MX91 not has power-domain@44461800 */ > > +/delete-node/ &mlmix; > > If someone want to use it in overlay file, /delete-node/ will not work. Do you expect someone including this SoC-dtsi in an overlay? I personally don't, well I'll welcome other comments. As imx93 is an upgrade to imx91, there is also the possibility to do it the other way around, similar to imx7s and imx7d. The latter one including imx7.dtsi and adding additionally peripherals. Best regards Alexander
On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > The i.MX 91 family features an Arm Cortex-A55 running at up to > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > along with a rich set of peripherals targeting medical, industrial > and consumer IoT market segments. > > The design of the i.MX91 platform is very similar to i.MX93. > The mainly difference between i.MX91 and i.MX93 is as follows: > - i.MX91 removed some clocks and modified the names of some clocks. > - i.MX91 only has one A core > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > Reviewed-by: Frank Li <Frank.Li@nxp.com> > --- > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > 2 files changed, 836 insertions(+) > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > new file mode 100644 > index 000000000000..bc58ce2102b2 > --- /dev/null > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > @@ -0,0 +1,770 @@ > +/* SPDX-License-Identifier: (GPL-2.0+ OR MIT) */ > +/* > + * Copyright 2024 NXP > + */ > + > +#ifndef __DTS_IMX91_PINFUNC_H > +#define __DTS_IMX91_PINFUNC_H > + > +/* > + * The pin function ID is a tuple of > + * <mux_reg conf_reg input_reg mux_mode input_val> > + */ > +#define MX91_PAD_DAP_TDI__JTAG_MUX_TDI 0x0000 0x01B0 0x03D8 0x00 0x00 > +#define MX91_PAD_DAP_TDI__MQS2_LEFT 0x0000 0x01B0 0x0000 0x01 0x00 > +#define MX91_PAD_DAP_TDI__CAN2_TX 0x0000 0x01B0 0x0000 0x03 0x00 > +#define MX91_PAD_DAP_TDI__FLEXIO2_FLEXIO30 0x0000 0x01B0 0x0000 0x04 0x00 > +#define MX91_PAD_DAP_TDI__GPIO3_IO28 0x0000 0x01B0 0x0000 0x05 0x00 > +#define MX91_PAD_DAP_TDI__LPUART5_RX 0x0000 0x01B0 0x0488 0x06 0x00 > + > +#define MX91_PAD_DAP_TMS_SWDIO__JTAG_MUX_TMS 0x0004 0x01B4 0x03DC 0x00 0x00 > +#define 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0x06 0x00 > + > +#define MX91_PAD_I2C2_SDA__LPI2C2_SDA 0x017C 0x032C 0x03EC 0x00 0x01 > +#define MX91_PAD_I2C2_SDA__LPUART2_RIN_B 0x017C 0x032C 0x0000 0x02 0x00 > +#define MX91_PAD_I2C2_SDA__TPM2_CH3 0x017C 0x032C 0x0000 0x03 0x00 > +#define MX91_PAD_I2C2_SDA__SAI1_RX_BCLK 0x017C 0x032C 0x0000 0x04 0x00 > +#define MX91_PAD_I2C2_SDA__GPIO1_IO3 0x017C 0x032C 0x0000 0x05 0x00 > + > +#define MX91_PAD_UART1_RXD__LPUART1_RX 0x0180 0x0330 0x0458 0x00 0x01 > +#define MX91_PAD_UART1_RXD__ELE_UART_RX 0x0180 0x0330 0x0000 0x01 0x00 > +#define MX91_PAD_UART1_RXD__LPSPI2_SIN 0x0180 0x0330 0x0440 0x02 0x02 > +#define MX91_PAD_UART1_RXD__TPM1_CH0 0x0180 0x0330 0x0000 0x03 0x00 > +#define MX91_PAD_UART1_RXD__GPIO1_IO4 0x0180 0x0330 0x0000 0x05 0x00 > + > +#define MX91_PAD_UART1_TXD__LPUART1_TX 0x0184 0x0334 0x045C 0x00 0x01 > +#define MX91_PAD_UART1_TXD__ELE_UART_TX 0x0184 0x0334 0x0000 0x01 0x00 > +#define MX91_PAD_UART1_TXD__LPSPI2_PCS0 0x0184 0x0334 0x0434 0x02 0x02 > +#define MX91_PAD_UART1_TXD__TPM1_CH1 0x0184 0x0334 0x0000 0x03 0x00 > +#define MX91_PAD_UART1_TXD__GPIO1_IO5 0x0184 0x0334 0x0000 0x05 0x00 > + > +#define MX91_PAD_UART2_RXD__LPUART2_RX 0x0188 0x0338 0x0464 0x00 0x01 > +#define MX91_PAD_UART2_RXD__LPUART1_CTS_B 0x0188 0x0338 0x0454 0x01 0x01 > +#define MX91_PAD_UART2_RXD__LPSPI2_SOUT 0x0188 0x0338 0x0444 0x02 0x02 > +#define MX91_PAD_UART2_RXD__TPM1_CH2 0x0188 0x0338 0x0000 0x03 0x00 > +#define MX91_PAD_UART2_RXD__SAI1_MCLK 0x0188 0x0338 0x04D4 0x04 0x00 > +#define MX91_PAD_UART2_RXD__GPIO1_IO6 0x0188 0x0338 0x0000 0x05 0x00 > + > +#define MX91_PAD_UART2_TXD__LPUART2_TX 0x018C 0x033C 0x0468 0x00 0x01 > +#define MX91_PAD_UART2_TXD__LPUART1_RTS_B 0x018C 0x033C 0x0000 0x01 0x00 > +#define MX91_PAD_UART2_TXD__LPSPI2_SCK 0x018C 0x033C 0x043C 0x02 0x02 > +#define MX91_PAD_UART2_TXD__TPM1_CH3 0x018C 0x033C 0x0000 0x03 0x00 > +#define MX91_PAD_UART2_TXD__GPIO1_IO7 0x018C 0x033C 0x0000 0x05 0x00 > +#define MX91_PAD_UART2_TXD__SAI3_TX_SYNC 0x018C 0x033C 0x04E0 0x07 0x02 > + > +#define MX91_PAD_PDM_CLK__PDM_CLK 0x0190 0x0340 0x0000 0x00 0x00 > +#define MX91_PAD_PDM_CLK__MQS1_LEFT 0x0190 0x0340 0x0000 0x01 0x00 > +#define MX91_PAD_PDM_CLK__LPTMR1_ALT1 0x0190 0x0340 0x0000 0x04 0x00 > +#define MX91_PAD_PDM_CLK__GPIO1_IO8 0x0190 0x0340 0x0000 0x05 0x00 > +#define MX91_PAD_PDM_CLK__CAN1_TX 0x0190 0x0340 0x0000 0x06 0x00 > + > +#define MX91_PAD_PDM_BIT_STREAM0__PDM_BIT_STREAM0 0x0194 0x0344 0x04C4 0x00 0x02 > +#define MX91_PAD_PDM_BIT_STREAM0__MQS1_RIGHT 0x0194 0x0344 0x0000 0x01 0x00 > +#define MX91_PAD_PDM_BIT_STREAM0__LPSPI1_PCS1 0x0194 0x0344 0x0424 0x02 0x01 > +#define MX91_PAD_PDM_BIT_STREAM0__TPM1_EXTCLK 0x0194 0x0344 0x0000 0x03 0x00 > +#define MX91_PAD_PDM_BIT_STREAM0__LPTMR1_ALT2 0x0194 0x0344 0x0000 0x04 0x00 > +#define MX91_PAD_PDM_BIT_STREAM0__GPIO1_IO9 0x0194 0x0344 0x0000 0x05 0x00 > +#define MX91_PAD_PDM_BIT_STREAM0__CAN1_RX 0x0194 0x0344 0x0360 0x06 0x01 > + > +#define MX91_PAD_PDM_BIT_STREAM1__PDM_BIT_STREAM1 0x0198 0x0348 0x04C8 0x00 0x02 > +#define MX91_PAD_PDM_BIT_STREAM1__LPSPI2_PCS1 0x0198 0x0348 0x0438 0x02 0x01 > +#define MX91_PAD_PDM_BIT_STREAM1__TPM2_EXTCLK 0x0198 0x0348 0x0000 0x03 0x00 > +#define MX91_PAD_PDM_BIT_STREAM1__LPTMR1_ALT3 0x0198 0x0348 0x0000 0x04 0x00 > +#define MX91_PAD_PDM_BIT_STREAM1__GPIO1_IO10 0x0198 0x0348 0x0000 0x05 0x00 > +#define MX91_PAD_PDM_BIT_STREAM1__CCMSRCGPCMIX_EXT_CLK1 0x0198 0x0348 0x0368 0x06 0x01 > + > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_SYNC 0x019C 0x034C 0x0000 0x00 0x00 > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_DATA1 0x019C 0x034C 0x0000 0x01 0x00 > +#define MX91_PAD_SAI1_TXFS__LPSPI1_PCS0 0x019C 0x034C 0x0420 0x02 0x01 > +#define MX91_PAD_SAI1_TXFS__LPUART2_DTR_B 0x019C 0x034C 0x0000 0x03 0x00 > +#define MX91_PAD_SAI1_TXFS__MQS1_LEFT 0x019C 0x034C 0x0000 0x04 0x00 > +#define MX91_PAD_SAI1_TXFS__GPIO1_IO11 0x019C 0x034C 0x0000 0x05 0x00 > + > +#define MX91_PAD_SAI1_TXC__SAI1_TX_BCLK 0x01A0 0x0350 0x0000 0x00 0x00 > +#define MX91_PAD_SAI1_TXC__LPUART2_CTS_B 0x01A0 0x0350 0x0460 0x01 0x01 > +#define MX91_PAD_SAI1_TXC__LPSPI1_SIN 0x01A0 0x0350 0x042C 0x02 0x01 > +#define MX91_PAD_SAI1_TXC__LPUART1_DSR_B 0x01A0 0x0350 0x0000 0x03 0x00 > +#define MX91_PAD_SAI1_TXC__CAN1_RX 0x01A0 0x0350 0x0360 0x04 0x02 > +#define MX91_PAD_SAI1_TXC__GPIO1_IO12 0x01A0 0x0350 0x0000 0x05 0x00 > + > +#define MX91_PAD_SAI1_TXD0__SAI1_TX_DATA0 0x01A4 0x0354 0x0000 0x00 0x00 > +#define MX91_PAD_SAI1_TXD0__LPUART2_RTS_B 0x01A4 0x0354 0x0000 0x01 0x00 > +#define MX91_PAD_SAI1_TXD0__LPSPI1_SCK 0x01A4 0x0354 0x0428 0x02 0x01 > +#define MX91_PAD_SAI1_TXD0__LPUART1_DTR_B 0x01A4 0x0354 0x0000 0x03 0x00 > +#define MX91_PAD_SAI1_TXD0__CAN1_TX 0x01A4 0x0354 0x0000 0x04 0x00 > +#define MX91_PAD_SAI1_TXD0__GPIO1_IO13 0x01A4 0x0354 0x0000 0x05 0x00 > +#define MX91_PAD_SAI1_TXD0__SAI1_MCLK 0x01A4 0x0354 0x04D4 0x06 0x01 > + > +#define MX91_PAD_SAI1_RXD0__SAI1_RX_DATA0 0x01A8 0x0358 0x0000 0x00 0x00 > +#define MX91_PAD_SAI1_RXD0__SAI1_MCLK 0x01A8 0x0358 0x04D4 0x01 0x02 > +#define MX91_PAD_SAI1_RXD0__LPSPI1_SOUT 0x01A8 0x0358 0x0430 0x02 0x01 > +#define MX91_PAD_SAI1_RXD0__LPUART2_DSR_B 0x01A8 0x0358 0x0000 0x03 0x00 > +#define MX91_PAD_SAI1_RXD0__MQS1_RIGHT 0x01A8 0x0358 0x0000 0x04 0x00 > +#define MX91_PAD_SAI1_RXD0__GPIO1_IO14 0x01A8 0x0358 0x0000 0x05 0x00 > + > +#define MX91_PAD_WDOG_ANY__WDOG1_WDOG_ANY 0x01AC 0x035C 0x0000 0x00 0x00 > +#define MX91_PAD_WDOG_ANY__GPIO1_IO15 0x01AC 0x035C 0x0000 0x05 0x00 > +#endif /* __DTS_IMX91_PINFUNC_H */ > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > new file mode 100644 > index 000000000000..a9f4c1fe61cc > --- /dev/null > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > @@ -0,0 +1,66 @@ > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > +/* > + * Copyright 2024 NXP > + */ > + > +#include "imx91-pinfunc.h" > +#include "imx93.dtsi" Since i.MX91 DDR PMU is compatible with i.MX93's: https://git.kernel.org/pub/scm/linux/kernel/git/next/linux-next.git/tree/Documentation/devicetree/bindings/perf/fsl-imx-ddr.yaml#n35 Could you please modify ddr-pmu node compatilbe to: compatible = "fsl,imx91-ddr-pmu", "fsl,imx93-ddr-pmu"; Thanks, Xu Yang > + > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > + cooling-device = > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > +}; > + > +&clk { > + compatible = "fsl,imx91-ccm"; > +}; > + > +&eqos { > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > + <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > +}; > + > +&fec { > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > + <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET2_REGULAR>, > + <&clk IMX93_CLK_DUMMY>; > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > + <&clk IMX91_CLK_ENET2_REGULAR>; > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > + assigned-clock-rates = <100000000>, <250000000>; > +}; > + > +&i3c1 { > + clocks = <&clk IMX93_CLK_BUS_AON>, > + <&clk IMX93_CLK_I3C1_GATE>, > + <&clk IMX93_CLK_DUMMY>; > +}; > + > +&i3c2 { > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > + <&clk IMX93_CLK_I3C2_GATE>, > + <&clk IMX93_CLK_DUMMY>; > +}; > + > +&tmu { > + status = "disabled"; > +}; > + > +/* i.MX91 only has one A core */ > +/delete-node/ &A55_1; > + > +/* i.MX91 not has cm33 */ > +/delete-node/ &cm33; > + > +/* i.MX91 not has power-domain@44461800 */ > +/delete-node/ &mlmix; > -- > 2.34.1 >
On Thu, Nov 07, 2024 at 01:49:50PM +0100, Alexander Stein wrote: > Hi, > > thanks for putting me on CC. > > Am Freitag, 8. November 2024, 03:27:02 CET schrieb Pengfei Li: > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > along with a rich set of peripherals targeting medical, industrial > > and consumer IoT market segments. > > > > The design of the i.MX91 platform is very similar to i.MX93. > > The mainly difference between i.MX91 and i.MX93 is as follows: > > - i.MX91 removed some clocks and modified the names of some clocks. > > - i.MX91 only has one A core > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > --- > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > 2 files changed, 836 insertions(+) > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > new file mode 100644 > > index 000000000000..bc58ce2102b2 > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > FWIW this is a 1:1 copy from downstream kernel Hi, thanks for the comments. Yes, it is same as downstream kernel. > > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > new file mode 100644 > > index 000000000000..a9f4c1fe61cc > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > @@ -0,0 +1,66 @@ > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#include "imx91-pinfunc.h" > > +#include "imx93.dtsi" > > + > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > + cooling-device = > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > +}; > > + > > +&clk { > > + compatible = "fsl,imx91-ccm"; > > +}; > > + > > +&eqos { > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > Is it just me or is the alignment of new lines not matching? Not sure about others, the alignment on my side is correct. > > > > +}; > > + > > +&fec { > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > + <&clk IMX93_CLK_DUMMY>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > Here as well: Is it just me or is the alignment of new lines not matching? Same as above. > > > + assigned-clock-rates = <100000000>, <250000000>; > > +}; > > + > > +&i3c1 { > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > + <&clk IMX93_CLK_I3C1_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&i3c2 { > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > + <&clk IMX93_CLK_I3C2_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&tmu { > > + status = "disabled"; > > Why does the TMU needs to be disabled instead of deleted? Actually, the i.MX91 also has a TMU, but the i.MX91 uses a different IP than the i.MX93, so a new driver is required. However, this new driver is not applied yet on upstream kernel, so it is disabled here for now. > > > +}; > > + > > +/* i.MX91 only has one A core */ > > +/delete-node/ &A55_1; > > + > > +/* i.MX91 not has cm33 */ > > +/delete-node/ &cm33; > > + > > +/* i.MX91 not has power-domain@44461800 */ > > +/delete-node/ &mlmix; > > > > Shouldn't the following node also be removed? > * mipi_csi > * dsi > * lvds_bridge > * lcdif_to_dsi > * lcdif_to_ldb > > Also in downstream kernel IMX91_CLK_MEDIA_AXI, which is IMX93_CLK_MEDIA_AXI > upstream, is set to 200 MHz. Is this applicable here as well? > For these nodes, it is only in the downstream kernel and not yet applied to the upstream kernel for i.MX93. So they cannot be removed in the upstream kernel yet. BR, Pengfei Li > Best regards, > Alexander > > -- > TQ-Systems GmbH | Mühlstraße 2, Gut Delling | 82229 Seefeld, Germany > Amtsgericht München, HRB 105018 > Geschäftsführer: Detlef Schneider, Rüdiger Stahl, Stefan Schneider > http://www.tq-group.com/ > > >
On Thu, Nov 07, 2024 at 02:06:27PM +0100, Alexander Stein wrote: > Am Donnerstag, 7. November 2024, 13:49:50 CET schrieb Alexander Stein: > > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > new file mode 100644 > > > index 000000000000..a9f4c1fe61cc > > > --- /dev/null > > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > @@ -0,0 +1,66 @@ > > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > > +/* > > > + * Copyright 2024 NXP > > > + */ > > > + > > > +#include "imx91-pinfunc.h" > > > +#include "imx93.dtsi" > > > + > > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > > + cooling-device = > > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > > +}; > > > + > > > +&clk { > > > + compatible = "fsl,imx91-ccm"; > > > +}; > > > + > > > +&eqos { > > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > Is it just me or is the alignment of new lines not matching? > > > > > > > +}; > > > + > > > +&fec { > > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > > + <&clk IMX93_CLK_DUMMY>; > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > Here as well: Is it just me or is the alignment of new lines not matching? > > > > > + assigned-clock-rates = <100000000>, <250000000>; > > > +}; > > > + > > > +&i3c1 { > > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > > + <&clk IMX93_CLK_I3C1_GATE>, > > > + <&clk IMX93_CLK_DUMMY>; > > > +}; > > > + > > > +&i3c2 { > > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > > + <&clk IMX93_CLK_I3C2_GATE>, > > > + <&clk IMX93_CLK_DUMMY>; > > > +}; > > > + > > > +&tmu { > > > + status = "disabled"; > > > > Why does the TMU needs to be disabled instead of deleted? > > > > > +}; > > > + > > > +/* i.MX91 only has one A core */ > > > +/delete-node/ &A55_1; > > > + > > > +/* i.MX91 not has cm33 */ > > > +/delete-node/ &cm33; > > > + > > > +/* i.MX91 not has power-domain@44461800 */ > > > +/delete-node/ &mlmix; > > > > > > > Shouldn't the following node also be removed? > > * mipi_csi > > * dsi > > * lvds_bridge > > * lcdif_to_dsi > > * lcdif_to_ldb > > Add mu1 and mu2 to that list. Hi, i.MX91 also has mu1 and mu2. so there is no need to remove them here. BR, Pengfei Li
On Fri, Nov 08, 2024 at 11:05:32AM +0800, Xu Yang wrote: > On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > along with a rich set of peripherals targeting medical, industrial > > and consumer IoT market segments. > > > > The design of the i.MX91 platform is very similar to i.MX93. > > The mainly difference between i.MX91 and i.MX93 is as follows: > > - i.MX91 removed some clocks and modified the names of some clocks. > > - i.MX91 only has one A core > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > --- > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > 2 files changed, 836 insertions(+) > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > new file mode 100644 > > index 000000000000..bc58ce2102b2 > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > @@ -0,0 +1,770 @@ > > +/* SPDX-License-Identifier: (GPL-2.0+ OR MIT) */ > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#ifndef __DTS_IMX91_PINFUNC_H > > +#define __DTS_IMX91_PINFUNC_H > > + > > +/* > > + * The pin function ID is a tuple of > > + * <mux_reg conf_reg input_reg mux_mode input_val> > > + */ > > +#define MX91_PAD_DAP_TDI__JTAG_MUX_TDI 0x0000 0x01B0 0x03D8 0x00 0x00 > > +#define MX91_PAD_DAP_TDI__MQS2_LEFT 0x0000 0x01B0 0x0000 0x01 0x00 > > +#define MX91_PAD_DAP_TDI__CAN2_TX 0x0000 0x01B0 0x0000 0x03 0x00 > > +#define MX91_PAD_DAP_TDI__FLEXIO2_FLEXIO30 0x0000 0x01B0 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TDI__GPIO3_IO28 0x0000 0x01B0 0x0000 0x05 0x00 > > +#define MX91_PAD_DAP_TDI__LPUART5_RX 0x0000 0x01B0 0x0488 0x06 0x00 > > + > > +#define MX91_PAD_DAP_TMS_SWDIO__JTAG_MUX_TMS 0x0004 0x01B4 0x03DC 0x00 0x00 > > +#define MX91_PAD_DAP_TMS_SWDIO__FLEXIO2_FLEXIO31 0x0004 0x01B4 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TMS_SWDIO__GPIO3_IO29 0x0004 0x01B4 0x0000 0x05 0x00 > > +#define MX91_PAD_DAP_TMS_SWDIO__LPUART5_RTS_B 0x0004 0x01B4 0x0000 0x06 0x00 > > + > > +#define MX91_PAD_DAP_TCLK_SWCLK__JTAG_MUX_TCK 0x0008 0x01B8 0x03D4 0x00 0x00 > > +#define MX91_PAD_DAP_TCLK_SWCLK__FLEXIO1_FLEXIO30 0x0008 0x01B8 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TCLK_SWCLK__GPIO3_IO30 0x0008 0x01B8 0x0000 0x05 0x00 > > +#define MX91_PAD_DAP_TCLK_SWCLK__LPUART5_CTS_B 0x0008 0x01B8 0x0484 0x06 0x00 > > + > > +#define MX91_PAD_DAP_TDO_TRACESWO__JTAG_MUX_TDO 0x000C 0x01BC 0x0000 0x00 0x00 > > +#define MX91_PAD_DAP_TDO_TRACESWO__MQS2_RIGHT 0x000C 0x01BC 0x0000 0x01 0x00 > > +#define MX91_PAD_DAP_TDO_TRACESWO__CAN2_RX 0x000C 0x01BC 0x0364 0x03 0x00 > > +#define MX91_PAD_DAP_TDO_TRACESWO__FLEXIO1_FLEXIO31 0x000C 0x01BC 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TDO_TRACESWO__GPIO3_IO31 0x000C 0x01BC 0x0000 0x05 0x00 > > +#define MX91_PAD_DAP_TDO_TRACESWO__LPUART5_TX 0x000C 0x01BC 0x048C 0x06 0x00 > > + > > +#define MX91_PAD_GPIO_IO00__GPIO2_IO0 0x0010 0x01C0 0x0000 0x00 0x00 > > +#define MX91_PAD_GPIO_IO00__LPI2C3_SDA 0x0010 0x01C0 0x03F4 0x01 0x00 > > +#define MX91_PAD_GPIO_IO00__MEDIAMIX_CAM_CLK 0x0010 0x01C0 0x04BC 0x02 0x00 > > +#define MX91_PAD_GPIO_IO00__MEDIAMIX_DISP_CLK 0x0010 0x01C0 0x0000 0x03 0x00 > > +#define MX91_PAD_GPIO_IO00__LPSPI6_PCS0 0x0010 0x01C0 0x0000 0x04 0x00 > > +#define MX91_PAD_GPIO_IO00__LPUART5_TX 0x0010 0x01C0 0x048C 0x05 0x01 > > +#define MX91_PAD_GPIO_IO00__LPI2C5_SDA 0x0010 0x01C0 0x0404 0x06 0x00 > > +#define MX91_PAD_GPIO_IO00__FLEXIO1_FLEXIO0 0x0010 0x01C0 0x036C 0x07 0x00 > > + > > +#define MX91_PAD_GPIO_IO01__GPIO2_IO1 0x0014 0x01C4 0x0000 0x00 0x00 > > +#define MX91_PAD_GPIO_IO01__LPI2C3_SCL 0x0014 0x01C4 0x03F0 0x01 0x00 > > +#define MX91_PAD_GPIO_IO01__MEDIAMIX_CAM_DATA0 0x0014 0x01C4 0x0490 0x02 0x00 > > +#define MX91_PAD_GPIO_IO01__MEDIAMIX_DISP_DE 0x0014 0x01C4 0x0000 0x03 0x00 > > +#define MX91_PAD_GPIO_IO01__LPSPI6_SIN 0x0014 0x01C4 0x0000 0x04 0x00 > > +#define MX91_PAD_GPIO_IO01__LPUART5_RX 0x0014 0x01C4 0x0488 0x05 0x01 > > +#define MX91_PAD_GPIO_IO01__LPI2C5_SCL 0x0014 0x01C4 0x0400 0x06 0x00 > > +#define MX91_PAD_GPIO_IO01__FLEXIO1_FLEXIO1 0x0014 0x01C4 0x0370 0x07 0x00 > > + > > +#define MX91_PAD_GPIO_IO02__GPIO2_IO2 0x0018 0x01C8 0x0000 0x00 0x00 > > +#define MX91_PAD_GPIO_IO02__LPI2C4_SDA 0x0018 0x01C8 0x03FC 0x01 0x00 > > +#define MX91_PAD_GPIO_IO02__MEDIAMIX_CAM_VSYNC 0x0018 0x01C8 0x04C0 0x02 0x00 > > +#define MX91_PAD_GPIO_IO02__MEDIAMIX_DISP_VSYNC 0x0018 0x01C8 0x0000 0x03 0x00 > > +#define MX91_PAD_GPIO_IO02__LPSPI6_SOUT 0x0018 0x01C8 0x0000 0x04 0x00 > > +#define MX91_PAD_GPIO_IO02__LPUART5_CTS_B 0x0018 0x01C8 0x0484 0x05 0x01 > > +#define MX91_PAD_GPIO_IO02__LPI2C6_SDA 0x0018 0x01C8 0x040C 0x06 0x00 > > +#define MX91_PAD_GPIO_IO02__FLEXIO1_FLEXIO2 0x0018 0x01C8 0x0374 0x07 0x00 > > + > > +#define MX91_PAD_GPIO_IO03__GPIO2_IO3 0x001C 0x01CC 0x0000 0x00 0x00 > > +#define MX91_PAD_GPIO_IO03__LPI2C4_SCL 0x001C 0x01CC 0x03F8 0x01 0x00 > > +#define MX91_PAD_GPIO_IO03__MEDIAMIX_CAM_HSYNC 0x001C 0x01CC 0x04B8 0x02 0x00 > > +#define MX91_PAD_GPIO_IO03__MEDIAMIX_DISP_HSYNC 0x001C 0x01CC 0x0000 0x03 0x00 > > +#define MX91_PAD_GPIO_IO03__LPSPI6_SCK 0x001C 0x01CC 0x0000 0x04 0x00 > > +#define MX91_PAD_GPIO_IO03__LPUART5_RTS_B 0x001C 0x01CC 0x0000 0x05 0x00 > > +#define MX91_PAD_GPIO_IO03__LPI2C6_SCL 0x001C 0x01CC 0x0408 0x06 0x00 > > +#define MX91_PAD_GPIO_IO03__FLEXIO1_FLEXIO3 0x001C 0x01CC 0x0378 0x07 0x00 > > + > > +#define MX91_PAD_GPIO_IO04__GPIO2_IO4 0x0020 0x01D0 0x0000 0x00 0x00 > > +#define MX91_PAD_GPIO_IO04__TPM3_CH0 0x0020 0x01D0 0x0000 0x01 0x00 > > +#define MX91_PAD_GPIO_IO04__PDM_CLK 0x0020 0x01D0 0x0000 0x02 0x00 > > +#define MX91_PAD_GPIO_IO04__MEDIAMIX_DISP_DATA0 0x0020 0x01D0 0x0000 0x03 0x00 > > +#define MX91_PAD_GPIO_IO04__LPSPI7_PCS0 0x0020 0x01D0 0x0000 0x04 0x00 > > +#define MX91_PAD_GPIO_IO04__LPUART6_TX 0x0020 0x01D0 0x0000 0x05 0x00 > > +#define MX91_PAD_GPIO_IO04__LPI2C6_SDA 0x0020 0x01D0 0x040C 0x06 0x01 > > +#define MX91_PAD_GPIO_IO04__FLEXIO1_FLEXIO4 0x0020 0x01D0 0x037C 0x07 0x00 > > + > > +#define MX91_PAD_GPIO_IO05__GPIO2_IO5 0x0024 0x01D4 0x0000 0x00 0x00 > > +#define MX91_PAD_GPIO_IO05__TPM4_CH0 0x0024 0x01D4 0x0000 0x01 0x00 > > +#define MX91_PAD_GPIO_IO05__PDM_BIT_STREAM0 0x0024 0x01D4 0x04C4 0x02 0x00 > > +#define MX91_PAD_GPIO_IO05__MEDIAMIX_DISP_DATA1 0x0024 0x01D4 0x0000 0x03 0x00 > > +#define MX91_PAD_GPIO_IO05__LPSPI7_SIN 0x0024 0x01D4 0x0000 0x04 0x00 > > +#define MX91_PAD_GPIO_IO05__LPUART6_RX 0x0024 0x01D4 0x0000 0x05 0x00 > > +#define MX91_PAD_GPIO_IO05__LPI2C6_SCL 0x0024 0x01D4 0x0408 0x06 0x01 > > +#define MX91_PAD_GPIO_IO05__FLEXIO1_FLEXIO5 0x0024 0x01D4 0x0380 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0x0190 0x0340 0x0000 0x06 0x00 > > + > > +#define MX91_PAD_PDM_BIT_STREAM0__PDM_BIT_STREAM0 0x0194 0x0344 0x04C4 0x00 0x02 > > +#define MX91_PAD_PDM_BIT_STREAM0__MQS1_RIGHT 0x0194 0x0344 0x0000 0x01 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__LPSPI1_PCS1 0x0194 0x0344 0x0424 0x02 0x01 > > +#define MX91_PAD_PDM_BIT_STREAM0__TPM1_EXTCLK 0x0194 0x0344 0x0000 0x03 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__LPTMR1_ALT2 0x0194 0x0344 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__GPIO1_IO9 0x0194 0x0344 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__CAN1_RX 0x0194 0x0344 0x0360 0x06 0x01 > > + > > +#define MX91_PAD_PDM_BIT_STREAM1__PDM_BIT_STREAM1 0x0198 0x0348 0x04C8 0x00 0x02 > > +#define MX91_PAD_PDM_BIT_STREAM1__LPSPI2_PCS1 0x0198 0x0348 0x0438 0x02 0x01 > > +#define MX91_PAD_PDM_BIT_STREAM1__TPM2_EXTCLK 0x0198 0x0348 0x0000 0x03 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__LPTMR1_ALT3 0x0198 0x0348 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__GPIO1_IO10 0x0198 0x0348 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__CCMSRCGPCMIX_EXT_CLK1 0x0198 0x0348 0x0368 0x06 0x01 > > + > > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_SYNC 0x019C 0x034C 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_DATA1 0x019C 0x034C 0x0000 0x01 0x00 > > +#define MX91_PAD_SAI1_TXFS__LPSPI1_PCS0 0x019C 0x034C 0x0420 0x02 0x01 > > +#define MX91_PAD_SAI1_TXFS__LPUART2_DTR_B 0x019C 0x034C 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXFS__MQS1_LEFT 0x019C 0x034C 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_TXFS__GPIO1_IO11 0x019C 0x034C 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_SAI1_TXC__SAI1_TX_BCLK 0x01A0 0x0350 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXC__LPUART2_CTS_B 0x01A0 0x0350 0x0460 0x01 0x01 > > +#define MX91_PAD_SAI1_TXC__LPSPI1_SIN 0x01A0 0x0350 0x042C 0x02 0x01 > > +#define MX91_PAD_SAI1_TXC__LPUART1_DSR_B 0x01A0 0x0350 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXC__CAN1_RX 0x01A0 0x0350 0x0360 0x04 0x02 > > +#define MX91_PAD_SAI1_TXC__GPIO1_IO12 0x01A0 0x0350 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_SAI1_TXD0__SAI1_TX_DATA0 0x01A4 0x0354 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXD0__LPUART2_RTS_B 0x01A4 0x0354 0x0000 0x01 0x00 > > +#define MX91_PAD_SAI1_TXD0__LPSPI1_SCK 0x01A4 0x0354 0x0428 0x02 0x01 > > +#define MX91_PAD_SAI1_TXD0__LPUART1_DTR_B 0x01A4 0x0354 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXD0__CAN1_TX 0x01A4 0x0354 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_TXD0__GPIO1_IO13 0x01A4 0x0354 0x0000 0x05 0x00 > > +#define MX91_PAD_SAI1_TXD0__SAI1_MCLK 0x01A4 0x0354 0x04D4 0x06 0x01 > > + > > +#define MX91_PAD_SAI1_RXD0__SAI1_RX_DATA0 0x01A8 0x0358 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_RXD0__SAI1_MCLK 0x01A8 0x0358 0x04D4 0x01 0x02 > > +#define MX91_PAD_SAI1_RXD0__LPSPI1_SOUT 0x01A8 0x0358 0x0430 0x02 0x01 > > +#define MX91_PAD_SAI1_RXD0__LPUART2_DSR_B 0x01A8 0x0358 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_RXD0__MQS1_RIGHT 0x01A8 0x0358 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_RXD0__GPIO1_IO14 0x01A8 0x0358 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_WDOG_ANY__WDOG1_WDOG_ANY 0x01AC 0x035C 0x0000 0x00 0x00 > > +#define MX91_PAD_WDOG_ANY__GPIO1_IO15 0x01AC 0x035C 0x0000 0x05 0x00 > > +#endif /* __DTS_IMX91_PINFUNC_H */ > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > new file mode 100644 > > index 000000000000..a9f4c1fe61cc > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > @@ -0,0 +1,66 @@ > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#include "imx91-pinfunc.h" > > +#include "imx93.dtsi" > > Since i.MX91 DDR PMU is compatible with i.MX93's: > https://git.kernel.org/pub/scm/linux/kernel/git/next/linux-next.git/tree/Documentation/devicetree/bindings/perf/fsl-imx-ddr.yaml#n35 > > Could you please modify ddr-pmu node compatilbe to: > > compatible = "fsl,imx91-ddr-pmu", "fsl,imx93-ddr-pmu"; > > Thanks, > Xu Yang Okay, it will be changed in the next version BR, Pengfei Li > > > + > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > + cooling-device = > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > +}; > > + > > +&clk { > > + compatible = "fsl,imx91-ccm"; > > +}; > > + > > +&eqos { > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > +}; > > + > > +&fec { > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > + <&clk IMX93_CLK_DUMMY>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > + assigned-clock-rates = <100000000>, <250000000>; > > +}; > > + > > +&i3c1 { > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > + <&clk IMX93_CLK_I3C1_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&i3c2 { > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > + <&clk IMX93_CLK_I3C2_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&tmu { > > + status = "disabled"; > > +}; > > + > > +/* i.MX91 only has one A core */ > > +/delete-node/ &A55_1; > > + > > +/* i.MX91 not has cm33 */ > > +/delete-node/ &cm33; > > + > > +/* i.MX91 not has power-domain@44461800 */ > > +/delete-node/ &mlmix; > > -- > > 2.34.1 > > >
Hi, Am Freitag, 8. November 2024, 10:56:46 CET schrieb Pengfei Li: > On Thu, Nov 07, 2024 at 01:49:50PM +0100, Alexander Stein wrote: > > Hi, > > > > thanks for putting me on CC. > > > > Am Freitag, 8. November 2024, 03:27:02 CET schrieb Pengfei Li: > > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > > along with a rich set of peripherals targeting medical, industrial > > > and consumer IoT market segments. > > > > > > The design of the i.MX91 platform is very similar to i.MX93. > > > The mainly difference between i.MX91 and i.MX93 is as follows: > > > - i.MX91 removed some clocks and modified the names of some clocks. > > > - i.MX91 only has one A core > > > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > > --- > > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > > 2 files changed, 836 insertions(+) > > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > > new file mode 100644 > > > index 000000000000..bc58ce2102b2 > > > --- /dev/null > > > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > > > FWIW this is a 1:1 copy from downstream kernel > > Hi, thanks for the comments. > > Yes, it is same as downstream kernel. > > > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > new file mode 100644 > > > index 000000000000..a9f4c1fe61cc > > > --- /dev/null > > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > @@ -0,0 +1,66 @@ > > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > > +/* > > > + * Copyright 2024 NXP > > > + */ > > > + > > > +#include "imx91-pinfunc.h" > > > +#include "imx93.dtsi" > > > + > > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > > + cooling-device = > > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > > +}; > > > + > > > +&clk { > > > + compatible = "fsl,imx91-ccm"; > > > +}; > > > + > > > +&eqos { > > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > Is it just me or is the alignment of new lines not matching? > > Not sure about others, the alignment on my side is correct. > > > > > > > > +}; > > > + > > > +&fec { > > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > > + <&clk IMX93_CLK_DUMMY>; > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > Here as well: Is it just me or is the alignment of new lines not matching? > > Same as above. > > > > > > + assigned-clock-rates = <100000000>, <250000000>; > > > +}; > > > + > > > +&i3c1 { > > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > > + <&clk IMX93_CLK_I3C1_GATE>, > > > + <&clk IMX93_CLK_DUMMY>; > > > +}; > > > + > > > +&i3c2 { > > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > > + <&clk IMX93_CLK_I3C2_GATE>, > > > + <&clk IMX93_CLK_DUMMY>; > > > +}; > > > + > > > +&tmu { > > > + status = "disabled"; > > > > Why does the TMU needs to be disabled instead of deleted? > > Actually, the i.MX91 also has a TMU, but the i.MX91 uses a different IP than the i.MX93, so a new driver is required. > However, this new driver is not applied yet on upstream kernel, so it is disabled here for now. Then, the compatible should be changed as well. > > > > > +}; > > > + > > > +/* i.MX91 only has one A core */ > > > +/delete-node/ &A55_1; > > > + > > > +/* i.MX91 not has cm33 */ > > > +/delete-node/ &cm33; > > > + > > > +/* i.MX91 not has power-domain@44461800 */ > > > +/delete-node/ &mlmix; > > > > > > > Shouldn't the following node also be removed? > > * mipi_csi > > * dsi > > * lvds_bridge > > * lcdif_to_dsi > > * lcdif_to_ldb > > > > Also in downstream kernel IMX91_CLK_MEDIA_AXI, which is IMX93_CLK_MEDIA_AXI > > upstream, is set to 200 MHz. Is this applicable here as well? > > > > For these nodes, it is only in the downstream kernel and not yet applied to the upstream kernel for i.MX93. > So they cannot be removed in the upstream kernel yet. Ah, sorry. They originated form my local changes. They need to be removed later on when they get added to imx93 though. Best regards, Alexander
Hi, Am Freitag, 8. November 2024, 11:06:26 CET schrieb Pengfei Li: > On Thu, Nov 07, 2024 at 02:06:27PM +0100, Alexander Stein wrote: > > Am Donnerstag, 7. November 2024, 13:49:50 CET schrieb Alexander Stein: > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > > new file mode 100644 > > > > index 000000000000..a9f4c1fe61cc > > > > --- /dev/null > > > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > > @@ -0,0 +1,66 @@ > > > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > > > +/* > > > > + * Copyright 2024 NXP > > > > + */ > > > > + > > > > +#include "imx91-pinfunc.h" > > > > +#include "imx93.dtsi" > > > > + > > > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > > > + cooling-device = > > > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > > > +}; > > > > + > > > > +&clk { > > > > + compatible = "fsl,imx91-ccm"; > > > > +}; > > > > + > > > > +&eqos { > > > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > > > Is it just me or is the alignment of new lines not matching? > > > > > > > > > > +}; > > > > + > > > > +&fec { > > > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > > > + <&clk IMX93_CLK_DUMMY>; > > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > > > Here as well: Is it just me or is the alignment of new lines not matching? > > > > > > > + assigned-clock-rates = <100000000>, <250000000>; > > > > +}; > > > > + > > > > +&i3c1 { > > > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > > > + <&clk IMX93_CLK_I3C1_GATE>, > > > > + <&clk IMX93_CLK_DUMMY>; > > > > +}; > > > > + > > > > +&i3c2 { > > > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > > > + <&clk IMX93_CLK_I3C2_GATE>, > > > > + <&clk IMX93_CLK_DUMMY>; > > > > +}; > > > > + > > > > +&tmu { > > > > + status = "disabled"; > > > > > > Why does the TMU needs to be disabled instead of deleted? > > > > > > > +}; > > > > + > > > > +/* i.MX91 only has one A core */ > > > > +/delete-node/ &A55_1; > > > > + > > > > +/* i.MX91 not has cm33 */ > > > > +/delete-node/ &cm33; > > > > + > > > > +/* i.MX91 not has power-domain@44461800 */ > > > > +/delete-node/ &mlmix; > > > > > > > > > > Shouldn't the following node also be removed? > > > * mipi_csi > > > * dsi > > > * lvds_bridge > > > * lcdif_to_dsi > > > * lcdif_to_ldb > > > > Add mu1 and mu2 to that list. > > Hi, i.MX91 also has mu1 and mu2. so there is no need to remove them here. Maybe you have more recent information. The RM available to me doesn't say anything about messaging unit, neither in memory map nor as a separate section describing the hardware. Memory area is marked as reserved. If there are actually mu1 and mu2 available, what is on the B-side? There is no Cortex-M33 after all. Best regards, Alexander
On Fri, Nov 08, 2024 at 03:07:50PM +0100, Alexander Stein wrote: > Hi, > > Am Freitag, 8. November 2024, 11:06:26 CET schrieb Pengfei Li: > > On Thu, Nov 07, 2024 at 02:06:27PM +0100, Alexander Stein wrote: > > > Am Donnerstag, 7. November 2024, 13:49:50 CET schrieb Alexander Stein: > > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > > > new file mode 100644 > > > > > index 000000000000..a9f4c1fe61cc > > > > > --- /dev/null > > > > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > > > @@ -0,0 +1,66 @@ > > > > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > > > > +/* > > > > > + * Copyright 2024 NXP > > > > > + */ > > > > > + > > > > > +#include "imx91-pinfunc.h" > > > > > +#include "imx93.dtsi" > > > > > + > > > > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > > > > + cooling-device = > > > > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > > > > +}; > > > > > + > > > > > +&clk { > > > > > + compatible = "fsl,imx91-ccm"; > > > > > +}; > > > > > + > > > > > +&eqos { > > > > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > > > > > Is it just me or is the alignment of new lines not matching? > > > > > > > > > > > > > +}; > > > > > + > > > > > +&fec { > > > > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > > > > + <&clk IMX93_CLK_DUMMY>; > > > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > > > > > Here as well: Is it just me or is the alignment of new lines not matching? > > > > > > > > > + assigned-clock-rates = <100000000>, <250000000>; > > > > > +}; > > > > > + > > > > > +&i3c1 { > > > > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > > > > + <&clk IMX93_CLK_I3C1_GATE>, > > > > > + <&clk IMX93_CLK_DUMMY>; > > > > > +}; > > > > > + > > > > > +&i3c2 { > > > > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > > > > + <&clk IMX93_CLK_I3C2_GATE>, > > > > > + <&clk IMX93_CLK_DUMMY>; > > > > > +}; > > > > > + > > > > > +&tmu { > > > > > + status = "disabled"; > > > > > > > > Why does the TMU needs to be disabled instead of deleted? > > > > > > > > > +}; > > > > > + > > > > > +/* i.MX91 only has one A core */ > > > > > +/delete-node/ &A55_1; > > > > > + > > > > > +/* i.MX91 not has cm33 */ > > > > > +/delete-node/ &cm33; > > > > > + > > > > > +/* i.MX91 not has power-domain@44461800 */ > > > > > +/delete-node/ &mlmix; > > > > > > > > > > > > > Shouldn't the following node also be removed? > > > > * mipi_csi > > > > * dsi > > > > * lvds_bridge > > > > * lcdif_to_dsi > > > > * lcdif_to_ldb > > > > > > Add mu1 and mu2 to that list. > > > > Hi, i.MX91 also has mu1 and mu2. so there is no need to remove them here. > > Maybe you have more recent information. The RM available to me doesn't > say anything about messaging unit, neither in memory map nor as a separate > section describing the hardware. Memory area is marked as reserved. > > If there are actually mu1 and mu2 available, what is on the B-side? There > is no Cortex-M33 after all. > Hi Alexander, I rechecked the RM and found that it did remove MU1 and MU2, I will remove these two nodes in the next version. Thanks for your comments! BR, Pengfei Li
On Fri, Nov 08, 2024 at 03:04:29PM +0100, Alexander Stein wrote: > Hi, > > Am Freitag, 8. November 2024, 10:56:46 CET schrieb Pengfei Li: > > On Thu, Nov 07, 2024 at 01:49:50PM +0100, Alexander Stein wrote: > > > Hi, > > > > > > thanks for putting me on CC. > > > > > > Am Freitag, 8. November 2024, 03:27:02 CET schrieb Pengfei Li: > > > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > > > along with a rich set of peripherals targeting medical, industrial > > > > and consumer IoT market segments. > > > > > > > > The design of the i.MX91 platform is very similar to i.MX93. > > > > The mainly difference between i.MX91 and i.MX93 is as follows: > > > > - i.MX91 removed some clocks and modified the names of some clocks. > > > > - i.MX91 only has one A core > > > > > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > > > --- > > > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > > > 2 files changed, 836 insertions(+) > > > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > > > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > > > new file mode 100644 > > > > index 000000000000..bc58ce2102b2 > > > > --- /dev/null > > > > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > > > > > FWIW this is a 1:1 copy from downstream kernel > > > > Hi, thanks for the comments. > > > > Yes, it is same as downstream kernel. > > > > > > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > > new file mode 100644 > > > > index 000000000000..a9f4c1fe61cc > > > > --- /dev/null > > > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > > @@ -0,0 +1,66 @@ > > > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > > > +/* > > > > + * Copyright 2024 NXP > > > > + */ > > > > + > > > > +#include "imx91-pinfunc.h" > > > > +#include "imx93.dtsi" > > > > + > > > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > > > + cooling-device = > > > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > > > +}; > > > > + > > > > +&clk { > > > > + compatible = "fsl,imx91-ccm"; > > > > +}; > > > > + > > > > +&eqos { > > > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > > > Is it just me or is the alignment of new lines not matching? > > > > Not sure about others, the alignment on my side is correct. > > > > > > > > > > > > +}; > > > > + > > > > +&fec { > > > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > > > + <&clk IMX93_CLK_DUMMY>; > > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > > > > Here as well: Is it just me or is the alignment of new lines not matching? > > > > Same as above. > > > > > > > > > + assigned-clock-rates = <100000000>, <250000000>; > > > > +}; > > > > + > > > > +&i3c1 { > > > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > > > + <&clk IMX93_CLK_I3C1_GATE>, > > > > + <&clk IMX93_CLK_DUMMY>; > > > > +}; > > > > + > > > > +&i3c2 { > > > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > > > + <&clk IMX93_CLK_I3C2_GATE>, > > > > + <&clk IMX93_CLK_DUMMY>; > > > > +}; > > > > + > > > > +&tmu { > > > > + status = "disabled"; > > > > > > Why does the TMU needs to be disabled instead of deleted? > > > > Actually, the i.MX91 also has a TMU, but the i.MX91 uses a different IP than the i.MX93, so a new driver is required. > > However, this new driver is not applied yet on upstream kernel, so it is disabled here for now. > > Then, the compatible should be changed as well. Ok, the new tmu driver and dt bindings and the compatible changes for this node will be included in the subsequent tmu patch set. BR, Pengfei Li
On Thu, Nov 07, 2024 at 04:54:34PM +0100, Alexander Stein wrote: > Hi Frank, > > Am Donnerstag, 7. November 2024, 16:06:26 CET schrieb Frank Li: > > On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > > along with a rich set of peripherals targeting medical, industrial > > > and consumer IoT market segments. > > > > > > The design of the i.MX91 platform is very similar to i.MX93. > > > The mainly difference between i.MX91 and i.MX93 is as follows: > > > - i.MX91 removed some clocks and modified the names of some clocks. > > > - i.MX91 only has one A core > > > > - pinmux change > > > > > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > > --- > > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > > 2 files changed, 836 insertions(+) > > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > > > [snip] > > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > new file mode 100644 > > > index 000000000000..a9f4c1fe61cc > > > --- /dev/null > > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > > @@ -0,0 +1,66 @@ > > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > > +/* > > > + * Copyright 2024 NXP > > > + */ > > > + > > > +#include "imx91-pinfunc.h" > > > +#include "imx93.dtsi" > > > + > > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > > + cooling-device = > > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > > +}; > > > + > > > +&clk { > > > + compatible = "fsl,imx91-ccm"; > > > +}; > > > + > > > +&eqos { > > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > +}; > > > + > > > +&fec { > > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > > + <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > > + <&clk IMX93_CLK_DUMMY>; > > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > > + assigned-clock-rates = <100000000>, <250000000>; > > > +}; > > > + > > > +&i3c1 { > > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > > + <&clk IMX93_CLK_I3C1_GATE>, > > > + <&clk IMX93_CLK_DUMMY>; > > > +}; > > > + > > > +&i3c2 { > > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > > + <&clk IMX93_CLK_I3C2_GATE>, > > > + <&clk IMX93_CLK_DUMMY>; > > > +}; > > > + > > > +&tmu { > > > + status = "disabled"; > > > +}; > > > + > > > +/* i.MX91 only has one A core */ > > > +/delete-node/ &A55_1; > > > + > > > +/* i.MX91 not has cm33 */ > > > +/delete-node/ &cm33; > > > + > > > +/* i.MX91 not has power-domain@44461800 */ > > > +/delete-node/ &mlmix; > > > > If someone want to use it in overlay file, /delete-node/ will not work. > > Do you expect someone including this SoC-dtsi in an overlay? > I personally don't, well I'll welcome other comments. Many boards of imx91 is the same as imx93. We should use overlay file to avoid duplicate every imx93's boards. There already have 14x14, 11x11, 9x9 boards dts file and some other overlay file base on these boards. If the board is totally new for imx91, still can include both imx93.dtsi and imx91.dtsi to create new boards dts. Frank > > As imx93 is an upgrade to imx91, there is also the possibility to do it > the other way around, similar to imx7s and imx7d. The latter one including > imx7.dtsi and adding additionally peripherals. > > Best regards > Alexander > -- > TQ-Systems GmbH | Mühlstraße 2, Gut Delling | 82229 Seefeld, Germany > Amtsgericht München, HRB 105018 > Geschäftsführer: Detlef Schneider, Rüdiger Stahl, Stefan Schneider > http://www.tq-group.com/ > >
On Thu, Nov 07, 2024 at 10:06:26AM -0500, Frank Li wrote: > On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > along with a rich set of peripherals targeting medical, industrial > > and consumer IoT market segments. > > > > The design of the i.MX91 platform is very similar to i.MX93. > > The mainly difference between i.MX91 and i.MX93 is as follows: > > - i.MX91 removed some clocks and modified the names of some clocks. > > - i.MX91 only has one A core > > - pinmux change Hi Frank, will change it in v2. > > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > --- > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > 2 files changed, 836 insertions(+) > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > new file mode 100644 > > index 000000000000..bc58ce2102b2 > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > @@ -0,0 +1,770 @@ > > +/* SPDX-License-Identifier: (GPL-2.0+ OR MIT) */ > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#ifndef __DTS_IMX91_PINFUNC_H > > +#define __DTS_IMX91_PINFUNC_H > > + > > +/* > > + * The pin function ID is a tuple of > > + * <mux_reg conf_reg input_reg mux_mode input_val> > > + */ > > +#define MX91_PAD_DAP_TDI__JTAG_MUX_TDI 0x0000 0x01B0 0x03D8 0x00 0x00 > > +#define MX91_PAD_DAP_TDI__MQS2_LEFT 0x0000 0x01B0 0x0000 0x01 0x00 > > +#define MX91_PAD_DAP_TDI__CAN2_TX 0x0000 0x01B0 0x0000 0x03 0x00 > > +#define MX91_PAD_DAP_TDI__FLEXIO2_FLEXIO30 0x0000 0x01B0 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TDI__GPIO3_IO28 0x0000 0x01B0 0x0000 0x05 0x00 > > +#define MX91_PAD_DAP_TDI__LPUART5_RX 0x0000 0x01B0 0x0488 0x06 0x00 > > work with tools team to generate low case hex value next time. will change it in v2. > > > + > > +#define MX91_PAD_DAP_TMS_SWDIO__JTAG_MUX_TMS 0x0004 0x01B4 0x03DC 0x00 0x00 > > +#define MX91_PAD_DAP_TMS_SWDIO__FLEXIO2_FLEXIO31 0x0004 0x01B4 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TMS_SWDIO__GPIO3_IO29 0x0004 0x01B4 0x0000 0x05 0x00 > > +#define MX91_PAD_DAP_TMS_SWDIO__LPUART5_RTS_B 0x0004 0x01B4 0x0000 0x06 0x00 > > + > > +#define MX91_PAD_DAP_TCLK_SWCLK__JTAG_MUX_TCK 0x0008 0x01B8 0x03D4 0x00 0x00 > > +#define MX91_PAD_DAP_TCLK_SWCLK__FLEXIO1_FLEXIO30 0x0008 0x01B8 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TCLK_SWCLK__GPIO3_IO30 0x0008 0x01B8 0x0000 0x05 0x00 > > +#define MX91_PAD_DAP_TCLK_SWCLK__LPUART5_CTS_B 0x0008 0x01B8 0x0484 0x06 0x00 > > + > > +#define MX91_PAD_DAP_TDO_TRACESWO__JTAG_MUX_TDO 0x000C 0x01BC 0x0000 0x00 0x00 > > +#define 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MX91_PAD_UART2_RXD__LPUART1_CTS_B 0x0188 0x0338 0x0454 0x01 0x01 > > +#define MX91_PAD_UART2_RXD__LPSPI2_SOUT 0x0188 0x0338 0x0444 0x02 0x02 > > +#define MX91_PAD_UART2_RXD__TPM1_CH2 0x0188 0x0338 0x0000 0x03 0x00 > > +#define MX91_PAD_UART2_RXD__SAI1_MCLK 0x0188 0x0338 0x04D4 0x04 0x00 > > +#define MX91_PAD_UART2_RXD__GPIO1_IO6 0x0188 0x0338 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_UART2_TXD__LPUART2_TX 0x018C 0x033C 0x0468 0x00 0x01 > > +#define MX91_PAD_UART2_TXD__LPUART1_RTS_B 0x018C 0x033C 0x0000 0x01 0x00 > > +#define MX91_PAD_UART2_TXD__LPSPI2_SCK 0x018C 0x033C 0x043C 0x02 0x02 > > +#define MX91_PAD_UART2_TXD__TPM1_CH3 0x018C 0x033C 0x0000 0x03 0x00 > > +#define MX91_PAD_UART2_TXD__GPIO1_IO7 0x018C 0x033C 0x0000 0x05 0x00 > > +#define MX91_PAD_UART2_TXD__SAI3_TX_SYNC 0x018C 0x033C 0x04E0 0x07 0x02 > > + > > +#define MX91_PAD_PDM_CLK__PDM_CLK 0x0190 0x0340 0x0000 0x00 0x00 > > +#define MX91_PAD_PDM_CLK__MQS1_LEFT 0x0190 0x0340 0x0000 0x01 0x00 > > +#define MX91_PAD_PDM_CLK__LPTMR1_ALT1 0x0190 0x0340 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_CLK__GPIO1_IO8 0x0190 0x0340 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_CLK__CAN1_TX 0x0190 0x0340 0x0000 0x06 0x00 > > + > > +#define MX91_PAD_PDM_BIT_STREAM0__PDM_BIT_STREAM0 0x0194 0x0344 0x04C4 0x00 0x02 > > +#define MX91_PAD_PDM_BIT_STREAM0__MQS1_RIGHT 0x0194 0x0344 0x0000 0x01 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__LPSPI1_PCS1 0x0194 0x0344 0x0424 0x02 0x01 > > +#define MX91_PAD_PDM_BIT_STREAM0__TPM1_EXTCLK 0x0194 0x0344 0x0000 0x03 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__LPTMR1_ALT2 0x0194 0x0344 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__GPIO1_IO9 0x0194 0x0344 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__CAN1_RX 0x0194 0x0344 0x0360 0x06 0x01 > > + > > +#define MX91_PAD_PDM_BIT_STREAM1__PDM_BIT_STREAM1 0x0198 0x0348 0x04C8 0x00 0x02 > > +#define MX91_PAD_PDM_BIT_STREAM1__LPSPI2_PCS1 0x0198 0x0348 0x0438 0x02 0x01 > > +#define MX91_PAD_PDM_BIT_STREAM1__TPM2_EXTCLK 0x0198 0x0348 0x0000 0x03 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__LPTMR1_ALT3 0x0198 0x0348 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__GPIO1_IO10 0x0198 0x0348 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__CCMSRCGPCMIX_EXT_CLK1 0x0198 0x0348 0x0368 0x06 0x01 > > + > > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_SYNC 0x019C 0x034C 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_DATA1 0x019C 0x034C 0x0000 0x01 0x00 > > +#define MX91_PAD_SAI1_TXFS__LPSPI1_PCS0 0x019C 0x034C 0x0420 0x02 0x01 > > +#define MX91_PAD_SAI1_TXFS__LPUART2_DTR_B 0x019C 0x034C 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXFS__MQS1_LEFT 0x019C 0x034C 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_TXFS__GPIO1_IO11 0x019C 0x034C 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_SAI1_TXC__SAI1_TX_BCLK 0x01A0 0x0350 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXC__LPUART2_CTS_B 0x01A0 0x0350 0x0460 0x01 0x01 > > +#define MX91_PAD_SAI1_TXC__LPSPI1_SIN 0x01A0 0x0350 0x042C 0x02 0x01 > > +#define MX91_PAD_SAI1_TXC__LPUART1_DSR_B 0x01A0 0x0350 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXC__CAN1_RX 0x01A0 0x0350 0x0360 0x04 0x02 > > +#define MX91_PAD_SAI1_TXC__GPIO1_IO12 0x01A0 0x0350 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_SAI1_TXD0__SAI1_TX_DATA0 0x01A4 0x0354 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXD0__LPUART2_RTS_B 0x01A4 0x0354 0x0000 0x01 0x00 > > +#define MX91_PAD_SAI1_TXD0__LPSPI1_SCK 0x01A4 0x0354 0x0428 0x02 0x01 > > +#define MX91_PAD_SAI1_TXD0__LPUART1_DTR_B 0x01A4 0x0354 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXD0__CAN1_TX 0x01A4 0x0354 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_TXD0__GPIO1_IO13 0x01A4 0x0354 0x0000 0x05 0x00 > > +#define MX91_PAD_SAI1_TXD0__SAI1_MCLK 0x01A4 0x0354 0x04D4 0x06 0x01 > > + > > +#define MX91_PAD_SAI1_RXD0__SAI1_RX_DATA0 0x01A8 0x0358 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_RXD0__SAI1_MCLK 0x01A8 0x0358 0x04D4 0x01 0x02 > > +#define MX91_PAD_SAI1_RXD0__LPSPI1_SOUT 0x01A8 0x0358 0x0430 0x02 0x01 > > +#define MX91_PAD_SAI1_RXD0__LPUART2_DSR_B 0x01A8 0x0358 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_RXD0__MQS1_RIGHT 0x01A8 0x0358 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_RXD0__GPIO1_IO14 0x01A8 0x0358 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_WDOG_ANY__WDOG1_WDOG_ANY 0x01AC 0x035C 0x0000 0x00 0x00 > > +#define MX91_PAD_WDOG_ANY__GPIO1_IO15 0x01AC 0x035C 0x0000 0x05 0x00 > > +#endif /* __DTS_IMX91_PINFUNC_H */ > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > new file mode 100644 > > index 000000000000..a9f4c1fe61cc > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > @@ -0,0 +1,66 @@ > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#include "imx91-pinfunc.h" > > +#include "imx93.dtsi" > > + > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > + cooling-device = > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > +}; > > + > > +&clk { > > + compatible = "fsl,imx91-ccm"; > > +}; > > + > > +&eqos { > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > +}; > > + > > +&fec { > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > + <&clk IMX93_CLK_DUMMY>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > + assigned-clock-rates = <100000000>, <250000000>; > > +}; > > + > > +&i3c1 { > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > + <&clk IMX93_CLK_I3C1_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&i3c2 { > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > + <&clk IMX93_CLK_I3C2_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&tmu { > > + status = "disabled"; > > +}; > > + > > +/* i.MX91 only has one A core */ > > +/delete-node/ &A55_1; > > + > > +/* i.MX91 not has cm33 */ > > +/delete-node/ &cm33; > > + > > +/* i.MX91 not has power-domain@44461800 */ > > +/delete-node/ &mlmix; > > If someone want to use it in overlay file, /delete-node/ will not work. This SOC-dtsi will only be used to make base dtb, overlay dtso will not include this dtsi. BR, Pengfei Li
On Thu, Nov 07, 2024 at 10:08:27AM -0500, Frank Li wrote: > On Thu, Nov 07, 2024 at 06:27:02PM -0800, Pengfei Li wrote: > > The i.MX 91 family features an Arm Cortex-A55 running at up to > > 1.4GHz, support for modern LPDDR4 memory to enable platform longevity, > > along with a rich set of peripherals targeting medical, industrial > > and consumer IoT market segments. > > > > The design of the i.MX91 platform is very similar to i.MX93. > > The mainly difference between i.MX91 and i.MX93 is as follows: > > - i.MX91 removed some clocks and modified the names of some clocks. > > - i.MX91 only has one A core > > > > Signed-off-by: Pengfei Li <pengfei.li_1@nxp.com> > > Reviewed-by: Frank Li <Frank.Li@nxp.com> > > --- > > arch/arm64/boot/dts/freescale/imx91-pinfunc.h | 770 ++++++++++++++++++ > > arch/arm64/boot/dts/freescale/imx91.dtsi | 66 ++ > > 2 files changed, 836 insertions(+) > > create mode 100644 arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > create mode 100644 arch/arm64/boot/dts/freescale/imx91.dtsi > > > > diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > new file mode 100644 > > index 000000000000..bc58ce2102b2 > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h > > @@ -0,0 +1,770 @@ > > +/* SPDX-License-Identifier: (GPL-2.0+ OR MIT) */ > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#ifndef __DTS_IMX91_PINFUNC_H > > +#define __DTS_IMX91_PINFUNC_H > > + > > +/* > > + * The pin function ID is a tuple of > > + * <mux_reg conf_reg input_reg mux_mode input_val> > > + */ > > +#define MX91_PAD_DAP_TDI__JTAG_MUX_TDI 0x0000 0x01B0 0x03D8 0x00 0x00 > > +#define MX91_PAD_DAP_TDI__MQS2_LEFT 0x0000 0x01B0 0x0000 0x01 0x00 > > +#define MX91_PAD_DAP_TDI__CAN2_TX 0x0000 0x01B0 0x0000 0x03 0x00 > > +#define MX91_PAD_DAP_TDI__FLEXIO2_FLEXIO30 0x0000 0x01B0 0x0000 0x04 0x00 > > +#define MX91_PAD_DAP_TDI__GPIO3_IO28 0x0000 0x01B0 0x0000 0x05 0x00 > > +#define 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> +#define MX91_PAD_UART1_RXD__LPUART1_RX 0x0180 0x0330 0x0458 0x00 0x01 > > +#define MX91_PAD_UART1_RXD__ELE_UART_RX 0x0180 0x0330 0x0000 0x01 0x00 > > +#define MX91_PAD_UART1_RXD__LPSPI2_SIN 0x0180 0x0330 0x0440 0x02 0x02 > > +#define MX91_PAD_UART1_RXD__TPM1_CH0 0x0180 0x0330 0x0000 0x03 0x00 > > +#define MX91_PAD_UART1_RXD__GPIO1_IO4 0x0180 0x0330 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_UART1_TXD__LPUART1_TX 0x0184 0x0334 0x045C 0x00 0x01 > > +#define MX91_PAD_UART1_TXD__ELE_UART_TX 0x0184 0x0334 0x0000 0x01 0x00 > > +#define MX91_PAD_UART1_TXD__LPSPI2_PCS0 0x0184 0x0334 0x0434 0x02 0x02 > > +#define MX91_PAD_UART1_TXD__TPM1_CH1 0x0184 0x0334 0x0000 0x03 0x00 > > +#define MX91_PAD_UART1_TXD__GPIO1_IO5 0x0184 0x0334 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_UART2_RXD__LPUART2_RX 0x0188 0x0338 0x0464 0x00 0x01 > > +#define MX91_PAD_UART2_RXD__LPUART1_CTS_B 0x0188 0x0338 0x0454 0x01 0x01 > > +#define MX91_PAD_UART2_RXD__LPSPI2_SOUT 0x0188 0x0338 0x0444 0x02 0x02 > > +#define MX91_PAD_UART2_RXD__TPM1_CH2 0x0188 0x0338 0x0000 0x03 0x00 > > +#define MX91_PAD_UART2_RXD__SAI1_MCLK 0x0188 0x0338 0x04D4 0x04 0x00 > > +#define MX91_PAD_UART2_RXD__GPIO1_IO6 0x0188 0x0338 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_UART2_TXD__LPUART2_TX 0x018C 0x033C 0x0468 0x00 0x01 > > +#define MX91_PAD_UART2_TXD__LPUART1_RTS_B 0x018C 0x033C 0x0000 0x01 0x00 > > +#define MX91_PAD_UART2_TXD__LPSPI2_SCK 0x018C 0x033C 0x043C 0x02 0x02 > > +#define MX91_PAD_UART2_TXD__TPM1_CH3 0x018C 0x033C 0x0000 0x03 0x00 > > +#define MX91_PAD_UART2_TXD__GPIO1_IO7 0x018C 0x033C 0x0000 0x05 0x00 > > +#define MX91_PAD_UART2_TXD__SAI3_TX_SYNC 0x018C 0x033C 0x04E0 0x07 0x02 > > + > > +#define MX91_PAD_PDM_CLK__PDM_CLK 0x0190 0x0340 0x0000 0x00 0x00 > > +#define MX91_PAD_PDM_CLK__MQS1_LEFT 0x0190 0x0340 0x0000 0x01 0x00 > > +#define MX91_PAD_PDM_CLK__LPTMR1_ALT1 0x0190 0x0340 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_CLK__GPIO1_IO8 0x0190 0x0340 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_CLK__CAN1_TX 0x0190 0x0340 0x0000 0x06 0x00 > > + > > +#define MX91_PAD_PDM_BIT_STREAM0__PDM_BIT_STREAM0 0x0194 0x0344 0x04C4 0x00 0x02 > > +#define MX91_PAD_PDM_BIT_STREAM0__MQS1_RIGHT 0x0194 0x0344 0x0000 0x01 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__LPSPI1_PCS1 0x0194 0x0344 0x0424 0x02 0x01 > > +#define MX91_PAD_PDM_BIT_STREAM0__TPM1_EXTCLK 0x0194 0x0344 0x0000 0x03 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__LPTMR1_ALT2 0x0194 0x0344 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__GPIO1_IO9 0x0194 0x0344 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM0__CAN1_RX 0x0194 0x0344 0x0360 0x06 0x01 > > + > > +#define MX91_PAD_PDM_BIT_STREAM1__PDM_BIT_STREAM1 0x0198 0x0348 0x04C8 0x00 0x02 > > +#define MX91_PAD_PDM_BIT_STREAM1__LPSPI2_PCS1 0x0198 0x0348 0x0438 0x02 0x01 > > +#define MX91_PAD_PDM_BIT_STREAM1__TPM2_EXTCLK 0x0198 0x0348 0x0000 0x03 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__LPTMR1_ALT3 0x0198 0x0348 0x0000 0x04 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__GPIO1_IO10 0x0198 0x0348 0x0000 0x05 0x00 > > +#define MX91_PAD_PDM_BIT_STREAM1__CCMSRCGPCMIX_EXT_CLK1 0x0198 0x0348 0x0368 0x06 0x01 > > + > > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_SYNC 0x019C 0x034C 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXFS__SAI1_TX_DATA1 0x019C 0x034C 0x0000 0x01 0x00 > > +#define MX91_PAD_SAI1_TXFS__LPSPI1_PCS0 0x019C 0x034C 0x0420 0x02 0x01 > > +#define MX91_PAD_SAI1_TXFS__LPUART2_DTR_B 0x019C 0x034C 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXFS__MQS1_LEFT 0x019C 0x034C 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_TXFS__GPIO1_IO11 0x019C 0x034C 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_SAI1_TXC__SAI1_TX_BCLK 0x01A0 0x0350 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXC__LPUART2_CTS_B 0x01A0 0x0350 0x0460 0x01 0x01 > > +#define MX91_PAD_SAI1_TXC__LPSPI1_SIN 0x01A0 0x0350 0x042C 0x02 0x01 > > +#define MX91_PAD_SAI1_TXC__LPUART1_DSR_B 0x01A0 0x0350 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXC__CAN1_RX 0x01A0 0x0350 0x0360 0x04 0x02 > > +#define MX91_PAD_SAI1_TXC__GPIO1_IO12 0x01A0 0x0350 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_SAI1_TXD0__SAI1_TX_DATA0 0x01A4 0x0354 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_TXD0__LPUART2_RTS_B 0x01A4 0x0354 0x0000 0x01 0x00 > > +#define MX91_PAD_SAI1_TXD0__LPSPI1_SCK 0x01A4 0x0354 0x0428 0x02 0x01 > > +#define MX91_PAD_SAI1_TXD0__LPUART1_DTR_B 0x01A4 0x0354 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_TXD0__CAN1_TX 0x01A4 0x0354 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_TXD0__GPIO1_IO13 0x01A4 0x0354 0x0000 0x05 0x00 > > +#define MX91_PAD_SAI1_TXD0__SAI1_MCLK 0x01A4 0x0354 0x04D4 0x06 0x01 > > + > > +#define MX91_PAD_SAI1_RXD0__SAI1_RX_DATA0 0x01A8 0x0358 0x0000 0x00 0x00 > > +#define MX91_PAD_SAI1_RXD0__SAI1_MCLK 0x01A8 0x0358 0x04D4 0x01 0x02 > > +#define MX91_PAD_SAI1_RXD0__LPSPI1_SOUT 0x01A8 0x0358 0x0430 0x02 0x01 > > +#define MX91_PAD_SAI1_RXD0__LPUART2_DSR_B 0x01A8 0x0358 0x0000 0x03 0x00 > > +#define MX91_PAD_SAI1_RXD0__MQS1_RIGHT 0x01A8 0x0358 0x0000 0x04 0x00 > > +#define MX91_PAD_SAI1_RXD0__GPIO1_IO14 0x01A8 0x0358 0x0000 0x05 0x00 > > + > > +#define MX91_PAD_WDOG_ANY__WDOG1_WDOG_ANY 0x01AC 0x035C 0x0000 0x00 0x00 > > +#define MX91_PAD_WDOG_ANY__GPIO1_IO15 0x01AC 0x035C 0x0000 0x05 0x00 > > +#endif /* __DTS_IMX91_PINFUNC_H */ > > diff --git a/arch/arm64/boot/dts/freescale/imx91.dtsi b/arch/arm64/boot/dts/freescale/imx91.dtsi > > new file mode 100644 > > index 000000000000..a9f4c1fe61cc > > --- /dev/null > > +++ b/arch/arm64/boot/dts/freescale/imx91.dtsi > > @@ -0,0 +1,66 @@ > > +// SPDX-License-Identifier: (GPL-2.0+ OR MIT) > > +/* > > + * Copyright 2024 NXP > > + */ > > + > > +#include "imx91-pinfunc.h" > > +#include "imx93.dtsi" > > + > > +&{/thermal-zones/cpu-thermal/cooling-maps/map0} { > > + cooling-device = > > + <&A55_0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>; > > +}; > > + > > +&clk { > > + compatible = "fsl,imx91-ccm"; > > +}; > > Do you need update iommux's compatible string? Hi Frank, will change it in v2. > > + > > +&eqos { > > + clocks = <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN_GATE>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET1_QOS_TSN>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > +}; > > + > > +&fec { > > + clocks = <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET2_REGULAR_GATE>, > > + <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>, > > + <&clk IMX93_CLK_DUMMY>; > > + assigned-clocks = <&clk IMX91_CLK_ENET_TIMER>, > > + <&clk IMX91_CLK_ENET2_REGULAR>; > > + assigned-clock-parents = <&clk IMX93_CLK_SYS_PLL_PFD1_DIV2>, > > + <&clk IMX93_CLK_SYS_PLL_PFD0_DIV2>; > > + assigned-clock-rates = <100000000>, <250000000>; > > +}; > > + > > +&i3c1 { > > + clocks = <&clk IMX93_CLK_BUS_AON>, > > + <&clk IMX93_CLK_I3C1_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&i3c2 { > > + clocks = <&clk IMX93_CLK_BUS_WAKEUP>, > > + <&clk IMX93_CLK_I3C2_GATE>, > > + <&clk IMX93_CLK_DUMMY>; > > +}; > > + > > +&tmu { > > + status = "disabled"; > > +}; > > > please order nodes. > > You can try https://github.com/lznuaa/dt-format will change it in v2. BR, Pengfei Li
diff --git a/arch/arm64/boot/dts/freescale/imx91-pinfunc.h b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h new file mode 100644 index 000000000000..bc58ce2102b2 --- /dev/null +++ b/arch/arm64/boot/dts/freescale/imx91-pinfunc.h @@ -0,0 +1,770 @@ +/* SPDX-License-Identifier: (GPL-2.0+ OR MIT) */ +/* + * Copyright 2024 NXP + */ + +#ifndef __DTS_IMX91_PINFUNC_H +#define __DTS_IMX91_PINFUNC_H + +/* + * The pin function ID is a tuple of + * <mux_reg conf_reg input_reg mux_mode input_val> + */ +#define MX91_PAD_DAP_TDI__JTAG_MUX_TDI 0x0000 0x01B0 0x03D8 0x00 0x00 +#define MX91_PAD_DAP_TDI__MQS2_LEFT 0x0000 0x01B0 0x0000 0x01 0x00 +#define MX91_PAD_DAP_TDI__CAN2_TX 0x0000 0x01B0 0x0000 0x03 0x00 +#define MX91_PAD_DAP_TDI__FLEXIO2_FLEXIO30 0x0000 0x01B0 0x0000 0x04 0x00 +#define MX91_PAD_DAP_TDI__GPIO3_IO28 0x0000 0x01B0 0x0000 0x05 0x00 +#define MX91_PAD_DAP_TDI__LPUART5_RX 0x0000 0x01B0 0x0488 0x06 0x00 + +#define MX91_PAD_DAP_TMS_SWDIO__JTAG_MUX_TMS 0x0004 0x01B4 0x03DC 0x00 0x00 +#define MX91_PAD_DAP_TMS_SWDIO__FLEXIO2_FLEXIO31 0x0004 0x01B4 0x0000 0x04 0x00 +#define MX91_PAD_DAP_TMS_SWDIO__GPIO3_IO29 0x0004 0x01B4 0x0000 0x05 0x00 +#define MX91_PAD_DAP_TMS_SWDIO__LPUART5_RTS_B 0x0004 0x01B4 0x0000 0x06 0x00 + +#define MX91_PAD_DAP_TCLK_SWCLK__JTAG_MUX_TCK 0x0008 0x01B8 0x03D4 0x00 0x00 +#define MX91_PAD_DAP_TCLK_SWCLK__FLEXIO1_FLEXIO30 0x0008 0x01B8 0x0000 0x04 0x00 +#define MX91_PAD_DAP_TCLK_SWCLK__GPIO3_IO30 0x0008 0x01B8 0x0000 0x05 0x00 +#define MX91_PAD_DAP_TCLK_SWCLK__LPUART5_CTS_B 0x0008 0x01B8 0x0484 0x06 0x00 + +#define MX91_PAD_DAP_TDO_TRACESWO__JTAG_MUX_TDO 0x000C 0x01BC 0x0000 0x00 0x00 +#define MX91_PAD_DAP_TDO_TRACESWO__MQS2_RIGHT 0x000C 0x01BC 0x0000 0x01 0x00 +#define MX91_PAD_DAP_TDO_TRACESWO__CAN2_RX 0x000C 0x01BC 0x0364 0x03 0x00 +#define MX91_PAD_DAP_TDO_TRACESWO__FLEXIO1_FLEXIO31 0x000C 0x01BC 0x0000 0x04 0x00 +#define MX91_PAD_DAP_TDO_TRACESWO__GPIO3_IO31 0x000C 0x01BC 0x0000 0x05 0x00 +#define MX91_PAD_DAP_TDO_TRACESWO__LPUART5_TX 0x000C 0x01BC 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