diff --git a/target/xtensa/Makefile.objs b/target/xtensa/Makefile.objs
index e0a3d5e103e6..79b8db6ced27 100644
--- a/target/xtensa/Makefile.objs
+++ b/target/xtensa/Makefile.objs
@@ -2,6 +2,7 @@ obj-y += core-DE_233L_FPU.o
 obj-y += core-dc232b.o
 obj-y += core-dc233c.o
 obj-y += core-de212.o
+obj-y += core-dsp3400.o
 obj-y += core-fsf.o
 obj-y += core-sample_controller.o
 obj-y += core-test_kc705_be.o
diff --git a/target/xtensa/core-dsp3400.c b/target/xtensa/core-dsp3400.c
new file mode 100644
index 000000000000..753e44d355a5
--- /dev/null
+++ b/target/xtensa/core-dsp3400.c
@@ -0,0 +1,31 @@
+#include "qemu/osdep.h"
+#include "cpu.h"
+#include "exec/gdbstub.h"
+#include "qemu-common.h"
+#include "qemu/host-utils.h"
+
+#include "core-dsp3400/core-isa.h"
+#include "core-dsp3400/core-matmap.h"
+#include "overlay_tool.h"
+
+#define xtensa_modules xtensa_modules_dsp3400
+#include "core-dsp3400/xtensa-modules.inc.c"
+
+static XtensaConfig dsp3400 __attribute__((unused)) = {
+    .name = "dsp3400",
+    .gdb_regmap = {
+        .reg = {
+#include "core-dsp3400/gdb-config.inc.c"
+        }
+    },
+    .isa_internal = &xtensa_modules,
+    .clock_freq_khz = 40000,
+    .opcode_translators = (const XtensaOpcodeTranslators *[]){
+        &xtensa_core_opcodes,
+        &xtensa_fpu2000_opcodes,
+        NULL,
+    },
+    DEFAULT_SECTIONS
+};
+
+REGISTER_CORE(dsp3400)
diff --git a/target/xtensa/core-dsp3400/core-isa.h b/target/xtensa/core-dsp3400/core-isa.h
new file mode 100644
index 000000000000..336b2467c6ac
--- /dev/null
+++ b/target/xtensa/core-dsp3400/core-isa.h
@@ -0,0 +1,452 @@
+/* 
+ * xtensa/config/core-isa.h -- HAL definitions that are dependent on Xtensa
+ *				processor CORE configuration
+ *
+ *  See <xtensa/config/core.h>, which includes this file, for more details.
+ */
+
+/* Xtensa processor core configuration information.
+
+   Copyright (c) 1999-2010 Tensilica Inc.
+
+   Permission is hereby granted, free of charge, to any person obtaining
+   a copy of this software and associated documentation files (the
+   "Software"), to deal in the Software without restriction, including
+   without limitation the rights to use, copy, modify, merge, publish,
+   distribute, sublicense, and/or sell copies of the Software, and to
+   permit persons to whom the Software is furnished to do so, subject to
+   the following conditions:
+
+   The above copyright notice and this permission notice shall be included
+   in all copies or substantial portions of the Software.
+
+   THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND,
+   EXPRESS OR IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF
+   MERCHANTABILITY, FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.
+   IN NO EVENT SHALL THE AUTHORS OR COPYRIGHT HOLDERS BE LIABLE FOR ANY
+   CLAIM, DAMAGES OR OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT,
+   TORT OR OTHERWISE, ARISING FROM, OUT OF OR IN CONNECTION WITH THE
+   SOFTWARE OR THE USE OR OTHER DEALINGS IN THE SOFTWARE.  */
+
+#ifndef _XTENSA_CORE_CONFIGURATION_H
+#define _XTENSA_CORE_CONFIGURATION_H
+
+
+/****************************************************************************
+	    Parameters Useful for Any Code, USER or PRIVILEGED
+ ****************************************************************************/
+
+/*
+ *  Note:  Macros of the form XCHAL_HAVE_*** have a value of 1 if the option is
+ *  configured, and a value of 0 otherwise.  These macros are always defined.
+ */
+
+
+/*----------------------------------------------------------------------
+				ISA
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_HAVE_BE			0	/* big-endian byte ordering */
+#define XCHAL_HAVE_WINDOWED		1	/* windowed registers option */
+#define XCHAL_NUM_AREGS			32	/* num of physical addr regs */
+#define XCHAL_NUM_AREGS_LOG2		5	/* log2(XCHAL_NUM_AREGS) */
+#define XCHAL_MAX_INSTRUCTION_SIZE	8	/* max instr bytes (3..8) */
+#define XCHAL_HAVE_DEBUG		1	/* debug option */
+#define XCHAL_HAVE_DENSITY		1	/* 16-bit instructions */
+#define XCHAL_HAVE_LOOPS		1	/* zero-overhead loops */
+#define XCHAL_HAVE_NSA			1	/* NSA/NSAU instructions */
+#define XCHAL_HAVE_MINMAX		1	/* MIN/MAX instructions */
+#define XCHAL_HAVE_SEXT			1	/* SEXT instruction */
+#define XCHAL_HAVE_CLAMPS		1	/* CLAMPS instruction */
+#define XCHAL_HAVE_MUL16		1	/* MUL16S/MUL16U instructions */
+#define XCHAL_HAVE_MUL32		0	/* MULL instruction */
+#define XCHAL_HAVE_MUL32_HIGH		0	/* MULUH/MULSH instructions */
+#define XCHAL_HAVE_DIV32		0	/* QUOS/QUOU/REMS/REMU instructions */
+#define XCHAL_HAVE_L32R			1	/* L32R instruction */
+#define XCHAL_HAVE_ABSOLUTE_LITERALS	1	/* non-PC-rel (extended) L32R */
+#define XCHAL_HAVE_CONST16		0	/* CONST16 instruction */
+#define XCHAL_HAVE_ADDX			1	/* ADDX#/SUBX# instructions */
+#define XCHAL_HAVE_WIDE_BRANCHES	0	/* B*.W18 or B*.W15 instr's */
+#define XCHAL_HAVE_PREDICTED_BRANCHES	0	/* B[EQ/EQZ/NE/NEZ]T instr's */
+#define XCHAL_HAVE_CALL4AND12		1	/* (obsolete option) */
+#define XCHAL_HAVE_ABS			1	/* ABS instruction */
+/*#define XCHAL_HAVE_POPC		0*/	/* POPC instruction */
+/*#define XCHAL_HAVE_CRC		0*/	/* CRC instruction */
+#define XCHAL_HAVE_RELEASE_SYNC		1	/* L32AI/S32RI instructions */
+#define XCHAL_HAVE_S32C1I		1	/* S32C1I instruction */
+#define XCHAL_HAVE_SPECULATION		0	/* speculation */
+#define XCHAL_HAVE_FULL_RESET		1	/* all regs/state reset */
+#define XCHAL_NUM_CONTEXTS		1	/* */
+#define XCHAL_NUM_MISC_REGS		0	/* num of scratch regs (0..4) */
+#define XCHAL_HAVE_TAP_MASTER		0	/* JTAG TAP control instr's */
+#define XCHAL_HAVE_PRID			1	/* processor ID register */
+#define XCHAL_HAVE_EXTERN_REGS		1	/* WER/RER instructions */
+#define XCHAL_HAVE_MP_INTERRUPTS	0	/* interrupt distributor port */
+#define XCHAL_HAVE_MP_RUNSTALL		0	/* core RunStall control port */
+#define XCHAL_HAVE_THREADPTR		1	/* THREADPTR register */
+#define XCHAL_HAVE_BOOLEANS		1	/* boolean registers */
+#define XCHAL_HAVE_CP			1	/* CPENABLE reg (coprocessor) */
+#define XCHAL_CP_MAXCFG			4	/* max allowed cp id plus one */
+#define XCHAL_HAVE_MAC16		0	/* MAC16 package */
+#define XCHAL_HAVE_VECTORFPU2005	0	/* vector floating-point pkg */
+#define XCHAL_HAVE_FP			1	/* floating point pkg */
+#define XCHAL_HAVE_DFP			0	/* double precision FP pkg */
+#define XCHAL_HAVE_DFP_accel		0	/* double precision FP acceleration pkg */
+#define XCHAL_HAVE_VECTRA1		0	/* Vectra I  pkg */
+#define XCHAL_HAVE_VECTRALX		0	/* Vectra LX pkg */
+#define XCHAL_HAVE_HIFIPRO		0	/* HiFiPro Audio Engine pkg */
+#define XCHAL_HAVE_HIFI2		0	/* HiFi2 Audio Engine pkg */
+#define XCHAL_HAVE_CONNXD2		0	/* ConnX D2 pkg */
+#define XCHAL_HAVE_BBE16		0	/* ConnX BBE16 pkg */
+#define XCHAL_HAVE_BBE16_RSQRT		0	/* BBE16 & vector recip sqrt */
+#define XCHAL_HAVE_BBE16_VECDIV		0	/* BBE16 & vector divide */
+#define XCHAL_HAVE_BBE16_DESPREAD	0	/* BBE16 & despread */
+#define XCHAL_HAVE_BSP3			0	/* ConnX BSP3 pkg */
+#define XCHAL_HAVE_SSP16		0	/* ConnX SSP16 pkg */
+#define XCHAL_HAVE_SSP16_VITERBI	0	/* SSP16 & viterbi */
+#define XCHAL_HAVE_TURBO16		0	/* ConnX Turbo16 pkg */
+
+
+/*----------------------------------------------------------------------
+				MISC
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_NUM_WRITEBUFFER_ENTRIES	8	/* size of write buffer */
+#define XCHAL_INST_FETCH_WIDTH		8	/* instr-fetch width in bytes */
+#define XCHAL_DATA_WIDTH		16	/* data width in bytes */
+/*  In T1050, applies to selected core load and store instructions (see ISA): */
+#define XCHAL_UNALIGNED_LOAD_EXCEPTION	1	/* unaligned loads cause exc. */
+#define XCHAL_UNALIGNED_STORE_EXCEPTION	1	/* unaligned stores cause exc.*/
+#define XCHAL_UNALIGNED_LOAD_HW		0	/* unaligned loads work in hw */
+#define XCHAL_UNALIGNED_STORE_HW	0	/* unaligned stores work in hw*/
+
+#define XCHAL_SW_VERSION		800002	/* sw version of this header */
+
+#define XCHAL_CORE_ID			"dsp3400_RC2"	/* alphanum core name
+						   (CoreID) set in the Xtensa
+						   Processor Generator */
+
+#define XCHAL_BUILD_UNIQUE_ID		0x0002DC22	/* 22-bit sw build ID */
+
+/*
+ *  These definitions describe the hardware targeted by this software.
+ */
+#define XCHAL_HW_CONFIGID0		0xC3F3DBFE	/* ConfigID hi 32 bits*/
+#define XCHAL_HW_CONFIGID1		0x1082C3B0	/* ConfigID lo 32 bits*/
+#define XCHAL_HW_VERSION_NAME		"LX3.0.1"	/* full version name */
+#define XCHAL_HW_VERSION_MAJOR		2300	/* major ver# of targeted hw */
+#define XCHAL_HW_VERSION_MINOR		1	/* minor ver# of targeted hw */
+#define XCHAL_HW_VERSION		230001	/* major*100+minor */
+#define XCHAL_HW_REL_LX3		1
+#define XCHAL_HW_REL_LX3_0		1
+#define XCHAL_HW_REL_LX3_0_1		1
+#define XCHAL_HW_CONFIGID_RELIABLE	1
+/*  If software targets a *range* of hardware versions, these are the bounds: */
+#define XCHAL_HW_MIN_VERSION_MAJOR	2300	/* major v of earliest tgt hw */
+#define XCHAL_HW_MIN_VERSION_MINOR	1	/* minor v of earliest tgt hw */
+#define XCHAL_HW_MIN_VERSION		230001	/* earliest targeted hw */
+#define XCHAL_HW_MAX_VERSION_MAJOR	2300	/* major v of latest tgt hw */
+#define XCHAL_HW_MAX_VERSION_MINOR	1	/* minor v of latest tgt hw */
+#define XCHAL_HW_MAX_VERSION		230001	/* latest targeted hw */
+
+
+/*----------------------------------------------------------------------
+				CACHE
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_ICACHE_LINESIZE		32	/* I-cache line size in bytes */
+#define XCHAL_DCACHE_LINESIZE		32	/* D-cache line size in bytes */
+#define XCHAL_ICACHE_LINEWIDTH		5	/* log2(I line size in bytes) */
+#define XCHAL_DCACHE_LINEWIDTH		5	/* log2(D line size in bytes) */
+
+#define XCHAL_ICACHE_SIZE		8192	/* I-cache size in bytes or 0 */
+#define XCHAL_DCACHE_SIZE		8192	/* D-cache size in bytes or 0 */
+
+#define XCHAL_DCACHE_IS_WRITEBACK	1	/* writeback feature */
+#define XCHAL_DCACHE_IS_COHERENT	0	/* MP coherence feature */
+
+#define XCHAL_HAVE_PREFETCH		0	/* PREFCTL register */
+
+
+
+
+/****************************************************************************
+    Parameters Useful for PRIVILEGED (Supervisory or Non-Virtualized) Code
+ ****************************************************************************/
+
+
+#ifndef XTENSA_HAL_NON_PRIVILEGED_ONLY
+
+/*----------------------------------------------------------------------
+				CACHE
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_HAVE_PIF			1	/* any outbound PIF present */
+
+/*  If present, cache size in bytes == (ways * 2^(linewidth + setwidth)).  */
+
+/*  Number of cache sets in log2(lines per way):  */
+#define XCHAL_ICACHE_SETWIDTH		7
+#define XCHAL_DCACHE_SETWIDTH		7
+
+/*  Cache set associativity (number of ways):  */
+#define XCHAL_ICACHE_WAYS		2
+#define XCHAL_DCACHE_WAYS		2
+
+/*  Cache features:  */
+#define XCHAL_ICACHE_LINE_LOCKABLE	1
+#define XCHAL_DCACHE_LINE_LOCKABLE	1
+#define XCHAL_ICACHE_ECC_PARITY		0
+#define XCHAL_DCACHE_ECC_PARITY		0
+
+/*  Cache access size in bytes (affects operation of SICW instruction):  */
+#define XCHAL_ICACHE_ACCESS_SIZE	8
+#define XCHAL_DCACHE_ACCESS_SIZE	16
+
+/*  Number of encoded cache attr bits (see <xtensa/hal.h> for decoded bits):  */
+#define XCHAL_CA_BITS			4
+
+
+/*----------------------------------------------------------------------
+			INTERNAL I/D RAM/ROMs and XLMI
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_NUM_INSTROM		0	/* number of core instr. ROMs */
+#define XCHAL_NUM_INSTRAM		2	/* number of core instr. RAMs */
+#define XCHAL_NUM_DATAROM		0	/* number of core data ROMs */
+#define XCHAL_NUM_DATARAM		2	/* number of core data RAMs */
+#define XCHAL_NUM_URAM			0	/* number of core unified RAMs*/
+#define XCHAL_NUM_XLMI			0	/* number of core XLMI ports */
+
+/*  Instruction RAM 0:  */
+#define XCHAL_INSTRAM0_VADDR		0x5FFE0000
+#define XCHAL_INSTRAM0_PADDR		0x5FFE0000
+#define XCHAL_INSTRAM0_SIZE		65536
+#define XCHAL_INSTRAM0_ECC_PARITY	0
+
+/*  Instruction RAM 1:  */
+#define XCHAL_INSTRAM1_VADDR		0x5FFF0000
+#define XCHAL_INSTRAM1_PADDR		0x5FFF0000
+#define XCHAL_INSTRAM1_SIZE		65536
+#define XCHAL_INSTRAM1_ECC_PARITY	0
+
+/*  Data RAM 0:  */
+#define XCHAL_DATARAM0_VADDR		0x5FFD0000
+#define XCHAL_DATARAM0_PADDR		0x5FFD0000
+#define XCHAL_DATARAM0_SIZE		32768
+#define XCHAL_DATARAM0_ECC_PARITY	0
+
+/*  Data RAM 1:  */
+#define XCHAL_DATARAM1_VADDR		0x5FFD8000
+#define XCHAL_DATARAM1_PADDR		0x5FFD8000
+#define XCHAL_DATARAM1_SIZE		32768
+#define XCHAL_DATARAM1_ECC_PARITY	0
+
+
+/*----------------------------------------------------------------------
+			INTERRUPTS and TIMERS
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_HAVE_INTERRUPTS		1	/* interrupt option */
+#define XCHAL_HAVE_HIGHPRI_INTERRUPTS	1	/* med/high-pri. interrupts */
+#define XCHAL_HAVE_NMI			0	/* non-maskable interrupt */
+#define XCHAL_HAVE_CCOUNT		1	/* CCOUNT reg. (timer option) */
+#define XCHAL_NUM_TIMERS		2	/* number of CCOMPAREn regs */
+#define XCHAL_NUM_INTERRUPTS		13	/* number of interrupts */
+#define XCHAL_NUM_INTERRUPTS_LOG2	4	/* ceil(log2(NUM_INTERRUPTS)) */
+#define XCHAL_NUM_EXTINTERRUPTS		9	/* num of external interrupts */
+#define XCHAL_NUM_INTLEVELS		6	/* number of interrupt levels
+						   (not including level zero) */
+#define XCHAL_EXCM_LEVEL		4	/* level masked by PS.EXCM */
+	/* (always 1 in XEA1; levels 2 .. EXCM_LEVEL are "medium priority") */
+
+/*  Masks of interrupts at each interrupt level:  */
+#define XCHAL_INTLEVEL1_MASK		0x00001200
+#define XCHAL_INTLEVEL2_MASK		0x00000980
+#define XCHAL_INTLEVEL3_MASK		0x00000460
+#define XCHAL_INTLEVEL4_MASK		0x00000019
+#define XCHAL_INTLEVEL5_MASK		0x00000006
+#define XCHAL_INTLEVEL6_MASK		0x00000000
+#define XCHAL_INTLEVEL7_MASK		0x00000000
+
+/*  Masks of interrupts at each range 1..n of interrupt levels:  */
+#define XCHAL_INTLEVEL1_ANDBELOW_MASK	0x00001200
+#define XCHAL_INTLEVEL2_ANDBELOW_MASK	0x00001B80
+#define XCHAL_INTLEVEL3_ANDBELOW_MASK	0x00001FE0
+#define XCHAL_INTLEVEL4_ANDBELOW_MASK	0x00001FF9
+#define XCHAL_INTLEVEL5_ANDBELOW_MASK	0x00001FFF
+#define XCHAL_INTLEVEL6_ANDBELOW_MASK	0x00001FFF
+#define XCHAL_INTLEVEL7_ANDBELOW_MASK	0x00001FFF
+
+/*  Level of each interrupt:  */
+#define XCHAL_INT0_LEVEL		4
+#define XCHAL_INT1_LEVEL		5
+#define XCHAL_INT2_LEVEL		5
+#define XCHAL_INT3_LEVEL		4
+#define XCHAL_INT4_LEVEL		4
+#define XCHAL_INT5_LEVEL		3
+#define XCHAL_INT6_LEVEL		3
+#define XCHAL_INT7_LEVEL		2
+#define XCHAL_INT8_LEVEL		2
+#define XCHAL_INT9_LEVEL		1
+#define XCHAL_INT10_LEVEL		3
+#define XCHAL_INT11_LEVEL		2
+#define XCHAL_INT12_LEVEL		1
+#define XCHAL_DEBUGLEVEL		6	/* debug interrupt level */
+#define XCHAL_HAVE_DEBUG_EXTERN_INT	1	/* OCD external db interrupt */
+
+/*  Type of each interrupt:  */
+#define XCHAL_INT0_TYPE 	XTHAL_INTTYPE_TIMER
+#define XCHAL_INT1_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT2_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT3_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT4_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT5_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT6_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT7_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT8_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT9_TYPE 	XTHAL_INTTYPE_EXTERN_LEVEL
+#define XCHAL_INT10_TYPE 	XTHAL_INTTYPE_SOFTWARE
+#define XCHAL_INT11_TYPE 	XTHAL_INTTYPE_TIMER
+#define XCHAL_INT12_TYPE 	XTHAL_INTTYPE_WRITE_ERROR
+
+/*  Masks of interrupts for each type of interrupt:  */
+#define XCHAL_INTTYPE_MASK_UNCONFIGURED	0xFFFFE000
+#define XCHAL_INTTYPE_MASK_SOFTWARE	0x00000400
+#define XCHAL_INTTYPE_MASK_EXTERN_EDGE	0x00000000
+#define XCHAL_INTTYPE_MASK_EXTERN_LEVEL	0x000003FE
+#define XCHAL_INTTYPE_MASK_TIMER	0x00000801
+#define XCHAL_INTTYPE_MASK_NMI		0x00000000
+#define XCHAL_INTTYPE_MASK_WRITE_ERROR	0x00001000
+
+/*  Interrupt numbers assigned to specific interrupt sources:  */
+#define XCHAL_TIMER0_INTERRUPT		0	/* CCOMPARE0 */
+#define XCHAL_TIMER1_INTERRUPT		11	/* CCOMPARE1 */
+#define XCHAL_TIMER2_INTERRUPT		XTHAL_TIMER_UNCONFIGURED
+#define XCHAL_TIMER3_INTERRUPT		XTHAL_TIMER_UNCONFIGURED
+#define XCHAL_WRITE_ERROR_INTERRUPT	12	/* write-error interrupt */
+
+/*  Interrupt numbers for levels at which only one interrupt is configured:  */
+/*  (There are many interrupts each at level(s) 1, 2, 3, 4, 5.)  */
+
+
+/*
+ *  External interrupt vectors/levels.
+ *  These macros describe how Xtensa processor interrupt numbers
+ *  (as numbered internally, eg. in INTERRUPT and INTENABLE registers)
+ *  map to external BInterrupt<n> pins, for those interrupts
+ *  configured as external (level-triggered, edge-triggered, or NMI).
+ *  See the Xtensa processor databook for more details.
+ */
+
+/*  Core interrupt numbers mapped to each EXTERNAL interrupt number:  */
+#define XCHAL_EXTINT0_NUM		1	/* (intlevel 5) */
+#define XCHAL_EXTINT1_NUM		2	/* (intlevel 5) */
+#define XCHAL_EXTINT2_NUM		3	/* (intlevel 4) */
+#define XCHAL_EXTINT3_NUM		4	/* (intlevel 4) */
+#define XCHAL_EXTINT4_NUM		5	/* (intlevel 3) */
+#define XCHAL_EXTINT5_NUM		6	/* (intlevel 3) */
+#define XCHAL_EXTINT6_NUM		7	/* (intlevel 2) */
+#define XCHAL_EXTINT7_NUM		8	/* (intlevel 2) */
+#define XCHAL_EXTINT8_NUM		9	/* (intlevel 1) */
+
+
+/*----------------------------------------------------------------------
+			EXCEPTIONS and VECTORS
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_XEA_VERSION		2	/* Xtensa Exception Architecture
+						   number: 1 == XEA1 (old)
+							   2 == XEA2 (new)
+							   0 == XEAX (extern) */
+#define XCHAL_HAVE_XEA1			0	/* Exception Architecture 1 */
+#define XCHAL_HAVE_XEA2			1	/* Exception Architecture 2 */
+#define XCHAL_HAVE_XEAX			0	/* External Exception Arch. */
+#define XCHAL_HAVE_EXCEPTIONS		1	/* exception option */
+#define XCHAL_HAVE_MEM_ECC_PARITY	0	/* local memory ECC/parity */
+#define XCHAL_HAVE_VECTOR_SELECT	1	/* relocatable vectors */
+#define XCHAL_HAVE_VECBASE		1	/* relocatable vectors */
+#define XCHAL_VECBASE_RESET_VADDR	0x5FFE0400  /* VECBASE reset value */
+#define XCHAL_VECBASE_RESET_PADDR	0x5FFE0400
+#define XCHAL_RESET_VECBASE_OVERLAP	0
+
+#define XCHAL_RESET_VECTOR0_VADDR	0x5FFE0000
+#define XCHAL_RESET_VECTOR0_PADDR	0x5FFE0000
+#define XCHAL_RESET_VECTOR1_VADDR	0xFFFF1000
+#define XCHAL_RESET_VECTOR1_PADDR	0xFFFF1000
+#define XCHAL_RESET_VECTOR_VADDR	0x5FFE0000
+#define XCHAL_RESET_VECTOR_PADDR	0x5FFE0000
+#define XCHAL_USER_VECOFS		0x0000023C
+#define XCHAL_USER_VECTOR_VADDR		0x5FFE063C
+#define XCHAL_USER_VECTOR_PADDR		0x5FFE063C
+#define XCHAL_KERNEL_VECOFS		0x0000021C
+#define XCHAL_KERNEL_VECTOR_VADDR	0x5FFE061C
+#define XCHAL_KERNEL_VECTOR_PADDR	0x5FFE061C
+#define XCHAL_DOUBLEEXC_VECOFS		0x0000025C
+#define XCHAL_DOUBLEEXC_VECTOR_VADDR	0x5FFE065C
+#define XCHAL_DOUBLEEXC_VECTOR_PADDR	0x5FFE065C
+#define XCHAL_WINDOW_OF4_VECOFS		0x00000000
+#define XCHAL_WINDOW_UF4_VECOFS		0x00000040
+#define XCHAL_WINDOW_OF8_VECOFS		0x00000080
+#define XCHAL_WINDOW_UF8_VECOFS		0x000000C0
+#define XCHAL_WINDOW_OF12_VECOFS	0x00000100
+#define XCHAL_WINDOW_UF12_VECOFS	0x00000140
+#define XCHAL_WINDOW_VECTORS_VADDR	0x5FFE0400
+#define XCHAL_WINDOW_VECTORS_PADDR	0x5FFE0400
+#define XCHAL_INTLEVEL2_VECOFS		0x0000017C
+#define XCHAL_INTLEVEL2_VECTOR_VADDR	0x5FFE057C
+#define XCHAL_INTLEVEL2_VECTOR_PADDR	0x5FFE057C
+#define XCHAL_INTLEVEL3_VECOFS		0x0000019C
+#define XCHAL_INTLEVEL3_VECTOR_VADDR	0x5FFE059C
+#define XCHAL_INTLEVEL3_VECTOR_PADDR	0x5FFE059C
+#define XCHAL_INTLEVEL4_VECOFS		0x000001BC
+#define XCHAL_INTLEVEL4_VECTOR_VADDR	0x5FFE05BC
+#define XCHAL_INTLEVEL4_VECTOR_PADDR	0x5FFE05BC
+#define XCHAL_INTLEVEL5_VECOFS		0x000001DC
+#define XCHAL_INTLEVEL5_VECTOR_VADDR	0x5FFE05DC
+#define XCHAL_INTLEVEL5_VECTOR_PADDR	0x5FFE05DC
+#define XCHAL_INTLEVEL6_VECOFS		0x000001FC
+#define XCHAL_INTLEVEL6_VECTOR_VADDR	0x5FFE05FC
+#define XCHAL_INTLEVEL6_VECTOR_PADDR	0x5FFE05FC
+#define XCHAL_DEBUG_VECOFS		XCHAL_INTLEVEL6_VECOFS
+#define XCHAL_DEBUG_VECTOR_VADDR	XCHAL_INTLEVEL6_VECTOR_VADDR
+#define XCHAL_DEBUG_VECTOR_PADDR	XCHAL_INTLEVEL6_VECTOR_PADDR
+
+
+/*----------------------------------------------------------------------
+				DEBUG
+  ----------------------------------------------------------------------*/
+
+#define XCHAL_HAVE_OCD			1	/* OnChipDebug option */
+#define XCHAL_NUM_IBREAK		2	/* number of IBREAKn regs */
+#define XCHAL_NUM_DBREAK		2	/* number of DBREAKn regs */
+#define XCHAL_HAVE_OCD_DIR_ARRAY	0	/* faster OCD option */
+
+
+/*----------------------------------------------------------------------
+				MMU
+  ----------------------------------------------------------------------*/
+
+/*  See core-matmap.h header file for more details.  */
+
+#define XCHAL_HAVE_TLBS			1	/* inverse of HAVE_CACHEATTR */
+#define XCHAL_HAVE_SPANNING_WAY		1	/* one way maps I+D 4GB vaddr */
+#define XCHAL_SPANNING_WAY		0	/* TLB spanning way number */
+#define XCHAL_HAVE_IDENTITY_MAP		0	/* vaddr == paddr always */
+#define XCHAL_HAVE_CACHEATTR		0	/* CACHEATTR register present */
+#define XCHAL_HAVE_MIMIC_CACHEATTR	0	/* region protection */
+#define XCHAL_HAVE_XLT_CACHEATTR	1	/* region prot. w/translation */
+#define XCHAL_HAVE_PTP_MMU		0	/* full MMU (with page table
+						   [autorefill] and protection)
+						   usable for an MMU-based OS */
+/*  If none of the above last 4 are set, it's a custom TLB configuration.  */
+
+#define XCHAL_MMU_ASID_BITS		0	/* number of bits in ASIDs */
+#define XCHAL_MMU_RINGS			1	/* number of rings (1..4) */
+#define XCHAL_MMU_RING_BITS		0	/* num of bits in RING field */
+
+#endif /* !XTENSA_HAL_NON_PRIVILEGED_ONLY */
+
+
+#endif /* _XTENSA_CORE_CONFIGURATION_H */
+
diff --git a/target/xtensa/core-dsp3400/core-matmap.h b/target/xtensa/core-dsp3400/core-matmap.h
new file mode 100644
index 000000000000..8d1aa8336ec6
--- /dev/null
+++ b/target/xtensa/core-dsp3400/core-matmap.h
@@ -0,0 +1,312 @@
+/* 
+ * xtensa/config/core-matmap.h -- Memory access and translation mapping
+ *	parameters (CHAL) of the Xtensa processor core configuration.
+ *
+ *  If you are using Xtensa Tools, see <xtensa/config/core.h> (which includes
+ *  this file) for more details.
+ *
+ *  In the Xtensa processor products released to date, all parameters
+ *  defined in this file are derivable (at least in theory) from
+ *  information contained in the core-isa.h header file.
+ *  In particular, the following core configuration parameters are relevant:
+ *	XCHAL_HAVE_CACHEATTR
+ *	XCHAL_HAVE_MIMIC_CACHEATTR
+ *	XCHAL_HAVE_XLT_CACHEATTR
+ *	XCHAL_HAVE_PTP_MMU
+ *	XCHAL_ITLB_ARF_ENTRIES_LOG2
+ *	XCHAL_DTLB_ARF_ENTRIES_LOG2
+ *	XCHAL_DCACHE_IS_WRITEBACK
+ *	XCHAL_ICACHE_SIZE		(presence of I-cache)
+ *	XCHAL_DCACHE_SIZE		(presence of D-cache)
+ *	XCHAL_HW_VERSION_MAJOR
+ *	XCHAL_HW_VERSION_MINOR
+ */
+
+/* Copyright (c) 1999-2010 Tensilica Inc.
+
+   Permission is hereby granted, free of charge, to any person obtaining
+   a copy of this software and associated documentation files (the
+   "Software"), to deal in the Software without restriction, including
+   without limitation the rights to use, copy, modify, merge, publish,
+   distribute, sublicense, and/or sell copies of the Software, and to
+   permit persons to whom the Software is furnished to do so, subject to
+   the following conditions:
+
+   The above copyright notice and this permission notice shall be included
+   in all copies or substantial portions of the Software.
+
+   THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND,
+   EXPRESS OR IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF
+   MERCHANTABILITY, FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.
+   IN NO EVENT SHALL THE AUTHORS OR COPYRIGHT HOLDERS BE LIABLE FOR ANY
+   CLAIM, DAMAGES OR OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT,
+   TORT OR OTHERWISE, ARISING FROM, OUT OF OR IN CONNECTION WITH THE
+   SOFTWARE OR THE USE OR OTHER DEALINGS IN THE SOFTWARE.  */
+
+
+#ifndef XTENSA_CONFIG_CORE_MATMAP_H
+#define XTENSA_CONFIG_CORE_MATMAP_H
+
+
+/*----------------------------------------------------------------------
+			CACHE (MEMORY ACCESS) ATTRIBUTES
+  ----------------------------------------------------------------------*/
+
+
+/*  Cache Attribute encodings -- lists of access modes for each cache attribute:  */
+#define XCHAL_FCA_LIST		XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_CACHED	XCHAL_SEP \
+				XTHAL_FAM_BYPASS	XCHAL_SEP \
+				XTHAL_FAM_CACHED	XCHAL_SEP \
+				XTHAL_FAM_CACHED	XCHAL_SEP \
+				XTHAL_FAM_CACHED	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_FAM_EXCEPTION
+#define XCHAL_LCA_LIST		XTHAL_LAM_CACHED_NOALLOC	XCHAL_SEP \
+				XTHAL_LAM_CACHED	XCHAL_SEP \
+				XTHAL_LAM_BYPASSG	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_CACHED	XCHAL_SEP \
+				XTHAL_LAM_CACHED	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_LAM_ISOLATE	XCHAL_SEP \
+				XTHAL_LAM_EXCEPTION
+#define XCHAL_SCA_LIST		XTHAL_SAM_WRITETHRU	XCHAL_SEP \
+				XTHAL_SAM_WRITETHRU	XCHAL_SEP \
+				XTHAL_SAM_BYPASS	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_WRITEBACK	XCHAL_SEP \
+				XTHAL_SAM_WRITEBACK_NOALLOC	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION	XCHAL_SEP \
+				XTHAL_SAM_ISOLATE	XCHAL_SEP \
+				XTHAL_SAM_EXCEPTION
+
+
+/*
+ *  Specific encoded cache attribute values of general interest.
+ *  If a specific cache mode is not available, the closest available
+ *  one is returned instead (eg. writethru instead of writeback,
+ *  bypass instead of writethru).
+ */
+#define XCHAL_CA_BYPASS  		2	/* cache disabled (bypassed) mode */
+#define XCHAL_CA_WRITETHRU		1	/* cache enabled (write-through) mode */
+#define XCHAL_CA_WRITEBACK		4	/* cache enabled (write-back) mode */
+#define XCHAL_CA_WRITEBACK_NOALLOC	4	/* cache enabled (write-back no-allocate) mode */
+#define XCHAL_CA_ILLEGAL		15	/* no access allowed (all cause exceptions) mode */
+#define XCHAL_CA_ISOLATE		14	/* cache isolate (accesses go to cache not memory) mode */
+
+
+/*----------------------------------------------------------------------
+				MMU
+  ----------------------------------------------------------------------*/
+
+/*
+ *  General notes on MMU parameters.
+ *
+ *  Terminology:
+ *	ASID = address-space ID (acts as an "extension" of virtual addresses)
+ *	VPN  = virtual page number
+ *	PPN  = physical page number
+ *	CA   = encoded cache attribute (access modes)
+ *	TLB  = translation look-aside buffer (term is stretched somewhat here)
+ *	I    = instruction (fetch accesses)
+ *	D    = data (load and store accesses)
+ *	way  = each TLB (ITLB and DTLB) consists of a number of "ways"
+ *		that simultaneously match the virtual address of an access;
+ *		a TLB successfully translates a virtual address if exactly
+ *		one way matches the vaddr; if none match, it is a miss;
+ *		if multiple match, one gets a "multihit" exception;
+ *		each way can be independently configured in terms of number of
+ *		entries, page sizes, which fields are writable or constant, etc.
+ *	set  = group of contiguous ways with exactly identical parameters
+ *	ARF  = auto-refill; hardware services a 1st-level miss by loading a PTE
+ *		from the page table and storing it in one of the auto-refill ways;
+ *		if this PTE load also misses, a miss exception is posted for s/w.
+ *	min-wired = a "min-wired" way can be used to map a single (minimum-sized)
+ * 		page arbitrarily under program control; it has a single entry,
+ *		is non-auto-refill (some other way(s) must be auto-refill),
+ *		all its fields (VPN, PPN, ASID, CA) are all writable, and it
+ *		supports the XCHAL_MMU_MIN_PTE_PAGE_SIZE page size (a current
+ *		restriction is that this be the only page size it supports).
+ *
+ *  TLB way entries are virtually indexed.
+ *  TLB ways that support multiple page sizes:
+ *	- must have all writable VPN and PPN fields;
+ *	- can only use one page size at any given time (eg. setup at startup),
+ *	  selected by the respective ITLBCFG or DTLBCFG special register,
+ *	  whose bits n*4+3 .. n*4 index the list of page sizes for way n
+ *	  (XCHAL_xTLB_SETm_PAGESZ_LOG2_LIST for set m corresponding to way n);
+ *	  this list may be sparse for auto-refill ways because auto-refill
+ *	  ways have independent lists of supported page sizes sharing a
+ *	  common encoding with PTE entries; the encoding is the index into
+ *	  this list; unsupported sizes for a given way are zero in the list;
+ *	  selecting unsupported sizes results in undefined hardware behaviour;
+ *	- is only possible for ways 0 thru 7 (due to ITLBCFG/DTLBCFG definition).
+ */
+
+#define XCHAL_MMU_ASID_INVALID		0	/* ASID value indicating invalid address space */
+#define XCHAL_MMU_ASID_KERNEL		0	/* ASID value indicating kernel (ring 0) address space */
+#define XCHAL_MMU_SR_BITS		0	/* number of size-restriction bits supported */
+#define XCHAL_MMU_CA_BITS		4	/* number of bits needed to hold cache attribute encoding */
+#define XCHAL_MMU_MAX_PTE_PAGE_SIZE	29	/* max page size in a PTE structure (log2) */
+#define XCHAL_MMU_MIN_PTE_PAGE_SIZE	29	/* min page size in a PTE structure (log2) */
+
+
+/***  Instruction TLB:  ***/
+
+#define XCHAL_ITLB_WAY_BITS		0	/* number of bits holding the ways */
+#define XCHAL_ITLB_WAYS			1	/* number of ways (n-way set-associative TLB) */
+#define XCHAL_ITLB_ARF_WAYS		0	/* number of auto-refill ways */
+#define XCHAL_ITLB_SETS			1	/* number of sets (groups of ways with identical settings) */
+
+/*  Way set to which each way belongs:  */
+#define XCHAL_ITLB_WAY0_SET		0
+
+/*  Ways sets that are used by hardware auto-refill (ARF):  */
+#define XCHAL_ITLB_ARF_SETS		0	/* number of auto-refill sets */
+
+/*  Way sets that are "min-wired" (see terminology comment above):  */
+#define XCHAL_ITLB_MINWIRED_SETS	0	/* number of "min-wired" sets */
+
+
+/*  ITLB way set 0 (group of ways 0 thru 0):  */
+#define XCHAL_ITLB_SET0_WAY			0	/* index of first way in this way set */
+#define XCHAL_ITLB_SET0_WAYS			1	/* number of (contiguous) ways in this way set */
+#define XCHAL_ITLB_SET0_ENTRIES_LOG2		3	/* log2(number of entries in this way) */
+#define XCHAL_ITLB_SET0_ENTRIES			8	/* number of entries in this way (always a power of 2) */
+#define XCHAL_ITLB_SET0_ARF			0	/* 1=autorefill by h/w, 0=non-autorefill (wired/constant/static) */
+#define XCHAL_ITLB_SET0_PAGESIZES		1	/* number of supported page sizes in this way */
+#define XCHAL_ITLB_SET0_PAGESZ_BITS		0	/* number of bits to encode the page size */
+#define XCHAL_ITLB_SET0_PAGESZ_LOG2_MIN		29	/* log2(minimum supported page size) */
+#define XCHAL_ITLB_SET0_PAGESZ_LOG2_MAX		29	/* log2(maximum supported page size) */
+#define XCHAL_ITLB_SET0_PAGESZ_LOG2_LIST	29	/* list of log2(page size)s, separated by XCHAL_SEP;
+							   2^PAGESZ_BITS entries in list, unsupported entries are zero */
+#define XCHAL_ITLB_SET0_ASID_CONSTMASK		0	/* constant ASID bits; 0 if all writable */
+#define XCHAL_ITLB_SET0_VPN_CONSTMASK		0x00000000	/* constant VPN bits, not including entry index bits; 0 if all writable */
+#define XCHAL_ITLB_SET0_PPN_CONSTMASK		0	/* constant PPN bits, including entry index bits; 0 if all writable */
+#define XCHAL_ITLB_SET0_CA_CONSTMASK		0	/* constant CA bits; 0 if all writable */
+#define XCHAL_ITLB_SET0_ASID_RESET		0	/* 1 if ASID reset values defined (and all writable); 0 otherwise */
+#define XCHAL_ITLB_SET0_VPN_RESET		0	/* 1 if VPN reset values defined (and all writable); 0 otherwise */
+#define XCHAL_ITLB_SET0_PPN_RESET		1	/* 1 if PPN reset values defined (and all writable); 0 otherwise */
+#define XCHAL_ITLB_SET0_CA_RESET		1	/* 1 if CA reset values defined (and all writable); 0 otherwise */
+/*  Constant VPN values for each entry of ITLB way set 0 (because VPN_CONSTMASK is non-zero):  */
+#define XCHAL_ITLB_SET0_E0_VPN_CONST		0x00000000
+#define XCHAL_ITLB_SET0_E1_VPN_CONST		0x20000000
+#define XCHAL_ITLB_SET0_E2_VPN_CONST		0x40000000
+#define XCHAL_ITLB_SET0_E3_VPN_CONST		0x60000000
+#define XCHAL_ITLB_SET0_E4_VPN_CONST		0x80000000
+#define XCHAL_ITLB_SET0_E5_VPN_CONST		0xA0000000
+#define XCHAL_ITLB_SET0_E6_VPN_CONST		0xC0000000
+#define XCHAL_ITLB_SET0_E7_VPN_CONST		0xE0000000
+/*  Reset PPN values for each entry of ITLB way set 0 (because SET0_PPN_RESET is non-zero):  */
+#define XCHAL_ITLB_SET0_E0_PPN_RESET		0x00000000
+#define XCHAL_ITLB_SET0_E1_PPN_RESET		0x20000000
+#define XCHAL_ITLB_SET0_E2_PPN_RESET		0x40000000
+#define XCHAL_ITLB_SET0_E3_PPN_RESET		0x60000000
+#define XCHAL_ITLB_SET0_E4_PPN_RESET		0x80000000
+#define XCHAL_ITLB_SET0_E5_PPN_RESET		0xA0000000
+#define XCHAL_ITLB_SET0_E6_PPN_RESET		0xC0000000
+#define XCHAL_ITLB_SET0_E7_PPN_RESET		0xE0000000
+/*  Reset CA values for each entry of ITLB way set 0 (because SET0_CA_RESET is non-zero):  */
+#define XCHAL_ITLB_SET0_E0_CA_RESET		0x02
+#define XCHAL_ITLB_SET0_E1_CA_RESET		0x02
+#define XCHAL_ITLB_SET0_E2_CA_RESET		0x02
+#define XCHAL_ITLB_SET0_E3_CA_RESET		0x02
+#define XCHAL_ITLB_SET0_E4_CA_RESET		0x02
+#define XCHAL_ITLB_SET0_E5_CA_RESET		0x02
+#define XCHAL_ITLB_SET0_E6_CA_RESET		0x02
+#define XCHAL_ITLB_SET0_E7_CA_RESET		0x02
+
+
+/***  Data TLB:  ***/
+
+#define XCHAL_DTLB_WAY_BITS		0	/* number of bits holding the ways */
+#define XCHAL_DTLB_WAYS			1	/* number of ways (n-way set-associative TLB) */
+#define XCHAL_DTLB_ARF_WAYS		0	/* number of auto-refill ways */
+#define XCHAL_DTLB_SETS			1	/* number of sets (groups of ways with identical settings) */
+
+/*  Way set to which each way belongs:  */
+#define XCHAL_DTLB_WAY0_SET		0
+
+/*  Ways sets that are used by hardware auto-refill (ARF):  */
+#define XCHAL_DTLB_ARF_SETS		0	/* number of auto-refill sets */
+
+/*  Way sets that are "min-wired" (see terminology comment above):  */
+#define XCHAL_DTLB_MINWIRED_SETS	0	/* number of "min-wired" sets */
+
+
+/*  DTLB way set 0 (group of ways 0 thru 0):  */
+#define XCHAL_DTLB_SET0_WAY			0	/* index of first way in this way set */
+#define XCHAL_DTLB_SET0_WAYS			1	/* number of (contiguous) ways in this way set */
+#define XCHAL_DTLB_SET0_ENTRIES_LOG2		3	/* log2(number of entries in this way) */
+#define XCHAL_DTLB_SET0_ENTRIES			8	/* number of entries in this way (always a power of 2) */
+#define XCHAL_DTLB_SET0_ARF			0	/* 1=autorefill by h/w, 0=non-autorefill (wired/constant/static) */
+#define XCHAL_DTLB_SET0_PAGESIZES		1	/* number of supported page sizes in this way */
+#define XCHAL_DTLB_SET0_PAGESZ_BITS		0	/* number of bits to encode the page size */
+#define XCHAL_DTLB_SET0_PAGESZ_LOG2_MIN		29	/* log2(minimum supported page size) */
+#define XCHAL_DTLB_SET0_PAGESZ_LOG2_MAX		29	/* log2(maximum supported page size) */
+#define XCHAL_DTLB_SET0_PAGESZ_LOG2_LIST	29	/* list of log2(page size)s, separated by XCHAL_SEP;
+							   2^PAGESZ_BITS entries in list, unsupported entries are zero */
+#define XCHAL_DTLB_SET0_ASID_CONSTMASK		0	/* constant ASID bits; 0 if all writable */
+#define XCHAL_DTLB_SET0_VPN_CONSTMASK		0x00000000	/* constant VPN bits, not including entry index bits; 0 if all writable */
+#define XCHAL_DTLB_SET0_PPN_CONSTMASK		0	/* constant PPN bits, including entry index bits; 0 if all writable */
+#define XCHAL_DTLB_SET0_CA_CONSTMASK		0	/* constant CA bits; 0 if all writable */
+#define XCHAL_DTLB_SET0_ASID_RESET		0	/* 1 if ASID reset values defined (and all writable); 0 otherwise */
+#define XCHAL_DTLB_SET0_VPN_RESET		0	/* 1 if VPN reset values defined (and all writable); 0 otherwise */
+#define XCHAL_DTLB_SET0_PPN_RESET		1	/* 1 if PPN reset values defined (and all writable); 0 otherwise */
+#define XCHAL_DTLB_SET0_CA_RESET		1	/* 1 if CA reset values defined (and all writable); 0 otherwise */
+/*  Constant VPN values for each entry of DTLB way set 0 (because VPN_CONSTMASK is non-zero):  */
+#define XCHAL_DTLB_SET0_E0_VPN_CONST		0x00000000
+#define XCHAL_DTLB_SET0_E1_VPN_CONST		0x20000000
+#define XCHAL_DTLB_SET0_E2_VPN_CONST		0x40000000
+#define XCHAL_DTLB_SET0_E3_VPN_CONST		0x60000000
+#define XCHAL_DTLB_SET0_E4_VPN_CONST		0x80000000
+#define XCHAL_DTLB_SET0_E5_VPN_CONST		0xA0000000
+#define XCHAL_DTLB_SET0_E6_VPN_CONST		0xC0000000
+#define XCHAL_DTLB_SET0_E7_VPN_CONST		0xE0000000
+/*  Reset PPN values for each entry of DTLB way set 0 (because SET0_PPN_RESET is non-zero):  */
+#define XCHAL_DTLB_SET0_E0_PPN_RESET		0x00000000
+#define XCHAL_DTLB_SET0_E1_PPN_RESET		0x20000000
+#define XCHAL_DTLB_SET0_E2_PPN_RESET		0x40000000
+#define XCHAL_DTLB_SET0_E3_PPN_RESET		0x60000000
+#define XCHAL_DTLB_SET0_E4_PPN_RESET		0x80000000
+#define XCHAL_DTLB_SET0_E5_PPN_RESET		0xA0000000
+#define XCHAL_DTLB_SET0_E6_PPN_RESET		0xC0000000
+#define XCHAL_DTLB_SET0_E7_PPN_RESET		0xE0000000
+/*  Reset CA values for each entry of DTLB way set 0 (because SET0_CA_RESET is non-zero):  */
+#define XCHAL_DTLB_SET0_E0_CA_RESET		0x02
+#define XCHAL_DTLB_SET0_E1_CA_RESET		0x02
+#define XCHAL_DTLB_SET0_E2_CA_RESET		0x02
+#define XCHAL_DTLB_SET0_E3_CA_RESET		0x02
+#define XCHAL_DTLB_SET0_E4_CA_RESET		0x02
+#define XCHAL_DTLB_SET0_E5_CA_RESET		0x02
+#define XCHAL_DTLB_SET0_E6_CA_RESET		0x02
+#define XCHAL_DTLB_SET0_E7_CA_RESET		0x02
+
+
+
+
+#endif /*XTENSA_CONFIG_CORE_MATMAP_H*/
+
diff --git a/target/xtensa/core-dsp3400/gdb-config.inc.c b/target/xtensa/core-dsp3400/gdb-config.inc.c
new file mode 100644
index 000000000000..f7f5f75c9875
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+++ b/target/xtensa/core-dsp3400/gdb-config.inc.c
@@ -0,0 +1,400 @@
+/* Configuration for the Xtensa architecture for GDB, the GNU debugger.
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+   MERCHANTABILITY, FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.
+   IN NO EVENT SHALL THE AUTHORS OR COPYRIGHT HOLDERS BE LIABLE FOR ANY
+   CLAIM, DAMAGES OR OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT,
+   TORT OR OTHERWISE, ARISING FROM, OUT OF OR IN CONNECTION WITH THE
+   SOFTWARE OR THE USE OR OTHER DEALINGS IN THE SOFTWARE.  */
+
+#include "xtensa-isa.h"
+#include "xtensa-isa-internal.h"
+
+
+/* Sysregs.  */
+
+static xtensa_sysreg_internal sysregs[] = {
+  { "LBEG", 0, 0 },
+  { "LEND", 1, 0 },
+  { "LCOUNT", 2, 0 },
+  { "BR", 4, 0 },
+  { "MMID", 89, 0 },
+  { "DDR", 104, 0 },
+  { "176", 176, 0 },
+  { "208", 208, 0 },
+  { "INTERRUPT", 226, 0 },
+  { "INTCLEAR", 227, 0 },
+  { "CCOUNT", 234, 0 },
+  { "PRID", 235, 0 },
+  { "ICOUNT", 236, 0 },
+  { "CCOMPARE0", 240, 0 },
+  { "CCOMPARE1", 241, 0 },
+  { "VECBASE", 231, 0 },
+  { "EPC1", 177, 0 },
+  { "EPC2", 178, 0 },
+  { "EPC3", 179, 0 },
+  { "EPC4", 180, 0 },
+  { "EPC5", 181, 0 },
+  { "EPC6", 182, 0 },
+  { "EXCSAVE1", 209, 0 },
+  { "EXCSAVE2", 210, 0 },
+  { "EXCSAVE3", 211, 0 },
+  { "EXCSAVE4", 212, 0 },
+  { "EXCSAVE5", 213, 0 },
+  { "EXCSAVE6", 214, 0 },
+  { "EPS2", 194, 0 },
+  { "EPS3", 195, 0 },
+  { "EPS4", 196, 0 },
+  { "EPS5", 197, 0 },
+  { "EPS6", 198, 0 },
+  { "EXCCAUSE", 232, 0 },
+  { "DEPC", 192, 0 },
+  { "EXCVADDR", 238, 0 },
+  { "WINDOWBASE", 72, 0 },
+  { "WINDOWSTART", 73, 0 },
+  { "SAR", 3, 0 },
+  { "LITBASE", 5, 0 },
+  { "PS", 230, 0 },
+  { "INTENABLE", 228, 0 },
+  { "DBREAKA0", 144, 0 },
+  { "DBREAKC0", 160, 0 },
+  { "DBREAKA1", 145, 0 },
+  { "DBREAKC1", 161, 0 },
+  { "IBREAKA0", 128, 0 },
+  { "IBREAKA1", 129, 0 },
+  { "IBREAKENABLE", 96, 0 },
+  { "ICOUNTLEVEL", 237, 0 },
+  { "DEBUGCAUSE", 233, 0 },
+  { "CPENABLE", 224, 0 },
+  { "SCOMPARE1", 12, 0 },
+  { "ATOMCTL", 99, 0 },
+  { "THREADPTR", 231, 1 },
+  { "FCR", 232, 1 },
+  { "FSR", 233, 1 },
+  { "EXPSTATE", 0, 1 },
+  { "SOV", 1, 1 },
+  { "SAT_MODE", 2, 1 },
+  { "SAR0", 3, 1 },
+  { "SAR1", 4, 1 },
+  { "SAR2", 5, 1 },
+  { "SAR3", 6, 1 },
+  { "HSAR0", 7, 1 },
+  { "HSAR1", 8, 1 },
+  { "HSAR2", 9, 1 },
+  { "HSAR3", 10, 1 },
+  { "MAX_REG_0", 11, 1 },
+  { "MAX_REG_1", 12, 1 },
+  { "MAX_REG_2", 13, 1 },
+  { "MAX_REG_3", 14, 1 },
+  { "ARG_MAX_REG_0", 15, 1 },
+  { "ARG_MAX_REG_1", 16, 1 },
+  { "ARG_MAX_REG_2", 17, 1 },
+  { "ARG_MAX_REG_3", 18, 1 },
+  { "NCO_COUNTER_0", 19, 1 },
+  { "NCO_COUNTER_1", 20, 1 },
+  { "NCO_COUNTER_2", 21, 1 },
+  { "NCO_COUNTER_3", 22, 1 },
+  { "INTERP_EXT_N", 23, 1 },
+  { "INTERP_EXT_L", 24, 1 },
+  { "LLR_BUF_0", 25, 1 },
+  { "LLR_BUF_1", 26, 1 },
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+  { "LLR_BUF_3", 28, 1 },
+  { "LLR_BUF_4", 29, 1 },
+  { "LLR_BUF_5", 30, 1 },
+  { "LLR_BUF_6", 31, 1 },
+  { "LLR_BUF_7", 32, 1 },
+  { "LLR_BUF_8", 33, 1 },
+  { "LLR_BUF_9", 34, 1 },
+  { "LLR_BUF_10", 35, 1 },
+  { "LLR_BUF_11", 36, 1 },
+  { "LLR_BUF_12", 37, 1 },
+  { "LLR_BUF_13", 38, 1 },
+  { "LLR_BUF_14", 39, 1 },
+  { "LLR_BUF_15", 40, 1 },
+  { "LLR_BUF_16", 41, 1 },
+  { "LLR_BUF_17", 42, 1 },
+  { "LLR_BUF_18", 43, 1 },
+  { "LLR_BUF_19", 44, 1 },
+  { "LLR_BUF_20", 45, 1 },
+  { "LLR_BUF_21", 46, 1 },
+  { "LLR_BUF_22", 47, 1 },
+  { "LLR_BUF_23", 48, 1 },
+  { "SMOD_BUF_0", 49, 1 },
+  { "SMOD_BUF_1", 50, 1 },
+  { "SMOD_BUF_2", 51, 1 },
+  { "SMOD_BUF_3", 52, 1 },
+  { "SMOD_BUF_4", 53, 1 },
+  { "SMOD_BUF_5", 54, 1 },
+  { "SMOD_BUF_6", 55, 1 },
+  { "SMOD_BUF_7", 56, 1 },
+  { "WEIGHT_REG", 57, 1 },
+  { "SCALE_REG", 58, 1 },
+  { "LLR_POS", 59, 1 },
+  { "SMOD_POS", 60, 1 },
+  { "PERM_REG", 61, 1 },
+  { "SMOD_OFFSET_TABLE_0", 62, 1 },
+  { "SMOD_OFFSET_TABLE_1", 63, 1 },
+  { "SMOD_OFFSET_TABLE_2", 64, 1 },
+  { "SMOD_OFFSET_TABLE_3", 65, 1 },
+  { "PHASOR_N", 66, 1 },
+  { "PHASOR_OFFSET", 67, 1 }
+};
+
+#define NUM_SYSREGS 125
+#define MAX_SPECIAL_REG 241
+#define MAX_USER_REG 233
+
+
+/* Processor states.  */
+
+static xtensa_state_internal states[] = {
+  { "LCOUNT", 32, 0 },
+  { "PC", 32, 0 },
+  { "ICOUNT", 32, 0 },
+  { "DDR", 32, 0 },
+  { "INTERRUPT", 13, 0 },
+  { "CCOUNT", 32, 0 },
+  { "XTSYNC", 1, 0 },
+  { "VECBASE", 22, 0 },
+  { "EPC1", 32, 0 },
+  { "EPC2", 32, 0 },
+  { "EPC3", 32, 0 },
+  { "EPC4", 32, 0 },
+  { "EPC5", 32, 0 },
+  { "EPC6", 32, 0 },
+  { "EXCSAVE1", 32, 0 },
+  { "EXCSAVE2", 32, 0 },
+  { "EXCSAVE3", 32, 0 },
+  { "EXCSAVE4", 32, 0 },
+  { "EXCSAVE5", 32, 0 },
+  { "EXCSAVE6", 32, 0 },
+  { "EPS2", 13, 0 },
+  { "EPS3", 13, 0 },
+  { "EPS4", 13, 0 },
+  { "EPS5", 13, 0 },
+  { "EPS6", 13, 0 },
+  { "EXCCAUSE", 6, 0 },
+  { "PSINTLEVEL", 4, 0 },
+  { "PSUM", 1, 0 },
+  { "PSWOE", 1, 0 },
+  { "PSEXCM", 1, 0 },
+  { "DEPC", 32, 0 },
+  { "EXCVADDR", 32, 0 },
+  { "WindowBase", 3, 0 },
+  { "WindowStart", 8, 0 },
+  { "PSCALLINC", 2, 0 },
+  { "PSOWB", 4, 0 },
+  { "LBEG", 32, 0 },
+  { "LEND", 32, 0 },
+  { "SAR", 6, 0 },
+  { "THREADPTR", 32, 0 },
+  { "LITBADDR", 20, 0 },
+  { "LITBEN", 1, 0 },
+  { "InOCDMode", 1, 0 },
+  { "INTENABLE", 13, 0 },
+  { "DBREAKA0", 32, 0 },
+  { "DBREAKC0", 8, 0 },
+  { "DBREAKA1", 32, 0 },
+  { "DBREAKC1", 8, 0 },
+  { "IBREAKA0", 32, 0 },
+  { "IBREAKA1", 32, 0 },
+  { "IBREAKENABLE", 2, 0 },
+  { "ICOUNTLEVEL", 4, 0 },
+  { "DEBUGCAUSE", 6, 0 },
+  { "DBNUM", 4, 0 },
+  { "CCOMPARE0", 32, 0 },
+  { "CCOMPARE1", 32, 0 },
+  { "CPENABLE", 4, 0 },
+  { "SCOMPARE1", 32, 0 },
+  { "ATOMCTL", 6, 0 },
+  { "RoundMode", 2, 0 },
+  { "InvalidEnable", 1, 0 },
+  { "DivZeroEnable", 1, 0 },
+  { "OverflowEnable", 1, 0 },
+  { "UnderflowEnable", 1, 0 },
+  { "InexactEnable", 1, 0 },
+  { "InvalidFlag", 1, 0 },
+  { "DivZeroFlag", 1, 0 },
+  { "OverflowFlag", 1, 0 },
+  { "UnderflowFlag", 1, 0 },
+  { "InexactFlag", 1, 0 },
+  { "FPreserved20", 20, 0 },
+  { "FPreserved20a", 20, 0 },
+  { "FPreserved5", 5, 0 },
+  { "FPreserved7", 7, 0 },
+  { "EXPSTATE", 32, XTENSA_STATE_IS_EXPORTED },
+  { "SOV", 4, XTENSA_STATE_IS_SHARED_OR },
+  { "SAT_MODE", 1, 0 },
+  { "SAR0", 6, 0 },
+  { "SAR1", 6, 0 },
+  { "SAR2", 6, 0 },
+  { "SAR3", 6, 0 },
+  { "HSAR0", 6, 0 },
+  { "HSAR1", 6, 0 },
+  { "HSAR2", 6, 0 },
+  { "HSAR3", 6, 0 },
+  { "MAX_REG", 128, 0 },
+  { "ARG_MAX_REG", 128, 0 },
+  { "NCO_COUNTER", 128, 0 },
+  { "INTERP_EXT_N", 4, 0 },
+  { "INTERP_EXT_L", 4, 0 },
+  { "LLR_BUF", 768, 0 },
+  { "SMOD_BUF", 256, 0 },
+  { "WEIGHT_REG", 8, 0 },
+  { "SCALE_REG", 5, 0 },
+  { "LLR_POS", 6, 0 },
+  { "SMOD_POS", 7, 0 },
+  { "PERM_REG", 32, 0 },
+  { "SMOD_OFFSET_TABLE", 128, 0 },
+  { "PHASOR_N", 4, 0 },
+  { "PHASOR_OFFSET", 16, 0 }
+};
+
+#define NUM_STATES 100
+
+enum xtensa_state_id {
+  STATE_LCOUNT,
+  STATE_PC,
+  STATE_ICOUNT,
+  STATE_DDR,
+  STATE_INTERRUPT,
+  STATE_CCOUNT,
+  STATE_XTSYNC,
+  STATE_VECBASE,
+  STATE_EPC1,
+  STATE_EPC2,
+  STATE_EPC3,
+  STATE_EPC4,
+  STATE_EPC5,
+  STATE_EPC6,
+  STATE_EXCSAVE1,
+  STATE_EXCSAVE2,
+  STATE_EXCSAVE3,
+  STATE_EXCSAVE4,
+  STATE_EXCSAVE5,
+  STATE_EXCSAVE6,
+  STATE_EPS2,
+  STATE_EPS3,
+  STATE_EPS4,
+  STATE_EPS5,
+  STATE_EPS6,
+  STATE_EXCCAUSE,
+  STATE_PSINTLEVEL,
+  STATE_PSUM,
+  STATE_PSWOE,
+  STATE_PSEXCM,
+  STATE_DEPC,
+  STATE_EXCVADDR,
+  STATE_WindowBase,
+  STATE_WindowStart,
+  STATE_PSCALLINC,
+  STATE_PSOWB,
+  STATE_LBEG,
+  STATE_LEND,
+  STATE_SAR,
+  STATE_THREADPTR,
+  STATE_LITBADDR,
+  STATE_LITBEN,
+  STATE_InOCDMode,
+  STATE_INTENABLE,
+  STATE_DBREAKA0,
+  STATE_DBREAKC0,
+  STATE_DBREAKA1,
+  STATE_DBREAKC1,
+  STATE_IBREAKA0,
+  STATE_IBREAKA1,
+  STATE_IBREAKENABLE,
+  STATE_ICOUNTLEVEL,
+  STATE_DEBUGCAUSE,
+  STATE_DBNUM,
+  STATE_CCOMPARE0,
+  STATE_CCOMPARE1,
+  STATE_CPENABLE,
+  STATE_SCOMPARE1,
+  STATE_ATOMCTL,
+  STATE_RoundMode,
+  STATE_InvalidEnable,
+  STATE_DivZeroEnable,
+  STATE_OverflowEnable,
+  STATE_UnderflowEnable,
+  STATE_InexactEnable,
+  STATE_InvalidFlag,
+  STATE_DivZeroFlag,
+  STATE_OverflowFlag,
+  STATE_UnderflowFlag,
+  STATE_InexactFlag,
+  STATE_FPreserved20,
+  STATE_FPreserved20a,
+  STATE_FPreserved5,
+  STATE_FPreserved7,
+  STATE_EXPSTATE,
+  STATE_SOV,
+  STATE_SAT_MODE,
+  STATE_SAR0,
+  STATE_SAR1,
+  STATE_SAR2,
+  STATE_SAR3,
+  STATE_HSAR0,
+  STATE_HSAR1,
+  STATE_HSAR2,
+  STATE_HSAR3,
+  STATE_MAX_REG,
+  STATE_ARG_MAX_REG,
+  STATE_NCO_COUNTER,
+  STATE_INTERP_EXT_N,
+  STATE_INTERP_EXT_L,
+  STATE_LLR_BUF,
+  STATE_SMOD_BUF,
+  STATE_WEIGHT_REG,
+  STATE_SCALE_REG,
+  STATE_LLR_POS,
+  STATE_SMOD_POS,
+  STATE_PERM_REG,
+  STATE_SMOD_OFFSET_TABLE,
+  STATE_PHASOR_N,
+  STATE_PHASOR_OFFSET
+};
+
+
+/* Field definitions.  */
+
+static unsigned
+Field_t_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_s_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_r_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_op2_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_op1_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op1_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_op0_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 28) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op0_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf) | (tie_t << 0);
+}
+
+static unsigned
+Field_n_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_n_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+}
+
+static unsigned
+Field_m_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_m_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_sr_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sr_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_st_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_st_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_thi3_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_thi3_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2098inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2098inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_sae4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_sae4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2019_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2019_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2100inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2100inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2102inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2102inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2186inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2186inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2185inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2185inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2149inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2149inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3627inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 10) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3627inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0x300000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2187inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2187inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2101inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2101inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2103inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2103inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2189inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2189inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2188inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2188inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2104inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2104inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2190inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2190inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2094inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 7) | ((insn[0] << 16) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2094inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0xfe00) | (tie_t << 9);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2105inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2105inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2191inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2191inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2192inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2192inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2194inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2194inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2197inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2197inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2160inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2160inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2173inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2173inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2112inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2112inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2199inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2199inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2200inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2200inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2114inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2114inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2113inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2113inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2201inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2201inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2115inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2115inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2215inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2215inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3630inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3630inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2203inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2203inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 22) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2254_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 25) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2254_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x60) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2116inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2116inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2117inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2117inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2119inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2119inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 17) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x7000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2089inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2089inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_r2_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  return tie_t;
+}
+
+static void
+Field_r2_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_bbi4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  return tie_t;
+}
+
+static void
+Field_bbi4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3631inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3631inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2085inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 11) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2085inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x1f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2088inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 12) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2088inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3633inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 14) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3633inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20000) | (tie_t << 17);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2082inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2082inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2083inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2083inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2084inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2084inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2086inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 12) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2086inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3634_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 14) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3634_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2156inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 21) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2156inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x700) | (tie_t << 8);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2037_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 21) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2037_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x700) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2021_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2021_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_sa4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  return tie_t;
+}
+
+static void
+Field_sa4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2035_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 21) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2035_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x600) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 23) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x100) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2225inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2225inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2226inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2226inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2228inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2228inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2230inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2230inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2222inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2222inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2221inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2221inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2238inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2238inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2239inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2239inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2241inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2241inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2223inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2223inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2232inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2232inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2234inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2234inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2237inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2237inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2240inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2240inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2229inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2229inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2224inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2224inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2227inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2227inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2231inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2231inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2247inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2247inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2091inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2091inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2153inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2153inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3635inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3635inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2154inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2154inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3636inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3636inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2155inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2155inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3637inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3637inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2134inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2134inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 19) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x1e00) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2096inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2096inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2244inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2244inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2245inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2245inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2246inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2246inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3638inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3638inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2235inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2235inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2157inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2157inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2253inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 25) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2253inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x60) | (tie_t << 5);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3639inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3639inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2255inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2255inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3640inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3640inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2171inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2171inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 22) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2172inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2172inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 22) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2174inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2174inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 22) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2158inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2158inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2205inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2205inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2159inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2159inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2161inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2161inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2168inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2168inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2136inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2136inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2090inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2090inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2184inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2184inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3642inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3642inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2252inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2252inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3643inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3643inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2092inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 7) | ((insn[0] << 16) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2092inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0xfe00) | (tie_t << 9);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2216inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 21) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2216inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x600) | (tie_t << 9);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3644inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 10) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3644inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x300000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2217inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 21) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2217inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x600) | (tie_t << 9);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3645inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 9) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3645inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0x700000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2208inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2208inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2209inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2209inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2210inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2210inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2212inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2212inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2213inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 21) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2213inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x600) | (tie_t << 9);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3647inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3647inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2214inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2214inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3648inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3648inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2120inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2120inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2122inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2122inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2123inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2123inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2125inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2125inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2129inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 16) >> 27);
+  tie_t = (tie_t << 5) | ((insn[0] << 23) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2129inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x1f0) | (tie_t << 4);
+  tie_t = (val << 22) >> 27;
+  insn[0] = (insn[0] & ~0xf800) | (tie_t << 11);
+  tie_t = (val << 18) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2124inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2124inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2126inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2126inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2127inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2127inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2128inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 12) | ((insn[0] << 16) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2128inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2131inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 16) >> 27);
+  tie_t = (tie_t << 5) | ((insn[0] << 23) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2131inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x1f0) | (tie_t << 4);
+  tie_t = (val << 22) >> 27;
+  insn[0] = (insn[0] & ~0xf800) | (tie_t << 11);
+  tie_t = (val << 18) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2138inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2138inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2146inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2146inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3649inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 19) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3649inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x1f00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2147inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2147inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3650inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 19) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3650inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x1f00) | (tie_t << 8);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2139inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2139inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2140inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2140inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2142inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2142inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2248inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2248inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3651inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3651inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2250inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2250inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3653inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3653inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2257inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2257inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3654inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3654inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2249inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2249inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3655inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3655inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2107inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2107inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2118inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2118inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2108inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2108inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2109inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2109inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2111inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2111inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2110inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2110inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2145inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 16) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2145inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf800) | (tie_t << 11);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2141inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2141inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
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+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2143inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 16) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2143inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff00) | (tie_t << 8);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2144inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 7) | ((insn[0] << 16) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2144inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0xfe00) | (tie_t << 9);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2204inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 21) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2204inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x700) | (tie_t << 8);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3656inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3656inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2195inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2195inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2196inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2196inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2198inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2198inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2169inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2169inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2220inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2220inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2106inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2106inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2151inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2151inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3657inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 9) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3657inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x700000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2251inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2251inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3658inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3658inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2206inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2206inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2202inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2202inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+  tie_t = (val << 22) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2095inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 7) | ((insn[0] << 16) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2095inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0xfe00) | (tie_t << 9);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2132inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2132inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+  tie_t = (val << 26) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 22) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3659inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3659inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2099inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 7) | ((insn[0] << 16) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2099inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0xfe00) | (tie_t << 9);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2137inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2137inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2133inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2133inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3660inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3660inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2175inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2175inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2177inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2177inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2242inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2242inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3661inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3661inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2162inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2162inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2164inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2164inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2163inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2163inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2218inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2218inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2219inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2219inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2207inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2207inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2211inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2211inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2165inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2165inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2166inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2166inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2178inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2178inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2180inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2180inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2179inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2179inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2181inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2181inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2167inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2167inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2193inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2193inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3662inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3662inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2236inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2236inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2243inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2243inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2182inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2182inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2183inst_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 20) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2183inst_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0) | (tie_t << 4);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_op0_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 28) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op0_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf) | (tie_t << 0);
+}
+
+static unsigned
+Field_t_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_r_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_op0_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 28) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op0_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf) | (tie_t << 0);
+}
+
+static unsigned
+Field_z_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_z_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+}
+
+static unsigned
+Field_i_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_i_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_s_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_sae_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s3_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s3_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2260gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2260gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2258gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2258gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2282gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2282gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2281gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2281gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2266gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 13) >> 18);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2266gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 17) >> 18;
+  insn[0] = (insn[0] & ~0x7ffe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2302_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2302_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2312gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2312gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2386_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2386_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2283gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2283gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2286gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2286gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2287gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2287gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2289gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2289gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2293gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2293gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2288gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2288gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2290gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2290gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2359gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 11) | ((insn[0] << 19) >> 21);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2359gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 21) >> 21;
+  insn[0] = (insn[0] & ~0x1ffc) | (tie_t << 2);
+  tie_t = (val << 20) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2384_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2384_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2361gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 11) | ((insn[0] << 19) >> 21);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2361gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 21) >> 21;
+  insn[0] = (insn[0] & ~0x1ffc) | (tie_t << 2);
+  tie_t = (val << 20) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2362gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 10) | ((insn[0] << 19) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2362gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0x1ff8) | (tie_t << 3);
+  tie_t = (val << 21) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3663gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3663gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2364gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2364gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 23) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+  tie_t = (val << 22) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3664gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3664gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2366gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2366gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 24) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3665gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3665gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2308gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2308gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2259gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2259gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2262gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 13) | ((insn[0] << 13) >> 19);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2262gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 19) >> 19;
+  insn[0] = (insn[0] & ~0x7ffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2284gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2284gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2275gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2275gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2354gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2354gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2333gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2333gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2310gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2310gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3667gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3667gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2357gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2357gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2376gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2376gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2313_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2313_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2343gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2343gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2342gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2342gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2344gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2344gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2345gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2345gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2346gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2346gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2373gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2373gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2374gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2374gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2375gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2375gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2335gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2335gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2339gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2339gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2334gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2334gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2336gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2336gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2337gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2337gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2338gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2338gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2340gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2340gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2341gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2341gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2369gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2369gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3668gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3668gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2280gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2280gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2309gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2309gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2261gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2261gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2321gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2321gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2322gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2322gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2355gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2355gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2324gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2324gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2372gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2372gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3669gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3669gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2263gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 17) | ((insn[0] << 13) >> 15);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2263gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 15) >> 15;
+  insn[0] = (insn[0] & ~0x7fffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2044_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2044_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2264gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 13) >> 18);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2264gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 17) >> 18;
+  insn[0] = (insn[0] & ~0x7ffe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2368gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2368gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3670gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3670gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2291gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2291gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2292gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2292gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2294gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2294gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2295gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2295gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2297gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2297gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2296gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2296gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2301gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2301gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2272_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2272_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2277gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2277gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2279gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2279gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2278gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2278gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2267gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2267gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2268gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2268gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2269gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2269gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2271gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2271gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 21) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2305_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2305_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2270gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2270gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2273gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2273gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 21) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2298gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2298gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2299gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2299gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2300gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2300gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2303gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2303gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3671gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3671gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2379gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 23) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2379gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x100) | (tie_t << 8);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3673gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3673gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2274gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 13) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2274gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x7f800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2306gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2306gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2304gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2304gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3674gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3674gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2353gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2353gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2371gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2371gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3675gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3675gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2314gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2314gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2316gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2316gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2317gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2317gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2319gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2319gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2378gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2378gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3676gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3676gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2323gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2323gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2331gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2331gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2347gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2347gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2383gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2383gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3678gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 19) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3678gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x1f00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2318gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2318gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2332gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2332gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2348gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2348gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2349gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2349gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2351gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2351gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2370gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2370gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2320gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2320gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2350gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2350gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2352gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2352gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2325gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2325gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2327gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2327gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2326gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2326gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2328gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2328gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2356gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2356gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2329gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2329gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2381gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2381gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3666_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3666_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2330gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2330gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2385gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2385gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2387gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2387gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2388gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2388gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3679gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3679gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2358gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2358gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2389gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 23) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2389gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x100) | (tie_t << 8);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3680gp_slot2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3680gp_slot2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2399gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2399gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_op0_s4_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s4_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3681gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3681gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 23) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2395gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2395gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2394gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2394gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2397gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2397gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2400gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2400gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3683gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3683gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2402gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2402gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2403gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2403gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3684gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3684gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2405gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 23) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2405gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x100) | (tie_t << 8);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3686gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3686gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2398gp_slot1_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2398gp_slot1_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_sae_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s5_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s5_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2447gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2447gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3688gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3688gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2449gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 13) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2449gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x60000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3689gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3689gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2418gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2418gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2462_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2462_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2464gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2464gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2454gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2454gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2436gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2436gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 21) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3690gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3690gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2438gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 13) | ((insn[0] << 13) >> 19);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2438gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 19) >> 19;
+  insn[0] = (insn[0] & ~0x7ffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2437gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2437gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2526gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2526gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2460gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2460gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2459gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2459gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2445_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2445_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2427gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2427gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 21) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2420gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2420gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2424gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2424gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2425gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2425gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2480gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2480gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2479gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2479gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2419gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2419gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 22) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2481gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2481gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2483gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2483gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2487gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2487gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2482gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2482gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2426gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2426gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2484gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2484gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2422gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2422gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2429gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2429gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2485gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2485gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2486gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2486gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2488gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2488gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2531gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2531gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3691gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 23) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3691gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x1e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2493gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2493gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2506gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2506gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3692gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3692gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2494gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2494gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2407gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2407gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2413gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2413gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2415gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2415gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2417gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2417gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2441gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2441gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3693gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3693gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2409gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2409gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2410gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2410gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2416gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2416gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2411gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2411gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2412gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2412gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2453gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2453gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2451gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2451gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2452gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2452gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2516gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2516gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2512gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2512gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2514gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2514gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2515gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2515gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2443gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 13) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2443gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x7f000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2444gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2444gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2067_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2067_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2439gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2439gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3695gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3695gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2423gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2423gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2508gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2508gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2058_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2058_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2509gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2509gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2510gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2510gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3696gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3696gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2496gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2496gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_s8_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2527gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2527gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2036_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2036_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2528gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2528gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3697gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 25) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3697gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x60) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2523gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2523gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3698gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3698gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2455gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2455gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2456gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2456gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2458gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2458gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2457gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2457gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2440gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2440gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2524gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2524gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3699gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 25) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3699gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x60) | (tie_t << 5);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2503gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2503gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2507gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 13) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2507gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0x60000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3700gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3700gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2498gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2498gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2500gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2500gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2501gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2501gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2502gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2502gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2504gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2504gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2505gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2505gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2433gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2433gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2430gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2430gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2431gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2431gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2432gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2432gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2434gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2434gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2435gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2435gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2517gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2517gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2518gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2518gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2519gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2519gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2520gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2520gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2489gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2489gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2491gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2491gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2490gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2490gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2492gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2492gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2529gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2529gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3702gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3702gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2468gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2468gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2470gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2470gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2448_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2448_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3703gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3703gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2521gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2521gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2530_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2530_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2461gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2461gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2463gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2463gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2497gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2497gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2499gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2499gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2465gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2465gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2467gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2467gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2471gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2471gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2473gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2473gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2477gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2477gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 21) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3705gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3705gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2472gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2472gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2495gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2495gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3706gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3706gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2466gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2466gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2474gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2474gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2475gp_slot0_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2475gp_slot0_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 19) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2595dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 12) >> 25);
+  tie_t = (tie_t << 9) | ((insn[0] << 21) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2595dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 25;
+  insn[0] = (insn[0] & ~0xfe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_op0_s6_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s6_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3708dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3708dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2579dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2579dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2580dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2580dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2582dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2582dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2586dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2586dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2581dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2581dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2583dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2583dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2599dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 10) | ((insn[0] << 20) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2599dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc) | (tie_t << 2);
+  tie_t = (val << 20) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3709dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3709dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2614_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2614_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2604dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2604dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 23) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3710dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3710dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2606dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2606dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 24) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3711dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3711dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2601dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 10) | ((insn[0] << 20) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2601dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc) | (tie_t << 2);
+  tie_t = (val << 20) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2602dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2602dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 21) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3713dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3713dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2645dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 12) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2645dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3714dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3714dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2658dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2658dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3716dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3716dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3717dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3717dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 26) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2636dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 12) >> 18);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2636dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 18) >> 18;
+  insn[0] = (insn[0] & ~0xfffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2577dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2577dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2635dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2635dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3719dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3719dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2571dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2571dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2547dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2547dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2646dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2646dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3721dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3721dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2574dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2574dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2655dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2655dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2557dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2557dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2558dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2558dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2560dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2560dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2559dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2559dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2561dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2561dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2562dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2562dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2563dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2563dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2647dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2647dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2549dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2549dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2550dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2550dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2552dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2552dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2556dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2556dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2551dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2551dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2553dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2553dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2554dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2554dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2555dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2555dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2573dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2573dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2628dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2628dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3722_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3722_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2642dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2642dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 22) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2605_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2605_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2539dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2539dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2578_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2578_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2541dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2541dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2572dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2572dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2542dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2542dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3723dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 18) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3723dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0x3ff0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2591dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 18) | ((insn[0] << 12) >> 14);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2591dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 14) >> 14;
+  insn[0] = (insn[0] & ~0xffffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2596dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2596dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 19) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3724dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3724dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2592dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 12) >> 25);
+  tie_t = (tie_t << 9) | ((insn[0] << 21) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2592dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 25;
+  insn[0] = (insn[0] & ~0xfe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2598dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2598dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2584dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2584dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2585dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2585dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2587dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2587dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2588dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2588dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2590dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2590dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2589dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2589dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2608dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2608dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2609dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2609dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2610dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2610dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2626dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 12) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2626dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0xc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3715_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3715_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2613dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2613dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2616dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2616dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2621dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2621dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2615dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2615dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2617dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2617dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2618dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2618dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2637dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 12) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2637dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0xfff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3725dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3725dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2641dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 11) | ((insn[0] << 12) >> 21);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2641dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 21) >> 21;
+  insn[0] = (insn[0] & ~0xffe00) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3726dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3726dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2619dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2619dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2620dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2620dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2622dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2622dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2623dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2623dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3727dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3727dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2654dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 5) | ((insn[0] << 21) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2654dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3728dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3728dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2611dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2611dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2612_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2612_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2624dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 12) >> 24);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2624dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 21) >> 24;
+  insn[0] = (insn[0] & ~0xff000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3729dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3729dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2625_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 12) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2625_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3731dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3731dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2643dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2643dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 22) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2640dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 12) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2640dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0xfff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2569dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2569dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2632dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2632dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_t_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2532dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2532dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2644dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2644dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3732dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3732dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2533dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2533dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2534dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2534dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2536dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2536dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2652dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 5) | ((insn[0] << 21) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2652dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3718_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3718_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2540dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2540dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2548dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2548dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2564dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2564dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2657dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2657dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2535dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2535dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2537dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2537dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2565dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2565dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2566dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2566dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2568dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2568dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2630dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2630dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2538dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2538dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2633dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2633dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3733dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3733dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2567dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2567dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2544dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2544dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2543dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2543dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2545dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2545dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2546dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2546dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2575dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2575dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2648dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2648dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2649dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2649dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2651dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2651dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2656dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2656dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3712_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3712_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2576dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2576dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2650dot_slot2_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2650dot_slot2_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s7_Slot_dot_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s7_Slot_dot_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3734dot_slot1_Slot_dot_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 15) | ((insn[0] << 15) >> 17);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3734dot_slot1_Slot_dot_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 17) >> 17;
+  insn[0] = (insn[0] & ~0x1fffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2068_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2068_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s8_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s8_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2668dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2668dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2666dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2666dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2674dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2674dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2688dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2688dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3735dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3735dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2705dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2705dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3737dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3737dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2677dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2677dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2678dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2678dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2679dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2679dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2690dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2690dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2680dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2680dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_t_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2697dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2697dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3738dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3738dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2667dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 17) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2667dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x7000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2704dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 17) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2704dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x7800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3739dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 21) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3739dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x7e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2689dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2689dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_r_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2669dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2669dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2671dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2671dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2675dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2675dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2672dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2672dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2673dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2673dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2676dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2676dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2682dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2682dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2686dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2686dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3736_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3736_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2681dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2681dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2683dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2683dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2684dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2684dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2685dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2685dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2699dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2699dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3740dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3740dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2692dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2692dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2693dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2693dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 24) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2695dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2695dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 25) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3741dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3741dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3742dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3742dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2700dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2700dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2702dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2702dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2701dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2701dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2703dot_slot0_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2703dot_slot0_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_sae_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s9_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s9_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2707pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2707pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2817_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2817_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2739pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2739pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3744pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3744pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2717pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2717pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2713pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 13) >> 18);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2713pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 17) >> 18;
+  insn[0] = (insn[0] & ~0x7ffe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3745pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3745pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+}
+
+static unsigned
+Field_t_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2718pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2718pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2721pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2721pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2722pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2722pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2724pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2724pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2728pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2728pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2736pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2736pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 22) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2819_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2819_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2723pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2723pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2793pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 11) | ((insn[0] << 19) >> 21);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2793pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 21) >> 21;
+  insn[0] = (insn[0] & ~0x1ffc) | (tie_t << 2);
+  tie_t = (val << 20) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2795pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 11) | ((insn[0] << 19) >> 21);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2795pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 21) >> 21;
+  insn[0] = (insn[0] & ~0x1ffc) | (tie_t << 2);
+  tie_t = (val << 20) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2796pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 10) | ((insn[0] << 19) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2796pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0x1ff8) | (tie_t << 3);
+  tie_t = (val << 21) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3746pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3746pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2798pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2798pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 23) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+  tie_t = (val << 22) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3747pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3747pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2801pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2801pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 24) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3749pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3749pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2743pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2743pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3750pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3750pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2706pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 13) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2706pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x7f000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2709pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 13) | ((insn[0] << 13) >> 19);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2709pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 19) >> 19;
+  insn[0] = (insn[0] & ~0x7ffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2719pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2719pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2715pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2715pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2788pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2788pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2747pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2747pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2791pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2791pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2775pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2775pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2777pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2777pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2776pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2776pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2778pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2778pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2779pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2779pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2780pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2780pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2810pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2810pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2811pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2811pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2767pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2767pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2769pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2769pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2773pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2773pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2768pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2768pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2770pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2770pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2771pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2771pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2772pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2772pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2774pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2774pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2805pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2805pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3751pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3751pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2741pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2741pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2746pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2746pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3752pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3752pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2755pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2755pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2756pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2756pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2789pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2789pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2758pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2758pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2809pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2809pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3753pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3753pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2710pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 17) | ((insn[0] << 13) >> 15);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2710pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 15) >> 15;
+  insn[0] = (insn[0] & ~0x7fffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2711pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 13) >> 18);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2711pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 17) >> 18;
+  insn[0] = (insn[0] & ~0x7ffe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_s_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2803pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2803pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3754pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3754pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2725pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2725pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2726pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2726pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2727pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2727pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2729pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2729pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2730pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2730pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2732pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2732pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2731pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2731pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2733pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2733pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2734pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2734pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2735pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2735pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2807pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2807pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3756pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3756pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2742pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2742pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2738pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2738pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 22) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2708pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2708pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2714pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 13) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2714pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0x7fe00) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2787pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2787pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2808pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2808pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3757pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3757pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2748pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2748pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2750pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2750pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2751pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2751pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2753pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2753pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2816pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2816pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_imm7_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2757pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2757pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2765pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2765pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2781pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2781pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2814pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2814pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3758pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3758pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2752pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2752pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2766pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2766pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2782pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2782pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2783pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2783pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2785pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2785pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2806pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2806pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2025_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2025_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2754pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2754pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2784pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2784pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2786pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2786pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2759pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2759pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2761pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2761pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2760pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2760pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2762pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2762pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2790pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2790pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2763pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2763pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2812pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2812pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3748_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3748_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2764pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2764pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2818pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2818pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2737_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2737_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2820pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2820pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2821pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2821pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3759pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3759pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2792pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2792pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2823pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 23) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2823pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x100) | (tie_t << 8);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3760pq_slot2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3760pq_slot2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2826pq_slot1_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2826pq_slot1_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_op0_s10_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s10_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3761pq_slot1_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 7) | ((insn[0] << 23) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3761pq_slot1_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc) | (tie_t << 2);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2825pq_slot1_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2825pq_slot1_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_sae_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s11_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s11_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2867pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2867pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3763pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3763pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2869pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 13) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2869pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x60000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3764pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3764pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2838pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2838pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2882_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2882_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2884pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2884pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2874pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2874pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2856pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2856pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 21) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3765pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3765pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2858pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 13) | ((insn[0] << 13) >> 19);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2858pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 19) >> 19;
+  insn[0] = (insn[0] & ~0x7ffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2857pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2857pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2946pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2946pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2880pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2880pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2879pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2879pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2865_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2865_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2847pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2847pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 21) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2840pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2840pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2844pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2844pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2845pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2845pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2900pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2900pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2899pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2899pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2839pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2839pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 22) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2901pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2901pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2903pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2903pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2907pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2907pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2902pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2902pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2846pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2846pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2904pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2904pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2842pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2842pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2849pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2849pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2905pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2905pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2906pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2906pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2908pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2908pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2950pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2950pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3766pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 23) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3766pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x1e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2913pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2913pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2926pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2926pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3767pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3767pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2914pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2914pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2827pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2827pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2833pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2833pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2835pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2835pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2837pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2837pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2861pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2861pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3768pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3768pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2829pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2829pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2830pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2830pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2836pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2836pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2831pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2831pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2832pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2832pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2873pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2873pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2871pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2871pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2872pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2872pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2936pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2936pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2932pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2932pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2934pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2934pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2935pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2935pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2863pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 13) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2863pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x7f000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2864pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2864pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2069_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2069_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2859pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2859pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2940_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2940_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2843pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2843pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2928pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2928pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2059_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2059_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2929pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2929pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2930pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2930pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3769pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3769pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2916pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2916pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_s8_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2947pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2947pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2036_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2036_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2948pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2948pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3770pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 25) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3770pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x60) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2942pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2942pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2875pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2875pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2876pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2876pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2878pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2878pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2877pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2877pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2860pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2860pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2941pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2941pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3771pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3771pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2923pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2923pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2927pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 13) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2927pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0x60000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3773pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3773pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2918pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2918pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2920pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2920pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2921pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2921pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2922pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2922pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2924pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2924pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2925pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2925pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2853pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2853pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2850pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2850pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2851pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2851pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2852pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2852pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2854pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2854pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2855pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2855pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2943pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2943pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3775pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3775pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3776pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3776pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3777pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3777pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2945pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2945pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2909pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2909pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2911pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2911pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2910pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2910pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2912pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2912pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2949pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2949pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3778pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3778pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2888pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2888pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2890pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2890pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2937pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2937pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2939pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2939pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3772_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3772_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2881pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2881pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2883pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2883pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2917pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2917pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2919pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2919pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2885pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2885pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2887pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2887pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2891pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2891pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2893pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2893pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2897pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2897pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 21) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3779pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3779pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2892pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2892pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2915pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2915pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3780pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3780pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2886pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2886pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2894pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2894pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2895pq_slot0_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2895pq_slot0_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 19) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2953acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2953acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_op0_s12_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s12_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3782acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3782acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2956acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2956acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_s_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2967acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2967acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2966acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2966acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3783acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3783acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2957acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2957acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2958acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2958acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2960acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2960acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3784acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3784acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2964acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2964acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3785acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3785acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2959acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2959acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2963acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2963acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2954acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2954acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3786acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3786acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2955acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2955acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3788acc2_slot2_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3788acc2_slot2_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2969acc2_slot1_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2969acc2_slot1_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_op0_s13_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s13_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3790acc2_slot1_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 8) >> 18);
+  tie_t = (tie_t << 7) | ((insn[0] << 23) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3790acc2_slot1_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc) | (tie_t << 2);
+  tie_t = (val << 11) >> 18;
+  insn[0] = (insn[0] & ~0xfffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2968acc2_slot1_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2968acc2_slot1_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3793acc2_slot1_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 11) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3793acc2_slot1_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+  tie_t = (val << 22) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 18) >> 28;
+  insn[0] = (insn[0] & ~0x1e0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2075_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2075_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2031_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 11) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2031_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x1e0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_op0_s14_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s14_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_r_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2973acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2973acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3795acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3795acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2980acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 18) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2980acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x3e00) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3796acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3796acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2976acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 18) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2976acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2989acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2989acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3798acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3798acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2990acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2990acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3799acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3799acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2977acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 18) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2977acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x3e00) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3797_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3797_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2981acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2981acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3800acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 20) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3800acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2975acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 18) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2975acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2982acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2982acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3801acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3801acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2984acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2984acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2985acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2985acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3802acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3802acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2987acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2987acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3803acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3803acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2039_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2039_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2974acc2_slot0_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 18) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2974acc2_slot0_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x3f00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3043smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 15) | ((insn[0] << 15) >> 17);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3043smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 17) >> 17;
+  insn[0] = (insn[0] & ~0x1fffc) | (tie_t << 2);
+  tie_t = (val << 16) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_op0_s15_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s15_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3805smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 13) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3805smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x60000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3061smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3061smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 23) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3806smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3806smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3063smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3063smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 24) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3807smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3807smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3049smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3049smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3050smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3050smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3052smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3052smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3056smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3056smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+  tie_t = (val << 19) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3809smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3809smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3038smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 16) >> 18);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3038smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 18) >> 18;
+  insn[0] = (insn[0] & ~0xfffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3091smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3091smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2041_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2041_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3102smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 12) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3102smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3810smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3810smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3116smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3116smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3812smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3812smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3813smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3813smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 26) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3092smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 12) >> 18);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3092smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 18) >> 18;
+  insn[0] = (insn[0] & ~0xfffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3047smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3047smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3090smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3090smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3814smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3814smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3030smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3030smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3006smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3006smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3104smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3104smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3816smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3816smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3033smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3033smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3111smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 21) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3111smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x780) | (tie_t << 7);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3016smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3016smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3017smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3017smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3019smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3019smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3018smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3018smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3020smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3020smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3021smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3021smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3022smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3022smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3105smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3105smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3008smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3008smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3009smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3009smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3011smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3011smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3015smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3015smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3010smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3010smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3012smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3012smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3013smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3013smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3014smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3014smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3070_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3070_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3032smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3032smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3084smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3084smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3817_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3817_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3098smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3098smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 22) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3062_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3062_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2998smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2998smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3048_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3048_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3000smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3000smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3031smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3031smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3001smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3001smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3818smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 18) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3818smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0x3ff0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3039smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 18) | ((insn[0] << 12) >> 14);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3039smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 14) >> 14;
+  insn[0] = (insn[0] & ~0xffffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3044smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 9) | ((insn[0] << 21) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3044smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3819smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3819smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3040smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 15) | ((insn[0] << 15) >> 17);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3040smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 17) >> 17;
+  insn[0] = (insn[0] & ~0x1fffc) | (tie_t << 2);
+  tie_t = (val << 16) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3046smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3046smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3051smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3051smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3053smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3053smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3054smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3054smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3055smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3055smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3058smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3058smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+  tie_t = (val << 19) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3059smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 14) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3059smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 21) >> 31;
+  insn[0] = (insn[0] & ~0x20000) | (tie_t << 17);
+  tie_t = (val << 20) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3821smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3821smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3065smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3065smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3066smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3066smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3067smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3067smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3080smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3080smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3069smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3069smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3071smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3071smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3072smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3072smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3074smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3074smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3073smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3073smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3075smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3075smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 19) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3093smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 12) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3093smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0xfff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3822smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3822smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3097smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 11) | ((insn[0] << 12) >> 21);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3097smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 21) >> 21;
+  insn[0] = (insn[0] & ~0xffe00) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3823smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3823smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3076smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3076smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3077smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3077smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3078smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3078smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3079smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 12) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3079smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3036smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 9) | ((insn[0] << 21) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3036smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc) | (tie_t << 2);
+  tie_t = (val << 21) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3068smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3068smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3081smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3081smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3082smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3082smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 24) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3824smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3824smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3100smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 12) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3100smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3825smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3825smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3106smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3106smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3099smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 12) >> 23);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3099smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 22) >> 23;
+  insn[0] = (insn[0] & ~0xff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3096smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 12) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3096smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0xfff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3028smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3028smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3087smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3087smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_t_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2991smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2991smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3101smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 12) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3101smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0xe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3826smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3826smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2992smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2992smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2993smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2993smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2995smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2995smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3113smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 21) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3113smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x780) | (tie_t << 7);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3827smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3827smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2999smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2999smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3007smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3007smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3023smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3023smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3115smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3115smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2994smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2994smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2996smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2996smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3024smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3024smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3025smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3025smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3027smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3027smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3085smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3085smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2997smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2997smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3088smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3088smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3828smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3828smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3026smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3026smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3003smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3003smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3002smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3002smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3004smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3004smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3005smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3005smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3034smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3034smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3107smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3107smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3109smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3109smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3114smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3114smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3808_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3808_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3108smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3108smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3035smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3035smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3110smod_slot2_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3110smod_slot2_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3118smod_slot1_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3118smod_slot1_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_op0_s16_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s16_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3829smod_slot1_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 16) >> 26);
+  tie_t = (tie_t << 7) | ((insn[0] << 23) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3829smod_slot1_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 26;
+  insn[0] = (insn[0] & ~0xfc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3117smod_slot1_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3117smod_slot1_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2080_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2080_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sae_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s17_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s17_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3120smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 13) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3120smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x7f000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3122smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3122smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3121smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3121smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3131smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3131smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3126smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3126smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3148smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 13) >> 25);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3148smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 21) >> 25;
+  insn[0] = (insn[0] & ~0x7f000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm6_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 20) >> 26);
+  return tie_t;
+}
+
+static void
+Field_imm6_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3164smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 11) | ((insn[0] << 13) >> 21);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3164smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 20) >> 21;
+  insn[0] = (insn[0] & ~0x7ff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3832smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3832smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3160smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 13) | ((insn[0] << 13) >> 19);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3160smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 19) >> 19;
+  insn[0] = (insn[0] & ~0x7ffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3161smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 11) | ((insn[0] << 13) >> 21);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3161smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 20) >> 21;
+  insn[0] = (insn[0] & ~0x7ff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3159smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 13) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3159smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x7ff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3165smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3165smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3135smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3135smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3133smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3133smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3119smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 13) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3119smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3155smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3155smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3833smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3833smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3149smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3149smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3834_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3834_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3137smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3137smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3138smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3138smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3184smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3184smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3836smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3836smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3182smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3182smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sas_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sas_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3153smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3153smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3186smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3186smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3837smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 23) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3837smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3168smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3168smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3171smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3171smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3175smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3175smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3140smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3140smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3170smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3170smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3152smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3152smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3144smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3144smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3172smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3172smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3173smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3173smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3174smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3174smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3188smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 13) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3188smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3838smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3838smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3180smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3180smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3166smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3166smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 20) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3181smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3181smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 20) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_s8_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3136smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3136smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3123smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3123smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3134smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3134smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3125smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3125smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3127smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3127smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3128smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3128smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3130smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3130smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3129smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3129smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3132smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3132smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3139smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3139smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3141smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3141smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3142smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3142smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3143smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3143smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3145smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3145smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3146smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 13) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3146smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x7f800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3150_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3150_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3156smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3156smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3157smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3157smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3158smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3158smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3176smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3176smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3177smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3177smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3179smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3179smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3178smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3178smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 19) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3841smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3841smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3842smod_slot0_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3842smod_slot0_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3208llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 14) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3208llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 18) >> 27;
+  insn[0] = (insn[0] & ~0x3e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_op0_s18_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s18_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3843llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3843llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3193llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3193llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3194llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3194llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3196llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3196llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3200llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3200llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3213llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 14) >> 31);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3213llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 24) >> 31;
+  insn[0] = (insn[0] & ~0x20000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3845llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3845llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3195llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3195llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3206_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 20) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3206_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3225_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3225_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3205_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 14) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3205_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3847llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3847llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3212_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3212_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3848llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3848llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3216llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3216llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 26) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3849llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3849llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3215llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3215llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3850llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3850llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3234llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3234llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3232llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3232llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3237llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 14) >> 25);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3237llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 21) >> 25;
+  insn[0] = (insn[0] & ~0x3f800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2074_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2074_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3192llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3192llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3230_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3230_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3191llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3191llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3243llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 14) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3243llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_t_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3218llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3218llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3851llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3851llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3244llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3244llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3853llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3853llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3242llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3242llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3855llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3855llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3231llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 23) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3231llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x100) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3856llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 18) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3856llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e00) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3203llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 16) | ((insn[0] << 14) >> 16);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3203llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 16) >> 16;
+  insn[0] = (insn[0] & ~0x3fffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3204llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 14) >> 27);
+  tie_t = (tie_t << 10) | ((insn[0] << 20) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3204llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc) | (tie_t << 2);
+  tie_t = (val << 17) >> 27;
+  insn[0] = (insn[0] & ~0x3e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3844_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3844_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3207llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 14) >> 27);
+  tie_t = (tie_t << 10) | ((insn[0] << 20) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3207llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc) | (tie_t << 2);
+  tie_t = (val << 17) >> 27;
+  insn[0] = (insn[0] & ~0x3e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3197llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3197llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3198llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3198llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3199llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3199llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3201llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3201llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3202llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3202llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3210llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3210llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 22) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3857llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3857llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3217_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3217_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3859llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 14) >> 24);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3859llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 23) >> 24;
+  insn[0] = (insn[0] & ~0x3fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3221llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3221llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3222llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3222llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3860llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3860llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3224llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3224llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3861llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3861llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3220llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3220llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3246_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3246_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3214_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 14) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3214_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3863llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 15) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3863llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x1f800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3226llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3226llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3864llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3864llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3235llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 14) >> 25);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3235llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 21) >> 25;
+  insn[0] = (insn[0] & ~0x3f800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3238llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 14) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3238llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x3f000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3862_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3862_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3241llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3241llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3865llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3865llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3236_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 14) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3236_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3240llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 14) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3240llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x3e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3228llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 23) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3228llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x100) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3866llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3866llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3247llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3247llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3867llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3867llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_s_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3233_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3233_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3245llr_slot2_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3245llr_slot2_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3868_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3868_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3250llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3250llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_op0_s19_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s19_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3869llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3869llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 22) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+  tie_t = (val << 18) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3254llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3254llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3872llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3872llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+  tie_t = (val << 21) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3252llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3252llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3875llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3875llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3253llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3253llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3876llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 18) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3876llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e00) | (tie_t << 9);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3251llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3251llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3878llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3878llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3248llr_slot1_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3248llr_slot1_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3870_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3870_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2071_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2071_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s20_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s20_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3260llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3260llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3258llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3258llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3266llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3266llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3286llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3286llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 25) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3879llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3879llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3303llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3303llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3269llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3269llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3293llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3293llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3297llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3297llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3881llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3881llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3272llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3272llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3274llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3274llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3302llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3302llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3883llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3883llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3275llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3275llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3289llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3289llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3292llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3292llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3277llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
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+}
+
+static void
+Field_dsp340050b49a6c_fld3277llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
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+  tie_t = (val << 23) >> 31;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3276llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3276llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3270llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3270llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3312llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3312llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3885llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3885llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3304llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3304llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+  tie_t = (val << 24) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3887llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3887llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3283llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3283llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3310llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3310llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3888llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3888llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3288llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3288llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3284llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3284llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 24) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2041_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2041_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3305llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3305llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+  tie_t = (val << 24) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3306llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3306llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+  tie_t = (val << 25) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3890llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3890llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3259llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 17) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3259llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x7000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3291llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3291llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3261llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3261llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3263llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3263llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3267llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3267llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3264llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3264llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3265llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3265llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3268llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3268llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3308llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3308llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3892llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3892llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3294llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3294llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3295llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3295llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3296llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3296llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3298llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3298llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3299llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3299llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3300llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 17) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3300llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x7800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3893llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3893llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3278llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3278llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3279llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3279llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3280llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3280llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3282llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3282llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3281llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3281llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+  tie_t = (val << 26) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3311llr_slot0_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3311llr_slot0_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_r_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3364_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3364_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s21_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s21_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3464dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3464dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3894dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3894dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3465dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3465dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3895dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3895dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3459dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3459dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3896dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 11) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3896dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3468dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 9) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3468dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3897dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3897dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3467dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 9) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3467dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x400000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3899dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3899dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3414dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3414dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3313dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3313dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3316dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3316dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3334dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3334dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_t_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3314_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3314_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3418dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3418dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3425dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3425dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3408dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 9) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3408dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x400000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3901dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3901dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3315dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3315dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3421dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3421dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3443dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3443dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3420dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3420dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3423dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3423dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3422dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3422dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3424dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3424dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3416dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3416dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3461dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3461dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3415dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3415dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3426dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3426dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3417dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3417dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3419dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3419dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3318_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3318_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3904dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3904dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3482dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3482dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3903dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 11) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3903dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x180000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2044_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 8) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2044_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0xf80000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3407_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3407_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3905dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 9) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3905dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3479dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3479dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 23) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3906dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3906dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3475dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3475dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 20) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3898dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3898dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3353dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 8) >> 25);
+  tie_t = (tie_t << 13) | ((insn[0] << 17) >> 19);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3353dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 19) >> 19;
+  insn[0] = (insn[0] & ~0x7ffc) | (tie_t << 2);
+  tie_t = (val << 12) >> 25;
+  insn[0] = (insn[0] & ~0xfe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3907dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3907dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3388dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 13) | ((insn[0] << 8) >> 19);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3388dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 15) >> 19;
+  insn[0] = (insn[0] & ~0xfff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3913dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3913dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3387dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 18) | ((insn[0] << 8) >> 14);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3387dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 14) >> 14;
+  insn[0] = (insn[0] & ~0xffffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3396dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 8) >> 25);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3396dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 21) >> 25;
+  insn[0] = (insn[0] & ~0xfe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3909dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 15) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3909dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3404dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 12) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3404dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x80000) | (tie_t << 19);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3910dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 10) >> 30);
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3910dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+  tie_t = (val << 21) >> 30;
+  insn[0] = (insn[0] & ~0x300000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3385dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3385dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3478dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3478dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 21) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3908dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3908dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3477dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3477dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 20) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3469dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 8) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3469dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0xff8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3484dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 13) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3484dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40000) | (tie_t << 18);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3916dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 11) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3916dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x180000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3451dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3451dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 21) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3914dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3914dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3450dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3450dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 19) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3453dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 8) >> 18);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3453dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 18) >> 18;
+  insn[0] = (insn[0] & ~0xfffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3365dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3365dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3366dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3366dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3368dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3368dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3372dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3372dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3367dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3367dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3369dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3369dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3345dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 12) | ((insn[0] << 18) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3345dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc) | (tie_t << 2);
+  tie_t = (val << 14) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3457dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 8) >> 25);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3457dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 21) >> 25;
+  insn[0] = (insn[0] & ~0xfe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3917dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3917dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3358dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 6) | ((insn[0] << 22) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3358dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x3f0) | (tie_t << 4);
+  tie_t = (val << 25) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 19) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3918dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3918dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 27) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3347dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 12) | ((insn[0] << 18) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3347dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc) | (tie_t << 2);
+  tie_t = (val << 14) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3348dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 12) | ((insn[0] << 18) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3348dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc) | (tie_t << 2);
+  tie_t = (val << 14) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3354dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 10) | ((insn[0] << 18) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3354dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0x3ff0) | (tie_t << 4);
+  tie_t = (val << 16) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_s4_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3397dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3397dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3919dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3919dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3462dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3462dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3394dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 8) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3394dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0xff0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3920dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 16) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3920dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3363dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3363dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3481dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3481dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3339dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3339dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3384dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3384dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3360dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3360dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3437dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3437dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3439dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3439dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3438dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3438dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3440dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3440dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3441dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3441dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3442dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3442dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3444dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3444dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3460dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3460dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3921dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3921dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3429dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3429dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3431dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3431dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3435dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3435dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3430dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3430dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3432dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
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+}
+
+static void
+Field_dsp340050b49a6c_fld3432dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3433dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3433dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3434dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3434dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3436dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3436dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3361dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3361dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3403dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 12) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3403dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc0000) | (tie_t << 18);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3922dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 10) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3922dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x300000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3386dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3386dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 18) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3923dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3923dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+  tie_t = (val << 18) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3324dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3324dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3325dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3325dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3340dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3340dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3327dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3327dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3342dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  tie_t = (tie_t << 6) | ((insn[0] << 22) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3342dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x3f0) | (tie_t << 4);
+  tie_t = (val << 24) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3356dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  tie_t = (tie_t << 6) | ((insn[0] << 22) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3356dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x3f0) | (tie_t << 4);
+  tie_t = (val << 23) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+  tie_t = (val << 17) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3924dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3924dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3349dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 22) | ((insn[0] << 8) >> 10);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3349dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 10) >> 10;
+  insn[0] = (insn[0] & ~0xfffffc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3350dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 8) >> 25);
+  tie_t = (tie_t << 13) | ((insn[0] << 17) >> 19);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3350dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 19) >> 19;
+  insn[0] = (insn[0] & ~0x7ffc) | (tie_t << 2);
+  tie_t = (val << 12) >> 25;
+  insn[0] = (insn[0] & ~0xfe0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3341dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3341dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3370dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3370dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3371dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3371dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3373dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3373dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3374dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3374dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
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+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3376dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
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+}
+
+static void
+Field_dsp340050b49a6c_fld3376dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3375dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3375dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3377dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3377dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3378dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3378dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3379dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 8) >> 22);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3379dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 14) >> 22;
+  insn[0] = (insn[0] & ~0xffc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3381dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3381dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3448dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3448dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 19) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3925dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3925dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3454dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 8) >> 24);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3454dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 19) >> 24;
+  insn[0] = (insn[0] & ~0xff0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3466_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3466_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3412dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3412dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3927dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3927dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3382dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 7) | ((insn[0] << 22) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3382dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8) | (tie_t << 3);
+  tie_t = (val << 19) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3928dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3928dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3410_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3410_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3929dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3929dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+  tie_t = (val << 17) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3390dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 8) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3390dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0xfff000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3413dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3413dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3930dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 13) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3930dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x7fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3456dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 8) >> 24);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3456dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 19) >> 24;
+  insn[0] = (insn[0] & ~0xff0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3392dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 11) | ((insn[0] << 8) >> 21);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3392dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 17) >> 21;
+  insn[0] = (insn[0] & ~0xffe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3900_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3900_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3337dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3337dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3446dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3446dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 20) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3317dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3317dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3458dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3458dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3319dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3319dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3320dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3320dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3322dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3322dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3399dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3399dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3931dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 11) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3931dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x1c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3326dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3326dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3427dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3427dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3470dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3470dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3411dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 9) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3411dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x400000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3933dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3933dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+  tie_t = (val << 23) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3321dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3321dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3428dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3428dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_s_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_r_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3471dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3471dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3472dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3472dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3474dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3474dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3323dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3323dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3480dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3480dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3473dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3473dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3328dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3328dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3330dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3330dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3329dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3329dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3331dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3331dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3362dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3362dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3332dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3332dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3445dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3445dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3333dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3333dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3335dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3335dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3401dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 8) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 12) >> 30);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3401dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 27) >> 30;
+  insn[0] = (insn[0] & ~0xc0000) | (tie_t << 18);
+  tie_t = (val << 25) >> 30;
+  insn[0] = (insn[0] & ~0xc00000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3934dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 10) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3934dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x300000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3406dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 8) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3406dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x800000) | (tie_t << 23);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3935dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 9) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3935dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x7c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3380dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3380dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 18) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3336dual_slot2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 8) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3336dual_slot2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0xfc0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_op0_s22_Slot_dual_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 31) >> 31);
+  return tie_t;
+}
+
+static void
+Field_op0_s22_Slot_dual_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x1) | (tie_t << 0);
+}
+
+static unsigned
+Field_imm8_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  return tie_t;
+}
+
+static void
+Field_imm8_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_op0_s23_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 9) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 30) >> 30);
+  return tie_t;
+}
+
+static void
+Field_op0_s23_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3) | (tie_t << 0);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x400000) | (tie_t << 22);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3532dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3532dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 24) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3602_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3602_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3533dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 10) >> 27);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3533dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 25) >> 27;
+  insn[0] = (insn[0] & ~0x3e0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3936dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3936dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2057_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2057_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3625dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3625dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_r_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_t_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3487dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 18) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3487dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x3800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3584_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3584_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3937dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3937dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3489dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3489dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3488dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 10) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3488dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3620dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3620dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3588dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 10) >> 27);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3588dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x3e0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3938dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3938dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3544dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3544dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3519dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3519dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 18) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3939dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3939dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3523dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 11) | ((insn[0] << 10) >> 21);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3523dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 21) >> 21;
+  insn[0] = (insn[0] & ~0x3ff800) | (tie_t << 11);
+}
+
+static unsigned
+Field_bbi_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 21) >> 27);
+  return tie_t;
+}
+
+static void
+Field_bbi_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3520dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3520dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3507dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 16) | ((insn[0] << 10) >> 16);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3507dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 16) >> 16;
+  insn[0] = (insn[0] & ~0x3fffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3506dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 15) | ((insn[0] << 10) >> 17);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3506dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 17) >> 17;
+  insn[0] = (insn[0] & ~0x3fff80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3614dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3614dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2079_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2079_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3550dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3550dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3549dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3549dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3531_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 10) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3531_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x3f8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3500dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3500dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 18) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3502dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3502dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 17) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3606dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3606dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3607dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3607dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3608dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3608dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sae_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3619_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 10) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3619_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x200000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3940dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 11) >> 25);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3940dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3613dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 10) >> 27);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3613dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 23) >> 27;
+  insn[0] = (insn[0] & ~0x3e0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3509dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3509dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3510dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3510dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3562dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3562dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3560dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3560dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3499dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3499dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3563dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3563dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3565dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3565dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3564dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3564dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3566dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3566dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3512dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3512dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3567dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3567dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3504dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3504dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 17) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3516dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3516dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3568dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3568dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3570dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3570dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3580dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3580dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3559dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3559dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+  tie_t = (val << 19) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3573dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3573dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3599dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3599dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3941dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3941dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3575dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3575dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3535dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3535dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2066_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2066_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3494dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3494dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3497dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3497dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3496dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3496dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3498dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 5) | ((insn[0] << 17) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3498dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c00) | (tie_t << 10);
+  tie_t = (val << 23) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3490dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3490dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3491dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3491dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3493dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3493dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3527dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3527dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 26) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3492dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3492dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3589dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3589dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_s8_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3541dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3541dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2037_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2037_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3542dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3542dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3543dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3543dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3552_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3552_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 23) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3626dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3626dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3621dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 10) >> 25);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3621dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 24) >> 25;
+  insn[0] = (insn[0] & ~0x3f8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3623dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 10) >> 25);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3623dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 24) >> 25;
+  insn[0] = (insn[0] & ~0x3f8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3622dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 10) >> 25);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3622dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 24) >> 25;
+  insn[0] = (insn[0] & ~0x3f8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3624dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 10) >> 25);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3624dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 24) >> 25;
+  insn[0] = (insn[0] & ~0x3f8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3529dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 10) | ((insn[0] << 10) >> 22);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3529dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 22) >> 22;
+  insn[0] = (insn[0] & ~0x3ff000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3530dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 10) >> 25);
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3530dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+  tie_t = (val << 23) >> 25;
+  insn[0] = (insn[0] & ~0x3f8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2072_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2072_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3524dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 17) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3524dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x7800) | (tie_t << 11);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3943dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 6) | ((insn[0] << 21) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3943dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x7e0) | (tie_t << 5);
+  tie_t = (val << 25) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3508dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3508dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3601dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3601dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3945dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3945dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3603dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3603dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3604dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3604dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3946dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 14) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3946dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x30000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3545dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3545dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3616dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 10) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3616dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x300000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3947dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 12) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3947dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 25) >> 26;
+  insn[0] = (insn[0] & ~0xfc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3618dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 10) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3618dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3949dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 11) >> 25);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3949dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 24) >> 25;
+  insn[0] = (insn[0] & ~0x1fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3609dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3609dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+  tie_t = (val << 19) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3546dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3546dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3548dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3548dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3554dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3554dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3547dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3547dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3522dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3522dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 19) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3950dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3950dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3611dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3611dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+  tie_t = (val << 19) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3592dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3592dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3594dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3594dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3598dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3598dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3951dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3951dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3600dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 10) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3600dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 24) >> 27;
+  insn[0] = (insn[0] & ~0x3e0000) | (tie_t << 17);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3952dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 15) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3952dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x18000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3593dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3593dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3595dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3595dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
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+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3596dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3596dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3597dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3597dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3511dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3511dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3513dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3513dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3514dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3514dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3515dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3515dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3517dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3517dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3518dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3518dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 17) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3536dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3536dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2060_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2060_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3539dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3539dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3954dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 14) >> 27);
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3954dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+  tie_t = (val << 26) >> 27;
+  insn[0] = (insn[0] & ~0x3e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3537dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3537dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3538dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 10) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3538dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0000) | (tie_t << 18);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3957dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3957dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3587dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3587dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 21) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3610_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 22) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3610_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x3e0) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3571dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3571dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3572dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3572dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3574dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3574dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3569dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3569dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+  tie_t = (val << 19) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3505dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 14) | ((insn[0] << 10) >> 18);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3505dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 18) >> 18;
+  insn[0] = (insn[0] & ~0x3fff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3612dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 10) >> 26);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3612dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 22) >> 26;
+  insn[0] = (insn[0] & ~0x3f0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3576dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3576dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 15) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3577dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3577dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 15) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3615dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 10) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3615dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x380000) | (tie_t << 19);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3958dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 13) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3958dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x7e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3551dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3551dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3553dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3553dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3590dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3590dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3591dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3591dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+  tie_t = (val << 20) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3555dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3555dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3557dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3557dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3578dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3578dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 15) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3579dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3579dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 15) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3581dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 8) | ((insn[0] << 22) >> 24);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3581dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc) | (tie_t << 2);
+  tie_t = (val << 16) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3582dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3582dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 25) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 17) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3959dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3959dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3556dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3556dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3558dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 9) | ((insn[0] << 10) >> 23);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3558dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 19) >> 23;
+  insn[0] = (insn[0] & ~0x3fe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3583dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3583dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+  tie_t = (val << 18) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3960dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3960dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+  tie_t = (val << 29) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3585dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  tie_t = (tie_t << 1) | ((insn[0] << 22) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3585dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x200) | (tie_t << 9);
+  tie_t = (val << 19) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld3961dual_slot0_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 18) >> 31);
+  tie_t = (tie_t << 2) | ((insn[0] << 23) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld3961dual_slot0_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0x180) | (tie_t << 7);
+  tie_t = (val << 28) >> 31;
+  insn[0] = (insn[0] & ~0x2000) | (tie_t << 13);
+}
+
+static unsigned
+Field_t_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_t_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_t_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_bbi_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_bbi_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_bbi_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 21) >> 27);
+  return tie_t;
+}
+
+static void
+Field_bbi_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm12_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 8) >> 20);
+  return tie_t;
+}
+
+static void
+Field_imm12_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0xfff000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm12_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 14) >> 20);
+  return tie_t;
+}
+
+static void
+Field_imm12_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm12_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 14) >> 20);
+  return tie_t;
+}
+
+static void
+Field_imm12_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 20) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm8_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 8) >> 24);
+  return tie_t;
+}
+
+static void
+Field_imm8_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_imm8_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 10) >> 24);
+  return tie_t;
+}
+
+static void
+Field_imm8_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_s_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_s_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_s_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_s_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_imm12b_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  tie_t = (tie_t << 8) | ((insn[0] << 8) >> 24);
+  return tie_t;
+}
+
+static void
+Field_imm12b_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0000) | (tie_t << 16);
+  tie_t = (val << 20) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_imm12b_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 14) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm12b_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_imm12b_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 14) >> 24);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm12b_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 20) >> 24;
+  insn[0] = (insn[0] & ~0x3fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_imm16_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 16) | ((insn[0] << 8) >> 16);
+  return tie_t;
+}
+
+static void
+Field_imm16_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 16) >> 16;
+  insn[0] = (insn[0] & ~0xffff00) | (tie_t << 8);
+}
+
+static unsigned
+Field_imm16_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 12) | ((insn[0] << 10) >> 20);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm16_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 16) >> 20;
+  insn[0] = (insn[0] & ~0x3ffc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_offset_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 18) | ((insn[0] << 8) >> 14);
+  return tie_t;
+}
+
+static void
+Field_offset_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 14) >> 14;
+  insn[0] = (insn[0] & ~0xffffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_op2_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_op2_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_op2_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_op2_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_op2_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_op2_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_op2_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_op2_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_r_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_r_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_r_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_r_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_r_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_r_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_r_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_r_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_r_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_r_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_r_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_sae_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 15) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x10000) | (tie_t << 16);
+}
+
+static unsigned
+Field_sae_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sae_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sal_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_sal_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sal_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sal_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sal_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sal_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sal_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sal_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sal_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sargt_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_sargt_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sargt_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sargt_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sargt_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sargt_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sargt_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sargt_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sargt_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_sas4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_sas4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+}
+
+static unsigned
+Field_sas_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sas_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+}
+
+static unsigned
+Field_sas_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sas_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+}
+
+static unsigned
+Field_sas_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sas_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+}
+
+static unsigned
+Field_sas_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sas_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+}
+
+static unsigned
+Field_sas_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_sas_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+}
+
+static unsigned
+Field_sr_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sr_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_sr_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  return tie_t;
+}
+
+static void
+Field_sr_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_st_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_st_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_st_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 20) >> 28);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_st_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 24) >> 28;
+  insn[0] = (insn[0] & ~0xf00) | (tie_t << 8);
+}
+
+static unsigned
+Field_imm4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm4_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm4_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm4_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm4_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_mn_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_mn_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+  tie_t = (val << 28) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_i_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_i_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_imm6lo_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm6lo_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm6lo_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm6lo_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm6hi_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_imm6hi_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+}
+
+static unsigned
+Field_imm6hi_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  return tie_t;
+}
+
+static void
+Field_imm6hi_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+}
+
+static unsigned
+Field_imm7lo_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm7lo_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm7lo_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm7lo_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_imm7hi_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  return tie_t;
+}
+
+static void
+Field_imm7hi_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+}
+
+static unsigned
+Field_imm7hi_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  return tie_t;
+}
+
+static void
+Field_imm7hi_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+}
+
+static unsigned
+Field_z_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 25) >> 31);
+  return tie_t;
+}
+
+static void
+Field_z_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x40) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm6_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm6_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+}
+
+static unsigned
+Field_imm6_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 26) >> 30);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm6_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 26) >> 30;
+  insn[0] = (insn[0] & ~0x30) | (tie_t << 4);
+}
+
+static unsigned
+Field_imm6_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 20) >> 26);
+  return tie_t;
+}
+
+static void
+Field_imm6_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm6_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 20) >> 26);
+  return tie_t;
+}
+
+static void
+Field_imm6_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm6_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 20) >> 26);
+  return tie_t;
+}
+
+static void
+Field_imm6_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm6_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 20) >> 26);
+  return tie_t;
+}
+
+static void
+Field_imm6_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+}
+
+static unsigned
+Field_imm7_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+  tie_t = (val << 25) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+}
+
+static unsigned
+Field_imm7_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_imm7_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 7) | ((insn[0] << 19) >> 25);
+  return tie_t;
+}
+
+static void
+Field_imm7_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 25) >> 25;
+  insn[0] = (insn[0] & ~0x1fc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t2_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_t2_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_t2_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_t2_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_t2_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 24) >> 29);
+  return tie_t;
+}
+
+static void
+Field_t2_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe0) | (tie_t << 5);
+}
+
+static unsigned
+Field_s2_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_s2_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+}
+
+static unsigned
+Field_s2_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_s2_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+}
+
+static unsigned
+Field_s2_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 20) >> 29);
+  return tie_t;
+}
+
+static void
+Field_s2_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00) | (tie_t << 9);
+}
+
+static unsigned
+Field_r2_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  return tie_t;
+}
+
+static void
+Field_r2_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_r2_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  return tie_t;
+}
+
+static void
+Field_r2_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static unsigned
+Field_t4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_t4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t4_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_t4_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_t4_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_t4_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_s4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_s4_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_s4_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_s4_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_s4_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_s4_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_s4_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_s4_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_r4_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_r4_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_r4_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_r4_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_r4_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  return tie_t;
+}
+
+static void
+Field_r4_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_t8_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_t8_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_t8_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_t8_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_t8_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_t8_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_s8_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_s8_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_s8_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_s8_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_s8_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_r8_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_r8_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_r8_Slot_inst16a_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_r8_Slot_inst16a_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_r8_Slot_inst16b_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_r8_Slot_inst16b_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+}
+
+static unsigned
+Field_xt_wbr15_imm_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 15) | ((insn[0] << 8) >> 17);
+  return tie_t;
+}
+
+static void
+Field_xt_wbr15_imm_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 17) >> 17;
+  insn[0] = (insn[0] & ~0xfffe00) | (tie_t << 9);
+}
+
+static unsigned
+Field_xt_wbr18_imm_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 18) | ((insn[0] << 8) >> 14);
+  return tie_t;
+}
+
+static void
+Field_xt_wbr18_imm_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 14) >> 14;
+  insn[0] = (insn[0] & ~0xffffc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_fimm8_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 8) >> 24);
+  return tie_t;
+}
+
+static void
+Field_fimm8_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0xff0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_fimm8_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 8) | ((insn[0] << 14) >> 24);
+  return tie_t;
+}
+
+static void
+Field_fimm8_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 24) >> 24;
+  insn[0] = (insn[0] & ~0x3fc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2029_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2029_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2030_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2030_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 22) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x300) | (tie_t << 8);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2032_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2032_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2035_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2035_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2035_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2035_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2035_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2035_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2035_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 27) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2035_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x18) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2036_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2036_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2036_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2036_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2036_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2036_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2037_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2037_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2037_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2037_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2037_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2037_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2037_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2037_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2038_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2038_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2038_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2038_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2038_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2038_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2038_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2038_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2038_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2038_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2038_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2038_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2038_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 14) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2038_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x38000) | (tie_t << 15);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2039_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2039_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2039_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2039_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2039_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2039_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2039_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2039_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2039_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2039_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2040_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2040_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2040_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2040_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2040_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2040_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2040_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2040_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2040_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 19) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2040_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x1000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2041_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 27) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2041_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x10) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2041_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2041_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2041_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2041_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2041_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2041_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2041_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 24) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2041_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x80) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2042_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 1) | ((insn[0] << 16) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2042_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8000) | (tie_t << 15);
+  tie_t = (val << 30) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2042_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2042_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2042_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2042_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2042_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 17) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2042_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x6000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2043_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 11) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2043_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x100000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2043_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2043_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2043_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2043_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2043_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
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+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2043_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2043_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2043_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2043_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2043_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2043_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2043_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2044_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 23) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2044_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x1f0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2044_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2044_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2044_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 25) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2044_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2044_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2044_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2044_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 21) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2044_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x400) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2045_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2045_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
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+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2046_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2046_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2047_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2047_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_dot_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_dot_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 8) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe00000) | (tie_t << 21);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2048_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2048_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 18) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x3000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 19) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0x1800) | (tie_t << 11);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 28) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 24) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2049_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 20) >> 30);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2049_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 30) >> 30;
+  insn[0] = (insn[0] & ~0xc00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_dot_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 15) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_dot_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x1e000) | (tie_t << 13);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2050_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 25) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2050_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x78) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 22) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0x3f0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2051_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 6) | ((insn[0] << 24) >> 26);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2051_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 26) >> 26;
+  insn[0] = (insn[0] & ~0xfc) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 16) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf000) | (tie_t << 12);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  tie_t = (tie_t << 1) | ((insn[0] << 29) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x4) | (tie_t << 2);
+  tie_t = (val << 28) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2052_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2052_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 8) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 20) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x800) | (tie_t << 11);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0xf00000) | (tie_t << 20);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 17) >> 31);
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+  tie_t = (val << 27) >> 31;
+  insn[0] = (insn[0] & ~0x4000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 5) | ((insn[0] << 13) >> 27);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 27) >> 27;
+  insn[0] = (insn[0] & ~0x7c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2053_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 14) >> 28);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2053_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 27) >> 28;
+  insn[0] = (insn[0] & ~0x3c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2054_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2054_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2054_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2054_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2054_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2054_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2054_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2054_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2054_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 2) | ((insn[0] << 16) >> 30);
+  tie_t = (tie_t << 1) | ((insn[0] << 26) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2054_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x20) | (tie_t << 5);
+  tie_t = (val << 29) >> 30;
+  insn[0] = (insn[0] & ~0xc000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2054_Slot_llr_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2054_Slot_llr_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2054_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2054_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2055_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 24) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2055_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2055_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2055_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2055_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2055_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2055_Slot_acc2_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2055_Slot_acc2_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2055_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2055_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2055_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 12) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2055_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0xf0000) | (tie_t << 16);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2055_Slot_dual_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2055_Slot_dual_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_inst_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 25) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_inst_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x70) | (tie_t << 4);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_gp_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_gp_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 26) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x38) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_dot_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_dot_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_pq_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_pq_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_smod_slot0_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_smod_slot0_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 22) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x380) | (tie_t << 7);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2056_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2056_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2025_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2025_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2025_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2025_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2025_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2025_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2025_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2025_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2025_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 1) | ((insn[0] << 28) >> 31);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2025_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 31) >> 31;
+  insn[0] = (insn[0] & ~0x8) | (tie_t << 3);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2027_Slot_gp_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2027_Slot_gp_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2027_Slot_dot_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2027_Slot_dot_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2027_Slot_pq_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2027_Slot_pq_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2027_Slot_acc2_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2027_Slot_acc2_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2027_Slot_smod_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2027_Slot_smod_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2027_Slot_llr_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2027_Slot_llr_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2027_Slot_dual_slot2_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2027_Slot_dual_slot2_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2026_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2026_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2026_Slot_dot_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2026_Slot_dot_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2026_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2026_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2026_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 18) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2026_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2026_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2026_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2026_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2026_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2031_Slot_gp_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2031_Slot_gp_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2031_Slot_dot_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2031_Slot_dot_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2031_Slot_pq_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2031_Slot_pq_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2031_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 26) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2031_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2031_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 4) | ((insn[0] << 22) >> 28);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2031_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 28) >> 28;
+  insn[0] = (insn[0] & ~0x3c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2028_Slot_acc2_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 15) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2028_Slot_acc2_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c000) | (tie_t << 14);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2028_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 27) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2028_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c) | (tie_t << 2);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2033_Slot_smod_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 23) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2033_Slot_smod_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c0) | (tie_t << 6);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2033_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 19) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2033_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0x1c00) | (tie_t << 10);
+}
+
+static unsigned
+Field_dsp340050b49a6c_fld2034_Slot_llr_slot1_get (const xtensa_insnbuf insn)
+{
+  unsigned tie_t = 0;
+  tie_t = (tie_t << 3) | ((insn[0] << 16) >> 29);
+  return tie_t;
+}
+
+static void
+Field_dsp340050b49a6c_fld2034_Slot_llr_slot1_set (xtensa_insnbuf insn, uint32 val)
+{
+  uint32 tie_t;
+  tie_t = (val << 29) >> 29;
+  insn[0] = (insn[0] & ~0xe000) | (tie_t << 13);
+}
+
+static void
+Implicit_Field_set (xtensa_insnbuf insn ATTRIBUTE_UNUSED,
+		    uint32 val ATTRIBUTE_UNUSED)
+{
+  /* Do nothing.  */
+}
+
+static unsigned
+Implicit_Field_ar0_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static unsigned
+Implicit_Field_ar4_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 4;
+}
+
+static unsigned
+Implicit_Field_ar8_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 8;
+}
+
+static unsigned
+Implicit_Field_ar12_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 12;
+}
+
+static unsigned
+Implicit_Field_bt16_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static unsigned
+Implicit_Field_bs16_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static unsigned
+Implicit_Field_br16_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static unsigned
+Implicit_Field_brall_get (const xtensa_insnbuf insn ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+enum xtensa_field_id {
+  FIELD_t,
+  FIELD_bbi4,
+  FIELD_bbi,
+  FIELD_imm12,
+  FIELD_imm8,
+  FIELD_s,
+  FIELD_imm12b,
+  FIELD_imm16,
+  FIELD_m,
+  FIELD_n,
+  FIELD_offset,
+  FIELD_op0,
+  FIELD_op1,
+  FIELD_op2,
+  FIELD_r,
+  FIELD_sa4,
+  FIELD_sae4,
+  FIELD_sae,
+  FIELD_sal,
+  FIELD_sargt,
+  FIELD_sas4,
+  FIELD_sas,
+  FIELD_sr,
+  FIELD_st,
+  FIELD_thi3,
+  FIELD_imm4,
+  FIELD_mn,
+  FIELD_i,
+  FIELD_imm6lo,
+  FIELD_imm6hi,
+  FIELD_imm7lo,
+  FIELD_imm7hi,
+  FIELD_z,
+  FIELD_imm6,
+  FIELD_imm7,
+  FIELD_t2,
+  FIELD_s2,
+  FIELD_r2,
+  FIELD_t4,
+  FIELD_s4,
+  FIELD_r4,
+  FIELD_t8,
+  FIELD_s8,
+  FIELD_r8,
+  FIELD_xt_wbr15_imm,
+  FIELD_xt_wbr18_imm,
+  FIELD_fimm8,
+  FIELD_dsp340050b49a6c_fld2019,
+  FIELD_dsp340050b49a6c_fld2021,
+  FIELD_dsp340050b49a6c_fld2029,
+  FIELD_dsp340050b49a6c_fld2030,
+  FIELD_dsp340050b49a6c_fld2032,
+  FIELD_dsp340050b49a6c_fld2035,
+  FIELD_dsp340050b49a6c_fld2036,
+  FIELD_dsp340050b49a6c_fld2037,
+  FIELD_dsp340050b49a6c_fld2038,
+  FIELD_dsp340050b49a6c_fld2039,
+  FIELD_dsp340050b49a6c_fld2040,
+  FIELD_dsp340050b49a6c_fld2041,
+  FIELD_dsp340050b49a6c_fld2042,
+  FIELD_dsp340050b49a6c_fld2043,
+  FIELD_dsp340050b49a6c_fld2044,
+  FIELD_dsp340050b49a6c_fld2045,
+  FIELD_dsp340050b49a6c_fld2046,
+  FIELD_dsp340050b49a6c_fld2047,
+  FIELD_dsp340050b49a6c_fld2048,
+  FIELD_dsp340050b49a6c_fld2049,
+  FIELD_dsp340050b49a6c_fld2050,
+  FIELD_dsp340050b49a6c_fld2051,
+  FIELD_dsp340050b49a6c_fld2052,
+  FIELD_dsp340050b49a6c_fld2053,
+  FIELD_dsp340050b49a6c_fld2054,
+  FIELD_dsp340050b49a6c_fld2055,
+  FIELD_dsp340050b49a6c_fld2056,
+  FIELD_dsp340050b49a6c_fld2082Inst,
+  FIELD_dsp340050b49a6c_fld2083Inst,
+  FIELD_dsp340050b49a6c_fld2084Inst,
+  FIELD_dsp340050b49a6c_fld2085Inst,
+  FIELD_dsp340050b49a6c_fld2086Inst,
+  FIELD_dsp340050b49a6c_fld2088Inst,
+  FIELD_dsp340050b49a6c_fld2089Inst,
+  FIELD_dsp340050b49a6c_fld2090Inst,
+  FIELD_dsp340050b49a6c_fld2091Inst,
+  FIELD_dsp340050b49a6c_fld2092Inst,
+  FIELD_dsp340050b49a6c_fld2094Inst,
+  FIELD_dsp340050b49a6c_fld2095Inst,
+  FIELD_dsp340050b49a6c_fld2096Inst,
+  FIELD_dsp340050b49a6c_fld2098Inst,
+  FIELD_dsp340050b49a6c_fld2099Inst,
+  FIELD_dsp340050b49a6c_fld2100Inst,
+  FIELD_dsp340050b49a6c_fld2101Inst,
+  FIELD_dsp340050b49a6c_fld2102Inst,
+  FIELD_dsp340050b49a6c_fld2103Inst,
+  FIELD_dsp340050b49a6c_fld2104Inst,
+  FIELD_dsp340050b49a6c_fld2105Inst,
+  FIELD_dsp340050b49a6c_fld2106Inst,
+  FIELD_dsp340050b49a6c_fld2107Inst,
+  FIELD_dsp340050b49a6c_fld2108Inst,
+  FIELD_dsp340050b49a6c_fld2109Inst,
+  FIELD_dsp340050b49a6c_fld2110Inst,
+  FIELD_dsp340050b49a6c_fld2111Inst,
+  FIELD_dsp340050b49a6c_fld2112Inst,
+  FIELD_dsp340050b49a6c_fld2113Inst,
+  FIELD_dsp340050b49a6c_fld2114Inst,
+  FIELD_dsp340050b49a6c_fld2115Inst,
+  FIELD_dsp340050b49a6c_fld2116Inst,
+  FIELD_dsp340050b49a6c_fld2117Inst,
+  FIELD_dsp340050b49a6c_fld2118Inst,
+  FIELD_dsp340050b49a6c_fld2119Inst,
+  FIELD_dsp340050b49a6c_fld2120Inst,
+  FIELD_dsp340050b49a6c_fld2122Inst,
+  FIELD_dsp340050b49a6c_fld2123Inst,
+  FIELD_dsp340050b49a6c_fld2124Inst,
+  FIELD_dsp340050b49a6c_fld2125Inst,
+  FIELD_dsp340050b49a6c_fld2126Inst,
+  FIELD_dsp340050b49a6c_fld2127Inst,
+  FIELD_dsp340050b49a6c_fld2128Inst,
+  FIELD_dsp340050b49a6c_fld2129Inst,
+  FIELD_dsp340050b49a6c_fld2131Inst,
+  FIELD_dsp340050b49a6c_fld2132Inst,
+  FIELD_dsp340050b49a6c_fld2133Inst,
+  FIELD_dsp340050b49a6c_fld2134Inst,
+  FIELD_dsp340050b49a6c_fld2136Inst,
+  FIELD_dsp340050b49a6c_fld2137Inst,
+  FIELD_dsp340050b49a6c_fld2138Inst,
+  FIELD_dsp340050b49a6c_fld2139Inst,
+  FIELD_dsp340050b49a6c_fld2140Inst,
+  FIELD_dsp340050b49a6c_fld2141Inst,
+  FIELD_dsp340050b49a6c_fld2142Inst,
+  FIELD_dsp340050b49a6c_fld2143Inst,
+  FIELD_dsp340050b49a6c_fld2144Inst,
+  FIELD_dsp340050b49a6c_fld2145Inst,
+  FIELD_dsp340050b49a6c_fld2146Inst,
+  FIELD_dsp340050b49a6c_fld2147Inst,
+  FIELD_dsp340050b49a6c_fld2149Inst,
+  FIELD_dsp340050b49a6c_fld2151Inst,
+  FIELD_dsp340050b49a6c_fld2153Inst,
+  FIELD_dsp340050b49a6c_fld2154Inst,
+  FIELD_dsp340050b49a6c_fld2155Inst,
+  FIELD_dsp340050b49a6c_fld2156Inst,
+  FIELD_dsp340050b49a6c_fld2157Inst,
+  FIELD_dsp340050b49a6c_fld2158Inst,
+  FIELD_dsp340050b49a6c_fld2159Inst,
+  FIELD_dsp340050b49a6c_fld2160Inst,
+  FIELD_dsp340050b49a6c_fld2161Inst,
+  FIELD_dsp340050b49a6c_fld2162Inst,
+  FIELD_dsp340050b49a6c_fld2163Inst,
+  FIELD_dsp340050b49a6c_fld2164Inst,
+  FIELD_dsp340050b49a6c_fld2165Inst,
+  FIELD_dsp340050b49a6c_fld2166Inst,
+  FIELD_dsp340050b49a6c_fld2167Inst,
+  FIELD_dsp340050b49a6c_fld2168Inst,
+  FIELD_dsp340050b49a6c_fld2169Inst,
+  FIELD_dsp340050b49a6c_fld2171Inst,
+  FIELD_dsp340050b49a6c_fld2172Inst,
+  FIELD_dsp340050b49a6c_fld2173Inst,
+  FIELD_dsp340050b49a6c_fld2174Inst,
+  FIELD_dsp340050b49a6c_fld2175Inst,
+  FIELD_dsp340050b49a6c_fld2177Inst,
+  FIELD_dsp340050b49a6c_fld2178Inst,
+  FIELD_dsp340050b49a6c_fld2179Inst,
+  FIELD_dsp340050b49a6c_fld2180Inst,
+  FIELD_dsp340050b49a6c_fld2181Inst,
+  FIELD_dsp340050b49a6c_fld2182Inst,
+  FIELD_dsp340050b49a6c_fld2183Inst,
+  FIELD_dsp340050b49a6c_fld2184Inst,
+  FIELD_dsp340050b49a6c_fld2185Inst,
+  FIELD_dsp340050b49a6c_fld2186Inst,
+  FIELD_dsp340050b49a6c_fld2187Inst,
+  FIELD_dsp340050b49a6c_fld2188Inst,
+  FIELD_dsp340050b49a6c_fld2189Inst,
+  FIELD_dsp340050b49a6c_fld2190Inst,
+  FIELD_dsp340050b49a6c_fld2191Inst,
+  FIELD_dsp340050b49a6c_fld2192Inst,
+  FIELD_dsp340050b49a6c_fld2193Inst,
+  FIELD_dsp340050b49a6c_fld2194Inst,
+  FIELD_dsp340050b49a6c_fld2195Inst,
+  FIELD_dsp340050b49a6c_fld2196Inst,
+  FIELD_dsp340050b49a6c_fld2197Inst,
+  FIELD_dsp340050b49a6c_fld2198Inst,
+  FIELD_dsp340050b49a6c_fld2199Inst,
+  FIELD_dsp340050b49a6c_fld2200Inst,
+  FIELD_dsp340050b49a6c_fld2201Inst,
+  FIELD_dsp340050b49a6c_fld2202Inst,
+  FIELD_dsp340050b49a6c_fld2203Inst,
+  FIELD_dsp340050b49a6c_fld2204Inst,
+  FIELD_dsp340050b49a6c_fld2205Inst,
+  FIELD_dsp340050b49a6c_fld2206Inst,
+  FIELD_dsp340050b49a6c_fld2207Inst,
+  FIELD_dsp340050b49a6c_fld2208Inst,
+  FIELD_dsp340050b49a6c_fld2209Inst,
+  FIELD_dsp340050b49a6c_fld2210Inst,
+  FIELD_dsp340050b49a6c_fld2211Inst,
+  FIELD_dsp340050b49a6c_fld2212Inst,
+  FIELD_dsp340050b49a6c_fld2213Inst,
+  FIELD_dsp340050b49a6c_fld2214Inst,
+  FIELD_dsp340050b49a6c_fld2215Inst,
+  FIELD_dsp340050b49a6c_fld2216Inst,
+  FIELD_dsp340050b49a6c_fld2217Inst,
+  FIELD_dsp340050b49a6c_fld2218Inst,
+  FIELD_dsp340050b49a6c_fld2219Inst,
+  FIELD_dsp340050b49a6c_fld2220Inst,
+  FIELD_dsp340050b49a6c_fld2221Inst,
+  FIELD_dsp340050b49a6c_fld2222Inst,
+  FIELD_dsp340050b49a6c_fld2223Inst,
+  FIELD_dsp340050b49a6c_fld2224Inst,
+  FIELD_dsp340050b49a6c_fld2225Inst,
+  FIELD_dsp340050b49a6c_fld2226Inst,
+  FIELD_dsp340050b49a6c_fld2227Inst,
+  FIELD_dsp340050b49a6c_fld2228Inst,
+  FIELD_dsp340050b49a6c_fld2229Inst,
+  FIELD_dsp340050b49a6c_fld2230Inst,
+  FIELD_dsp340050b49a6c_fld2231Inst,
+  FIELD_dsp340050b49a6c_fld2232Inst,
+  FIELD_dsp340050b49a6c_fld2234Inst,
+  FIELD_dsp340050b49a6c_fld2235Inst,
+  FIELD_dsp340050b49a6c_fld2236Inst,
+  FIELD_dsp340050b49a6c_fld2237Inst,
+  FIELD_dsp340050b49a6c_fld2238Inst,
+  FIELD_dsp340050b49a6c_fld2239Inst,
+  FIELD_dsp340050b49a6c_fld2240Inst,
+  FIELD_dsp340050b49a6c_fld2241Inst,
+  FIELD_dsp340050b49a6c_fld2242Inst,
+  FIELD_dsp340050b49a6c_fld2243Inst,
+  FIELD_dsp340050b49a6c_fld2244Inst,
+  FIELD_dsp340050b49a6c_fld2245Inst,
+  FIELD_dsp340050b49a6c_fld2246Inst,
+  FIELD_dsp340050b49a6c_fld2247Inst,
+  FIELD_dsp340050b49a6c_fld2248Inst,
+  FIELD_dsp340050b49a6c_fld2249Inst,
+  FIELD_dsp340050b49a6c_fld2250Inst,
+  FIELD_dsp340050b49a6c_fld2251Inst,
+  FIELD_dsp340050b49a6c_fld2252Inst,
+  FIELD_dsp340050b49a6c_fld2253Inst,
+  FIELD_dsp340050b49a6c_fld2254,
+  FIELD_dsp340050b49a6c_fld2255Inst,
+  FIELD_dsp340050b49a6c_fld2257Inst,
+  FIELD_dsp340050b49a6c_fld3627Inst,
+  FIELD_dsp340050b49a6c_fld3630Inst,
+  FIELD_dsp340050b49a6c_fld3631Inst,
+  FIELD_dsp340050b49a6c_fld3633Inst,
+  FIELD_dsp340050b49a6c_fld3634,
+  FIELD_dsp340050b49a6c_fld3635Inst,
+  FIELD_dsp340050b49a6c_fld3636Inst,
+  FIELD_dsp340050b49a6c_fld3637Inst,
+  FIELD_dsp340050b49a6c_fld3638Inst,
+  FIELD_dsp340050b49a6c_fld3639Inst,
+  FIELD_dsp340050b49a6c_fld3640Inst,
+  FIELD_dsp340050b49a6c_fld3642Inst,
+  FIELD_dsp340050b49a6c_fld3643Inst,
+  FIELD_dsp340050b49a6c_fld3644Inst,
+  FIELD_dsp340050b49a6c_fld3645Inst,
+  FIELD_dsp340050b49a6c_fld3647Inst,
+  FIELD_dsp340050b49a6c_fld3648Inst,
+  FIELD_dsp340050b49a6c_fld3649Inst,
+  FIELD_dsp340050b49a6c_fld3650Inst,
+  FIELD_dsp340050b49a6c_fld3651Inst,
+  FIELD_dsp340050b49a6c_fld3653Inst,
+  FIELD_dsp340050b49a6c_fld3654Inst,
+  FIELD_dsp340050b49a6c_fld3655Inst,
+  FIELD_dsp340050b49a6c_fld3656Inst,
+  FIELD_dsp340050b49a6c_fld3657Inst,
+  FIELD_dsp340050b49a6c_fld3658Inst,
+  FIELD_dsp340050b49a6c_fld3659Inst,
+  FIELD_dsp340050b49a6c_fld3660Inst,
+  FIELD_dsp340050b49a6c_fld3661Inst,
+  FIELD_dsp340050b49a6c_fld3662Inst,
+  FIELD_op0_s3,
+  FIELD_dsp340050b49a6c_fld2025,
+  FIELD_dsp340050b49a6c_fld2027,
+  FIELD_dsp340050b49a6c_fld2258GP_slot2,
+  FIELD_dsp340050b49a6c_fld2259GP_slot2,
+  FIELD_dsp340050b49a6c_fld2260GP_slot2,
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+  FIELD_dsp340050b49a6c_fld2267GP_slot2,
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+  FIELD_dsp340050b49a6c_fld3943DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3945DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3946DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3947DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3949DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3950DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3951DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3952DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3954DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3957DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3958DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3959DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3960DUAL_slot0,
+  FIELD_dsp340050b49a6c_fld3961DUAL_slot0,
+  FIELD__ar0,
+  FIELD__ar4,
+  FIELD__ar8,
+  FIELD__ar12,
+  FIELD__bt16,
+  FIELD__bs16,
+  FIELD__br16,
+  FIELD__brall
+};
+
+
+/* Functional units.  */
+
+static xtensa_funcUnit_internal funcUnits[] = {
+
+};
+
+
+/* Register files.  */
+
+enum xtensa_regfile_id {
+  REGFILE_AR,
+  REGFILE_BR,
+  REGFILE_FR,
+  REGFILE_ACU,
+  REGFILE_CM,
+  REGFILE_PQ,
+  REGFILE_BR2,
+  REGFILE_BR4,
+  REGFILE_BR8,
+  REGFILE_BR16
+};
+
+static xtensa_regfile_internal regfiles[] = {
+  { "AR", "a", REGFILE_AR, 32, 32 },
+  { "BR", "b", REGFILE_BR, 1, 16 },
+  { "FR", "f", REGFILE_FR, 32, 16 },
+  { "ACU", "ACU", REGFILE_ACU, 320, 8 },
+  { "CM", "CM", REGFILE_CM, 128, 16 },
+  { "PQ", "PQ", REGFILE_PQ, 256, 16 },
+  { "BR2", "b", REGFILE_BR, 2, 8 },
+  { "BR4", "b", REGFILE_BR, 4, 4 },
+  { "BR8", "b", REGFILE_BR, 8, 2 },
+  { "BR16", "b", REGFILE_BR, 16, 1 }
+};
+
+
+/* Interfaces.  */
+
+static xtensa_interface_internal interfaces[] = {
+  { "INQ0_32_Empty", 1, 0, 0, 'i' },
+  { "INQ0_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 0, 'i' },
+  { "INQ0_32_NOTRDY", 1, 0, 0, 'i' },
+  { "INQ0_32_KILL", 1, 0, 0, 'o' },
+  { "INQ1_32_Empty", 1, 0, 1, 'i' },
+  { "INQ1_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 1, 'i' },
+  { "INQ1_32_NOTRDY", 1, 0, 1, 'i' },
+  { "INQ1_32_KILL", 1, 0, 1, 'o' },
+  { "INQ2_32_Empty", 1, 0, 2, 'i' },
+  { "INQ2_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 2, 'i' },
+  { "INQ2_32_NOTRDY", 1, 0, 2, 'i' },
+  { "INQ2_32_KILL", 1, 0, 2, 'o' },
+  { "INQ3_32_Empty", 1, 0, 3, 'i' },
+  { "INQ3_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 3, 'i' },
+  { "INQ3_32_NOTRDY", 1, 0, 3, 'i' },
+  { "INQ3_32_KILL", 1, 0, 3, 'o' },
+  { "OUTQ0_32_Full", 1, 0, 4, 'i' },
+  { "OUTQ0_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 4, 'o' },
+  { "OUTQ0_32_NOTRDY", 1, 0, 4, 'i' },
+  { "OUTQ0_32_KILL", 1, 0, 4, 'o' },
+  { "OUTQ1_32_Full", 1, 0, 5, 'i' },
+  { "OUTQ1_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 5, 'o' },
+  { "OUTQ1_32_NOTRDY", 1, 0, 5, 'i' },
+  { "OUTQ1_32_KILL", 1, 0, 5, 'o' },
+  { "OUTQ2_32_Full", 1, 0, 6, 'i' },
+  { "OUTQ2_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 6, 'o' },
+  { "OUTQ2_32_NOTRDY", 1, 0, 6, 'i' },
+  { "OUTQ2_32_KILL", 1, 0, 6, 'o' },
+  { "OUTQ3_32_Full", 1, 0, 7, 'i' },
+  { "OUTQ3_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 7, 'o' },
+  { "OUTQ3_32_NOTRDY", 1, 0, 7, 'i' },
+  { "OUTQ3_32_KILL", 1, 0, 7, 'o' },
+  { "OUTQ4_32_Full", 1, 0, 8, 'i' },
+  { "OUTQ4_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 8, 'o' },
+  { "OUTQ4_32_NOTRDY", 1, 0, 8, 'i' },
+  { "OUTQ4_32_KILL", 1, 0, 8, 'o' },
+  { "OUTQ5_32_Full", 1, 0, 9, 'i' },
+  { "OUTQ5_32", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 9, 'o' },
+  { "OUTQ5_32_NOTRDY", 1, 0, 9, 'i' },
+  { "OUTQ5_32_KILL", 1, 0, 9, 'o' },
+  { "SIGNALQ_Full", 1, 0, 10, 'i' },
+  { "SIGNALQ", 32, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 10, 'o' },
+  { "SIGNALQ_NOTRDY", 1, 0, 10, 'i' },
+  { "SIGNALQ_KILL", 1, 0, 10, 'o' },
+  { "INQ0_128_Empty", 1, 0, 11, 'i' },
+  { "INQ0_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 11, 'i' },
+  { "INQ0_128_NOTRDY", 1, 0, 11, 'i' },
+  { "INQ0_128_KILL", 1, 0, 11, 'o' },
+  { "INQ1_128_Empty", 1, 0, 12, 'i' },
+  { "INQ1_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 12, 'i' },
+  { "INQ1_128_NOTRDY", 1, 0, 12, 'i' },
+  { "INQ1_128_KILL", 1, 0, 12, 'o' },
+  { "INQ2_128_Empty", 1, 0, 13, 'i' },
+  { "INQ2_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 13, 'i' },
+  { "INQ2_128_NOTRDY", 1, 0, 13, 'i' },
+  { "INQ2_128_KILL", 1, 0, 13, 'o' },
+  { "INQ3_128_Empty", 1, 0, 14, 'i' },
+  { "INQ3_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 14, 'i' },
+  { "INQ3_128_NOTRDY", 1, 0, 14, 'i' },
+  { "INQ3_128_KILL", 1, 0, 14, 'o' },
+  { "INQ4_128_Empty", 1, 0, 15, 'i' },
+  { "INQ4_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 15, 'i' },
+  { "INQ4_128_NOTRDY", 1, 0, 15, 'i' },
+  { "INQ4_128_KILL", 1, 0, 15, 'o' },
+  { "INQ5_128_Empty", 1, 0, 16, 'i' },
+  { "INQ5_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 16, 'i' },
+  { "INQ5_128_NOTRDY", 1, 0, 16, 'i' },
+  { "INQ5_128_KILL", 1, 0, 16, 'o' },
+  { "OUTQ0_128_Full", 1, 0, 17, 'i' },
+  { "OUTQ0_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 17, 'o' },
+  { "OUTQ0_128_NOTRDY", 1, 0, 17, 'i' },
+  { "OUTQ0_128_KILL", 1, 0, 17, 'o' },
+  { "OUTQ1_128_Full", 1, 0, 18, 'i' },
+  { "OUTQ1_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 18, 'o' },
+  { "OUTQ1_128_NOTRDY", 1, 0, 18, 'i' },
+  { "OUTQ1_128_KILL", 1, 0, 18, 'o' },
+  { "OUTQ2_128_Full", 1, 0, 19, 'i' },
+  { "OUTQ2_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 19, 'o' },
+  { "OUTQ2_128_NOTRDY", 1, 0, 19, 'i' },
+  { "OUTQ2_128_KILL", 1, 0, 19, 'o' },
+  { "OUTQ3_128_Full", 1, 0, 20, 'i' },
+  { "OUTQ3_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 20, 'o' },
+  { "OUTQ3_128_NOTRDY", 1, 0, 20, 'i' },
+  { "OUTQ3_128_KILL", 1, 0, 20, 'o' },
+  { "OUTQ4_128_Full", 1, 0, 21, 'i' },
+  { "OUTQ4_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 21, 'o' },
+  { "OUTQ4_128_NOTRDY", 1, 0, 21, 'i' },
+  { "OUTQ4_128_KILL", 1, 0, 21, 'o' },
+  { "OUTQ5_128_Full", 1, 0, 22, 'i' },
+  { "OUTQ5_128", 128, XTENSA_INTERFACE_HAS_SIDE_EFFECT, 22, 'o' },
+  { "OUTQ5_128_NOTRDY", 1, 0, 22, 'i' },
+  { "OUTQ5_128_KILL", 1, 0, 22, 'o' },
+  { "IMPWIRE", 32, 0, 23, 'i' },
+  { "LU128_Out", 128, 0, 24, 'o' },
+  { "LU128_In", 128, 0, 25, 'i' }
+};
+
+enum xtensa_interface_id {
+  INTERFACE_INQ0_32_Empty,
+  INTERFACE_INQ0_32,
+  INTERFACE_INQ0_32_NOTRDY,
+  INTERFACE_INQ0_32_KILL,
+  INTERFACE_INQ1_32_Empty,
+  INTERFACE_INQ1_32,
+  INTERFACE_INQ1_32_NOTRDY,
+  INTERFACE_INQ1_32_KILL,
+  INTERFACE_INQ2_32_Empty,
+  INTERFACE_INQ2_32,
+  INTERFACE_INQ2_32_NOTRDY,
+  INTERFACE_INQ2_32_KILL,
+  INTERFACE_INQ3_32_Empty,
+  INTERFACE_INQ3_32,
+  INTERFACE_INQ3_32_NOTRDY,
+  INTERFACE_INQ3_32_KILL,
+  INTERFACE_OUTQ0_32_Full,
+  INTERFACE_OUTQ0_32,
+  INTERFACE_OUTQ0_32_NOTRDY,
+  INTERFACE_OUTQ0_32_KILL,
+  INTERFACE_OUTQ1_32_Full,
+  INTERFACE_OUTQ1_32,
+  INTERFACE_OUTQ1_32_NOTRDY,
+  INTERFACE_OUTQ1_32_KILL,
+  INTERFACE_OUTQ2_32_Full,
+  INTERFACE_OUTQ2_32,
+  INTERFACE_OUTQ2_32_NOTRDY,
+  INTERFACE_OUTQ2_32_KILL,
+  INTERFACE_OUTQ3_32_Full,
+  INTERFACE_OUTQ3_32,
+  INTERFACE_OUTQ3_32_NOTRDY,
+  INTERFACE_OUTQ3_32_KILL,
+  INTERFACE_OUTQ4_32_Full,
+  INTERFACE_OUTQ4_32,
+  INTERFACE_OUTQ4_32_NOTRDY,
+  INTERFACE_OUTQ4_32_KILL,
+  INTERFACE_OUTQ5_32_Full,
+  INTERFACE_OUTQ5_32,
+  INTERFACE_OUTQ5_32_NOTRDY,
+  INTERFACE_OUTQ5_32_KILL,
+  INTERFACE_SIGNALQ_Full,
+  INTERFACE_SIGNALQ,
+  INTERFACE_SIGNALQ_NOTRDY,
+  INTERFACE_SIGNALQ_KILL,
+  INTERFACE_INQ0_128_Empty,
+  INTERFACE_INQ0_128,
+  INTERFACE_INQ0_128_NOTRDY,
+  INTERFACE_INQ0_128_KILL,
+  INTERFACE_INQ1_128_Empty,
+  INTERFACE_INQ1_128,
+  INTERFACE_INQ1_128_NOTRDY,
+  INTERFACE_INQ1_128_KILL,
+  INTERFACE_INQ2_128_Empty,
+  INTERFACE_INQ2_128,
+  INTERFACE_INQ2_128_NOTRDY,
+  INTERFACE_INQ2_128_KILL,
+  INTERFACE_INQ3_128_Empty,
+  INTERFACE_INQ3_128,
+  INTERFACE_INQ3_128_NOTRDY,
+  INTERFACE_INQ3_128_KILL,
+  INTERFACE_INQ4_128_Empty,
+  INTERFACE_INQ4_128,
+  INTERFACE_INQ4_128_NOTRDY,
+  INTERFACE_INQ4_128_KILL,
+  INTERFACE_INQ5_128_Empty,
+  INTERFACE_INQ5_128,
+  INTERFACE_INQ5_128_NOTRDY,
+  INTERFACE_INQ5_128_KILL,
+  INTERFACE_OUTQ0_128_Full,
+  INTERFACE_OUTQ0_128,
+  INTERFACE_OUTQ0_128_NOTRDY,
+  INTERFACE_OUTQ0_128_KILL,
+  INTERFACE_OUTQ1_128_Full,
+  INTERFACE_OUTQ1_128,
+  INTERFACE_OUTQ1_128_NOTRDY,
+  INTERFACE_OUTQ1_128_KILL,
+  INTERFACE_OUTQ2_128_Full,
+  INTERFACE_OUTQ2_128,
+  INTERFACE_OUTQ2_128_NOTRDY,
+  INTERFACE_OUTQ2_128_KILL,
+  INTERFACE_OUTQ3_128_Full,
+  INTERFACE_OUTQ3_128,
+  INTERFACE_OUTQ3_128_NOTRDY,
+  INTERFACE_OUTQ3_128_KILL,
+  INTERFACE_OUTQ4_128_Full,
+  INTERFACE_OUTQ4_128,
+  INTERFACE_OUTQ4_128_NOTRDY,
+  INTERFACE_OUTQ4_128_KILL,
+  INTERFACE_OUTQ5_128_Full,
+  INTERFACE_OUTQ5_128,
+  INTERFACE_OUTQ5_128_NOTRDY,
+  INTERFACE_OUTQ5_128_KILL,
+  INTERFACE_IMPWIRE,
+  INTERFACE_LU128_Out,
+  INTERFACE_LU128_In
+};
+
+
+/* Constant tables.  */
+
+/* constant table ai4c */
+static const unsigned CONST_TBL_ai4c_0[] = {
+  0xffffffff,
+  0x1,
+  0x2,
+  0x3,
+  0x4,
+  0x5,
+  0x6,
+  0x7,
+  0x8,
+  0x9,
+  0xa,
+  0xb,
+  0xc,
+  0xd,
+  0xe,
+  0xf,
+  0
+};
+
+/* constant table b4c */
+static const unsigned CONST_TBL_b4c_0[] = {
+  0xffffffff,
+  0x1,
+  0x2,
+  0x3,
+  0x4,
+  0x5,
+  0x6,
+  0x7,
+  0x8,
+  0xa,
+  0xc,
+  0x10,
+  0x20,
+  0x40,
+  0x80,
+  0x100,
+  0
+};
+
+/* constant table b4cu */
+static const unsigned CONST_TBL_b4cu_0[] = {
+  0x8000,
+  0x10000,
+  0x2,
+  0x3,
+  0x4,
+  0x5,
+  0x6,
+  0x7,
+  0x8,
+  0xa,
+  0xc,
+  0x10,
+  0x20,
+  0x40,
+  0x80,
+  0x100,
+  0
+};
+
+/* constant table LLR_CONSTELLATION_TABLE */
+static const unsigned CONST_TBL_LLR_CONSTELLATION_TABLE_0[] = {
+  0x1 & 0xf,
+  0x2 & 0xf,
+  0x8 & 0xf,
+  0x4 & 0xf,
+  0x8 & 0xf,
+  0x6 & 0xf,
+  0x8 & 0xf,
+  0x8 & 0xf,
+  0
+};
+
+
+/* Instruction operands.  */
+
+static int
+Operand_soffsetx4_decode (uint32 *valp)
+{
+  unsigned soffsetx4_0, offset_0;
+  offset_0 = *valp & 0x3ffff;
+  soffsetx4_0 = 0x4 + ((((int) offset_0 << 14) >> 14) << 2);
+  *valp = soffsetx4_0;
+  return 0;
+}
+
+static int
+Operand_soffsetx4_encode (uint32 *valp)
+{
+  unsigned offset_0, soffsetx4_0;
+  soffsetx4_0 = *valp;
+  offset_0 = ((soffsetx4_0 - 0x4) >> 2) & 0x3ffff;
+  *valp = offset_0;
+  return 0;
+}
+
+static int
+Operand_soffsetx4_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= (pc & ~0x3);
+  return 0;
+}
+
+static int
+Operand_soffsetx4_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += (pc & ~0x3);
+  return 0;
+}
+
+static int
+Operand_uimm12x8_decode (uint32 *valp)
+{
+  unsigned uimm12x8_0, imm12_0;
+  imm12_0 = *valp & 0xfff;
+  uimm12x8_0 = imm12_0 << 3;
+  *valp = uimm12x8_0;
+  return 0;
+}
+
+static int
+Operand_uimm12x8_encode (uint32 *valp)
+{
+  unsigned imm12_0, uimm12x8_0;
+  uimm12x8_0 = *valp;
+  imm12_0 = ((uimm12x8_0 >> 3) & 0xfff);
+  *valp = imm12_0;
+  return 0;
+}
+
+static int
+Operand_simm4_decode (uint32 *valp)
+{
+  unsigned simm4_0, mn_0;
+  mn_0 = *valp & 0xf;
+  simm4_0 = ((int) mn_0 << 28) >> 28;
+  *valp = simm4_0;
+  return 0;
+}
+
+static int
+Operand_simm4_encode (uint32 *valp)
+{
+  unsigned mn_0, simm4_0;
+  simm4_0 = *valp;
+  mn_0 = (simm4_0 & 0xf);
+  *valp = mn_0;
+  return 0;
+}
+
+static int
+Operand_arr_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_arr_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_ars_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_ars_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_art_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_art_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_ar0_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_ar0_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x1f) != 0;
+  return error;
+}
+
+static int
+Operand_ar4_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_ar4_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x1f) != 0;
+  return error;
+}
+
+static int
+Operand_ar8_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_ar8_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x1f) != 0;
+  return error;
+}
+
+static int
+Operand_ar12_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_ar12_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x1f) != 0;
+  return error;
+}
+
+static int
+Operand_ars_entry_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_ars_entry_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x1f) != 0;
+  return error;
+}
+
+static int
+Operand_immrx4_decode (uint32 *valp)
+{
+  unsigned immrx4_0, r_0;
+  r_0 = *valp & 0xf;
+  immrx4_0 = (((0xfffffff) << 4) | r_0) << 2;
+  *valp = immrx4_0;
+  return 0;
+}
+
+static int
+Operand_immrx4_encode (uint32 *valp)
+{
+  unsigned r_0, immrx4_0;
+  immrx4_0 = *valp;
+  r_0 = ((immrx4_0 >> 2) & 0xf);
+  *valp = r_0;
+  return 0;
+}
+
+static int
+Operand_lsi4x4_decode (uint32 *valp)
+{
+  unsigned lsi4x4_0, r_0;
+  r_0 = *valp & 0xf;
+  lsi4x4_0 = r_0 << 2;
+  *valp = lsi4x4_0;
+  return 0;
+}
+
+static int
+Operand_lsi4x4_encode (uint32 *valp)
+{
+  unsigned r_0, lsi4x4_0;
+  lsi4x4_0 = *valp;
+  r_0 = ((lsi4x4_0 >> 2) & 0xf);
+  *valp = r_0;
+  return 0;
+}
+
+static int
+Operand_simm7_decode (uint32 *valp)
+{
+  unsigned simm7_0, imm7_0;
+  imm7_0 = *valp & 0x7f;
+  simm7_0 = ((((-((((imm7_0 >> 6) & 1)) & (((imm7_0 >> 5) & 1)))) & 0x1ffffff)) << 7) | imm7_0;
+  *valp = simm7_0;
+  return 0;
+}
+
+static int
+Operand_simm7_encode (uint32 *valp)
+{
+  unsigned imm7_0, simm7_0;
+  simm7_0 = *valp;
+  imm7_0 = (simm7_0 & 0x7f);
+  *valp = imm7_0;
+  return 0;
+}
+
+static int
+Operand_uimm6_decode (uint32 *valp)
+{
+  unsigned uimm6_0, imm6_0;
+  imm6_0 = *valp & 0x3f;
+  uimm6_0 = 0x4 + (((0) << 6) | imm6_0);
+  *valp = uimm6_0;
+  return 0;
+}
+
+static int
+Operand_uimm6_encode (uint32 *valp)
+{
+  unsigned imm6_0, uimm6_0;
+  uimm6_0 = *valp;
+  imm6_0 = (uimm6_0 - 0x4) & 0x3f;
+  *valp = imm6_0;
+  return 0;
+}
+
+static int
+Operand_uimm6_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= pc;
+  return 0;
+}
+
+static int
+Operand_uimm6_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += pc;
+  return 0;
+}
+
+static int
+Operand_ai4const_decode (uint32 *valp)
+{
+  unsigned ai4const_0, t_0;
+  t_0 = *valp & 0xf;
+  ai4const_0 = CONST_TBL_ai4c_0[t_0 & 0xf];
+  *valp = ai4const_0;
+  return 0;
+}
+
+static int
+Operand_ai4const_encode (uint32 *valp)
+{
+  unsigned t_0, ai4const_0;
+  ai4const_0 = *valp;
+  switch (ai4const_0)
+    {
+    case 0xffffffff: t_0 = 0; break;
+    case 0x1: t_0 = 0x1; break;
+    case 0x2: t_0 = 0x2; break;
+    case 0x3: t_0 = 0x3; break;
+    case 0x4: t_0 = 0x4; break;
+    case 0x5: t_0 = 0x5; break;
+    case 0x6: t_0 = 0x6; break;
+    case 0x7: t_0 = 0x7; break;
+    case 0x8: t_0 = 0x8; break;
+    case 0x9: t_0 = 0x9; break;
+    case 0xa: t_0 = 0xa; break;
+    case 0xb: t_0 = 0xb; break;
+    case 0xc: t_0 = 0xc; break;
+    case 0xd: t_0 = 0xd; break;
+    case 0xe: t_0 = 0xe; break;
+    default: t_0 = 0xf; break;
+    }
+  *valp = t_0;
+  return 0;
+}
+
+static int
+Operand_b4const_decode (uint32 *valp)
+{
+  unsigned b4const_0, r_0;
+  r_0 = *valp & 0xf;
+  b4const_0 = CONST_TBL_b4c_0[r_0 & 0xf];
+  *valp = b4const_0;
+  return 0;
+}
+
+static int
+Operand_b4const_encode (uint32 *valp)
+{
+  unsigned r_0, b4const_0;
+  b4const_0 = *valp;
+  switch (b4const_0)
+    {
+    case 0xffffffff: r_0 = 0; break;
+    case 0x1: r_0 = 0x1; break;
+    case 0x2: r_0 = 0x2; break;
+    case 0x3: r_0 = 0x3; break;
+    case 0x4: r_0 = 0x4; break;
+    case 0x5: r_0 = 0x5; break;
+    case 0x6: r_0 = 0x6; break;
+    case 0x7: r_0 = 0x7; break;
+    case 0x8: r_0 = 0x8; break;
+    case 0xa: r_0 = 0x9; break;
+    case 0xc: r_0 = 0xa; break;
+    case 0x10: r_0 = 0xb; break;
+    case 0x20: r_0 = 0xc; break;
+    case 0x40: r_0 = 0xd; break;
+    case 0x80: r_0 = 0xe; break;
+    default: r_0 = 0xf; break;
+    }
+  *valp = r_0;
+  return 0;
+}
+
+static int
+Operand_b4constu_decode (uint32 *valp)
+{
+  unsigned b4constu_0, r_0;
+  r_0 = *valp & 0xf;
+  b4constu_0 = CONST_TBL_b4cu_0[r_0 & 0xf];
+  *valp = b4constu_0;
+  return 0;
+}
+
+static int
+Operand_b4constu_encode (uint32 *valp)
+{
+  unsigned r_0, b4constu_0;
+  b4constu_0 = *valp;
+  switch (b4constu_0)
+    {
+    case 0x8000: r_0 = 0; break;
+    case 0x10000: r_0 = 0x1; break;
+    case 0x2: r_0 = 0x2; break;
+    case 0x3: r_0 = 0x3; break;
+    case 0x4: r_0 = 0x4; break;
+    case 0x5: r_0 = 0x5; break;
+    case 0x6: r_0 = 0x6; break;
+    case 0x7: r_0 = 0x7; break;
+    case 0x8: r_0 = 0x8; break;
+    case 0xa: r_0 = 0x9; break;
+    case 0xc: r_0 = 0xa; break;
+    case 0x10: r_0 = 0xb; break;
+    case 0x20: r_0 = 0xc; break;
+    case 0x40: r_0 = 0xd; break;
+    case 0x80: r_0 = 0xe; break;
+    default: r_0 = 0xf; break;
+    }
+  *valp = r_0;
+  return 0;
+}
+
+static int
+Operand_uimm8_decode (uint32 *valp)
+{
+  unsigned uimm8_0, imm8_0;
+  imm8_0 = *valp & 0xff;
+  uimm8_0 = imm8_0;
+  *valp = uimm8_0;
+  return 0;
+}
+
+static int
+Operand_uimm8_encode (uint32 *valp)
+{
+  unsigned imm8_0, uimm8_0;
+  uimm8_0 = *valp;
+  imm8_0 = (uimm8_0 & 0xff);
+  *valp = imm8_0;
+  return 0;
+}
+
+static int
+Operand_uimm8x2_decode (uint32 *valp)
+{
+  unsigned uimm8x2_0, imm8_0;
+  imm8_0 = *valp & 0xff;
+  uimm8x2_0 = imm8_0 << 1;
+  *valp = uimm8x2_0;
+  return 0;
+}
+
+static int
+Operand_uimm8x2_encode (uint32 *valp)
+{
+  unsigned imm8_0, uimm8x2_0;
+  uimm8x2_0 = *valp;
+  imm8_0 = ((uimm8x2_0 >> 1) & 0xff);
+  *valp = imm8_0;
+  return 0;
+}
+
+static int
+Operand_uimm8x4_decode (uint32 *valp)
+{
+  unsigned uimm8x4_0, imm8_0;
+  imm8_0 = *valp & 0xff;
+  uimm8x4_0 = imm8_0 << 2;
+  *valp = uimm8x4_0;
+  return 0;
+}
+
+static int
+Operand_uimm8x4_encode (uint32 *valp)
+{
+  unsigned imm8_0, uimm8x4_0;
+  uimm8x4_0 = *valp;
+  imm8_0 = ((uimm8x4_0 >> 2) & 0xff);
+  *valp = imm8_0;
+  return 0;
+}
+
+static int
+Operand_uimm4x16_decode (uint32 *valp)
+{
+  unsigned uimm4x16_0, op2_0;
+  op2_0 = *valp & 0xf;
+  uimm4x16_0 = op2_0 << 4;
+  *valp = uimm4x16_0;
+  return 0;
+}
+
+static int
+Operand_uimm4x16_encode (uint32 *valp)
+{
+  unsigned op2_0, uimm4x16_0;
+  uimm4x16_0 = *valp;
+  op2_0 = ((uimm4x16_0 >> 4) & 0xf);
+  *valp = op2_0;
+  return 0;
+}
+
+static int
+Operand_simm8_decode (uint32 *valp)
+{
+  unsigned simm8_0, imm8_0;
+  imm8_0 = *valp & 0xff;
+  simm8_0 = ((int) imm8_0 << 24) >> 24;
+  *valp = simm8_0;
+  return 0;
+}
+
+static int
+Operand_simm8_encode (uint32 *valp)
+{
+  unsigned imm8_0, simm8_0;
+  simm8_0 = *valp;
+  imm8_0 = (simm8_0 & 0xff);
+  *valp = imm8_0;
+  return 0;
+}
+
+static int
+Operand_simm8x256_decode (uint32 *valp)
+{
+  unsigned simm8x256_0, imm8_0;
+  imm8_0 = *valp & 0xff;
+  simm8x256_0 = (((int) imm8_0 << 24) >> 24) << 8;
+  *valp = simm8x256_0;
+  return 0;
+}
+
+static int
+Operand_simm8x256_encode (uint32 *valp)
+{
+  unsigned imm8_0, simm8x256_0;
+  simm8x256_0 = *valp;
+  imm8_0 = ((simm8x256_0 >> 8) & 0xff);
+  *valp = imm8_0;
+  return 0;
+}
+
+static int
+Operand_simm12b_decode (uint32 *valp)
+{
+  unsigned simm12b_0, imm12b_0;
+  imm12b_0 = *valp & 0xfff;
+  simm12b_0 = ((int) imm12b_0 << 20) >> 20;
+  *valp = simm12b_0;
+  return 0;
+}
+
+static int
+Operand_simm12b_encode (uint32 *valp)
+{
+  unsigned imm12b_0, simm12b_0;
+  simm12b_0 = *valp;
+  imm12b_0 = (simm12b_0 & 0xfff);
+  *valp = imm12b_0;
+  return 0;
+}
+
+static int
+Operand_msalp32_decode (uint32 *valp)
+{
+  unsigned msalp32_0, sal_0;
+  sal_0 = *valp & 0x1f;
+  msalp32_0 = 0x20 - sal_0;
+  *valp = msalp32_0;
+  return 0;
+}
+
+static int
+Operand_msalp32_encode (uint32 *valp)
+{
+  unsigned sal_0, msalp32_0;
+  msalp32_0 = *valp;
+  sal_0 = (0x20 - msalp32_0) & 0x1f;
+  *valp = sal_0;
+  return 0;
+}
+
+static int
+Operand_op2p1_decode (uint32 *valp)
+{
+  unsigned op2p1_0, op2_0;
+  op2_0 = *valp & 0xf;
+  op2p1_0 = op2_0 + 0x1;
+  *valp = op2p1_0;
+  return 0;
+}
+
+static int
+Operand_op2p1_encode (uint32 *valp)
+{
+  unsigned op2_0, op2p1_0;
+  op2p1_0 = *valp;
+  op2_0 = (op2p1_0 - 0x1) & 0xf;
+  *valp = op2_0;
+  return 0;
+}
+
+static int
+Operand_label8_decode (uint32 *valp)
+{
+  unsigned label8_0, imm8_0;
+  imm8_0 = *valp & 0xff;
+  label8_0 = 0x4 + (((int) imm8_0 << 24) >> 24);
+  *valp = label8_0;
+  return 0;
+}
+
+static int
+Operand_label8_encode (uint32 *valp)
+{
+  unsigned imm8_0, label8_0;
+  label8_0 = *valp;
+  imm8_0 = (label8_0 - 0x4) & 0xff;
+  *valp = imm8_0;
+  return 0;
+}
+
+static int
+Operand_label8_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= pc;
+  return 0;
+}
+
+static int
+Operand_label8_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += pc;
+  return 0;
+}
+
+static int
+Operand_ulabel8_decode (uint32 *valp)
+{
+  unsigned ulabel8_0, imm8_0;
+  imm8_0 = *valp & 0xff;
+  ulabel8_0 = 0x4 + (((0) << 8) | imm8_0);
+  *valp = ulabel8_0;
+  return 0;
+}
+
+static int
+Operand_ulabel8_encode (uint32 *valp)
+{
+  unsigned imm8_0, ulabel8_0;
+  ulabel8_0 = *valp;
+  imm8_0 = (ulabel8_0 - 0x4) & 0xff;
+  *valp = imm8_0;
+  return 0;
+}
+
+static int
+Operand_ulabel8_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= pc;
+  return 0;
+}
+
+static int
+Operand_ulabel8_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += pc;
+  return 0;
+}
+
+static int
+Operand_label12_decode (uint32 *valp)
+{
+  unsigned label12_0, imm12_0;
+  imm12_0 = *valp & 0xfff;
+  label12_0 = 0x4 + (((int) imm12_0 << 20) >> 20);
+  *valp = label12_0;
+  return 0;
+}
+
+static int
+Operand_label12_encode (uint32 *valp)
+{
+  unsigned imm12_0, label12_0;
+  label12_0 = *valp;
+  imm12_0 = (label12_0 - 0x4) & 0xfff;
+  *valp = imm12_0;
+  return 0;
+}
+
+static int
+Operand_label12_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= pc;
+  return 0;
+}
+
+static int
+Operand_label12_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += pc;
+  return 0;
+}
+
+static int
+Operand_soffset_decode (uint32 *valp)
+{
+  unsigned soffset_0, offset_0;
+  offset_0 = *valp & 0x3ffff;
+  soffset_0 = 0x4 + (((int) offset_0 << 14) >> 14);
+  *valp = soffset_0;
+  return 0;
+}
+
+static int
+Operand_soffset_encode (uint32 *valp)
+{
+  unsigned offset_0, soffset_0;
+  soffset_0 = *valp;
+  offset_0 = (soffset_0 - 0x4) & 0x3ffff;
+  *valp = offset_0;
+  return 0;
+}
+
+static int
+Operand_soffset_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= pc;
+  return 0;
+}
+
+static int
+Operand_soffset_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += pc;
+  return 0;
+}
+
+static int
+Operand_uimm16x4_decode (uint32 *valp)
+{
+  unsigned uimm16x4_0, imm16_0;
+  imm16_0 = *valp & 0xffff;
+  uimm16x4_0 = (((0xffff) << 16) | imm16_0) << 2;
+  *valp = uimm16x4_0;
+  return 0;
+}
+
+static int
+Operand_uimm16x4_encode (uint32 *valp)
+{
+  unsigned imm16_0, uimm16x4_0;
+  uimm16x4_0 = *valp;
+  imm16_0 = (uimm16x4_0 >> 2) & 0xffff;
+  *valp = imm16_0;
+  return 0;
+}
+
+static int
+Operand_uimm16x4_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= ((pc + 3) & ~0x3);
+  return 0;
+}
+
+static int
+Operand_uimm16x4_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += ((pc + 3) & ~0x3);
+  return 0;
+}
+
+static int
+Operand_immt_decode (uint32 *valp)
+{
+  unsigned immt_0, t_0;
+  t_0 = *valp & 0xf;
+  immt_0 = t_0;
+  *valp = immt_0;
+  return 0;
+}
+
+static int
+Operand_immt_encode (uint32 *valp)
+{
+  unsigned t_0, immt_0;
+  immt_0 = *valp;
+  t_0 = immt_0 & 0xf;
+  *valp = t_0;
+  return 0;
+}
+
+static int
+Operand_imms_decode (uint32 *valp)
+{
+  unsigned imms_0, s_0;
+  s_0 = *valp & 0xf;
+  imms_0 = s_0;
+  *valp = imms_0;
+  return 0;
+}
+
+static int
+Operand_imms_encode (uint32 *valp)
+{
+  unsigned s_0, imms_0;
+  imms_0 = *valp;
+  s_0 = imms_0 & 0xf;
+  *valp = s_0;
+  return 0;
+}
+
+static int
+Operand_bt_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_bt_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_bs_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_bs_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_br_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_br_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_bt2_decode (uint32 *valp)
+{
+  *valp = *valp << 1;
+  return 0;
+}
+
+static int
+Operand_bt2_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x7 << 1)) != 0;
+  *valp = *valp >> 1;
+  return error;
+}
+
+static int
+Operand_bs2_decode (uint32 *valp)
+{
+  *valp = *valp << 1;
+  return 0;
+}
+
+static int
+Operand_bs2_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x7 << 1)) != 0;
+  *valp = *valp >> 1;
+  return error;
+}
+
+static int
+Operand_br2_decode (uint32 *valp)
+{
+  *valp = *valp << 1;
+  return 0;
+}
+
+static int
+Operand_br2_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x7 << 1)) != 0;
+  *valp = *valp >> 1;
+  return error;
+}
+
+static int
+Operand_bt4_decode (uint32 *valp)
+{
+  *valp = *valp << 2;
+  return 0;
+}
+
+static int
+Operand_bt4_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x3 << 2)) != 0;
+  *valp = *valp >> 2;
+  return error;
+}
+
+static int
+Operand_bs4_decode (uint32 *valp)
+{
+  *valp = *valp << 2;
+  return 0;
+}
+
+static int
+Operand_bs4_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x3 << 2)) != 0;
+  *valp = *valp >> 2;
+  return error;
+}
+
+static int
+Operand_br4_decode (uint32 *valp)
+{
+  *valp = *valp << 2;
+  return 0;
+}
+
+static int
+Operand_br4_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x3 << 2)) != 0;
+  *valp = *valp >> 2;
+  return error;
+}
+
+static int
+Operand_bt8_decode (uint32 *valp)
+{
+  *valp = *valp << 3;
+  return 0;
+}
+
+static int
+Operand_bt8_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x1 << 3)) != 0;
+  *valp = *valp >> 3;
+  return error;
+}
+
+static int
+Operand_bs8_decode (uint32 *valp)
+{
+  *valp = *valp << 3;
+  return 0;
+}
+
+static int
+Operand_bs8_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x1 << 3)) != 0;
+  *valp = *valp >> 3;
+  return error;
+}
+
+static int
+Operand_br8_decode (uint32 *valp)
+{
+  *valp = *valp << 3;
+  return 0;
+}
+
+static int
+Operand_br8_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0x1 << 3)) != 0;
+  *valp = *valp >> 3;
+  return error;
+}
+
+static int
+Operand_bt16_decode (uint32 *valp)
+{
+  *valp = *valp << 4;
+  return 0;
+}
+
+static int
+Operand_bt16_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0 << 4)) != 0;
+  *valp = *valp >> 4;
+  return error;
+}
+
+static int
+Operand_bs16_decode (uint32 *valp)
+{
+  *valp = *valp << 4;
+  return 0;
+}
+
+static int
+Operand_bs16_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0 << 4)) != 0;
+  *valp = *valp >> 4;
+  return error;
+}
+
+static int
+Operand_br16_decode (uint32 *valp)
+{
+  *valp = *valp << 4;
+  return 0;
+}
+
+static int
+Operand_br16_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0 << 4)) != 0;
+  *valp = *valp >> 4;
+  return error;
+}
+
+static int
+Operand_brall_decode (uint32 *valp)
+{
+  *valp = *valp << 4;
+  return 0;
+}
+
+static int
+Operand_brall_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~(0 << 4)) != 0;
+  *valp = *valp >> 4;
+  return error;
+}
+
+static int
+Operand_tp7_decode (uint32 *valp)
+{
+  unsigned tp7_0, t_0;
+  t_0 = *valp & 0xf;
+  tp7_0 = t_0 + 0x7;
+  *valp = tp7_0;
+  return 0;
+}
+
+static int
+Operand_tp7_encode (uint32 *valp)
+{
+  unsigned t_0, tp7_0;
+  tp7_0 = *valp;
+  t_0 = (tp7_0 - 0x7) & 0xf;
+  *valp = t_0;
+  return 0;
+}
+
+static int
+Operand_xt_wbr15_label_decode (uint32 *valp)
+{
+  unsigned xt_wbr15_label_0, xt_wbr15_imm_0;
+  xt_wbr15_imm_0 = *valp & 0x7fff;
+  xt_wbr15_label_0 = 0x4 + (((int) xt_wbr15_imm_0 << 17) >> 17);
+  *valp = xt_wbr15_label_0;
+  return 0;
+}
+
+static int
+Operand_xt_wbr15_label_encode (uint32 *valp)
+{
+  unsigned xt_wbr15_imm_0, xt_wbr15_label_0;
+  xt_wbr15_label_0 = *valp;
+  xt_wbr15_imm_0 = (xt_wbr15_label_0 - 0x4) & 0x7fff;
+  *valp = xt_wbr15_imm_0;
+  return 0;
+}
+
+static int
+Operand_xt_wbr15_label_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= pc;
+  return 0;
+}
+
+static int
+Operand_xt_wbr15_label_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += pc;
+  return 0;
+}
+
+static int
+Operand_xt_wbr18_label_decode (uint32 *valp)
+{
+  unsigned xt_wbr18_label_0, xt_wbr18_imm_0;
+  xt_wbr18_imm_0 = *valp & 0x3ffff;
+  xt_wbr18_label_0 = 0x4 + (((int) xt_wbr18_imm_0 << 14) >> 14);
+  *valp = xt_wbr18_label_0;
+  return 0;
+}
+
+static int
+Operand_xt_wbr18_label_encode (uint32 *valp)
+{
+  unsigned xt_wbr18_imm_0, xt_wbr18_label_0;
+  xt_wbr18_label_0 = *valp;
+  xt_wbr18_imm_0 = (xt_wbr18_label_0 - 0x4) & 0x3ffff;
+  *valp = xt_wbr18_imm_0;
+  return 0;
+}
+
+static int
+Operand_xt_wbr18_label_ator (uint32 *valp, uint32 pc)
+{
+  *valp -= pc;
+  return 0;
+}
+
+static int
+Operand_xt_wbr18_label_rtoa (uint32 *valp, uint32 pc)
+{
+  *valp += pc;
+  return 0;
+}
+
+static int
+Operand_cimm8x4_decode (uint32 *valp)
+{
+  unsigned cimm8x4_0, fimm8_0;
+  fimm8_0 = *valp & 0xff;
+  cimm8x4_0 = (fimm8_0 << 2) | 0;
+  *valp = cimm8x4_0;
+  return 0;
+}
+
+static int
+Operand_cimm8x4_encode (uint32 *valp)
+{
+  unsigned fimm8_0, cimm8x4_0;
+  cimm8x4_0 = *valp;
+  fimm8_0 = (cimm8x4_0 >> 2) & 0xff;
+  *valp = fimm8_0;
+  return 0;
+}
+
+static int
+Operand_frr_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_frr_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_frs_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_frs_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_frt_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_frt_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper45_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper45_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper46_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper46_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper47_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper47_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper48_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper48_imm_0, dsp340050b49a6c_fld2047_0;
+  dsp340050b49a6c_fld2047_0 = *valp & 0x1;
+  dsp340050b49a6c_oper48_imm_0 = (0 << 1) | dsp340050b49a6c_fld2047_0;
+  *valp = dsp340050b49a6c_oper48_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper48_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2047_0, dsp340050b49a6c_oper48_imm_0;
+  dsp340050b49a6c_oper48_imm_0 = *valp;
+  dsp340050b49a6c_fld2047_0 = (((dsp340050b49a6c_oper48_imm_0 >> 0) & 1)) & 0x1;
+  *valp = dsp340050b49a6c_fld2047_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper49_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper49_imm_0, dsp340050b49a6c_fld2025_0;
+  dsp340050b49a6c_fld2025_0 = *valp & 0x1;
+  dsp340050b49a6c_oper49_imm_0 = (0 << 1) | dsp340050b49a6c_fld2025_0;
+  *valp = dsp340050b49a6c_oper49_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper49_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2025_0, dsp340050b49a6c_oper49_imm_0;
+  dsp340050b49a6c_oper49_imm_0 = *valp;
+  dsp340050b49a6c_fld2025_0 = (((dsp340050b49a6c_oper49_imm_0 >> 0) & 1)) & 0x1;
+  *valp = dsp340050b49a6c_fld2025_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper50_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper50_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper51_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper51_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x7) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper52_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper52_imm_0, dsp340050b49a6c_fld2049_0;
+  dsp340050b49a6c_fld2049_0 = *valp & 0x3;
+  dsp340050b49a6c_oper52_imm_0 = (0 << 2) | dsp340050b49a6c_fld2049_0;
+  *valp = dsp340050b49a6c_oper52_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper52_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2049_0, dsp340050b49a6c_oper52_imm_0;
+  dsp340050b49a6c_oper52_imm_0 = *valp;
+  dsp340050b49a6c_fld2049_0 = (dsp340050b49a6c_oper52_imm_0 & 0x3);
+  *valp = dsp340050b49a6c_fld2049_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper53_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper53_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper54_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper54_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x7) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper55_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper55_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper56_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper56_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper57_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper57_imm_0, dsp340050b49a6c_fld2041_0;
+  dsp340050b49a6c_fld2041_0 = *valp & 0x1;
+  dsp340050b49a6c_oper57_imm_0 = (0 << 1) | dsp340050b49a6c_fld2041_0;
+  *valp = dsp340050b49a6c_oper57_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper57_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2041_0, dsp340050b49a6c_oper57_imm_0;
+  dsp340050b49a6c_oper57_imm_0 = *valp;
+  dsp340050b49a6c_fld2041_0 = (((dsp340050b49a6c_oper57_imm_0 >> 0) & 1)) & 0x1;
+  *valp = dsp340050b49a6c_fld2041_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper58_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper58_imm_0, dsp340050b49a6c_fld2051_0;
+  dsp340050b49a6c_fld2051_0 = *valp & 0x3f;
+  dsp340050b49a6c_oper58_imm_0 = ((int) dsp340050b49a6c_fld2051_0 << 26) >> 26;
+  *valp = dsp340050b49a6c_oper58_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper58_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2051_0, dsp340050b49a6c_oper58_imm_0;
+  dsp340050b49a6c_oper58_imm_0 = *valp;
+  dsp340050b49a6c_fld2051_0 = (dsp340050b49a6c_oper58_imm_0 & 0x3f);
+  *valp = dsp340050b49a6c_fld2051_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper59_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper59_imm_0, dsp340050b49a6c_fld2052_0;
+  dsp340050b49a6c_fld2052_0 = *valp & 0xf;
+  dsp340050b49a6c_oper59_imm_0 = (0 << 4) | dsp340050b49a6c_fld2052_0;
+  *valp = dsp340050b49a6c_oper59_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper59_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2052_0, dsp340050b49a6c_oper59_imm_0;
+  dsp340050b49a6c_oper59_imm_0 = *valp;
+  dsp340050b49a6c_fld2052_0 = (dsp340050b49a6c_oper59_imm_0 & 0xf);
+  *valp = dsp340050b49a6c_fld2052_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper60_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper60_imm_0, dsp340050b49a6c_fld2053_0;
+  dsp340050b49a6c_fld2053_0 = *valp & 0x1f;
+  dsp340050b49a6c_oper60_imm_0 = (0 << 5) | dsp340050b49a6c_fld2053_0;
+  *valp = dsp340050b49a6c_oper60_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper60_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2053_0, dsp340050b49a6c_oper60_imm_0;
+  dsp340050b49a6c_oper60_imm_0 = *valp;
+  dsp340050b49a6c_fld2053_0 = (dsp340050b49a6c_oper60_imm_0 & 0x1f);
+  *valp = dsp340050b49a6c_fld2053_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper61_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper61_imm_0, dsp340050b49a6c_fld2044_0;
+  dsp340050b49a6c_fld2044_0 = *valp & 0x1f;
+  dsp340050b49a6c_oper61_imm_0 = (0 << 5) | dsp340050b49a6c_fld2044_0;
+  *valp = dsp340050b49a6c_oper61_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper61_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2044_0, dsp340050b49a6c_oper61_imm_0;
+  dsp340050b49a6c_oper61_imm_0 = *valp;
+  dsp340050b49a6c_fld2044_0 = (dsp340050b49a6c_oper61_imm_0 & 0x1f);
+  *valp = dsp340050b49a6c_fld2044_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper62_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper62_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper63_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper63_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x7) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper64_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper64_imm_0, dsp340050b49a6c_fld2032_0;
+  dsp340050b49a6c_fld2032_0 = *valp & 0x3;
+  dsp340050b49a6c_oper64_imm_0 = (0 << 2) | dsp340050b49a6c_fld2032_0;
+  *valp = dsp340050b49a6c_oper64_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper64_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2032_0, dsp340050b49a6c_oper64_imm_0;
+  dsp340050b49a6c_oper64_imm_0 = *valp;
+  dsp340050b49a6c_fld2032_0 = (dsp340050b49a6c_oper64_imm_0 & 0x3);
+  *valp = dsp340050b49a6c_fld2032_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper65_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper65_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper66_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper66_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x7) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper67_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper67_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x7) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper68_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper68_imm_0, dsp340050b49a6c_fld2035_0;
+  dsp340050b49a6c_fld2035_0 = *valp & 0x3;
+  dsp340050b49a6c_oper68_imm_0 = (0 << 2) | dsp340050b49a6c_fld2035_0;
+  *valp = dsp340050b49a6c_oper68_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper68_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2035_0, dsp340050b49a6c_oper68_imm_0;
+  dsp340050b49a6c_oper68_imm_0 = *valp;
+  dsp340050b49a6c_fld2035_0 = (dsp340050b49a6c_oper68_imm_0 & 0x3);
+  *valp = dsp340050b49a6c_fld2035_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper69_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper69_imm_0, dsp340050b49a6c_fld2036_0;
+  dsp340050b49a6c_fld2036_0 = *valp & 0x1;
+  dsp340050b49a6c_oper69_imm_0 = (0 << 1) | dsp340050b49a6c_fld2036_0;
+  *valp = dsp340050b49a6c_oper69_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper69_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2036_0, dsp340050b49a6c_oper69_imm_0;
+  dsp340050b49a6c_oper69_imm_0 = *valp;
+  dsp340050b49a6c_fld2036_0 = (((dsp340050b49a6c_oper69_imm_0 >> 0) & 1)) & 0x1;
+  *valp = dsp340050b49a6c_fld2036_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper70_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper70_imm_0, dsp340050b49a6c_fld2037_0;
+  dsp340050b49a6c_fld2037_0 = *valp & 0x7;
+  dsp340050b49a6c_oper70_imm_0 = (0 << 3) | dsp340050b49a6c_fld2037_0;
+  *valp = dsp340050b49a6c_oper70_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper70_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2037_0, dsp340050b49a6c_oper70_imm_0;
+  dsp340050b49a6c_oper70_imm_0 = *valp;
+  dsp340050b49a6c_fld2037_0 = (dsp340050b49a6c_oper70_imm_0 & 0x7);
+  *valp = dsp340050b49a6c_fld2037_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper71_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper71_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0x7) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper72_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper72_imm_0, dsp340050b49a6c_fld2042_0;
+  dsp340050b49a6c_fld2042_0 = *valp & 0x3;
+  dsp340050b49a6c_oper72_imm_0 = (0 << 2) | dsp340050b49a6c_fld2042_0;
+  *valp = dsp340050b49a6c_oper72_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper72_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2042_0, dsp340050b49a6c_oper72_imm_0;
+  dsp340050b49a6c_oper72_imm_0 = *valp;
+  dsp340050b49a6c_fld2042_0 = (dsp340050b49a6c_oper72_imm_0 & 0x3);
+  *valp = dsp340050b49a6c_fld2042_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper73_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper73_imm_0, dsp340050b49a6c_fld2038_0;
+  dsp340050b49a6c_fld2038_0 = *valp & 0xf;
+  dsp340050b49a6c_oper73_imm_0 = ((0 << 4) | dsp340050b49a6c_fld2038_0) << 3;
+  *valp = dsp340050b49a6c_oper73_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper73_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2038_0, dsp340050b49a6c_oper73_imm_0;
+  dsp340050b49a6c_oper73_imm_0 = *valp;
+  dsp340050b49a6c_fld2038_0 = ((dsp340050b49a6c_oper73_imm_0 >> 3) & 0xf);
+  *valp = dsp340050b49a6c_fld2038_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper74_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper74_imm_0, dsp340050b49a6c_fld2038_0;
+  dsp340050b49a6c_fld2038_0 = *valp & 0xf;
+  dsp340050b49a6c_oper74_imm_0 = ((0 << 4) | dsp340050b49a6c_fld2038_0) << 4;
+  *valp = dsp340050b49a6c_oper74_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper74_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2038_0, dsp340050b49a6c_oper74_imm_0;
+  dsp340050b49a6c_oper74_imm_0 = *valp;
+  dsp340050b49a6c_fld2038_0 = ((dsp340050b49a6c_oper74_imm_0 >> 4) & 0xf);
+  *valp = dsp340050b49a6c_fld2038_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper75_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper75_imm_0, dsp340050b49a6c_fld2038_0;
+  dsp340050b49a6c_fld2038_0 = *valp & 0xf;
+  dsp340050b49a6c_oper75_imm_0 = ((0 << 4) | dsp340050b49a6c_fld2038_0) << 2;
+  *valp = dsp340050b49a6c_oper75_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper75_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2038_0, dsp340050b49a6c_oper75_imm_0;
+  dsp340050b49a6c_oper75_imm_0 = *valp;
+  dsp340050b49a6c_fld2038_0 = ((dsp340050b49a6c_oper75_imm_0 >> 2) & 0xf);
+  *valp = dsp340050b49a6c_fld2038_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper76_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper76_imm_0, dsp340050b49a6c_fld2053_0;
+  dsp340050b49a6c_fld2053_0 = *valp & 0x1f;
+  dsp340050b49a6c_oper76_imm_0 = ((0 << 5) | dsp340050b49a6c_fld2053_0) << 4;
+  *valp = dsp340050b49a6c_oper76_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper76_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2053_0, dsp340050b49a6c_oper76_imm_0;
+  dsp340050b49a6c_oper76_imm_0 = *valp;
+  dsp340050b49a6c_fld2053_0 = ((dsp340050b49a6c_oper76_imm_0 >> 4) & 0x1f);
+  *valp = dsp340050b49a6c_fld2053_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper77_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper77_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper78_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper78_imm_0, dsp340050b49a6c_fld2056_0;
+  dsp340050b49a6c_fld2056_0 = *valp & 0x7;
+  dsp340050b49a6c_oper78_imm_0 = (0 << 3) | dsp340050b49a6c_fld2056_0;
+  *valp = dsp340050b49a6c_oper78_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper78_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2056_0, dsp340050b49a6c_oper78_imm_0;
+  dsp340050b49a6c_oper78_imm_0 = *valp;
+  dsp340050b49a6c_fld2056_0 = (dsp340050b49a6c_oper78_imm_0 & 0x7);
+  *valp = dsp340050b49a6c_fld2056_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper79_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper79_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper80_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper80_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper81_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper81_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper82_reg_decode (uint32 *valp ATTRIBUTE_UNUSED)
+{
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper82_reg_encode (uint32 *valp)
+{
+  int error;
+  error = (*valp & ~0xf) != 0;
+  return error;
+}
+
+static int
+Operand_dsp340050b49a6c_oper83_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper83_imm_0, dsp340050b49a6c_fld2040_0;
+  dsp340050b49a6c_fld2040_0 = *valp & 0x1f;
+  dsp340050b49a6c_oper83_imm_0 = ((0 << 5) | dsp340050b49a6c_fld2040_0) << 4;
+  *valp = dsp340050b49a6c_oper83_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper83_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2040_0, dsp340050b49a6c_oper83_imm_0;
+  dsp340050b49a6c_oper83_imm_0 = *valp;
+  dsp340050b49a6c_fld2040_0 = ((dsp340050b49a6c_oper83_imm_0 >> 4) & 0x1f);
+  *valp = dsp340050b49a6c_fld2040_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper84_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper84_imm_0, dsp340050b49a6c_fld2029_0;
+  dsp340050b49a6c_fld2029_0 = *valp & 0xf;
+  dsp340050b49a6c_oper84_imm_0 = ((0 << 4) | dsp340050b49a6c_fld2029_0) << 3;
+  *valp = dsp340050b49a6c_oper84_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper84_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2029_0, dsp340050b49a6c_oper84_imm_0;
+  dsp340050b49a6c_oper84_imm_0 = *valp;
+  dsp340050b49a6c_fld2029_0 = ((dsp340050b49a6c_oper84_imm_0 >> 3) & 0xf);
+  *valp = dsp340050b49a6c_fld2029_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper85_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper85_imm_0, dsp340050b49a6c_fld2029_0;
+  dsp340050b49a6c_fld2029_0 = *valp & 0xf;
+  dsp340050b49a6c_oper85_imm_0 = ((0 << 4) | dsp340050b49a6c_fld2029_0) << 4;
+  *valp = dsp340050b49a6c_oper85_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper85_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2029_0, dsp340050b49a6c_oper85_imm_0;
+  dsp340050b49a6c_oper85_imm_0 = *valp;
+  dsp340050b49a6c_fld2029_0 = ((dsp340050b49a6c_oper85_imm_0 >> 4) & 0xf);
+  *valp = dsp340050b49a6c_fld2029_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper86_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper86_imm_0, dsp340050b49a6c_fld2029_0;
+  dsp340050b49a6c_fld2029_0 = *valp & 0xf;
+  dsp340050b49a6c_oper86_imm_0 = ((0 << 4) | dsp340050b49a6c_fld2029_0) << 2;
+  *valp = dsp340050b49a6c_oper86_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper86_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2029_0, dsp340050b49a6c_oper86_imm_0;
+  dsp340050b49a6c_oper86_imm_0 = *valp;
+  dsp340050b49a6c_fld2029_0 = ((dsp340050b49a6c_oper86_imm_0 >> 2) & 0xf);
+  *valp = dsp340050b49a6c_fld2029_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper87_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper87_imm_0, dsp340050b49a6c_fld2043_0;
+  dsp340050b49a6c_fld2043_0 = *valp & 0x1f;
+  dsp340050b49a6c_oper87_imm_0 = ((0 << 5) | dsp340050b49a6c_fld2043_0) << 4;
+  *valp = dsp340050b49a6c_oper87_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper87_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2043_0, dsp340050b49a6c_oper87_imm_0;
+  dsp340050b49a6c_oper87_imm_0 = *valp;
+  dsp340050b49a6c_fld2043_0 = ((dsp340050b49a6c_oper87_imm_0 >> 4) & 0x1f);
+  *valp = dsp340050b49a6c_fld2043_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper88_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper88_imm_0, dsp340050b49a6c_fld2030_0;
+  dsp340050b49a6c_fld2030_0 = *valp & 0xf;
+  dsp340050b49a6c_oper88_imm_0 = (0 << 4) | dsp340050b49a6c_fld2030_0;
+  *valp = dsp340050b49a6c_oper88_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper88_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2030_0, dsp340050b49a6c_oper88_imm_0;
+  dsp340050b49a6c_oper88_imm_0 = *valp;
+  dsp340050b49a6c_fld2030_0 = (dsp340050b49a6c_oper88_imm_0 & 0xf);
+  *valp = dsp340050b49a6c_fld2030_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper89_imm_decode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_oper89_imm_0, dsp340050b49a6c_fld2052_0;
+  dsp340050b49a6c_fld2052_0 = *valp & 0xf;
+  dsp340050b49a6c_oper89_imm_0 = ((0 << 4) | dsp340050b49a6c_fld2052_0) << 2;
+  *valp = dsp340050b49a6c_oper89_imm_0;
+  return 0;
+}
+
+static int
+Operand_dsp340050b49a6c_oper89_imm_encode (uint32 *valp)
+{
+  unsigned dsp340050b49a6c_fld2052_0, dsp340050b49a6c_oper89_imm_0;
+  dsp340050b49a6c_oper89_imm_0 = *valp;
+  dsp340050b49a6c_fld2052_0 = ((dsp340050b49a6c_oper89_imm_0 >> 2) & 0xf);
+  *valp = dsp340050b49a6c_fld2052_0;
+  return 0;
+}
+
+static xtensa_operand_internal operands[] = {
+  { "soffsetx4", FIELD_offset, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_soffsetx4_encode, Operand_soffsetx4_decode,
+    Operand_soffsetx4_ator, Operand_soffsetx4_rtoa },
+  { "uimm12x8", FIELD_imm12, -1, 0,
+    0,
+    Operand_uimm12x8_encode, Operand_uimm12x8_decode,
+    0, 0 },
+  { "simm4", FIELD_mn, -1, 0,
+    0,
+    Operand_simm4_encode, Operand_simm4_decode,
+    0, 0 },
+  { "arr", FIELD_r, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_arr_encode, Operand_arr_decode,
+    0, 0 },
+  { "ars", FIELD_s, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_ars_encode, Operand_ars_decode,
+    0, 0 },
+  { "*ars_invisible", FIELD_s, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER | XTENSA_OPERAND_IS_INVISIBLE,
+    Operand_ars_encode, Operand_ars_decode,
+    0, 0 },
+  { "art", FIELD_t, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_art_encode, Operand_art_decode,
+    0, 0 },
+  { "ar0", FIELD__ar0, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER | XTENSA_OPERAND_IS_INVISIBLE,
+    Operand_ar0_encode, Operand_ar0_decode,
+    0, 0 },
+  { "ar4", FIELD__ar4, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER | XTENSA_OPERAND_IS_INVISIBLE,
+    Operand_ar4_encode, Operand_ar4_decode,
+    0, 0 },
+  { "ar8", FIELD__ar8, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER | XTENSA_OPERAND_IS_INVISIBLE,
+    Operand_ar8_encode, Operand_ar8_decode,
+    0, 0 },
+  { "ar12", FIELD__ar12, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER | XTENSA_OPERAND_IS_INVISIBLE,
+    Operand_ar12_encode, Operand_ar12_decode,
+    0, 0 },
+  { "ars_entry", FIELD_s, REGFILE_AR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_ars_entry_encode, Operand_ars_entry_decode,
+    0, 0 },
+  { "immrx4", FIELD_r, -1, 0,
+    0,
+    Operand_immrx4_encode, Operand_immrx4_decode,
+    0, 0 },
+  { "lsi4x4", FIELD_r, -1, 0,
+    0,
+    Operand_lsi4x4_encode, Operand_lsi4x4_decode,
+    0, 0 },
+  { "simm7", FIELD_imm7, -1, 0,
+    0,
+    Operand_simm7_encode, Operand_simm7_decode,
+    0, 0 },
+  { "uimm6", FIELD_imm6, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_uimm6_encode, Operand_uimm6_decode,
+    Operand_uimm6_ator, Operand_uimm6_rtoa },
+  { "ai4const", FIELD_t, -1, 0,
+    0,
+    Operand_ai4const_encode, Operand_ai4const_decode,
+    0, 0 },
+  { "b4const", FIELD_r, -1, 0,
+    0,
+    Operand_b4const_encode, Operand_b4const_decode,
+    0, 0 },
+  { "b4constu", FIELD_r, -1, 0,
+    0,
+    Operand_b4constu_encode, Operand_b4constu_decode,
+    0, 0 },
+  { "uimm8", FIELD_imm8, -1, 0,
+    0,
+    Operand_uimm8_encode, Operand_uimm8_decode,
+    0, 0 },
+  { "uimm8x2", FIELD_imm8, -1, 0,
+    0,
+    Operand_uimm8x2_encode, Operand_uimm8x2_decode,
+    0, 0 },
+  { "uimm8x4", FIELD_imm8, -1, 0,
+    0,
+    Operand_uimm8x4_encode, Operand_uimm8x4_decode,
+    0, 0 },
+  { "uimm4x16", FIELD_op2, -1, 0,
+    0,
+    Operand_uimm4x16_encode, Operand_uimm4x16_decode,
+    0, 0 },
+  { "simm8", FIELD_imm8, -1, 0,
+    0,
+    Operand_simm8_encode, Operand_simm8_decode,
+    0, 0 },
+  { "simm8x256", FIELD_imm8, -1, 0,
+    0,
+    Operand_simm8x256_encode, Operand_simm8x256_decode,
+    0, 0 },
+  { "simm12b", FIELD_imm12b, -1, 0,
+    0,
+    Operand_simm12b_encode, Operand_simm12b_decode,
+    0, 0 },
+  { "msalp32", FIELD_sal, -1, 0,
+    0,
+    Operand_msalp32_encode, Operand_msalp32_decode,
+    0, 0 },
+  { "op2p1", FIELD_op2, -1, 0,
+    0,
+    Operand_op2p1_encode, Operand_op2p1_decode,
+    0, 0 },
+  { "label8", FIELD_imm8, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_label8_encode, Operand_label8_decode,
+    Operand_label8_ator, Operand_label8_rtoa },
+  { "ulabel8", FIELD_imm8, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_ulabel8_encode, Operand_ulabel8_decode,
+    Operand_ulabel8_ator, Operand_ulabel8_rtoa },
+  { "label12", FIELD_imm12, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_label12_encode, Operand_label12_decode,
+    Operand_label12_ator, Operand_label12_rtoa },
+  { "soffset", FIELD_offset, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_soffset_encode, Operand_soffset_decode,
+    Operand_soffset_ator, Operand_soffset_rtoa },
+  { "uimm16x4", FIELD_imm16, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_uimm16x4_encode, Operand_uimm16x4_decode,
+    Operand_uimm16x4_ator, Operand_uimm16x4_rtoa },
+  { "immt", FIELD_t, -1, 0,
+    0,
+    Operand_immt_encode, Operand_immt_decode,
+    0, 0 },
+  { "imms", FIELD_s, -1, 0,
+    0,
+    Operand_imms_encode, Operand_imms_decode,
+    0, 0 },
+  { "bt", FIELD_t, REGFILE_BR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bt_encode, Operand_bt_decode,
+    0, 0 },
+  { "bs", FIELD_s, REGFILE_BR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bs_encode, Operand_bs_decode,
+    0, 0 },
+  { "br", FIELD_r, REGFILE_BR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_br_encode, Operand_br_decode,
+    0, 0 },
+  { "bt2", FIELD_t2, REGFILE_BR, 2,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bt2_encode, Operand_bt2_decode,
+    0, 0 },
+  { "bs2", FIELD_s2, REGFILE_BR, 2,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bs2_encode, Operand_bs2_decode,
+    0, 0 },
+  { "br2", FIELD_r2, REGFILE_BR, 2,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_br2_encode, Operand_br2_decode,
+    0, 0 },
+  { "bt4", FIELD_t4, REGFILE_BR, 4,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bt4_encode, Operand_bt4_decode,
+    0, 0 },
+  { "bs4", FIELD_s4, REGFILE_BR, 4,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bs4_encode, Operand_bs4_decode,
+    0, 0 },
+  { "br4", FIELD_r4, REGFILE_BR, 4,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_br4_encode, Operand_br4_decode,
+    0, 0 },
+  { "bt8", FIELD_t8, REGFILE_BR, 8,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bt8_encode, Operand_bt8_decode,
+    0, 0 },
+  { "bs8", FIELD_s8, REGFILE_BR, 8,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bs8_encode, Operand_bs8_decode,
+    0, 0 },
+  { "br8", FIELD_r8, REGFILE_BR, 8,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_br8_encode, Operand_br8_decode,
+    0, 0 },
+  { "bt16", FIELD__bt16, REGFILE_BR, 16,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bt16_encode, Operand_bt16_decode,
+    0, 0 },
+  { "bs16", FIELD__bs16, REGFILE_BR, 16,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_bs16_encode, Operand_bs16_decode,
+    0, 0 },
+  { "br16", FIELD__br16, REGFILE_BR, 16,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_br16_encode, Operand_br16_decode,
+    0, 0 },
+  { "brall", FIELD__brall, REGFILE_BR, 16,
+    XTENSA_OPERAND_IS_REGISTER | XTENSA_OPERAND_IS_INVISIBLE,
+    Operand_brall_encode, Operand_brall_decode,
+    0, 0 },
+  { "tp7", FIELD_t, -1, 0,
+    0,
+    Operand_tp7_encode, Operand_tp7_decode,
+    0, 0 },
+  { "xt_wbr15_label", FIELD_xt_wbr15_imm, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_xt_wbr15_label_encode, Operand_xt_wbr15_label_decode,
+    Operand_xt_wbr15_label_ator, Operand_xt_wbr15_label_rtoa },
+  { "xt_wbr18_label", FIELD_xt_wbr18_imm, -1, 0,
+    XTENSA_OPERAND_IS_PCRELATIVE,
+    Operand_xt_wbr18_label_encode, Operand_xt_wbr18_label_decode,
+    Operand_xt_wbr18_label_ator, Operand_xt_wbr18_label_rtoa },
+  { "cimm8x4", FIELD_fimm8, -1, 0,
+    0,
+    Operand_cimm8x4_encode, Operand_cimm8x4_decode,
+    0, 0 },
+  { "frr", FIELD_r, REGFILE_FR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_frr_encode, Operand_frr_decode,
+    0, 0 },
+  { "frs", FIELD_s, REGFILE_FR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_frs_encode, Operand_frs_decode,
+    0, 0 },
+  { "frt", FIELD_t, REGFILE_FR, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_frt_encode, Operand_frt_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper45_reg", FIELD_dsp340050b49a6c_fld2045, REGFILE_CM, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_dsp340050b49a6c_oper45_reg_encode, Operand_dsp340050b49a6c_oper45_reg_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper46_reg", FIELD_dsp340050b49a6c_fld2046, REGFILE_CM, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_dsp340050b49a6c_oper46_reg_encode, Operand_dsp340050b49a6c_oper46_reg_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper47_reg", FIELD_dsp340050b49a6c_fld2029, REGFILE_CM, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_dsp340050b49a6c_oper47_reg_encode, Operand_dsp340050b49a6c_oper47_reg_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper48_imm", FIELD_dsp340050b49a6c_fld2047, -1, 0,
+    0,
+    Operand_dsp340050b49a6c_oper48_imm_encode, Operand_dsp340050b49a6c_oper48_imm_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper49_imm", FIELD_dsp340050b49a6c_fld2025, -1, 0,
+    0,
+    Operand_dsp340050b49a6c_oper49_imm_encode, Operand_dsp340050b49a6c_oper49_imm_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper50_reg", FIELD_dsp340050b49a6c_fld2026, REGFILE_CM, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_dsp340050b49a6c_oper50_reg_encode, Operand_dsp340050b49a6c_oper50_reg_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper51_reg", FIELD_dsp340050b49a6c_fld2048, REGFILE_ACU, 1,
+    XTENSA_OPERAND_IS_REGISTER,
+    Operand_dsp340050b49a6c_oper51_reg_encode, Operand_dsp340050b49a6c_oper51_reg_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper52_imm", FIELD_dsp340050b49a6c_fld2049, -1, 0,
+    0,
+    Operand_dsp340050b49a6c_oper52_imm_encode, Operand_dsp340050b49a6c_oper52_imm_decode,
+    0, 0 },
+  { "dsp340050b49a6c_oper53_reg", FIELD_dsp340050b49a6c_fld2027, REGFILE_CM, 1,
+    XTENSA_OPERAND_IS_REGISTER,
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+
+static xtensa_arg_internal Iclass_xt_iclass_xsr_ccount_args[] = {
+  { { OPERAND_art }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_xsr_ccount_stateArgs[] = {
+  { { STATE_XTSYNC }, 'o' },
+  { { STATE_CCOUNT }, 'm' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_rsr_ccompare0_args[] = {
+  { { OPERAND_art }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_rsr_ccompare0_stateArgs[] = {
+  { { STATE_CCOMPARE0 }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_wsr_ccompare0_args[] = {
+  { { OPERAND_art }, 'i' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_wsr_ccompare0_stateArgs[] = {
+  { { STATE_CCOMPARE0 }, 'o' },
+  { { STATE_INTERRUPT }, 'm' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_xsr_ccompare0_args[] = {
+  { { OPERAND_art }, 'm' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_xsr_ccompare0_stateArgs[] = {
+  { { STATE_CCOMPARE0 }, 'm' },
+  { { STATE_INTERRUPT }, 'm' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_rsr_ccompare1_args[] = {
+  { { OPERAND_art }, 'o' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_rsr_ccompare1_stateArgs[] = {
+  { { STATE_CCOMPARE1 }, 'i' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_wsr_ccompare1_args[] = {
+  { { OPERAND_art }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_wsr_ccompare1_stateArgs[] = {
+  { { STATE_CCOMPARE1 }, 'o' },
+  { { STATE_INTERRUPT }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_xsr_ccompare1_args[] = {
+  { { OPERAND_art }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_xsr_ccompare1_stateArgs[] = {
+  { { STATE_CCOMPARE1 }, 'm' },
+  { { STATE_INTERRUPT }, 'm' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_icache_args[] = {
+  { { OPERAND_ars }, 'i' },
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+static xtensa_arg_internal Iclass_xt_iclass_sicx_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_dcache_args[] = {
+  { { OPERAND_ars }, 'i' },
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+static xtensa_arg_internal Iclass_xt_iclass_dcache_ind_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_dcache_inv_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_dcache_lock_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_sdct_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_ldct_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_rdtlb_args[] = {
+  { { OPERAND_art }, 'o' },
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+static xtensa_arg_internal Iclass_xt_iclass_wdtlb_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_wdtlb_stateArgs[] = {
+  { { STATE_XTSYNC }, 'o' }
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+static xtensa_arg_internal Iclass_xt_iclass_ritlb_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_witlb_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_rsr_cpenable_stateArgs[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_wsr_cpenable_args[] = {
+  { { OPERAND_art }, 'i' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_wsr_cpenable_stateArgs[] = {
+  { { STATE_CPENABLE }, 'o' }
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+static xtensa_arg_internal Iclass_xt_iclass_xsr_cpenable_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_xsr_cpenable_stateArgs[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_clamp_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_s32c1i_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_s32c1i_stateArgs[] = {
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+  { { STATE_SCOMPARE1 }, 'i' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_rsr_scompare1_args[] = {
+  { { OPERAND_art }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_rsr_scompare1_stateArgs[] = {
+  { { STATE_SCOMPARE1 }, 'i' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_wsr_scompare1_args[] = {
+  { { OPERAND_art }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_xt_iclass_wsr_scompare1_stateArgs[] = {
+  { { STATE_SCOMPARE1 }, 'o' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_xsr_scompare1_args[] = {
+  { { OPERAND_art }, 'm' }
+};
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+static xtensa_arg_internal Iclass_xt_iclass_xsr_scompare1_stateArgs[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_rsr_atomctl_args[] = {
+  { { OPERAND_art }, 'o' }
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+static xtensa_arg_internal Iclass_xt_iclass_rsr_atomctl_stateArgs[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_wsr_atomctl_args[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_wsr_atomctl_stateArgs[] = {
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+static xtensa_arg_internal Iclass_xt_iclass_xsr_atomctl_args[] = {
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+
+static xtensa_arg_internal Iclass_xt_iclass_xsr_atomctl_stateArgs[] = {
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+static xtensa_arg_internal Iclass_rur_fcr_args[] = {
+  { { OPERAND_arr }, 'o' }
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+static xtensa_arg_internal Iclass_rur_fcr_stateArgs[] = {
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+static xtensa_arg_internal Iclass_wur_fcr_args[] = {
+  { { OPERAND_art }, 'i' }
+};
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+static xtensa_arg_internal Iclass_wur_fcr_stateArgs[] = {
+  { { STATE_RoundMode }, 'o' },
+  { { STATE_InvalidEnable }, 'o' },
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+  { { STATE_OverflowEnable }, 'o' },
+  { { STATE_UnderflowEnable }, 'o' },
+  { { STATE_InexactEnable }, 'o' },
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+  { { STATE_FPreserved5 }, 'o' },
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+};
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+static xtensa_arg_internal Iclass_rur_fsr_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
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+static xtensa_arg_internal Iclass_rur_fsr_stateArgs[] = {
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+
+static xtensa_arg_internal Iclass_wur_fsr_args[] = {
+  { { OPERAND_art }, 'i' }
+};
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+static xtensa_arg_internal Iclass_wur_fsr_stateArgs[] = {
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+};
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+static xtensa_arg_internal Iclass_fp_args[] = {
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+static xtensa_arg_internal Iclass_fp_stateArgs[] = {
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+};
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+static xtensa_arg_internal Iclass_fp_mac_args[] = {
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+  { { OPERAND_frs }, 'i' },
+  { { OPERAND_frt }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_fp_mac_stateArgs[] = {
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+};
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+static xtensa_arg_internal Iclass_fp_cmov_args[] = {
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+static xtensa_arg_internal Iclass_fp_cmov_stateArgs[] = {
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+};
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+static xtensa_arg_internal Iclass_fp_mov_args[] = {
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+static xtensa_arg_internal Iclass_fp_mov_stateArgs[] = {
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+};
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+static xtensa_arg_internal Iclass_fp_mov2_args[] = {
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+static xtensa_arg_internal Iclass_fp_mov2_stateArgs[] = {
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+static xtensa_arg_internal Iclass_fp_cmp_args[] = {
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+static xtensa_arg_internal Iclass_fp_float_args[] = {
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+static xtensa_arg_internal Iclass_fp_int_args[] = {
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+static xtensa_arg_internal Iclass_fp_lsi_args[] = {
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+};
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+static xtensa_arg_internal Iclass_fp_lsiu_args[] = {
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+static xtensa_arg_internal Iclass_fp_lsiu_stateArgs[] = {
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+static xtensa_arg_internal Iclass_fp_lsx_args[] = {
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+static xtensa_arg_internal Iclass_fp_lsxu_args[] = {
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+static xtensa_arg_internal Iclass_fp_ssiu_args[] = {
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+static xtensa_arg_internal Iclass_fp_ssx_args[] = {
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+  { { OPERAND_art }, 'i' }
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+static xtensa_arg_internal Iclass_fp_ssxu_args[] = {
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+static xtensa_arg_internal Iclass_fp_ssxu_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_ARGMAX_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
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+static xtensa_arg_internal Iclass_iclass_GET_ARGMAX_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_HSAR_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
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+static xtensa_arg_internal Iclass_iclass_GET_HSAR_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_HSAR2SAR_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_GET_HSAR2SAR_stateArgs[] = {
+  { { STATE_SAR3 }, 'o' },
+  { { STATE_SAR2 }, 'o' },
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+  { { STATE_HSAR3 }, 'i' },
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+static xtensa_arg_internal Iclass_iclass_GET_INTERP_EXT_N_args[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_INTERP_EXT_N_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_INTERP_EXT_L_args[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_INTERP_EXT_L_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_LLR_BUF_args[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_LLR_BUF_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_LLR_POS_args[] = {
+  { { OPERAND_arr }, 'o' }
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+static xtensa_arg_internal Iclass_iclass_GET_LLR_POS_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_MAX_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_GET_MAX_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_GET_NCO_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
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+static xtensa_arg_internal Iclass_iclass_GET_NCO_stateArgs[] = {
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+  { { STATE_CPENABLE }, 'i' }
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+static xtensa_arg_internal Iclass_iclass_GET_PERM_REG_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_GET_PERM_REG_stateArgs[] = {
+  { { STATE_PERM_REG }, 'i' },
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+};
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+static xtensa_arg_internal Iclass_iclass_GET_PHASOR_N_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_GET_PHASOR_N_stateArgs[] = {
+  { { STATE_PHASOR_N }, 'i' },
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+static xtensa_arg_internal Iclass_iclass_GET_PHASOR_OFFSET_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_SAC32_R_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
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+static xtensa_arg_internal Iclass_iclass_SAC_IH_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'i' },
+  { { OPERAND_ars }, 'i' },
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+
+static xtensa_arg_internal Iclass_iclass_MOVAC_I_args[] = {
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+static xtensa_arg_internal Iclass_iclass_MOVAC_I2R_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_MOVAC_R2I_stateArgs[] = {
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+  { { STATE_CPENABLE }, 'i' }
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+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'm' }
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+
+static xtensa_arg_internal Iclass_iclass_MACXP_1_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_MACXP_2_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper50_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'i' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_MACXP_2_stateArgs[] = {
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+
+static xtensa_arg_internal Iclass_iclass_MACXP_3_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_MOV2AC_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_MPYXP_3_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_NORMACPQ_I_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_NORMACPQ_R_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_NORMD_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_RCMAC_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_RFIRA_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
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+static xtensa_arg_internal Iclass_iclass_RFIRD_args[] = {
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+static xtensa_arg_internal Iclass_iclass_RFIRD_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_RFIRDA_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_RMPY_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_SMOD_ALIGN_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper63_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper50_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper78_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SMOD_ALIGN_stateArgs[] = {
+  { { STATE_SMOD_BUF }, 'm' },
+  { { STATE_SMOD_POS }, 'm' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SMOD_SCR_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper66_reg }, 'i' },
+  { { OPERAND_ars }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SMOD_SCR_stateArgs[] = {
+  { { STATE_PERM_REG }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SUB2AC_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper50_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper52_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SUB2AC_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAR0 }, 'i' },
+  { { STATE_SAR1 }, 'i' },
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+  { { STATE_SAR3 }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_WGHT32_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper65_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper50_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper62_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_WGHT32_stateArgs[] = {
+  { { STATE_WEIGHT_REG }, 'i' },
+  { { STATE_SCALE_REG }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_CLRTIEP_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper61_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_CLRTIEP_stateArgs[] = {
+  { { STATE_EXPSTATE }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_0_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'i' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_0_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_2FIFO_0_intfArgs[] = {
+  INTERFACE_OUTQ0_128
+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_1_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_1_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_2FIFO_1_intfArgs[] = {
+  INTERFACE_OUTQ1_128
+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_2_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_2_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_2FIFO_2_intfArgs[] = {
+  INTERFACE_OUTQ2_128
+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_3_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_2FIFO_3_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_2FIFO_3_intfArgs[] = {
+  INTERFACE_OUTQ3_128
+};
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+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_0_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_0_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_R2FIFO_0_intfArgs[] = {
+  INTERFACE_OUTQ0_128
+};
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+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_1_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_1_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_R2FIFO_1_intfArgs[] = {
+  INTERFACE_OUTQ1_128
+};
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+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_2_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
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+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_2_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_R2FIFO_2_intfArgs[] = {
+  INTERFACE_OUTQ2_128
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+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_3_args[] = {
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+};
+
+static xtensa_arg_internal Iclass_iclass_EXT_R2FIFO_3_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_EXT_R2FIFO_3_intfArgs[] = {
+  INTERFACE_OUTQ3_128
+};
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+static xtensa_arg_internal Iclass_iclass_LUT_args[] = {
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+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
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+static xtensa_interface Iclass_iclass_LUT_intfArgs[] = {
+  INTERFACE_LU128_Out,
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+};
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+static xtensa_arg_internal Iclass_iclass_LUT_AR_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_AR_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_LUT_AR_intfArgs[] = {
+  INTERFACE_LU128_Out,
+  INTERFACE_LU128_In
+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_IEXT_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_IEXT_stateArgs[] = {
+  { { STATE_INTERP_EXT_L }, 'i' },
+  { { STATE_INTERP_EXT_N }, 'i' },
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+};
+
+static xtensa_interface Iclass_iclass_LUT_IEXT_intfArgs[] = {
+  INTERFACE_LU128_Out,
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+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_PHASOR_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_PHASOR_stateArgs[] = {
+  { { STATE_PHASOR_N }, 'i' },
+  { { STATE_PHASOR_OFFSET }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_LUT_PHASOR_intfArgs[] = {
+  INTERFACE_LU128_Out,
+  INTERFACE_LU128_In
+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_REXT_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_REXT_stateArgs[] = {
+  { { STATE_INTERP_EXT_L }, 'i' },
+  { { STATE_INTERP_EXT_N }, 'i' },
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+};
+
+static xtensa_interface Iclass_iclass_LUT_REXT_intfArgs[] = {
+  INTERFACE_LU128_Out,
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+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_WRITE_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_LUT_WRITE_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_LUT_WRITE_intfArgs[] = {
+  INTERFACE_LU128_Out,
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+};
+
+static xtensa_interface Iclass_iclass_MOVEQ128_0_intfArgs[] = {
+  INTERFACE_OUTQ0_128,
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+
+static xtensa_interface Iclass_iclass_MOVEQ128_1_intfArgs[] = {
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+static xtensa_interface Iclass_iclass_MOVEQ128_2_intfArgs[] = {
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+static xtensa_interface Iclass_iclass_MOVEQ128_3_intfArgs[] = {
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+static xtensa_interface Iclass_iclass_MOVEQ128_4_intfArgs[] = {
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+static xtensa_interface Iclass_iclass_MOVEQ128_5_intfArgs[] = {
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+  INTERFACE_INQ5_128
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+
+static xtensa_interface Iclass_iclass_MOVEQ32_0_intfArgs[] = {
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+  INTERFACE_INQ0_32
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+
+static xtensa_interface Iclass_iclass_MOVEQ32_1_intfArgs[] = {
+  INTERFACE_OUTQ1_32,
+  INTERFACE_INQ1_32
+};
+
+static xtensa_interface Iclass_iclass_MOVEQ32_2_intfArgs[] = {
+  INTERFACE_OUTQ2_32,
+  INTERFACE_INQ2_32
+};
+
+static xtensa_interface Iclass_iclass_MOVEQ32_3_intfArgs[] = {
+  INTERFACE_OUTQ3_32,
+  INTERFACE_INQ3_32
+};
+
+static xtensa_arg_internal Iclass_iclass_NCO_UPDATE_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_NCO_UPDATE_stateArgs[] = {
+  { { STATE_NCO_COUNTER }, 'm' },
+  { { STATE_PHASOR_N }, 'i' },
+  { { STATE_PHASOR_OFFSET }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_NCO_UPDATE_intfArgs[] = {
+  INTERFACE_LU128_Out,
+  INTERFACE_LU128_In
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_0_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_0_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_0_intfArgs[] = {
+  INTERFACE_INQ0_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_1_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_1_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_1_intfArgs[] = {
+  INTERFACE_INQ1_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2_intfArgs[] = {
+  INTERFACE_INQ2_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_3_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_3_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_3_intfArgs[] = {
+  INTERFACE_INQ3_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_4_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_4_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_4_intfArgs[] = {
+  INTERFACE_INQ4_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_5_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_5_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_5_intfArgs[] = {
+  INTERFACE_INQ5_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_0_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_0_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2CMPQ_0_intfArgs[] = {
+  INTERFACE_INQ0_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_1_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_1_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2CMPQ_1_intfArgs[] = {
+  INTERFACE_INQ1_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_2_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_2_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2CMPQ_2_intfArgs[] = {
+  INTERFACE_INQ2_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_3_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2CMPQ_3_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2CMPQ_3_intfArgs[] = {
+  INTERFACE_INQ3_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2M_0_args[] = {
+  { { OPERAND_ars }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper83_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2M_0_intfArgs[] = {
+  INTERFACE_INQ0_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2M_1_args[] = {
+  { { OPERAND_ars }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper83_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2M_1_intfArgs[] = {
+  INTERFACE_INQ1_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2M_2_args[] = {
+  { { OPERAND_ars }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper83_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2M_2_intfArgs[] = {
+  INTERFACE_INQ2_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2M_3_args[] = {
+  { { OPERAND_ars }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper83_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2M_3_intfArgs[] = {
+  INTERFACE_INQ3_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_0_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
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+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_0_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2PQ_0_intfArgs[] = {
+  INTERFACE_INQ0_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_1_args[] = {
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+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_1_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2PQ_1_intfArgs[] = {
+  INTERFACE_INQ1_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_2_args[] = {
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+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_2_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2PQ_2_intfArgs[] = {
+  INTERFACE_INQ2_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_3_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_3_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2PQ_3_intfArgs[] = {
+  INTERFACE_INQ3_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_4_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_4_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2PQ_4_intfArgs[] = {
+  INTERFACE_INQ4_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_5_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP128_2PQ_5_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP128_2PQ_5_intfArgs[] = {
+  INTERFACE_INQ5_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_01_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper65_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_01_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP2X128_2PQ_01_intfArgs[] = {
+  INTERFACE_INQ0_128,
+  INTERFACE_INQ1_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_03_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper65_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_03_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP2X128_2PQ_03_intfArgs[] = {
+  INTERFACE_INQ0_128,
+  INTERFACE_INQ3_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_21_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper65_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_21_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP2X128_2PQ_21_intfArgs[] = {
+  INTERFACE_INQ2_128,
+  INTERFACE_INQ1_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_23_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper65_reg }, 'o' }
+};
+
+static xtensa_arg_internal Iclass_iclass_POP2X128_2PQ_23_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_POP2X128_2PQ_23_intfArgs[] = {
+  INTERFACE_INQ2_128,
+  INTERFACE_INQ3_128
+};
+
+static xtensa_arg_internal Iclass_iclass_POP32_0_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
+
+static xtensa_interface Iclass_iclass_POP32_0_intfArgs[] = {
+  INTERFACE_INQ0_32
+};
+
+static xtensa_arg_internal Iclass_iclass_POP32_1_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
+
+static xtensa_interface Iclass_iclass_POP32_1_intfArgs[] = {
+  INTERFACE_INQ1_32
+};
+
+static xtensa_arg_internal Iclass_iclass_POP32_2_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
+
+static xtensa_interface Iclass_iclass_POP32_2_intfArgs[] = {
+  INTERFACE_INQ2_32
+};
+
+static xtensa_arg_internal Iclass_iclass_POP32_3_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
+
+static xtensa_interface Iclass_iclass_POP32_3_intfArgs[] = {
+  INTERFACE_INQ3_32
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH128_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper78_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH128_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_PUSH128_intfArgs[] = {
+  INTERFACE_OUTQ0_128,
+  INTERFACE_OUTQ0_128_KILL,
+  INTERFACE_OUTQ1_128,
+  INTERFACE_OUTQ1_128_KILL,
+  INTERFACE_OUTQ2_128,
+  INTERFACE_OUTQ2_128_KILL,
+  INTERFACE_OUTQ3_128,
+  INTERFACE_OUTQ3_128_KILL,
+  INTERFACE_OUTQ4_128,
+  INTERFACE_OUTQ4_128_KILL,
+  INTERFACE_OUTQ5_128,
+  INTERFACE_OUTQ5_128_KILL
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH128_M_args[] = {
+  { { OPERAND_ars }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper52_imm }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper83_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_PUSH128_M_intfArgs[] = {
+  INTERFACE_OUTQ0_128,
+  INTERFACE_OUTQ0_128_KILL,
+  INTERFACE_OUTQ1_128,
+  INTERFACE_OUTQ1_128_KILL,
+  INTERFACE_OUTQ2_128,
+  INTERFACE_OUTQ2_128_KILL,
+  INTERFACE_OUTQ3_128,
+  INTERFACE_OUTQ3_128_KILL
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH128_PQ_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper78_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH128_PQ_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_PUSH128_PQ_intfArgs[] = {
+  INTERFACE_OUTQ0_128,
+  INTERFACE_OUTQ0_128_KILL,
+  INTERFACE_OUTQ1_128,
+  INTERFACE_OUTQ1_128_KILL,
+  INTERFACE_OUTQ2_128,
+  INTERFACE_OUTQ2_128_KILL,
+  INTERFACE_OUTQ3_128,
+  INTERFACE_OUTQ3_128_KILL,
+  INTERFACE_OUTQ4_128,
+  INTERFACE_OUTQ4_128_KILL,
+  INTERFACE_OUTQ5_128,
+  INTERFACE_OUTQ5_128_KILL
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH2X128_PQ_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper56_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper57_imm }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH2X128_PQ_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_PUSH2X128_PQ_intfArgs[] = {
+  INTERFACE_OUTQ0_128,
+  INTERFACE_OUTQ1_128,
+  INTERFACE_OUTQ2_128,
+  INTERFACE_OUTQ3_128,
+  INTERFACE_OUTQ0_128_KILL,
+  INTERFACE_OUTQ1_128_KILL,
+  INTERFACE_OUTQ2_128_KILL,
+  INTERFACE_OUTQ3_128_KILL
+};
+
+static xtensa_arg_internal Iclass_iclass_PUSH32_args[] = {
+  { { OPERAND_ars }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper59_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_PUSH32_intfArgs[] = {
+  INTERFACE_OUTQ0_32,
+  INTERFACE_OUTQ0_32_KILL,
+  INTERFACE_OUTQ1_32,
+  INTERFACE_OUTQ1_32_KILL,
+  INTERFACE_OUTQ2_32,
+  INTERFACE_OUTQ2_32_KILL,
+  INTERFACE_OUTQ3_32,
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+  INTERFACE_OUTQ4_32,
+  INTERFACE_OUTQ4_32_KILL,
+  INTERFACE_OUTQ5_32,
+  INTERFACE_OUTQ5_32_KILL
+};
+
+static xtensa_arg_internal Iclass_iclass_QREADY_args[] = {
+  { { OPERAND_arr }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper61_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_QREADY_intfArgs[] = {
+  INTERFACE_INQ0_32_NOTRDY,
+  INTERFACE_INQ1_32_NOTRDY,
+  INTERFACE_INQ2_32_NOTRDY,
+  INTERFACE_INQ3_32_NOTRDY,
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+  INTERFACE_OUTQ1_32_NOTRDY,
+  INTERFACE_OUTQ2_32_NOTRDY,
+  INTERFACE_OUTQ3_32_NOTRDY,
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+  INTERFACE_OUTQ5_32_NOTRDY,
+  INTERFACE_INQ0_128_NOTRDY,
+  INTERFACE_INQ1_128_NOTRDY,
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+  INTERFACE_INQ5_128_NOTRDY,
+  INTERFACE_OUTQ0_128_NOTRDY,
+  INTERFACE_OUTQ1_128_NOTRDY,
+  INTERFACE_OUTQ2_128_NOTRDY,
+  INTERFACE_OUTQ3_128_NOTRDY,
+  INTERFACE_OUTQ4_128_NOTRDY,
+  INTERFACE_OUTQ5_128_NOTRDY,
+  INTERFACE_SIGNALQ_NOTRDY
+};
+
+static xtensa_arg_internal Iclass_iclass_RDTIEP_args[] = {
+  { { OPERAND_arr }, 'o' }
+};
+
+static xtensa_interface Iclass_iclass_RDTIEP_intfArgs[] = {
+  INTERFACE_IMPWIRE
+};
+
+static xtensa_arg_internal Iclass_iclass_SETTIEP_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper61_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SETTIEP_stateArgs[] = {
+  { { STATE_EXPSTATE }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SMOD_LUT_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper78_imm }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper57_imm }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_SMOD_LUT_stateArgs[] = {
+  { { STATE_SMOD_OFFSET_TABLE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_SMOD_LUT_intfArgs[] = {
+  INTERFACE_LU128_Out,
+  INTERFACE_LU128_In
+};
+
+static xtensa_arg_internal Iclass_iclass_WRTBSIGQ_args[] = {
+  { { OPERAND_ars }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_WRTBSIGQ_intfArgs[] = {
+  INTERFACE_SIGNALQ
+};
+
+static xtensa_arg_internal Iclass_iclass_WRTBSIGQM_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper61_imm }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_WRTBSIGQM_intfArgs[] = {
+  INTERFACE_SIGNALQ
+};
+
+static xtensa_arg_internal Iclass_iclass_WRTIEP_args[] = {
+  { { OPERAND_art }, 'i' },
+  { { OPERAND_ars }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_WRTIEP_stateArgs[] = {
+  { { STATE_EXPSTATE }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_iclass_WRTSIGQ_args[] = {
+  { { OPERAND_ars }, 'i' }
+};
+
+static xtensa_interface Iclass_iclass_WRTSIGQ_intfArgs[] = {
+  INTERFACE_SIGNALQ
+};
+
+static xtensa_arg_internal Iclass_iclass_ABS8_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ABS8_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADD16_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper47_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper48_imm }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper49_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADD16_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADD32_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper53_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADD32_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDAC_I2R_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDAC_I2R_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDAC_R2I_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDAC_R2I_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDAR2_args[] = {
+  { { OPERAND_ars }, 'm' },
+  { { OPERAND_art }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDCM_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper53_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDCM_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDWRP_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper55_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ADDWRP_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_AND128_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper55_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_AND128_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ARGMAX8_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper53_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ARGMAX8_stateArgs[] = {
+  { { STATE_MAX_REG }, 'm' },
+  { { STATE_ARG_MAX_REG }, 'm' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASL_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper53_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASL_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASL32_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper47_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper55_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASL32_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASLACM_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper58_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASLACM_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASLM_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper59_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASLM_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASLM32_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper58_imm }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASLM32_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASR_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper53_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASR_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASR32_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper47_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper55_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASR32_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASRAC_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'm' },
+  { { OPERAND_dsp340050b49a6c_oper55_reg }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASRAC_stateArgs[] = {
+  { { STATE_SOV }, 'm' },
+  { { STATE_SAT_MODE }, 'i' },
+  { { STATE_CPENABLE }, 'i' }
+};
+
+static xtensa_arg_internal Iclass_iclass_ASRM_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper45_reg }, 'o' },
+  { { OPERAND_dsp340050b49a6c_oper46_reg }, 'i' },
+  { { OPERAND_dsp340050b49a6c_oper59_imm }, 'i' }
+};
+
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+static xtensa_arg_internal Iclass_iclass_BITFINS_args[] = {
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+static xtensa_arg_internal Iclass_iclass_MIN8_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_MINCLB_R_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_OR128_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_PERM_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_REDAC_args[] = {
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+static xtensa_arg_internal Iclass_iclass_REDAC_stateArgs[] = {
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+
+static xtensa_arg_internal Iclass_iclass_REDAC2_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_REDAC4_args[] = {
+  { { OPERAND_dsp340050b49a6c_oper51_reg }, 'm' }
+};
+
+static xtensa_arg_internal Iclass_iclass_REDAC4_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_REDACS_args[] = {
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+
+static xtensa_arg_internal Iclass_iclass_REDACS_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_SMINCLB_C_args[] = {
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+static xtensa_arg_internal Iclass_iclass_SMINCLB_C_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_SMINCLB_R_args[] = {
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+};
+
+static xtensa_arg_internal Iclass_iclass_SMINCLB_R_stateArgs[] = {
+  { { STATE_HSAR3 }, 'o' },
+  { { STATE_HSAR2 }, 'o' },
+  { { STATE_HSAR1 }, 'o' },
+  { { STATE_HSAR0 }, 'o' },
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+static xtensa_arg_internal Iclass_iclass_STSWAPBM_args[] = {
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+static xtensa_arg_internal Iclass_iclass_STSWAPBMU_args[] = {
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+static xtensa_arg_internal Iclass_iclass_SUB32_args[] = {
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+static xtensa_arg_internal Iclass_iclass_SUBAC_I2R_args[] = {
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+
+static xtensa_arg_internal Iclass_iclass_SUBAC_I2R_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_SUBAC_R2I_args[] = {
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+static xtensa_arg_internal Iclass_iclass_SUBAC_R2I_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_SUBARX_args[] = {
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+static xtensa_arg_internal Iclass_iclass_SUBCM_stateArgs[] = {
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+static xtensa_arg_internal Iclass_iclass_SUBMEAN_stateArgs[] = {
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+};
+
+static xtensa_arg_internal Iclass_iclass_SUBWRP_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
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+static xtensa_arg_internal Iclass_iclass_TRANS_args[] = {
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+static xtensa_arg_internal Iclass_iclass_TRANS_stateArgs[] = {
+  { { STATE_CPENABLE }, 'i' }
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+static xtensa_arg_internal Iclass_iclass_XOR128_args[] = {
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+static xtensa_arg_internal Iclass_iclass_XOR128_stateArgs[] = {
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+static xtensa_arg_internal Iclass_rur_expstate_args[] = {
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+static xtensa_arg_internal Iclass_wur_expstate_stateArgs[] = {
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+static xtensa_arg_internal Iclass_wur_sov_stateArgs[] = {
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+static xtensa_arg_internal Iclass_rur_sat_mode_stateArgs[] = {
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+static xtensa_arg_internal Iclass_rur_sar2_stateArgs[] = {
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+  { 1, Iclass_xt_iclass_rsr_icount_args,
+    1, Iclass_xt_iclass_rsr_icount_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_icount_args,
+    2, Iclass_xt_iclass_wsr_icount_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_icount_args,
+    2, Iclass_xt_iclass_xsr_icount_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_icountlevel_args,
+    1, Iclass_xt_iclass_rsr_icountlevel_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_icountlevel_args,
+    1, Iclass_xt_iclass_wsr_icountlevel_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_icountlevel_args,
+    1, Iclass_xt_iclass_xsr_icountlevel_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_ddr_args,
+    1, Iclass_xt_iclass_rsr_ddr_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_ddr_args,
+    2, Iclass_xt_iclass_wsr_ddr_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_ddr_args,
+    2, Iclass_xt_iclass_xsr_ddr_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_rfdo_args,
+    9, Iclass_xt_iclass_rfdo_stateArgs, 0, 0 },
+  { 0, 0 /* xt_iclass_rfdd */,
+    1, Iclass_xt_iclass_rfdd_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_mmid_args,
+    1, Iclass_xt_iclass_wsr_mmid_stateArgs, 0, 0 },
+  { 3, Iclass_xt_iclass_bbool1_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_bbool4_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_bbool8_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_bbranch_args,
+    0, 0, 0, 0 },
+  { 3, Iclass_xt_iclass_bmove_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_RSR_BR_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_WSR_BR_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_XSR_BR_args,
+    0, 0, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_ccount_args,
+    1, Iclass_xt_iclass_rsr_ccount_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_ccount_args,
+    2, Iclass_xt_iclass_wsr_ccount_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_ccount_args,
+    2, Iclass_xt_iclass_xsr_ccount_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_ccompare0_args,
+    1, Iclass_xt_iclass_rsr_ccompare0_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_ccompare0_args,
+    2, Iclass_xt_iclass_wsr_ccompare0_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_ccompare0_args,
+    2, Iclass_xt_iclass_xsr_ccompare0_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_ccompare1_args,
+    1, Iclass_xt_iclass_rsr_ccompare1_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_ccompare1_args,
+    2, Iclass_xt_iclass_wsr_ccompare1_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_ccompare1_args,
+    2, Iclass_xt_iclass_xsr_ccompare1_stateArgs, 0, 0 },
+  { 2, Iclass_xt_iclass_icache_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_icache_lock_args,
+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_licx_args,
+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_dcache_inv_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_dpf_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_dcache_lock_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_sdct_args,
+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
+  { 1, Iclass_xt_iclass_idtlb_args,
+    1, Iclass_xt_iclass_idtlb_stateArgs, 0, 0 },
+  { 2, Iclass_xt_iclass_rdtlb_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_wdtlb_args,
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+  { 1, Iclass_xt_iclass_iitlb_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_ritlb_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_witlb_args,
+    0, 0, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_cpenable_args,
+    1, Iclass_xt_iclass_rsr_cpenable_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_cpenable_args,
+    1, Iclass_xt_iclass_wsr_cpenable_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_cpenable_args,
+    1, Iclass_xt_iclass_xsr_cpenable_stateArgs, 0, 0 },
+  { 3, Iclass_xt_iclass_clamp_args,
+    0, 0, 0, 0 },
+  { 3, Iclass_xt_iclass_minmax_args,
+    0, 0, 0, 0 },
+  { 2, Iclass_xt_iclass_nsa_args,
+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
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+    0, 0, 0, 0 },
+  { 3, Iclass_xt_iclass_s32c1i_args,
+    3, Iclass_xt_iclass_s32c1i_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_scompare1_args,
+    1, Iclass_xt_iclass_rsr_scompare1_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_scompare1_args,
+    1, Iclass_xt_iclass_wsr_scompare1_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_scompare1_args,
+    1, Iclass_xt_iclass_xsr_scompare1_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_rsr_atomctl_args,
+    1, Iclass_xt_iclass_rsr_atomctl_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_wsr_atomctl_args,
+    2, Iclass_xt_iclass_wsr_atomctl_stateArgs, 0, 0 },
+  { 1, Iclass_xt_iclass_xsr_atomctl_args,
+    2, Iclass_xt_iclass_xsr_atomctl_stateArgs, 0, 0 },
+  { 0, 0 /* xt_iclass_rer */,
+    0, 0, 0, 0 },
+  { 0, 0 /* xt_iclass_wer */,
+    0, 0, 0, 0 },
+  { 1, Iclass_rur_fcr_args,
+    9, Iclass_rur_fcr_stateArgs, 0, 0 },
+  { 1, Iclass_wur_fcr_args,
+    9, Iclass_wur_fcr_stateArgs, 0, 0 },
+  { 1, Iclass_rur_fsr_args,
+    8, Iclass_rur_fsr_stateArgs, 0, 0 },
+  { 1, Iclass_wur_fsr_args,
+    8, Iclass_wur_fsr_stateArgs, 0, 0 },
+  { 3, Iclass_fp_args,
+    2, Iclass_fp_stateArgs, 0, 0 },
+  { 3, Iclass_fp_mac_args,
+    2, Iclass_fp_mac_stateArgs, 0, 0 },
+  { 3, Iclass_fp_cmov_args,
+    1, Iclass_fp_cmov_stateArgs, 0, 0 },
+  { 3, Iclass_fp_mov_args,
+    1, Iclass_fp_mov_stateArgs, 0, 0 },
+  { 2, Iclass_fp_mov2_args,
+    1, Iclass_fp_mov2_stateArgs, 0, 0 },
+  { 3, Iclass_fp_cmp_args,
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+    1, Iclass_fp_lsiu_stateArgs, 0, 0 },
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+    1, Iclass_fp_lsx_stateArgs, 0, 0 },
+  { 3, Iclass_fp_lsxu_args,
+    1, Iclass_fp_lsxu_stateArgs, 0, 0 },
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+    1, Iclass_fp_ssi_stateArgs, 0, 0 },
+  { 3, Iclass_fp_ssiu_args,
+    1, Iclass_fp_ssiu_stateArgs, 0, 0 },
+  { 3, Iclass_fp_ssx_args,
+    1, Iclass_fp_ssx_stateArgs, 0, 0 },
+  { 3, Iclass_fp_ssxu_args,
+    1, Iclass_fp_ssxu_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_ARGMAX_args,
+    2, Iclass_iclass_GET_ARGMAX_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_HSAR_args,
+    5, Iclass_iclass_GET_HSAR_stateArgs, 0, 0 },
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+  { 1, Iclass_iclass_GET_INTERP_EXT_N_args,
+    2, Iclass_iclass_GET_INTERP_EXT_N_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_INTERP_EXT_L_args,
+    2, Iclass_iclass_GET_INTERP_EXT_L_stateArgs, 0, 0 },
+  { 2, Iclass_iclass_GET_LLR_BUF_args,
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+  { 1, Iclass_iclass_GET_LLR_POS_args,
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+  { 1, Iclass_iclass_GET_MAX_args,
+    2, Iclass_iclass_GET_MAX_stateArgs, 0, 0 },
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+    2, Iclass_iclass_GET_NCO_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_PERM_REG_args,
+    2, Iclass_iclass_GET_PERM_REG_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_PHASOR_N_args,
+    2, Iclass_iclass_GET_PHASOR_N_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_PHASOR_OFFSET_args,
+    2, Iclass_iclass_GET_PHASOR_OFFSET_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_SAR_args,
+    5, Iclass_iclass_GET_SAR_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_SCALE_REG_args,
+    2, Iclass_iclass_GET_SCALE_REG_stateArgs, 0, 0 },
+  { 2, Iclass_iclass_GET_SMOD_BUF_args,
+    2, Iclass_iclass_GET_SMOD_BUF_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_SMOD_OFFSET_TABLE_args,
+    2, Iclass_iclass_GET_SMOD_OFFSET_TABLE_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_SMOD_POS_args,
+    2, Iclass_iclass_GET_SMOD_POS_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_SOV_args,
+    2, Iclass_iclass_GET_SOV_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_GET_WGHT_args,
+    2, Iclass_iclass_GET_WGHT_stateArgs, 0, 0 },
+  { 1, Iclass_iclass_SET_ARGMAX_args,
+    2, Iclass_iclass_SET_ARGMAX_stateArgs, 0, 0 },
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+    2, Iclass_iclass_SET_PERM_REG_stateArgs, 0, 0 },
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+    1, Iclass_iclass_LCM_X_stateArgs, 0, 0 },
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+    1, Iclass_iclass_SCM_U_stateArgs, 0, 0 },
+  { 3, Iclass_iclass_SCM_X_args,
+    1, Iclass_iclass_SCM_X_stateArgs, 0, 0 },
+  { 3, Iclass_iclass_SCM_XU_args,
+    1, Iclass_iclass_SCM_XU_stateArgs, 0, 0 },
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+    1, Iclass_iclass_STORE_Q_stateArgs, 0, 0 },
+  { 2, Iclass_iclass_AR2CM_DUP_args,
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+    1, Iclass_iclass_POP128_2CMPQ_2_stateArgs, 1, Iclass_iclass_POP128_2CMPQ_2_intfArgs },
+  { 3, Iclass_iclass_POP128_2CMPQ_3_args,
+    1, Iclass_iclass_POP128_2CMPQ_3_stateArgs, 1, Iclass_iclass_POP128_2CMPQ_3_intfArgs },
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+  { 2, Iclass_iclass_POP128_2M_1_args,
+    0, 0, 1, Iclass_iclass_POP128_2M_1_intfArgs },
+  { 2, Iclass_iclass_POP128_2M_2_args,
+    0, 0, 1, Iclass_iclass_POP128_2M_2_intfArgs },
+  { 2, Iclass_iclass_POP128_2M_3_args,
+    0, 0, 1, Iclass_iclass_POP128_2M_3_intfArgs },
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+static void
+Opcode_callx8_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe0;
+}
+
+static void
+Opcode_callx4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd0;
+}
+
+static void
+Opcode_entry_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x36;
+}
+
+static void
+Opcode_movsp_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1000;
+}
+
+static void
+Opcode_rotw_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x408000;
+}
+
+static void
+Opcode_retw_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x90;
+}
+
+static void
+Opcode_retw_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf01d;
+}
+
+static void
+Opcode_rfwo_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3400;
+}
+
+static void
+Opcode_rfwu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3500;
+}
+
+static void
+Opcode_l32e_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x90000;
+}
+
+static void
+Opcode_s32e_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x490000;
+}
+
+static void
+Opcode_rsr_windowbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34800;
+}
+
+static void
+Opcode_wsr_windowbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x134800;
+}
+
+static void
+Opcode_xsr_windowbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x614800;
+}
+
+static void
+Opcode_rsr_windowstart_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34900;
+}
+
+static void
+Opcode_wsr_windowstart_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x134900;
+}
+
+static void
+Opcode_xsr_windowstart_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x614900;
+}
+
+static void
+Opcode_add_n_Slot_inst16a_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa;
+}
+
+static void
+Opcode_addi_n_Slot_inst16a_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb;
+}
+
+static void
+Opcode_addi_n_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_addi_n_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30001;
+}
+
+static void
+Opcode_addi_n_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_addi_n_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_addi_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30001;
+}
+
+static void
+Opcode_addi_n_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_addi_n_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30000;
+}
+
+static void
+Opcode_addi_n_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_addi_n_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe0002;
+}
+
+static void
+Opcode_addi_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3f8001;
+}
+
+static void
+Opcode_beqz_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8c;
+}
+
+static void
+Opcode_beqz_n_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13000;
+}
+
+static void
+Opcode_beqz_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13000;
+}
+
+static void
+Opcode_beqz_n_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4f001;
+}
+
+static void
+Opcode_beqz_n_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc05001;
+}
+
+static void
+Opcode_beqz_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d3001;
+}
+
+static void
+Opcode_bnez_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xcc;
+}
+
+static void
+Opcode_bnez_n_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x23000;
+}
+
+static void
+Opcode_bnez_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x23000;
+}
+
+static void
+Opcode_bnez_n_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x52001;
+}
+
+static void
+Opcode_bnez_n_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc09001;
+}
+
+static void
+Opcode_bnez_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e3001;
+}
+
+static void
+Opcode_ill_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf06d;
+}
+
+static void
+Opcode_l32i_n_Slot_inst16a_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8;
+}
+
+static void
+Opcode_l32i_n_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c001;
+}
+
+static void
+Opcode_l32i_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c001;
+}
+
+static void
+Opcode_l32i_n_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c000;
+}
+
+static void
+Opcode_l32i_n_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4001;
+}
+
+static void
+Opcode_l32i_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40c000;
+}
+
+static void
+Opcode_mov_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd;
+}
+
+static void
+Opcode_mov_n_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2ec00;
+}
+
+static void
+Opcode_mov_n_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd400;
+}
+
+static void
+Opcode_mov_n_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd803;
+}
+
+static void
+Opcode_mov_n_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e000;
+}
+
+static void
+Opcode_mov_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd400;
+}
+
+static void
+Opcode_mov_n_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2000;
+}
+
+static void
+Opcode_mov_n_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x53401;
+}
+
+static void
+Opcode_mov_n_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb403;
+}
+
+static void
+Opcode_mov_n_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x601401;
+}
+
+static void
+Opcode_mov_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c6c01;
+}
+
+static void
+Opcode_movi_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc;
+}
+
+static void
+Opcode_movi_n_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c000;
+}
+
+static void
+Opcode_movi_n_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x42002;
+}
+
+static void
+Opcode_movi_n_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc002;
+}
+
+static void
+Opcode_movi_n_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30000;
+}
+
+static void
+Opcode_movi_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x42002;
+}
+
+static void
+Opcode_movi_n_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_movi_n_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x50001;
+}
+
+static void
+Opcode_movi_n_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8003;
+}
+
+static void
+Opcode_movi_n_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x402001;
+}
+
+static void
+Opcode_movi_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x530000;
+}
+
+static void
+Opcode_nop_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf03d;
+}
+
+static void
+Opcode_ret_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf00d;
+}
+
+static void
+Opcode_s32i_n_Slot_inst16a_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9;
+}
+
+static void
+Opcode_s32i_n_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20002;
+}
+
+static void
+Opcode_s32i_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20002;
+}
+
+static void
+Opcode_s32i_n_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40001;
+}
+
+static void
+Opcode_s32i_n_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
+Opcode_s32i_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4a4000;
+}
+
+static void
+Opcode_rur_threadptr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30e70;
+}
+
+static void
+Opcode_wur_threadptr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf3e700;
+}
+
+static void
+Opcode_addi_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc002;
+}
+
+static void
+Opcode_addi_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2001;
+}
+
+static void
+Opcode_addi_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1000;
+}
+
+static void
+Opcode_addmi_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd002;
+}
+
+static void
+Opcode_addmi_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x401;
+}
+
+static void
+Opcode_addmi_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2000;
+}
+
+static void
+Opcode_add_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800000;
+}
+
+static void
+Opcode_add_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_add_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x28001;
+}
+
+static void
+Opcode_add_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_add_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_add_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x28001;
+}
+
+static void
+Opcode_add_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_add_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x28000;
+}
+
+static void
+Opcode_add_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_add_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd0002;
+}
+
+static void
+Opcode_add_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3f0001;
+}
+
+static void
+Opcode_sub_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc00000;
+}
+
+static void
+Opcode_sub_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x24000;
+}
+
+static void
+Opcode_sub_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x48002;
+}
+
+static void
+Opcode_sub_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8001;
+}
+
+static void
+Opcode_sub_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x24000;
+}
+
+static void
+Opcode_sub_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x60002;
+}
+
+static void
+Opcode_sub_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8001;
+}
+
+static void
+Opcode_sub_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c001;
+}
+
+static void
+Opcode_sub_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8002;
+}
+
+static void
+Opcode_sub_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1f0002;
+}
+
+static void
+Opcode_sub_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4ec000;
+}
+
+static void
+Opcode_addx2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x900000;
+}
+
+static void
+Opcode_addx2_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c001;
+}
+
+static void
+Opcode_addx2_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c001;
+}
+
+static void
+Opcode_addx2_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c000;
+}
+
+static void
+Opcode_addx2_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd4002;
+}
+
+static void
+Opcode_addx2_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3fc001;
+}
+
+static void
+Opcode_addx4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa00000;
+}
+
+static void
+Opcode_addx4_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34001;
+}
+
+static void
+Opcode_addx4_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34001;
+}
+
+static void
+Opcode_addx4_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34000;
+}
+
+static void
+Opcode_addx4_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd8002;
+}
+
+static void
+Opcode_addx4_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400000;
+}
+
+static void
+Opcode_addx8_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb00000;
+}
+
+static void
+Opcode_addx8_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x38001;
+}
+
+static void
+Opcode_addx8_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x38001;
+}
+
+static void
+Opcode_addx8_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x38000;
+}
+
+static void
+Opcode_addx8_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xdc002;
+}
+
+static void
+Opcode_addx8_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x404000;
+}
+
+static void
+Opcode_subx2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd00000;
+}
+
+static void
+Opcode_subx2_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x50002;
+}
+
+static void
+Opcode_subx2_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c002;
+}
+
+static void
+Opcode_subx2_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34001;
+}
+
+static void
+Opcode_subx2_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1ec002;
+}
+
+static void
+Opcode_subx2_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4f8000;
+}
+
+static void
+Opcode_subx4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe00000;
+}
+
+static void
+Opcode_subx4_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x60002;
+}
+
+static void
+Opcode_subx4_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x54002;
+}
+
+static void
+Opcode_subx4_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x38001;
+}
+
+static void
+Opcode_subx4_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1f4002;
+}
+
+static void
+Opcode_subx4_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4fc000;
+}
+
+static void
+Opcode_subx8_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf00000;
+}
+
+static void
+Opcode_subx8_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c002;
+}
+
+static void
+Opcode_subx8_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x58002;
+}
+
+static void
+Opcode_subx8_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c001;
+}
+
+static void
+Opcode_subx8_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1f8002;
+}
+
+static void
+Opcode_subx8_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x504000;
+}
+
+static void
+Opcode_and_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100000;
+}
+
+static void
+Opcode_and_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
+Opcode_and_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c001;
+}
+
+static void
+Opcode_and_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_and_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
+Opcode_and_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c001;
+}
+
+static void
+Opcode_and_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c000;
+}
+
+static void
+Opcode_and_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_and_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe4002;
+}
+
+static void
+Opcode_and_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x408000;
+}
+
+static void
+Opcode_or_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200000;
+}
+
+static void
+Opcode_or_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c000;
+}
+
+static void
+Opcode_or_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8002;
+}
+
+static void
+Opcode_or_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_or_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c000;
+}
+
+static void
+Opcode_or_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8002;
+}
+
+static void
+Opcode_or_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10001;
+}
+
+static void
+Opcode_or_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4003;
+}
+
+static void
+Opcode_or_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1d4002;
+}
+
+static void
+Opcode_or_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x494000;
+}
+
+static void
+Opcode_xor_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x300000;
+}
+
+static void
+Opcode_xor_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x28000;
+}
+
+static void
+Opcode_xor_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x54002;
+}
+
+static void
+Opcode_xor_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc001;
+}
+
+static void
+Opcode_xor_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x28000;
+}
+
+static void
+Opcode_xor_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5c002;
+}
+
+static void
+Opcode_xor_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x44001;
+}
+
+static void
+Opcode_xor_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc002;
+}
+
+static void
+Opcode_xor_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1fc002;
+}
+
+static void
+Opcode_xor_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x518000;
+}
+
+static void
+Opcode_beqi_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x26;
+}
+
+static void
+Opcode_beqi_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40;
+}
+
+static void
+Opcode_beqi_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_bnei_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x66;
+}
+
+static void
+Opcode_bnei_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800040;
+}
+
+static void
+Opcode_bnei_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc2;
+}
+
+static void
+Opcode_bgei_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe6;
+}
+
+static void
+Opcode_bgei_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80;
+}
+
+static void
+Opcode_bgei_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x42;
+}
+
+static void
+Opcode_blti_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa6;
+}
+
+static void
+Opcode_blti_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200;
+}
+
+static void
+Opcode_blti_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x102;
+}
+
+static void
+Opcode_bbci_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6007;
+}
+
+static void
+Opcode_bbci_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x801;
+}
+
+static void
+Opcode_bbci_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_bbsi_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe007;
+}
+
+static void
+Opcode_bbsi_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1001;
+}
+
+static void
+Opcode_bbsi_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800;
+}
+
+static void
+Opcode_bgeui_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf6;
+}
+
+static void
+Opcode_bgeui_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100;
+}
+
+static void
+Opcode_bgeui_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x82;
+}
+
+static void
+Opcode_bltui_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb6;
+}
+
+static void
+Opcode_bltui_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400040;
+}
+
+static void
+Opcode_bltui_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x202;
+}
+
+static void
+Opcode_beq_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1007;
+}
+
+static void
+Opcode_beq_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800801;
+}
+
+static void
+Opcode_beq_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2800;
+}
+
+static void
+Opcode_bne_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9007;
+}
+
+static void
+Opcode_bne_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x401001;
+}
+
+static void
+Opcode_bne_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_bge_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa007;
+}
+
+static void
+Opcode_bge_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400c01;
+}
+
+static void
+Opcode_bge_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3000;
+}
+
+static void
+Opcode_blt_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2007;
+}
+
+static void
+Opcode_blt_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc00801;
+}
+
+static void
+Opcode_blt_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3400;
+}
+
+static void
+Opcode_bgeu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb007;
+}
+
+static void
+Opcode_bgeu_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800c01;
+}
+
+static void
+Opcode_bgeu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c00;
+}
+
+static void
+Opcode_bltu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3007;
+}
+
+static void
+Opcode_bltu_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc00c01;
+}
+
+static void
+Opcode_bltu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3800;
+}
+
+static void
+Opcode_bany_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8007;
+}
+
+static void
+Opcode_bany_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800401;
+}
+
+static void
+Opcode_bany_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1800;
+}
+
+static void
+Opcode_bnone_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x7;
+}
+
+static void
+Opcode_bnone_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x801001;
+}
+
+static void
+Opcode_bnone_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x403;
+}
+
+static void
+Opcode_ball_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4007;
+}
+
+static void
+Opcode_ball_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400401;
+}
+
+static void
+Opcode_ball_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1400;
+}
+
+static void
+Opcode_bnall_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc007;
+}
+
+static void
+Opcode_bnall_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1801;
+}
+
+static void
+Opcode_bnall_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c00;
+}
+
+static void
+Opcode_bbc_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5007;
+}
+
+static void
+Opcode_bbc_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc00401;
+}
+
+static void
+Opcode_bbc_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c00;
+}
+
+static void
+Opcode_bbs_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd007;
+}
+
+static void
+Opcode_bbs_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400801;
+}
+
+static void
+Opcode_bbs_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2400;
+}
+
+static void
+Opcode_beqz_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x16;
+}
+
+static void
+Opcode_beqz_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80002;
+}
+
+static void
+Opcode_beqz_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80001;
+}
+
+static void
+Opcode_bnez_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x56;
+}
+
+static void
+Opcode_bnez_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400002;
+}
+
+static void
+Opcode_bnez_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc0001;
+}
+
+static void
+Opcode_bgez_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd6;
+}
+
+static void
+Opcode_bgez_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100002;
+}
+
+static void
+Opcode_bgez_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100001;
+}
+
+static void
+Opcode_bltz_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x96;
+}
+
+static void
+Opcode_bltz_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200002;
+}
+
+static void
+Opcode_bltz_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200001;
+}
+
+static void
+Opcode_call0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5;
+}
+
+static void
+Opcode_callx0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc0;
+}
+
+static void
+Opcode_extui_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40000;
+}
+
+static void
+Opcode_extui_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_extui_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_extui_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_extui_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_extui_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_extui_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_extui_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_ill_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_j_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6;
+}
+
+static void
+Opcode_jx_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa0;
+}
+
+static void
+Opcode_l16ui_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1002;
+}
+
+static void
+Opcode_l16ui_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1003;
+}
+
+static void
+Opcode_l16si_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9002;
+}
+
+static void
+Opcode_l16si_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x803;
+}
+
+static void
+Opcode_l32i_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2002;
+}
+
+static void
+Opcode_l32i_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2003;
+}
+
+static void
+Opcode_l32r_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_l32r_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400001;
+}
+
+static void
+Opcode_l8ui_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_l8ui_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc03;
+}
+
+static void
+Opcode_loop_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8076;
+}
+
+static void
+Opcode_loopnez_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9076;
+}
+
+static void
+Opcode_loopgtz_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa076;
+}
+
+static void
+Opcode_movi_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa002;
+}
+
+static void
+Opcode_movi_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800002;
+}
+
+static void
+Opcode_movi_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c0001;
+}
+
+static void
+Opcode_moveqz_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x830000;
+}
+
+static void
+Opcode_moveqz_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20000;
+}
+
+static void
+Opcode_moveqz_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x74001;
+}
+
+static void
+Opcode_moveqz_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20000;
+}
+
+static void
+Opcode_moveqz_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x74001;
+}
+
+static void
+Opcode_moveqz_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x78000;
+}
+
+static void
+Opcode_moveqz_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c4002;
+}
+
+static void
+Opcode_moveqz_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x454000;
+}
+
+static void
+Opcode_movnez_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x930000;
+}
+
+static void
+Opcode_movnez_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x18000;
+}
+
+static void
+Opcode_movnez_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_movnez_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x18000;
+}
+
+static void
+Opcode_movnez_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_movnez_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4001;
+}
+
+static void
+Opcode_movnez_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1e0002;
+}
+
+static void
+Opcode_movnez_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x474000;
+}
+
+static void
+Opcode_movltz_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa30000;
+}
+
+static void
+Opcode_movltz_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x14000;
+}
+
+static void
+Opcode_movltz_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x7c001;
+}
+
+static void
+Opcode_movltz_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x14000;
+}
+
+static void
+Opcode_movltz_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x7c001;
+}
+
+static void
+Opcode_movltz_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_movltz_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1d0002;
+}
+
+static void
+Opcode_movltz_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x470000;
+}
+
+static void
+Opcode_movgez_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb30000;
+}
+
+static void
+Opcode_movgez_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc000;
+}
+
+static void
+Opcode_movgez_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x78001;
+}
+
+static void
+Opcode_movgez_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc000;
+}
+
+static void
+Opcode_movgez_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x78001;
+}
+
+static void
+Opcode_movgez_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x7c000;
+}
+
+static void
+Opcode_movgez_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c8002;
+}
+
+static void
+Opcode_movgez_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x464000;
+}
+
+static void
+Opcode_neg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x600000;
+}
+
+static void
+Opcode_neg_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34034;
+}
+
+static void
+Opcode_neg_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6000c;
+}
+
+static void
+Opcode_neg_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x801f;
+}
+
+static void
+Opcode_neg_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34020;
+}
+
+static void
+Opcode_neg_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6000c;
+}
+
+static void
+Opcode_neg_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_neg_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x54035;
+}
+
+static void
+Opcode_neg_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc01f;
+}
+
+static void
+Opcode_neg_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x14001a;
+}
+
+static void
+Opcode_neg_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x36000d;
+}
+
+static void
+Opcode_abs_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x600100;
+}
+
+static void
+Opcode_abs_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34030;
+}
+
+static void
+Opcode_abs_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000c;
+}
+
+static void
+Opcode_abs_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34010;
+}
+
+static void
+Opcode_abs_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000c;
+}
+
+static void
+Opcode_abs_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x54021;
+}
+
+static void
+Opcode_abs_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140016;
+}
+
+static void
+Opcode_abs_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34000d;
+}
+
+static void
+Opcode_nop_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20f0;
+}
+
+static void
+Opcode_nop_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x32f64;
+}
+
+static void
+Opcode_nop_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc030;
+}
+
+static void
+Opcode_nop_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x35430;
+}
+
+static void
+Opcode_nop_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xda5d4;
+}
+
+static void
+Opcode_nop_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa0000;
+}
+
+static void
+Opcode_nop_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa42f;
+}
+
+static void
+Opcode_nop_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2eda4;
+}
+
+static void
+Opcode_nop_Slot_pq_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200;
+}
+
+static void
+Opcode_nop_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x35430;
+}
+
+static void
+Opcode_nop_Slot_acc2_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x60;
+}
+
+static void
+Opcode_nop_Slot_acc2_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200;
+}
+
+static void
+Opcode_nop_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e40;
+}
+
+static void
+Opcode_nop_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9add4;
+}
+
+static void
+Opcode_nop_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x202;
+}
+
+static void
+Opcode_nop_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5b015;
+}
+
+static void
+Opcode_nop_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x168dd;
+}
+
+static void
+Opcode_nop_Slot_llr_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400;
+}
+
+static void
+Opcode_nop_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc237;
+}
+
+static void
+Opcode_nop_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa50dc;
+}
+
+static void
+Opcode_nop_Slot_dual_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2dec31;
+}
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+static void
+Opcode_ret_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80;
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+static void
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+{
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+
+static void
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+static void
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+{
+  slotbuf[0] = 0x6002;
+}
+
+static void
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+static void
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+{
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+}
+
+static void
+Opcode_s8i_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c03;
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+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x3d740;
+}
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+static void
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+static void
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+static void
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+{
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+
+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x3d6c0;
+}
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+static void
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+{
+  slotbuf[0] = 0x5dec1;
+}
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x2e6c01;
+}
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+static void
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+{
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+static void
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+static void
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+  slotbuf[0] = 0x3d700;
+}
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+static void
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+{
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+}
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+static void
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+}
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+static void
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+{
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+static void
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+{
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+}
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+static void
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+}
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+static void
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+{
+  slotbuf[0] = 0x3d680;
+}
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+static void
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+{
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+static void
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+}
+
+static void
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+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x3d400;
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+static void
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+static void
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+static void
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+static void
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+{
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+static void
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x10000;
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+static void
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+}
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+static void
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x38002;
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+static void
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+{
+  slotbuf[0] = 0x5800c;
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+static void
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+static void
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+static void
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+static void
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+{
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+static void
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+static void
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+{
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+}
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+static void
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x5002c;
+}
+
+static void
+Opcode_sra_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5403d;
+}
+
+static void
+Opcode_sra_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc02b;
+}
+
+static void
+Opcode_sra_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x144016;
+}
+
+static void
+Opcode_sra_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34802d;
+}
+
+static void
+Opcode_slli_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10000;
+}
+
+static void
+Opcode_slli_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40001;
+}
+
+static void
+Opcode_slli_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10003;
+}
+
+static void
+Opcode_slli_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40000;
+}
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+static void
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+{
+  slotbuf[0] = 0x10003;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+
+static void
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+{
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+static void
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+{
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+}
+
+static void
+Opcode_srai_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x18000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x18001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x18000;
+}
+
+static void
+Opcode_srai_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x18000;
+}
+
+static void
+Opcode_srai_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc8002;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3e8001;
+}
+
+static void
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+{
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x3c002;
+}
+
+static void
+Opcode_srli_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30001;
+}
+
+static void
+Opcode_srli_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1e8002;
+}
+
+static void
+Opcode_srli_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4cc000;
+}
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+static void
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+{
+  slotbuf[0] = 0x20c0;
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x2000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2010;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2020;
+}
+
+static void
+Opcode_dsync_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2030;
+}
+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x30100;
+}
+
+static void
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+{
+  slotbuf[0] = 0x130100;
+}
+
+static void
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+{
+  slotbuf[0] = 0x610100;
+}
+
+static void
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+{
+  slotbuf[0] = 0x30200;
+}
+
+static void
+Opcode_wsr_lcount_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x130200;
+}
+
+static void
+Opcode_xsr_lcount_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x610200;
+}
+
+static void
+Opcode_rsr_lbeg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30000;
+}
+
+static void
+Opcode_wsr_lbeg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x130000;
+}
+
+static void
+Opcode_xsr_lbeg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x610000;
+}
+
+static void
+Opcode_rsr_sar_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30300;
+}
+
+static void
+Opcode_wsr_sar_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x130300;
+}
+
+static void
+Opcode_xsr_sar_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x610300;
+}
+
+static void
+Opcode_rsr_litbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30500;
+}
+
+static void
+Opcode_wsr_litbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_xsr_litbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x3b000;
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+
+static void
+Opcode_wsr_176_Slot_inst_encode (xtensa_insnbuf slotbuf)
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+}
+
+static void
+Opcode_rsr_208_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3d000;
+}
+
+static void
+Opcode_rsr_ps_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+{
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+static void
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+{
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+}
+
+static void
+Opcode_rsr_epc1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3b100;
+}
+
+static void
+Opcode_wsr_epc1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13b100;
+}
+
+static void
+Opcode_xsr_epc1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61b100;
+}
+
+static void
+Opcode_rsr_excsave1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3d100;
+}
+
+static void
+Opcode_wsr_excsave1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13d100;
+}
+
+static void
+Opcode_xsr_excsave1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61d100;
+}
+
+static void
+Opcode_rsr_epc2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3b200;
+}
+
+static void
+Opcode_wsr_epc2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13b200;
+}
+
+static void
+Opcode_xsr_epc2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61b200;
+}
+
+static void
+Opcode_rsr_excsave2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3d200;
+}
+
+static void
+Opcode_wsr_excsave2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+{
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+}
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+static void
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+}
+
+static void
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+}
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+static void
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+}
+
+static void
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+{
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+}
+
+static void
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+}
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+static void
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+}
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+static void
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+
+static void
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+static void
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+}
+
+static void
+Opcode_rsr_excsave4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+}
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+static void
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+{
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+}
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+{
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+}
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+static void
+Opcode_wsr_eps6_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
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+static void
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+{
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+}
+
+static void
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+{
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+}
+
+static void
+Opcode_wsr_excvaddr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13ee00;
+}
+
+static void
+Opcode_xsr_excvaddr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
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+static void
+Opcode_rsr_depc_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c000;
+}
+
+static void
+Opcode_wsr_depc_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13c000;
+}
+
+static void
+Opcode_xsr_depc_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61c000;
+}
+
+static void
+Opcode_rsr_exccause_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3e800;
+}
+
+static void
+Opcode_wsr_exccause_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_xsr_exccause_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x3e700;
+}
+
+static void
+Opcode_wsr_vecbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13e700;
+}
+
+static void
+Opcode_xsr_vecbase_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61e700;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+}
+
+static void
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+{
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+}
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+static void
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+{
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+}
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+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x13e200;
+}
+
+static void
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+{
+  slotbuf[0] = 0x13e300;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3e400;
+}
+
+static void
+Opcode_wsr_intenable_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13e400;
+}
+
+static void
+Opcode_xsr_intenable_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61e400;
+}
+
+static void
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+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_break_n_Slot_inst16b_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_rsr_dbreaka0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x39000;
+}
+
+static void
+Opcode_wsr_dbreaka0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x139000;
+}
+
+static void
+Opcode_xsr_dbreaka0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x619000;
+}
+
+static void
+Opcode_rsr_dbreakc0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3a000;
+}
+
+static void
+Opcode_wsr_dbreakc0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13a000;
+}
+
+static void
+Opcode_xsr_dbreakc0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61a000;
+}
+
+static void
+Opcode_rsr_dbreaka1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x39100;
+}
+
+static void
+Opcode_wsr_dbreaka1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x139100;
+}
+
+static void
+Opcode_xsr_dbreaka1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x619100;
+}
+
+static void
+Opcode_rsr_dbreakc1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3a100;
+}
+
+static void
+Opcode_wsr_dbreakc1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13a100;
+}
+
+static void
+Opcode_xsr_dbreakc1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61a100;
+}
+
+static void
+Opcode_rsr_ibreaka0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x38000;
+}
+
+static void
+Opcode_wsr_ibreaka0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x138000;
+}
+
+static void
+Opcode_xsr_ibreaka0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x618000;
+}
+
+static void
+Opcode_rsr_ibreaka1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x38100;
+}
+
+static void
+Opcode_wsr_ibreaka1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x138100;
+}
+
+static void
+Opcode_xsr_ibreaka1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x618100;
+}
+
+static void
+Opcode_rsr_ibreakenable_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x36000;
+}
+
+static void
+Opcode_wsr_ibreakenable_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x136000;
+}
+
+static void
+Opcode_xsr_ibreakenable_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x616000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3e900;
+}
+
+static void
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+{
+  slotbuf[0] = 0x13e900;
+}
+
+static void
+Opcode_xsr_debugcause_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61e900;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3ec00;
+}
+
+static void
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+{
+  slotbuf[0] = 0x13ec00;
+}
+
+static void
+Opcode_xsr_icount_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61ec00;
+}
+
+static void
+Opcode_rsr_icountlevel_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3ed00;
+}
+
+static void
+Opcode_wsr_icountlevel_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13ed00;
+}
+
+static void
+Opcode_xsr_icountlevel_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61ed00;
+}
+
+static void
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+{
+  slotbuf[0] = 0x36800;
+}
+
+static void
+Opcode_wsr_ddr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x136800;
+}
+
+static void
+Opcode_xsr_ddr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x616800;
+}
+
+static void
+Opcode_rfdo_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf1e000;
+}
+
+static void
+Opcode_rfdd_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf1e010;
+}
+
+static void
+Opcode_wsr_mmid_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x135900;
+}
+
+static void
+Opcode_andb_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x48001;
+}
+
+static void
+Opcode_andb_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x48001;
+}
+
+static void
+Opcode_andb_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x48000;
+}
+
+static void
+Opcode_andb_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe8002;
+}
+
+static void
+Opcode_andb_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x410000;
+}
+
+static void
+Opcode_andbc_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x120000;
+}
+
+static void
+Opcode_orb_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x220000;
+}
+
+static void
+Opcode_orb_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10002;
+}
+
+static void
+Opcode_orb_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10002;
+}
+
+static void
+Opcode_orb_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20001;
+}
+
+static void
+Opcode_orb_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1d8002;
+}
+
+static void
+Opcode_orb_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x498000;
+}
+
+static void
+Opcode_orbc_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x320000;
+}
+
+static void
+Opcode_xorb_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x420000;
+}
+
+static void
+Opcode_xorb_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x58002;
+}
+
+static void
+Opcode_xorb_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x64002;
+}
+
+static void
+Opcode_xorb_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x48001;
+}
+
+static void
+Opcode_xorb_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x240002;
+}
+
+static void
+Opcode_xorb_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x51c000;
+}
+
+static void
+Opcode_any4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
+Opcode_any4_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x35400;
+}
+
+static void
+Opcode_any4_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x35400;
+}
+
+static void
+Opcode_any4_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x58421;
+}
+
+static void
+Opcode_any4_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x481421;
+}
+
+static void
+Opcode_any4_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2cec21;
+}
+
+static void
+Opcode_all4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9000;
+}
+
+static void
+Opcode_any8_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa000;
+}
+
+static void
+Opcode_any8_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d420;
+}
+
+static void
+Opcode_any8_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d420;
+}
+
+static void
+Opcode_any8_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x58019;
+}
+
+static void
+Opcode_any8_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x481419;
+}
+
+static void
+Opcode_any8_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2cec31;
+}
+
+static void
+Opcode_all8_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb000;
+}
+
+static void
+Opcode_bf_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x76;
+}
+
+static void
+Opcode_bt_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1076;
+}
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+static void
+Opcode_movf_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc30000;
+}
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+static void
+Opcode_movt_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd30000;
+}
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+static void
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+{
+  slotbuf[0] = 0x4002;
+}
+
+static void
+Opcode_movt_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4002;
+}
+
+static void
+Opcode_movt_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8001;
+}
+
+static void
+Opcode_movt_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1cc002;
+}
+
+static void
+Opcode_movt_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x47c000;
+}
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+static void
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+{
+  slotbuf[0] = 0x30400;
+}
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+static void
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+{
+  slotbuf[0] = 0x130400;
+}
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+static void
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+{
+  slotbuf[0] = 0x610400;
+}
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+static void
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+{
+  slotbuf[0] = 0x3ea00;
+}
+
+static void
+Opcode_wsr_ccount_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13ea00;
+}
+
+static void
+Opcode_xsr_ccount_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61ea00;
+}
+
+static void
+Opcode_rsr_ccompare0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3f000;
+}
+
+static void
+Opcode_wsr_ccompare0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13f000;
+}
+
+static void
+Opcode_xsr_ccompare0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61f000;
+}
+
+static void
+Opcode_rsr_ccompare1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3f100;
+}
+
+static void
+Opcode_wsr_ccompare1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x13f100;
+}
+
+static void
+Opcode_xsr_ccompare1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x61f100;
+}
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+static void
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+{
+  slotbuf[0] = 0x70c2;
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+static void
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+{
+  slotbuf[0] = 0x70e2;
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+static void
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+{
+  slotbuf[0] = 0x70d2;
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+static void
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+{
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+static void
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+{
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+static void
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+{
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+static void
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+static void
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+static void
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+  slotbuf[0] = 0xf11000;
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+static void
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+{
+  slotbuf[0] = 0xf13000;
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x27082;
+}
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+static void
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+{
+  slotbuf[0] = 0x37082;
+}
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+static void
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+{
+  slotbuf[0] = 0xf19000;
+}
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+static void
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+{
+  slotbuf[0] = 0xf18000;
+}
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+static void
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+{
+  slotbuf[0] = 0x50c000;
+}
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+static void
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+{
+  slotbuf[0] = 0x50d000;
+}
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+static void
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+{
+  slotbuf[0] = 0x50b000;
+}
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+static void
+Opcode_rdtlb1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x50f000;
+}
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+static void
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+{
+  slotbuf[0] = 0x50e000;
+}
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+static void
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+{
+  slotbuf[0] = 0x504000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x505000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x503000;
+}
+
+static void
+Opcode_ritlb1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x507000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x506000;
+}
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+static void
+Opcode_rsr_cpenable_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3e000;
+}
+
+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x61e000;
+}
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x50001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x50001;
+}
+
+static void
+Opcode_clamps_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x50000;
+}
+
+static void
+Opcode_clamps_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf0002;
+}
+
+static void
+Opcode_clamps_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x440000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x430000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x70001;
+}
+
+static void
+Opcode_min_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x70001;
+}
+
+static void
+Opcode_min_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6c000;
+}
+
+static void
+Opcode_min_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xfc002;
+}
+
+static void
+Opcode_min_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x460000;
+}
+
+static void
+Opcode_max_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x530000;
+}
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+static void
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+{
+  slotbuf[0] = 0x64001;
+}
+
+static void
+Opcode_max_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x64001;
+}
+
+static void
+Opcode_max_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x68000;
+}
+
+static void
+Opcode_max_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf4002;
+}
+
+static void
+Opcode_max_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x448000;
+}
+
+static void
+Opcode_minu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x630000;
+}
+
+static void
+Opcode_minu_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6c001;
+}
+
+static void
+Opcode_minu_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6c001;
+}
+
+static void
+Opcode_minu_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x74000;
+}
+
+static void
+Opcode_minu_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c0002;
+}
+
+static void
+Opcode_minu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x44c000;
+}
+
+static void
+Opcode_maxu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x730000;
+}
+
+static void
+Opcode_maxu_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x68001;
+}
+
+static void
+Opcode_maxu_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x68001;
+}
+
+static void
+Opcode_maxu_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x70000;
+}
+
+static void
+Opcode_maxu_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf8002;
+}
+
+static void
+Opcode_maxu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x450000;
+}
+
+static void
+Opcode_nsa_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40e000;
+}
+
+static void
+Opcode_nsa_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x15400;
+}
+
+static void
+Opcode_nsa_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x15400;
+}
+
+static void
+Opcode_nsa_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x53801;
+}
+
+static void
+Opcode_nsa_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c1401;
+}
+
+static void
+Opcode_nsa_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2ce801;
+}
+
+static void
+Opcode_nsau_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40f000;
+}
+
+static void
+Opcode_nsau_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x25400;
+}
+
+static void
+Opcode_nsau_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x25400;
+}
+
+static void
+Opcode_nsau_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x53c01;
+}
+
+static void
+Opcode_nsau_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c5401;
+}
+
+static void
+Opcode_nsau_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d6801;
+}
+
+static void
+Opcode_sext_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x230000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x34002;
+}
+
+static void
+Opcode_sext_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34002;
+}
+
+static void
+Opcode_sext_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x24001;
+}
+
+static void
+Opcode_sext_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1dc002;
+}
+
+static void
+Opcode_sext_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4d0000;
+}
+
+static void
+Opcode_l32ai_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb002;
+}
+
+static void
+Opcode_s32ri_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf002;
+}
+
+static void
+Opcode_s32c1i_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe002;
+}
+
+static void
+Opcode_rsr_scompare1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x30c00;
+}
+
+static void
+Opcode_wsr_scompare1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x130c00;
+}
+
+static void
+Opcode_xsr_scompare1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x610c00;
+}
+
+static void
+Opcode_rsr_atomctl_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x36300;
+}
+
+static void
+Opcode_wsr_atomctl_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x136300;
+}
+
+static void
+Opcode_xsr_atomctl_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x616300;
+}
+
+static void
+Opcode_rer_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x406000;
+}
+
+static void
+Opcode_wer_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x407000;
+}
+
+static void
+Opcode_rur_fcr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30e80;
+}
+
+static void
+Opcode_wur_fcr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf3e800;
+}
+
+static void
+Opcode_rur_fsr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30e90;
+}
+
+static void
+Opcode_wur_fsr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf3e900;
+}
+
+static void
+Opcode_add_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa0000;
+}
+
+static void
+Opcode_add_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3f4001;
+}
+
+static void
+Opcode_sub_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1a0000;
+}
+
+static void
+Opcode_sub_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4f4000;
+}
+
+static void
+Opcode_mul_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2a0000;
+}
+
+static void
+Opcode_mul_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x490000;
+}
+
+static void
+Opcode_madd_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4a0000;
+}
+
+static void
+Opcode_madd_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x444000;
+}
+
+static void
+Opcode_msub_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5a0000;
+}
+
+static void
+Opcode_msub_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x488000;
+}
+
+static void
+Opcode_movf_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xcb0000;
+}
+
+static void
+Opcode_movf_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x45c000;
+}
+
+static void
+Opcode_movt_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xdb0000;
+}
+
+static void
+Opcode_movt_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x484000;
+}
+
+static void
+Opcode_moveqz_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8b0000;
+}
+
+static void
+Opcode_moveqz_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x458000;
+}
+
+static void
+Opcode_movnez_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9b0000;
+}
+
+static void
+Opcode_movnez_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x478000;
+}
+
+static void
+Opcode_movltz_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xab0000;
+}
+
+static void
+Opcode_movltz_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x46c000;
+}
+
+static void
+Opcode_movgez_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xbb0000;
+}
+
+static void
+Opcode_movgez_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x468000;
+}
+
+static void
+Opcode_abs_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xfa0010;
+}
+
+static void
+Opcode_abs_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x142;
+}
+
+static void
+Opcode_mov_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xfa0000;
+}
+
+static void
+Opcode_mov_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4142;
+}
+
+static void
+Opcode_neg_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xfa0060;
+}
+
+static void
+Opcode_neg_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8142;
+}
+
+static void
+Opcode_un_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1b0000;
+}
+
+static void
+Opcode_un_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x50c000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2b0000;
+}
+
+static void
+Opcode_oeq_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_ueq_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3b0000;
+}
+
+static void
+Opcode_ueq_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x510000;
+}
+
+static void
+Opcode_olt_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4b0000;
+}
+
+static void
+Opcode_olt_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x48c000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x5b0000;
+}
+
+static void
+Opcode_ult_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x580000;
+}
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+static void
+Opcode_ole_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6b0000;
+}
+
+static void
+Opcode_ole_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c0000;
+}
+
+static void
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+
+static void
+Opcode_ule_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x540000;
+}
+
+static void
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+{
+  slotbuf[0] = 0xca0000;
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+
+static void
+Opcode_float_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x500000;
+}
+
+static void
+Opcode_ufloat_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xda0000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x520000;
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+static void
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+{
+  slotbuf[0] = 0x8a0000;
+}
+
+static void
+Opcode_round_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x49c000;
+}
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+static void
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+{
+  slotbuf[0] = 0xba0000;
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+
+static void
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+}
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+static void
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+{
+  slotbuf[0] = 0xaa0000;
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+
+static void
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+{
+  slotbuf[0] = 0x600000;
+}
+
+static void
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+{
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+}
+
+static void
+Opcode_trunc_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x508000;
+}
+
+static void
+Opcode_utrunc_s_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xea0000;
+}
+
+static void
+Opcode_utrunc_s_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x514000;
+}
+
+static void
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+{
+  slotbuf[0] = 0xfa0040;
+}
+
+static void
+Opcode_rfr_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20142;
+}
+
+static void
+Opcode_wfr_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xfa0050;
+}
+
+static void
+Opcode_lsi_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_lsi_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140001;
+}
+
+static void
+Opcode_lsiu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8003;
+}
+
+static void
+Opcode_lsiu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x180001;
+}
+
+static void
+Opcode_lsx_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80000;
+}
+
+static void
+Opcode_lsxu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x180000;
+}
+
+static void
+Opcode_lsxu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x430000;
+}
+
+static void
+Opcode_ssi_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4003;
+}
+
+static void
+Opcode_ssi_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x240001;
+}
+
+static void
+Opcode_ssiu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc003;
+}
+
+static void
+Opcode_ssiu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x280001;
+}
+
+static void
+Opcode_ssx_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x480000;
+}
+
+static void
+Opcode_ssx_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4d4000;
+}
+
+static void
+Opcode_ssxu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x580000;
+}
+
+static void
+Opcode_ssxu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4d8000;
+}
+
+static void
+Opcode_get_argmax_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6b700;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3407c;
+}
+
+static void
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+{
+  slotbuf[0] = 0x181d4;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3401c;
+}
+
+static void
+Opcode_get_argmax_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8294;
+}
+
+static void
+Opcode_get_argmax_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xdd;
+}
+
+static void
+Opcode_get_argmax_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x840ec;
+}
+
+static void
+Opcode_get_hsar_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6ba00;
+}
+
+static void
+Opcode_get_hsar_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x340bc;
+}
+
+static void
+Opcode_get_hsar_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d434;
+}
+
+static void
+Opcode_get_hsar_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x281d4;
+}
+
+static void
+Opcode_get_hsar_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x802f;
+}
+
+static void
+Opcode_get_hsar_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34058;
+}
+
+static void
+Opcode_get_hsar_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d434;
+}
+
+static void
+Opcode_get_hsar_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8314;
+}
+
+static void
+Opcode_get_hsar_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x58415;
+}
+
+static void
+Opcode_get_hsar_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40d9;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc83b;
+}
+
+static void
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+{
+  slotbuf[0] = 0x880ec;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2dec05;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+
+static void
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+{
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+}
+
+static void
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+{
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+
+static void
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+{
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+
+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x2d438;
+}
+
+static void
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+{
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+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x80d9;
+}
+
+static void
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+{
+  slotbuf[0] = 0xd03b;
+}
+
+static void
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+{
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+}
+
+static void
+Opcode_get_hsar2sar_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2dec09;
+}
+
+static void
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+{
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+
+static void
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+{
+  slotbuf[0] = 0x6806c;
+}
+
+static void
+Opcode_get_interp_ext_n_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6806c;
+}
+
+static void
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+{
+  slotbuf[0] = 0x64101;
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+
+static void
+Opcode_get_interp_ext_n_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+
+static void
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+{
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+
+static void
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+{
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+
+static void
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+{
+  slotbuf[0] = 0x6802c;
+}
+
+static void
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+{
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+
+static void
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+{
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+static void
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+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x2d400;
+}
+
+static void
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+{
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+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x2cec01;
+}
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+static void
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+{
+  slotbuf[0] = 0xb70ba0;
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+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x680ac;
+}
+
+static void
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+{
+  slotbuf[0] = 0x64201;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc06f;
+}
+
+static void
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+{
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+static void
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+{
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+{
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+static void
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+static void
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+static void
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+{
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+static void
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+{
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+static void
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+static void
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+{
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+static void
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+{
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+}
+
+static void
+Opcode_get_nco_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_get_nco_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8c0ec;
+}
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+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x8037;
+}
+
+static void
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+{
+  slotbuf[0] = 0x6812c;
+}
+
+static void
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+{
+  slotbuf[0] = 0x64049;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc0ef;
+}
+
+static void
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+{
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+static void
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+static void
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+}
+
+static void
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+{
+  slotbuf[0] = 0x6822c;
+}
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+static void
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+static void
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x681ec;
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+static void
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+static void
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x8294;
+}
+
+static void
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+{
+  slotbuf[0] = 0x400dd;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+static void
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+static void
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+{
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+static void
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+
+static void
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+
+static void
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+static void
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+static void
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+
+static void
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+{
+  slotbuf[0] = 0x3d480;
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+
+static void
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+static void
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x3d600;
+}
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+static void
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+static void
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+{
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+static void
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+{
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x410d9;
+}
+
+static void
+Opcode_set_sar_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x683ac;
+}
+
+static void
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+{
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+static void
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+static void
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+  slotbuf[0] = 0x3d540;
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+static void
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+static void
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+static void
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+static void
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+  slotbuf[0] = 0xc00;
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+{
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+static void
+Opcode_lac_rl_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2800;
+}
+
+static void
+Opcode_lac_rl_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2800;
+}
+
+static void
+Opcode_lac_rl_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c2401;
+}
+
+static void
+Opcode_lcm_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x70300;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40008;
+}
+
+static void
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+{
+  slotbuf[0] = 0x4001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40008;
+}
+
+static void
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+{
+  slotbuf[0] = 0x54000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2;
+}
+
+static void
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+{
+  slotbuf[0] = 0x340011;
+}
+
+static void
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+{
+  slotbuf[0] = 0x70000;
+}
+
+static void
+Opcode_lcm_pinc_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40000;
+}
+
+static void
+Opcode_lcm_pinc_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40000;
+}
+
+static void
+Opcode_lcm_pinc_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_lcm_pinc_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x340001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x680000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x54001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x54001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x58000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x414000;
+}
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+static void
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+{
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+}
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+static void
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+{
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+}
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x40004;
+}
+
+static void
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+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x10001;
+}
+
+static void
+Opcode_lcm_u_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x380001;
+}
+
+static void
+Opcode_lcm_x_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x880000;
+}
+
+static void
+Opcode_lcm_x_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x58001;
+}
+
+static void
+Opcode_lcm_x_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_lcm_x_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x58001;
+}
+
+static void
+Opcode_lcm_x_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x5c000;
+}
+
+static void
+Opcode_lcm_x_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4002;
+}
+
+static void
+Opcode_lcm_x_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x418000;
+}
+
+static void
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+{
+  slotbuf[0] = 0xa80000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x5c001;
+}
+
+static void
+Opcode_lcm_xu_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4002;
+}
+
+static void
+Opcode_lcm_xu_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5c001;
+}
+
+static void
+Opcode_lcm_xu_Slot_acc2_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4002;
+}
+
+static void
+Opcode_lcm_xu_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x64000;
+}
+
+static void
+Opcode_lcm_xu_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_lcm_xu_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x41c000;
+}
+
+static void
+Opcode_lp_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x70200;
+}
+
+static void
+Opcode_lp_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x340005;
+}
+
+static void
+Opcode_lp_x_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc80000;
+}
+
+static void
+Opcode_lp_x_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x424000;
+}
+
+static void
+Opcode_lq_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x70400;
+}
+
+static void
+Opcode_lq_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x340009;
+}
+
+static void
+Opcode_lq_x_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe80000;
+}
+
+static void
+Opcode_lq_x_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x428000;
+}
+
+static void
+Opcode_lut0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d0000;
+}
+
+static void
+Opcode_lut0_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x42c000;
+}
+
+static void
+Opcode_lut1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3d0000;
+}
+
+static void
+Opcode_lut1_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x434000;
+}
+
+static void
+Opcode_lut2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4d0000;
+}
+
+static void
+Opcode_lut2_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x438000;
+}
+
+static void
+Opcode_lut3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6c0000;
+}
+
+static void
+Opcode_lut3_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x43c000;
+}
+
+static void
+Opcode_sac2x32_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc0000;
+}
+
+static void
+Opcode_sac2x32_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_sac2x32_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_sac2x32_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c0001;
+}
+
+static void
+Opcode_sac2x64_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf88000;
+}
+
+static void
+Opcode_sac2x64_0_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5c002;
+}
+
+static void
+Opcode_sac2x64_0_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x68002;
+}
+
+static void
+Opcode_sac2x64_0_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x52a000;
+}
+
+static void
+Opcode_sac2x64_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8d8000;
+}
+
+static void
+Opcode_sac2x64_1_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5e002;
+}
+
+static void
+Opcode_sac2x64_1_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x70002;
+}
+
+static void
+Opcode_sac2x64_1_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x52c000;
+}
+
+static void
+Opcode_sac2x64_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9d8000;
+}
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+static void
+Opcode_sac2x64_2_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_sac2x64_2_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6a002;
+}
+
+static void
+Opcode_sac2x64_2_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x52e000;
+}
+
+static void
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+static void
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+}
+
+static void
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+}
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+static void
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x8001;
+}
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+static void
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+{
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+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x40002;
+}
+
+static void
+Opcode_sac_ih_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+}
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+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x18002;
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+
+static void
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+static void
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+  slotbuf[0] = 0x1a002;
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+
+static void
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+static void
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+static void
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x10000;
+}
+
+static void
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+static void
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+{
+  slotbuf[0] = 0x14002;
+}
+
+static void
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+{
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+static void
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+{
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+}
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+static void
+Opcode_scm_u_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x8001;
+}
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+static void
+Opcode_scm_x_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c4000;
+}
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+static void
+Opcode_scm_xu_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb80000;
+}
+
+static void
+Opcode_scm_xu_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+}
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+static void
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+{
+  slotbuf[0] = 0xc000;
+}
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+static void
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+{
+  slotbuf[0] = 0x24002;
+}
+
+static void
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+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
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+{
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+}
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+static void
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+static void
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+
+static void
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+
+static void
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+{
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+}
+
+static void
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+
+static void
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+
+static void
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+static void
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+{
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+static void
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+{
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+
+static void
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+{
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+static void
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+{
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+
+static void
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+{
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+static void
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+{
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+
+static void
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+{
+  slotbuf[0] = 0x5400;
+}
+
+static void
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+{
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+
+static void
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+{
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+
+static void
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+static void
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+static void
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+static void
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+static void
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+{
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+{
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+
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+{
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+
+static void
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+{
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+{
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+{
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+{
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+{
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+static void
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+{
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+static void
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+{
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+static void
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+
+static void
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+{
+  slotbuf[0] = 0xb000;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x2;
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x2ed00;
+}
+
+static void
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+{
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+
+static void
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+static void
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+{
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+static void
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+{
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+static void
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+static void
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+}
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+static void
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+{
+  slotbuf[0] = 0x3d780;
+}
+
+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+}
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x44010;
+}
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+static void
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+static void
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+static void
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+{
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+
+static void
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+{
+  slotbuf[0] = 0x60001;
+}
+
+static void
+Opcode_comb_ar_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x60000;
+}
+
+static void
+Opcode_comb_ar_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x480000;
+}
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+static void
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+{
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+static void
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+static void
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+static void
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+static void
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+
+static void
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+{
+  slotbuf[0] = 0x4001d;
+}
+
+static void
+Opcode_conj_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x44008;
+}
+
+static void
+Opcode_conj_Slot_acc2_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
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+{
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+
+static void
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+{
+  slotbuf[0] = 0x8054;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+static void
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+{
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+static void
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+{
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+
+static void
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+static void
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+static void
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+}
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+static void
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+{
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x970b80;
+}
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+static void
+Opcode_movac_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6a042;
+}
+
+static void
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+{
+  slotbuf[0] = 0x6e202;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc142;
+}
+
+static void
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+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x978b80;
+}
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+static void
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+{
+  slotbuf[0] = 0x2020;
+}
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+static void
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+{
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+static void
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+{
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+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x80001;
+}
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+static void
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+{
+  slotbuf[0] = 0xc402;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc00c0;
+}
+
+static void
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+{
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+static void
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+{
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+static void
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+
+static void
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+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x40099;
+}
+
+static void
+Opcode_movcm_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4002c;
+}
+
+static void
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+{
+  slotbuf[0] = 0x9;
+}
+
+static void
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+{
+  slotbuf[0] = 0x101;
+}
+
+static void
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+{
+  slotbuf[0] = 0x8114;
+}
+
+static void
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+{
+  slotbuf[0] = 0x54029;
+}
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+static void
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+{
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+}
+
+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x800e0;
+}
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+static void
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+{
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+}
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+static void
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+{
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+
+static void
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+{
+  slotbuf[0] = 0xc02;
+}
+
+static void
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+{
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+
+static void
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+{
+  slotbuf[0] = 0x1;
+}
+
+static void
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+{
+  slotbuf[0] = 0x4181;
+}
+
+static void
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+{
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+static void
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+{
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+}
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+static void
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+{
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+
+static void
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+{
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+}
+
+static void
+Opcode_movcnd_0_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4240;
+}
+
+static void
+Opcode_movcnd_0_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x281c01;
+}
+
+static void
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+{
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+static void
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+{
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+}
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+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x4280;
+}
+
+static void
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+{
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+{
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+static void
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+{
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+static void
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+{
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+}
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+static void
+Opcode_movcnd_2_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4300;
+}
+
+static void
+Opcode_movcnd_2_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x283;
+}
+
+static void
+Opcode_movcnd_2_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c1c01;
+}
+
+static void
+Opcode_movcnd_3_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_movcnd_3_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x42c0;
+}
+
+static void
+Opcode_movcnd_3_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3401;
+}
+
+static void
+Opcode_movcnd_3_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x42c0;
+}
+
+static void
+Opcode_movcnd_3_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x303;
+}
+
+static void
+Opcode_movcnd_3_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x341c01;
+}
+
+static void
+Opcode_movcnd_4_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3c01;
+}
+
+static void
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+{
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+}
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+static void
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+{
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+}
+
+static void
+Opcode_movcnd_4_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4340;
+}
+
+static void
+Opcode_movcnd_4_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+}
+
+static void
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x4380;
+}
+
+static void
+Opcode_movcnd_5_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
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+{
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+}
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+static void
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+{
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+static void
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+static void
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+{
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+static void
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+{
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+{
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+}
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x41c0;
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+static void
+Opcode_movcnd8_7_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
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+static void
+Opcode_movcnd8_7_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x241c01;
+}
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+static void
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+{
+  slotbuf[0] = 0x370300;
+}
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+static void
+Opcode_mov_i_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4800c;
+}
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+static void
+Opcode_mov_i_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_mov_i_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4800c;
+}
+
+static void
+Opcode_mov_i_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x54031;
+}
+
+static void
+Opcode_mov_i_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc017;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+}
+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x10801;
+}
+
+static void
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+{
+  slotbuf[0] = 0x570300;
+}
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+static void
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+{
+  slotbuf[0] = 0x5000c;
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+static void
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+{
+  slotbuf[0] = 0x801b;
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+
+static void
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+{
+  slotbuf[0] = 0x5000c;
+}
+
+static void
+Opcode_mov_r_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5402d;
+}
+
+static void
+Opcode_mov_r_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc01b;
+}
+
+static void
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+{
+  slotbuf[0] = 0x35000d;
+}
+
+static void
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+{
+  slotbuf[0] = 0x970300;
+}
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+static void
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+{
+  slotbuf[0] = 0x40219;
+}
+
+static void
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+{
+  slotbuf[0] = 0x4802c;
+}
+
+static void
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+{
+  slotbuf[0] = 0x80d4;
+}
+
+static void
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+{
+  slotbuf[0] = 0x8027;
+}
+
+static void
+Opcode_negcm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40219;
+}
+
+static void
+Opcode_negcm_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4802c;
+}
+
+static void
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+{
+  slotbuf[0] = 0x21;
+}
+
+static void
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+{
+  slotbuf[0] = 0x201;
+}
+
+static void
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+{
+  slotbuf[0] = 0x80d4;
+}
+
+static void
+Opcode_negcm_Slot_smod_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x54039;
+}
+
+static void
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+{
+  slotbuf[0] = 0x219;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc027;
+}
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+static void
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+{
+  slotbuf[0] = 0x800e4;
+}
+
+static void
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+{
+  slotbuf[0] = 0x34402d;
+}
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+static void
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+{
+  slotbuf[0] = 0x16a180;
+}
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+static void
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+{
+  slotbuf[0] = 0x3d7a0;
+}
+
+static void
+Opcode_pop16llr_1_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3d7a0;
+}
+
+static void
+Opcode_pop16llr_1_Slot_llr_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x11040;
+}
+
+static void
+Opcode_pop16llr_1_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e6c41;
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+static void
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+{
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+static void
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+{
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+static void
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+{
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+}
+
+static void
+Opcode_pq2cm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x38000;
+}
+
+static void
+Opcode_pq2cm_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x88018;
+}
+
+static void
+Opcode_pq2cm_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10002;
+}
+
+static void
+Opcode_pq2cm_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x440080;
+}
+
+static void
+Opcode_swapac_r_Slot_acc2_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100;
+}
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+static void
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+{
+  slotbuf[0] = 0xb70b00;
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+static void
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+{
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+}
+
+static void
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+{
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+
+static void
+Opcode_swapac_ri_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+static void
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+{
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+static void
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+{
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0x38140;
+}
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+static void
+Opcode_swapb_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x11401;
+}
+
+static void
+Opcode_swapb_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd402;
+}
+
+static void
+Opcode_swapb_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc80c0;
+}
+
+static void
+Opcode_add2ac_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc000;
+}
+
+static void
+Opcode_addac_Slot_llr_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_cdot_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_cdotac_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_cdotacs_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_cmac_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_cmac_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4001;
+}
+
+static void
+Opcode_cmacs_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2000;
+}
+
+static void
+Opcode_cmpy_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_cmpy_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8001;
+}
+
+static void
+Opcode_cmpy2cm_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc001;
+}
+
+static void
+Opcode_cmpy2cm_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
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+{
+  slotbuf[0] = 0x1;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2001;
+}
+
+static void
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+{
+  slotbuf[0] = 0;
+}
+
+static void
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+{
+  slotbuf[0] = 0x1;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3;
+}
+
+static void
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+{
+  slotbuf[0] = 0x20000;
+}
+
+static void
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+{
+  slotbuf[0] = 0x20001;
+}
+
+static void
+Opcode_lin_int_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc002;
+}
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+static void
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+{
+  slotbuf[0] = 0x1;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2000;
+}
+
+static void
+Opcode_mac_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_mac_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6001;
+}
+
+static void
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+{
+  slotbuf[0] = 0x2002;
+}
+
+static void
+Opcode_macd8_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20002;
+}
+
+static void
+Opcode_macpqxp_0_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20003;
+}
+
+static void
+Opcode_macpqxp_1_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40000;
+}
+
+static void
+Opcode_macpqxp_2_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40001;
+}
+
+static void
+Opcode_macpqxp_3_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40002;
+}
+
+static void
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+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_macxp2_0_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40003;
+}
+
+static void
+Opcode_macxp2_1_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x60000;
+}
+
+static void
+Opcode_macxp_0_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2003;
+}
+
+static void
+Opcode_macxp_1_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_macxp_2_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6000;
+}
+
+static void
+Opcode_macxp_3_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4001;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc010;
+}
+
+static void
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+{
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+static void
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+
+static void
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+{
+  slotbuf[0] = 0xc003;
+}
+
+static void
+Opcode_mpy2cm_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_mpy2pq_Slot_pq_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_mpy8_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4002;
+}
+
+static void
+Opcode_mpyadd8_2cm_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10000;
+}
+
+static void
+Opcode_mpyadd8_2cm_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
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+static void
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+{
+  slotbuf[0] = 0x60001;
+}
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+static void
+Opcode_mpypqxp_0_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x60002;
+}
+
+static void
+Opcode_mpypqxp_1_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x60003;
+}
+
+static void
+Opcode_mpypqxp_2_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80000;
+}
+
+static void
+Opcode_mpypqxp_3_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80001;
+}
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+static void
+Opcode_mpys_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6002;
+}
+
+static void
+Opcode_mpyxp2pq_Slot_pq_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100;
+}
+
+static void
+Opcode_mpyxp2_0_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80002;
+}
+
+static void
+Opcode_mpyxp2_1_Slot_dot_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80003;
+}
+
+static void
+Opcode_mpyxp_0_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4003;
+}
+
+static void
+Opcode_mpyxp_1_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6003;
+}
+
+static void
+Opcode_mpyxp_2_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
+Opcode_mpyxp_3_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa000;
+}
+
+static void
+Opcode_normacd_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8001;
+}
+
+static void
+Opcode_normacd_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc001;
+}
+
+static void
+Opcode_normacpq_i_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe000;
+}
+
+static void
+Opcode_normacpq_r_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe040;
+}
+
+static void
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+{
+  slotbuf[0] = 0xa001;
+}
+
+static void
+Opcode_normd_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe001;
+}
+
+static void
+Opcode_normpypq_i_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe080;
+}
+
+static void
+Opcode_normpypq_r_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe100;
+}
+
+static void
+Opcode_rcmac_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8002;
+}
+
+static void
+Opcode_rcmpy_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa002;
+}
+
+static void
+Opcode_rcmpy2cm_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10001;
+}
+
+static void
+Opcode_rcmpy2cm_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc000;
+}
+
+static void
+Opcode_rfir_Slot_acc2_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_rfira_Slot_acc2_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_rfird_Slot_acc2_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
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+static void
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+{
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+}
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+static void
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+{
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+}
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+static void
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+{
+  slotbuf[0] = 0xa003;
+}
+
+static void
+Opcode_rmpy2cm_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10002;
+}
+
+static void
+Opcode_rmpy2cm_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_smod_align_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_smod_scr_Slot_smod_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2;
+}
+
+static void
+Opcode_sub2ac_Slot_gp_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc020;
+}
+
+static void
+Opcode_wght32_Slot_llr_slot1_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
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+static void
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+static void
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+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x56008;
+}
+
+static void
+Opcode_ext_r2fifo_3_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+static void
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+static void
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+{
+  slotbuf[0] = 0x40180;
+}
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+static void
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+static void
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+
+static void
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+}
+
+static void
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+{
+  slotbuf[0] = 0x10000;
+}
+
+static void
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+{
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+static void
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+{
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+
+static void
+Opcode_lut_ar_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
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+
+static void
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+{
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+
+static void
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+
+static void
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+{
+  slotbuf[0] = 0x401c0;
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x240;
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+
+static void
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+static void
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+static void
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+static void
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+
+static void
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+{
+  slotbuf[0] = 0x40059;
+}
+
+static void
+Opcode_lut_phasor_Slot_acc2_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5;
+}
+
+static void
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+{
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+static void
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+
+static void
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+static void
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+Opcode_moveq32_0_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd8dd4;
+}
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+static void
+Opcode_moveq32_0_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
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+  slotbuf[0] = 0x8214;
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+{
+  slotbuf[0] = 0x119;
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+{
+  slotbuf[0] = 0x80d;
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+
+static void
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+{
+  slotbuf[0] = 0x2b80;
+}
+
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+}
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+  slotbuf[0] = 0x28018;
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+
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+
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+
+static void
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+  slotbuf[0] = 0x48018;
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+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x64071;
+}
+
+static void
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+{
+  slotbuf[0] = 0x825;
+}
+
+static void
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+{
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+
+static void
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+{
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0x46002;
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+static void
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+
+static void
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+static void
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+static void
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+
+static void
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+{
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+}
+
+static void
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+static void
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+static void
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+static void
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+{
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+static void
+Opcode_add16_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x481401;
+}
+
+static void
+Opcode_add32_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40000;
+}
+
+static void
+Opcode_add32_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_add32_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40000;
+}
+
+static void
+Opcode_add32_Slot_acc2_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3;
+}
+
+static void
+Opcode_add32_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_add32_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_add32_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc00040;
+}
+
+static void
+Opcode_addac_i2r_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb78380;
+}
+
+static void
+Opcode_addac_i2r_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6a00c;
+}
+
+static void
+Opcode_addac_i2r_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6a00c;
+}
+
+static void
+Opcode_addac_i2r_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x35832d;
+}
+
+static void
+Opcode_addac_r2i_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xb78390;
+}
+
+static void
+Opcode_addac_r2i_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6a04c;
+}
+
+static void
+Opcode_addac_r2i_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6a04c;
+}
+
+static void
+Opcode_addac_r2i_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x3583ad;
+}
+
+static void
+Opcode_addar2_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e400;
+}
+
+static void
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+{
+  slotbuf[0] = 0x20001;
+}
+
+static void
+Opcode_addar2_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2d000;
+}
+
+static void
+Opcode_addar2_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x20001;
+}
+
+static void
+Opcode_addar2_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc002;
+}
+
+static void
+Opcode_addar2_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x501401;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40040;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40;
+}
+
+static void
+Opcode_addcm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40040;
+}
+
+static void
+Opcode_addcm_Slot_acc2_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_addcm_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40;
+}
+
+static void
+Opcode_addcm_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40;
+}
+
+static void
+Opcode_addcm_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc40040;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40080;
+}
+
+static void
+Opcode_addwrp_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80;
+}
+
+static void
+Opcode_addwrp_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40080;
+}
+
+static void
+Opcode_addwrp_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80;
+}
+
+static void
+Opcode_addwrp_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80;
+}
+
+static void
+Opcode_addwrp_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc80040;
+}
+
+static void
+Opcode_and128_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40100;
+}
+
+static void
+Opcode_and128_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100;
+}
+
+static void
+Opcode_and128_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40100;
+}
+
+static void
+Opcode_and128_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100;
+}
+
+static void
+Opcode_and128_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x100;
+}
+
+static void
+Opcode_and128_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd00040;
+}
+
+static void
+Opcode_argmax8_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc82;
+}
+
+static void
+Opcode_argmax8_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4141;
+}
+
+static void
+Opcode_argmax8_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2002;
+}
+
+static void
+Opcode_argmax8_Slot_acc2_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_argmax8_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4581;
+}
+
+static void
+Opcode_argmax8_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40140;
+}
+
+static void
+Opcode_argmax8_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2000c0;
+}
+
+static void
+Opcode_asl_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40200;
+}
+
+static void
+Opcode_asl_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200;
+}
+
+static void
+Opcode_asl_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40200;
+}
+
+static void
+Opcode_asl_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200;
+}
+
+static void
+Opcode_asl_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x200;
+}
+
+static void
+Opcode_asl_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe00040;
+}
+
+static void
+Opcode_asl32_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_asl32_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_asl32_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_asl32_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000;
+}
+
+static void
+Opcode_asl32_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc0;
+}
+
+static void
+Opcode_asl32_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1c01;
+}
+
+static void
+Opcode_aslacm_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xbc8000;
+}
+
+static void
+Opcode_aslacm_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x70002;
+}
+
+static void
+Opcode_aslacm_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6e002;
+}
+
+static void
+Opcode_aslacm_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x302;
+}
+
+static void
+Opcode_aslm_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40001;
+}
+
+static void
+Opcode_aslm_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
+Opcode_aslm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40001;
+}
+
+static void
+Opcode_aslm_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8000;
+}
+
+static void
+Opcode_aslm_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
+Opcode_aslm_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140002;
+}
+
+static void
+Opcode_aslm32_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2002;
+}
+
+static void
+Opcode_aslm32_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4301;
+}
+
+static void
+Opcode_aslm32_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1002;
+}
+
+static void
+Opcode_aslm32_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4301;
+}
+
+static void
+Opcode_aslm32_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40300;
+}
+
+static void
+Opcode_aslm32_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400100;
+}
+
+static void
+Opcode_asr_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400c0;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc0;
+}
+
+static void
+Opcode_asr_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400c0;
+}
+
+static void
+Opcode_asr_Slot_acc2_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4001;
+}
+
+static void
+Opcode_asr_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc0;
+}
+
+static void
+Opcode_asr_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140;
+}
+
+static void
+Opcode_asr_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xcc0040;
+}
+
+static void
+Opcode_asr32_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x401;
+}
+
+static void
+Opcode_asr32_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140;
+}
+
+static void
+Opcode_asr32_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x401;
+}
+
+static void
+Opcode_asr32_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140;
+}
+
+static void
+Opcode_asr32_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x180;
+}
+
+static void
+Opcode_asr32_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x41c01;
+}
+
+static void
+Opcode_asrac_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x570b00;
+}
+
+static void
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+{
+  slotbuf[0] = 0x6a002;
+}
+
+static void
+Opcode_asrac_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x6e102;
+}
+
+static void
+Opcode_asrac_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x80142;
+}
+
+static void
+Opcode_asrm_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40005;
+}
+
+static void
+Opcode_asrm_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8004;
+}
+
+static void
+Opcode_asrm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40005;
+}
+
+static void
+Opcode_asrm_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8004;
+}
+
+static void
+Opcode_asrm_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5;
+}
+
+static void
+Opcode_asrm_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x180002;
+}
+
+static void
+Opcode_bitfext_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0;
+}
+
+static void
+Opcode_bitfins_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x1;
+}
+
+static void
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+{
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+static void
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+{
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+static void
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+{
+  slotbuf[0] = 0xe403;
+}
+
+static void
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+{
+  slotbuf[0] = 0x5802c;
+}
+
+static void
+Opcode_clb_c_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34c02d;
+}
+
+static void
+Opcode_clb_r_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x578b00;
+}
+
+static void
+Opcode_clb_r_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5a02c;
+}
+
+static void
+Opcode_clb_r_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe803;
+}
+
+static void
+Opcode_clb_r_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x5a02c;
+}
+
+static void
+Opcode_clb_r_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x34e02d;
+}
+
+static void
+Opcode_cmp8_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40009;
+}
+
+static void
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+{
+  slotbuf[0] = 0x8008;
+}
+
+static void
+Opcode_cmp8_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40009;
+}
+
+static void
+Opcode_cmp8_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8008;
+}
+
+static void
+Opcode_cmp8_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9;
+}
+
+static void
+Opcode_cmp8_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140006;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40011;
+}
+
+static void
+Opcode_cmp_i_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8010;
+}
+
+static void
+Opcode_cmp_i_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40011;
+}
+
+static void
+Opcode_cmp_i_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8010;
+}
+
+static void
+Opcode_cmp_i_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x11;
+}
+
+static void
+Opcode_cmp_i_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x14000a;
+}
+
+static void
+Opcode_cmp_r_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40021;
+}
+
+static void
+Opcode_cmp_r_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8020;
+}
+
+static void
+Opcode_cmp_r_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40021;
+}
+
+static void
+Opcode_cmp_r_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8020;
+}
+
+static void
+Opcode_cmp_r_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x21;
+}
+
+static void
+Opcode_cmp_r_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x140012;
+}
+
+static void
+Opcode_ext_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd80000;
+}
+
+static void
+Opcode_ext_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2a002;
+}
+
+static void
+Opcode_ext_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8002;
+}
+
+static void
+Opcode_ext_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2a002;
+}
+
+static void
+Opcode_ext_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x524000;
+}
+
+static void
+Opcode_ext_r_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xd88000;
+}
+
+static void
+Opcode_ext_r_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e002;
+}
+
+static void
+Opcode_ext_r_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xa002;
+}
+
+static void
+Opcode_ext_r_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e002;
+}
+
+static void
+Opcode_ext_r_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x528000;
+}
+
+static void
+Opcode_ext32_i_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x170600;
+}
+
+static void
+Opcode_ext32_i_Slot_gp_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x44028;
+}
+
+static void
+Opcode_ext32_i_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf402;
+}
+
+static void
+Opcode_ext32_i_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x44028;
+}
+
+static void
+Opcode_ext32_i_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x340019;
+}
+
+static void
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+{
+  slotbuf[0] = 0x270600;
+}
+
+static void
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+{
+  slotbuf[0] = 0x4c008;
+}
+
+static void
+Opcode_ext32_r_Slot_dot_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf802;
+}
+
+static void
+Opcode_ext32_r_Slot_pq_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4c008;
+}
+
+static void
+Opcode_ext32_r_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x340039;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40140;
+}
+
+static void
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+{
+  slotbuf[0] = 0x180;
+}
+
+static void
+Opcode_extui4_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40140;
+}
+
+static void
+Opcode_extui4_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x180;
+}
+
+static void
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+{
+  slotbuf[0] = 0x1c0;
+}
+
+static void
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+{
+  slotbuf[0] = 0xd40040;
+}
+
+static void
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+{
+  slotbuf[0] = 0x4000d;
+}
+
+static void
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+{
+  slotbuf[0] = 0xc000;
+}
+
+static void
+Opcode_lslm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4000d;
+}
+
+static void
+Opcode_lslm_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc000;
+}
+
+static void
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+{
+  slotbuf[0] = 0xd;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x800c;
+}
+
+static void
+Opcode_lsrm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40015;
+}
+
+static void
+Opcode_lsrm_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800c;
+}
+
+static void
+Opcode_lsrm_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x15;
+}
+
+static void
+Opcode_lsrm_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x14000e;
+}
+
+static void
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+{
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+}
+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x40280;
+}
+
+static void
+Opcode_max8_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x300;
+}
+
+static void
+Opcode_max8_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c0;
+}
+
+static void
+Opcode_max8_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe80040;
+}
+
+static void
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+{
+  slotbuf[0] = 0x40300;
+}
+
+static void
+Opcode_mean_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c0;
+}
+
+static void
+Opcode_mean_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40300;
+}
+
+static void
+Opcode_mean_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2c0;
+}
+
+static void
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+{
+  slotbuf[0] = 0x340;
+}
+
+static void
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+{
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+}
+
+static void
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+}
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+static void
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+{
+  slotbuf[0] = 0x340;
+}
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+static void
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+{
+  slotbuf[0] = 0x402c0;
+}
+
+static void
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+{
+  slotbuf[0] = 0x340;
+}
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+static void
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+}
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+static void
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+static void
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+}
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+static void
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+{
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+}
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+static void
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+}
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+static void
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+}
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+static void
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+{
+  slotbuf[0] = 0xf40040;
+}
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+static void
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+{
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+}
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+static void
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+{
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+}
+
+static void
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+{
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+}
+
+static void
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+{
+  slotbuf[0] = 0x6002c;
+}
+
+static void
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+{
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+static void
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+static void
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+static void
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+static void
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+{
+  slotbuf[0] = 0x6800c;
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+static void
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+static void
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+{
+  slotbuf[0] = 0x4005d;
+}
+
+static void
+Opcode_not128_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8154;
+}
+
+static void
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+{
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+static void
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+}
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+static void
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+{
+  slotbuf[0] = 0x40380;
+}
+
+static void
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+{
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+static void
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+}
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+static void
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+static void
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+static void
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+static void
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+  slotbuf[0] = 0x7000c;
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+static void
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+{
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+static void
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+{
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+
+static void
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+
+static void
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+{
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+{
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+
+static void
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+static void
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+static void
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+static void
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+{
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+
+static void
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+static void
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+static void
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+
+static void
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+{
+  slotbuf[0] = 0x6a18c;
+}
+
+static void
+Opcode_subac_r2i_Slot_dual_slot0_encode (xtensa_insnbuf slotbuf)
+{
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+}
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+static void
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+{
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+}
+
+static void
+Opcode_subarx_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x11401;
+}
+
+static void
+Opcode_subarx_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x2e400;
+}
+
+static void
+Opcode_subarx_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x10c01;
+}
+
+static void
+Opcode_subarx_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xcc02;
+}
+
+static void
+Opcode_subarx_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4cd401;
+}
+
+static void
+Opcode_subcm_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40002;
+}
+
+static void
+Opcode_subcm_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4081;
+}
+
+static void
+Opcode_subcm_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40002;
+}
+
+static void
+Opcode_subcm_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4101;
+}
+
+static void
+Opcode_subcm_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40080;
+}
+
+static void
+Opcode_subcm_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xc0;
+}
+
+static void
+Opcode_submean_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40042;
+}
+
+static void
+Opcode_submean_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4101;
+}
+
+static void
+Opcode_submean_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40042;
+}
+
+static void
+Opcode_submean_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4201;
+}
+
+static void
+Opcode_submean_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40100;
+}
+
+static void
+Opcode_submean_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400080;
+}
+
+static void
+Opcode_subwrp_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40082;
+}
+
+static void
+Opcode_subwrp_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4201;
+}
+
+static void
+Opcode_subwrp_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40082;
+}
+
+static void
+Opcode_subwrp_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40c1;
+}
+
+static void
+Opcode_subwrp_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40200;
+}
+
+static void
+Opcode_subwrp_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800080;
+}
+
+static void
+Opcode_trans_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4009d;
+}
+
+static void
+Opcode_trans_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8194;
+}
+
+static void
+Opcode_trans_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4009d;
+}
+
+static void
+Opcode_trans_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x8194;
+}
+
+static void
+Opcode_trans_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x9d;
+}
+
+static void
+Opcode_trans_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x800f0;
+}
+
+static void
+Opcode_xor128_Slot_gp_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40102;
+}
+
+static void
+Opcode_xor128_Slot_dot_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40c1;
+}
+
+static void
+Opcode_xor128_Slot_pq_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x40102;
+}
+
+static void
+Opcode_xor128_Slot_smod_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x4141;
+}
+
+static void
+Opcode_xor128_Slot_llr_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400c0;
+}
+
+static void
+Opcode_xor128_Slot_dual_slot2_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0x400c0;
+}
+
+static void
+Opcode_rur_expstate_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30000;
+}
+
+static void
+Opcode_wur_expstate_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30000;
+}
+
+static void
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+{
+  slotbuf[0] = 0xe30010;
+}
+
+static void
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+{
+  slotbuf[0] = 0xf30100;
+}
+
+static void
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+{
+  slotbuf[0] = 0xe30020;
+}
+
+static void
+Opcode_wur_sat_mode_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30200;
+}
+
+static void
+Opcode_rur_sar0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30030;
+}
+
+static void
+Opcode_wur_sar0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30300;
+}
+
+static void
+Opcode_rur_sar1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30040;
+}
+
+static void
+Opcode_wur_sar1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30400;
+}
+
+static void
+Opcode_rur_sar2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30050;
+}
+
+static void
+Opcode_wur_sar2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30500;
+}
+
+static void
+Opcode_rur_sar3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30060;
+}
+
+static void
+Opcode_wur_sar3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30600;
+}
+
+static void
+Opcode_rur_hsar0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30070;
+}
+
+static void
+Opcode_wur_hsar0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30700;
+}
+
+static void
+Opcode_rur_hsar1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30080;
+}
+
+static void
+Opcode_wur_hsar1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30800;
+}
+
+static void
+Opcode_rur_hsar2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30090;
+}
+
+static void
+Opcode_wur_hsar2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30900;
+}
+
+static void
+Opcode_rur_hsar3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe300a0;
+}
+
+static void
+Opcode_wur_hsar3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30a00;
+}
+
+static void
+Opcode_rur_max_reg_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe300b0;
+}
+
+static void
+Opcode_wur_max_reg_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30b00;
+}
+
+static void
+Opcode_rur_max_reg_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe300c0;
+}
+
+static void
+Opcode_wur_max_reg_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30c00;
+}
+
+static void
+Opcode_rur_max_reg_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe300d0;
+}
+
+static void
+Opcode_wur_max_reg_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30d00;
+}
+
+static void
+Opcode_rur_max_reg_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe300e0;
+}
+
+static void
+Opcode_wur_max_reg_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30e00;
+}
+
+static void
+Opcode_rur_arg_max_reg_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe300f0;
+}
+
+static void
+Opcode_wur_arg_max_reg_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf30f00;
+}
+
+static void
+Opcode_rur_arg_max_reg_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30100;
+}
+
+static void
+Opcode_wur_arg_max_reg_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31000;
+}
+
+static void
+Opcode_rur_arg_max_reg_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30110;
+}
+
+static void
+Opcode_wur_arg_max_reg_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31100;
+}
+
+static void
+Opcode_rur_arg_max_reg_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30120;
+}
+
+static void
+Opcode_wur_arg_max_reg_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31200;
+}
+
+static void
+Opcode_rur_nco_counter_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
+
+static void
+Opcode_wur_nco_counter_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31300;
+}
+
+static void
+Opcode_rur_nco_counter_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30140;
+}
+
+static void
+Opcode_wur_nco_counter_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31400;
+}
+
+static void
+Opcode_rur_nco_counter_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30150;
+}
+
+static void
+Opcode_wur_nco_counter_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31500;
+}
+
+static void
+Opcode_rur_nco_counter_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30160;
+}
+
+static void
+Opcode_wur_nco_counter_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31600;
+}
+
+static void
+Opcode_rur_interp_ext_n_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30170;
+}
+
+static void
+Opcode_wur_interp_ext_n_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf31700;
+}
+
+static void
+Opcode_rur_interp_ext_l_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30180;
+}
+
+static void
+Opcode_wur_interp_ext_l_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
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+}
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+static void
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+static void
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+static void
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+static void
+Opcode_wur_llr_buf_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
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+  slotbuf[0] = 0xf31a00;
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+static void
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+
+static void
+Opcode_wur_llr_buf_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
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+static void
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+static void
+Opcode_wur_llr_buf_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
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+static void
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+static void
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+static void
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+static void
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+{
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+static void
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+static void
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+{
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+static void
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+static void
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+static void
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+static void
+Opcode_wur_smod_buf_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33100;
+}
+
+static void
+Opcode_rur_smod_buf_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30320;
+}
+
+static void
+Opcode_wur_smod_buf_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33200;
+}
+
+static void
+Opcode_rur_smod_buf_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30330;
+}
+
+static void
+Opcode_wur_smod_buf_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33300;
+}
+
+static void
+Opcode_rur_smod_buf_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30340;
+}
+
+static void
+Opcode_wur_smod_buf_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33400;
+}
+
+static void
+Opcode_rur_smod_buf_4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30350;
+}
+
+static void
+Opcode_wur_smod_buf_4_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33500;
+}
+
+static void
+Opcode_rur_smod_buf_5_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30360;
+}
+
+static void
+Opcode_wur_smod_buf_5_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33600;
+}
+
+static void
+Opcode_rur_smod_buf_6_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30370;
+}
+
+static void
+Opcode_wur_smod_buf_6_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33700;
+}
+
+static void
+Opcode_rur_smod_buf_7_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30380;
+}
+
+static void
+Opcode_wur_smod_buf_7_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33800;
+}
+
+static void
+Opcode_rur_weight_reg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30390;
+}
+
+static void
+Opcode_wur_weight_reg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33900;
+}
+
+static void
+Opcode_rur_scale_reg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe303a0;
+}
+
+static void
+Opcode_wur_scale_reg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33a00;
+}
+
+static void
+Opcode_rur_llr_pos_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe303b0;
+}
+
+static void
+Opcode_wur_llr_pos_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33b00;
+}
+
+static void
+Opcode_rur_smod_pos_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe303c0;
+}
+
+static void
+Opcode_wur_smod_pos_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33c00;
+}
+
+static void
+Opcode_rur_perm_reg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe303d0;
+}
+
+static void
+Opcode_wur_perm_reg_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33d00;
+}
+
+static void
+Opcode_rur_smod_offset_table_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe303e0;
+}
+
+static void
+Opcode_wur_smod_offset_table_0_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33e00;
+}
+
+static void
+Opcode_rur_smod_offset_table_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe303f0;
+}
+
+static void
+Opcode_wur_smod_offset_table_1_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf33f00;
+}
+
+static void
+Opcode_rur_smod_offset_table_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30400;
+}
+
+static void
+Opcode_wur_smod_offset_table_2_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf34000;
+}
+
+static void
+Opcode_rur_smod_offset_table_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30410;
+}
+
+static void
+Opcode_wur_smod_offset_table_3_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf34100;
+}
+
+static void
+Opcode_rur_phasor_n_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30420;
+}
+
+static void
+Opcode_wur_phasor_n_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf34200;
+}
+
+static void
+Opcode_rur_phasor_offset_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xe30430;
+}
+
+static void
+Opcode_wur_phasor_offset_Slot_inst_encode (xtensa_insnbuf slotbuf)
+{
+  slotbuf[0] = 0xf34300;
+}
+
+static xtensa_opcode_encode_fn Opcode_excw_encode_fns[] = {
+  Opcode_excw_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_rfe_encode_fns[] = {
+  Opcode_rfe_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_rfde_encode_fns[] = {
+  Opcode_rfde_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_syscall_encode_fns[] = {
+  Opcode_syscall_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_simcall_encode_fns[] = {
+  Opcode_simcall_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_call12_encode_fns[] = {
+  Opcode_call12_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_call8_encode_fns[] = {
+  Opcode_call8_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_call4_encode_fns[] = {
+  Opcode_call4_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_callx12_encode_fns[] = {
+  Opcode_callx12_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_callx8_encode_fns[] = {
+  Opcode_callx8_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_callx4_encode_fns[] = {
+  Opcode_callx4_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_entry_encode_fns[] = {
+  Opcode_entry_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_movsp_encode_fns[] = {
+  Opcode_movsp_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_rotw_encode_fns[] = {
+  Opcode_rotw_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_retw_encode_fns[] = {
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+};
+
+static xtensa_opcode_encode_fn Opcode_retw_n_encode_fns[] = {
+  0, 0, Opcode_retw_n_Slot_inst16b_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_rfwo_encode_fns[] = {
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+};
+
+static xtensa_opcode_encode_fn Opcode_rfwu_encode_fns[] = {
+  Opcode_rfwu_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_l32e_encode_fns[] = {
+  Opcode_l32e_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_s32e_encode_fns[] = {
+  Opcode_s32e_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
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+static xtensa_opcode_encode_fn Opcode_rsr_windowbase_encode_fns[] = {
+  Opcode_rsr_windowbase_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_wsr_windowbase_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_xsr_windowbase_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_rsr_windowstart_encode_fns[] = {
+  Opcode_rsr_windowstart_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_wsr_windowstart_encode_fns[] = {
+  Opcode_wsr_windowstart_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_xsr_windowstart_encode_fns[] = {
+  Opcode_xsr_windowstart_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_add_n_encode_fns[] = {
+  0, Opcode_add_n_Slot_inst16a_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_addi_n_encode_fns[] = {
+  0, Opcode_addi_n_Slot_inst16a_encode, 0, Opcode_addi_n_Slot_gp_slot2_encode, 0, Opcode_addi_n_Slot_gp_slot0_encode, 0, 0, Opcode_addi_n_Slot_dot_slot0_encode, Opcode_addi_n_Slot_pq_slot2_encode, 0, Opcode_addi_n_Slot_pq_slot0_encode, 0, 0, Opcode_addi_n_Slot_acc2_slot0_encode, 0, 0, Opcode_addi_n_Slot_smod_slot0_encode, 0, 0, Opcode_addi_n_Slot_llr_slot0_encode, Opcode_addi_n_Slot_dual_slot2_encode, 0, Opcode_addi_n_Slot_dual_slot0_encode
+};
+
+static xtensa_opcode_encode_fn Opcode_beqz_n_encode_fns[] = {
+  0, 0, Opcode_beqz_n_Slot_inst16b_encode, 0, 0, Opcode_beqz_n_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_beqz_n_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_beqz_n_Slot_smod_slot0_encode, 0, 0, 0, Opcode_beqz_n_Slot_dual_slot2_encode, 0, Opcode_beqz_n_Slot_dual_slot0_encode
+};
+
+static xtensa_opcode_encode_fn Opcode_bnez_n_encode_fns[] = {
+  0, 0, Opcode_bnez_n_Slot_inst16b_encode, 0, 0, Opcode_bnez_n_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_bnez_n_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_bnez_n_Slot_smod_slot0_encode, 0, 0, 0, Opcode_bnez_n_Slot_dual_slot2_encode, 0, Opcode_bnez_n_Slot_dual_slot0_encode
+};
+
+static xtensa_opcode_encode_fn Opcode_ill_n_encode_fns[] = {
+  0, 0, Opcode_ill_n_Slot_inst16b_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
+};
+
+static xtensa_opcode_encode_fn Opcode_l32i_n_encode_fns[] = {
+  0, Opcode_l32i_n_Slot_inst16a_encode, 0, 0, 0, Opcode_l32i_n_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_l32i_n_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_l32i_n_Slot_smod_slot0_encode, 0, 0, Opcode_l32i_n_Slot_llr_slot0_encode, 0, 0, Opcode_l32i_n_Slot_dual_slot0_encode
+};
+
+static xtensa_opcode_encode_fn Opcode_mov_n_encode_fns[] = {
+  0, 0, Opcode_mov_n_Slot_inst16b_encode, Opcode_mov_n_Slot_gp_slot2_encode, 0, Opcode_mov_n_Slot_gp_slot0_encode, 0, 0, Opcode_mov_n_Slot_dot_slot0_encode, Opcode_mov_n_Slot_pq_slot2_encode, 0, Opcode_mov_n_Slot_pq_slot0_encode, 0, 0, Opcode_mov_n_Slot_acc2_slot0_encode, 0, 0, Opcode_mov_n_Slot_smod_slot0_encode, 0, 0, Opcode_mov_n_Slot_llr_slot0_encode, Opcode_mov_n_Slot_dual_slot2_encode, 0, Opcode_mov_n_Slot_dual_slot0_encode
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+static xtensa_opcode_encode_fn Opcode_movi_n_encode_fns[] = {
+  0, 0, Opcode_movi_n_Slot_inst16b_encode, Opcode_movi_n_Slot_gp_slot2_encode, 0, Opcode_movi_n_Slot_gp_slot0_encode, 0, 0, Opcode_movi_n_Slot_dot_slot0_encode, Opcode_movi_n_Slot_pq_slot2_encode, 0, Opcode_movi_n_Slot_pq_slot0_encode, 0, 0, Opcode_movi_n_Slot_acc2_slot0_encode, 0, 0, Opcode_movi_n_Slot_smod_slot0_encode, 0, 0, Opcode_movi_n_Slot_llr_slot0_encode, Opcode_movi_n_Slot_dual_slot2_encode, 0, Opcode_movi_n_Slot_dual_slot0_encode
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+
+static xtensa_opcode_encode_fn Opcode_nop_n_encode_fns[] = {
+  0, 0, Opcode_nop_n_Slot_inst16b_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
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+
+static xtensa_opcode_encode_fn Opcode_ret_n_encode_fns[] = {
+  0, 0, Opcode_ret_n_Slot_inst16b_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
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+static xtensa_opcode_encode_fn Opcode_s32i_n_encode_fns[] = {
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+};
+
+static xtensa_opcode_encode_fn Opcode_rur_threadptr_encode_fns[] = {
+  Opcode_rur_threadptr_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
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+static xtensa_opcode_encode_fn Opcode_wur_threadptr_encode_fns[] = {
+  Opcode_wur_threadptr_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0
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+static xtensa_opcode_encode_fn Opcode_addi_encode_fns[] = {
+  Opcode_addi_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, Opcode_addi_Slot_dual_slot2_encode, 0, Opcode_addi_Slot_dual_slot0_encode
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+
+static xtensa_opcode_encode_fn Opcode_addmi_encode_fns[] = {
+  Opcode_addmi_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, Opcode_addmi_Slot_dual_slot2_encode, 0, Opcode_addmi_Slot_dual_slot0_encode
+};
+
+static xtensa_opcode_encode_fn Opcode_add_encode_fns[] = {
+  Opcode_add_Slot_inst_encode, 0, 0, Opcode_add_Slot_gp_slot2_encode, 0, Opcode_add_Slot_gp_slot0_encode, 0, 0, Opcode_add_Slot_dot_slot0_encode, Opcode_add_Slot_pq_slot2_encode, 0, Opcode_add_Slot_pq_slot0_encode, 0, 0, Opcode_add_Slot_acc2_slot0_encode, 0, 0, Opcode_add_Slot_smod_slot0_encode, 0, 0, Opcode_add_Slot_llr_slot0_encode, Opcode_add_Slot_dual_slot2_encode, 0, Opcode_add_Slot_dual_slot0_encode
+};
+
+static xtensa_opcode_encode_fn Opcode_sub_encode_fns[] = {
+  Opcode_sub_Slot_inst_encode, 0, 0, Opcode_sub_Slot_gp_slot2_encode, 0, Opcode_sub_Slot_gp_slot0_encode, 0, 0, Opcode_sub_Slot_dot_slot0_encode, Opcode_sub_Slot_pq_slot2_encode, 0, Opcode_sub_Slot_pq_slot0_encode, 0, 0, Opcode_sub_Slot_acc2_slot0_encode, 0, 0, Opcode_sub_Slot_smod_slot0_encode, 0, 0, Opcode_sub_Slot_llr_slot0_encode, Opcode_sub_Slot_dual_slot2_encode, 0, Opcode_sub_Slot_dual_slot0_encode
+};
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+static xtensa_opcode_encode_fn Opcode_addx2_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_clamps_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_min_encode_fns[] = {
+  Opcode_min_Slot_inst_encode, 0, 0, 0, 0, Opcode_min_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_min_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_min_Slot_smod_slot0_encode, 0, 0, 0, Opcode_min_Slot_dual_slot2_encode, 0, Opcode_min_Slot_dual_slot0_encode
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+static xtensa_opcode_encode_fn Opcode_max_encode_fns[] = {
+  Opcode_max_Slot_inst_encode, 0, 0, 0, 0, Opcode_max_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_max_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_max_Slot_smod_slot0_encode, 0, 0, 0, Opcode_max_Slot_dual_slot2_encode, 0, Opcode_max_Slot_dual_slot0_encode
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+static xtensa_opcode_encode_fn Opcode_minu_encode_fns[] = {
+  Opcode_minu_Slot_inst_encode, 0, 0, 0, 0, Opcode_minu_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_minu_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_minu_Slot_smod_slot0_encode, 0, 0, 0, Opcode_minu_Slot_dual_slot2_encode, 0, Opcode_minu_Slot_dual_slot0_encode
+};
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+static xtensa_opcode_encode_fn Opcode_maxu_encode_fns[] = {
+  Opcode_maxu_Slot_inst_encode, 0, 0, 0, 0, Opcode_maxu_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_maxu_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_maxu_Slot_smod_slot0_encode, 0, 0, 0, Opcode_maxu_Slot_dual_slot2_encode, 0, Opcode_maxu_Slot_dual_slot0_encode
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+
+static xtensa_opcode_encode_fn Opcode_nsa_encode_fns[] = {
+  Opcode_nsa_Slot_inst_encode, 0, 0, 0, 0, Opcode_nsa_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_nsa_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_nsa_Slot_smod_slot0_encode, 0, 0, 0, Opcode_nsa_Slot_dual_slot2_encode, 0, Opcode_nsa_Slot_dual_slot0_encode
+};
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+static xtensa_opcode_encode_fn Opcode_nsau_encode_fns[] = {
+  Opcode_nsau_Slot_inst_encode, 0, 0, 0, 0, Opcode_nsau_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_nsau_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_nsau_Slot_smod_slot0_encode, 0, 0, 0, Opcode_nsau_Slot_dual_slot2_encode, 0, Opcode_nsau_Slot_dual_slot0_encode
+};
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+static xtensa_opcode_encode_fn Opcode_sext_encode_fns[] = {
+  Opcode_sext_Slot_inst_encode, 0, 0, 0, 0, Opcode_sext_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_sext_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, Opcode_sext_Slot_smod_slot0_encode, 0, 0, 0, Opcode_sext_Slot_dual_slot2_encode, 0, Opcode_sext_Slot_dual_slot0_encode
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+static xtensa_opcode_encode_fn Opcode_l32ai_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_s32ri_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_s32c1i_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_rsr_scompare1_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_moveqz_s_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_movnez_s_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_movltz_s_encode_fns[] = {
+  Opcode_movltz_s_Slot_inst_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, Opcode_movltz_s_Slot_dual_slot0_encode
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+
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+static xtensa_opcode_encode_fn Opcode_get_argmax_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_hsar_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_hsar2sar_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_interp_ext_n_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_interp_ext_l_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_phasor_offset_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_scale_reg_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_smod_buf_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_smod_offset_table_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_smod_pos_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_sov_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_get_wght_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_set_argmax_encode_fns[] = {
+  Opcode_set_argmax_Slot_inst_encode, 0, 0, Opcode_set_argmax_Slot_gp_slot2_encode, 0, 0, Opcode_set_argmax_Slot_dot_slot2_encode, 0, 0, Opcode_set_argmax_Slot_pq_slot2_encode, 0, 0, 0, 0, 0, Opcode_set_argmax_Slot_smod_slot2_encode, 0, 0, Opcode_set_argmax_Slot_llr_slot2_encode, 0, 0, Opcode_set_argmax_Slot_dual_slot2_encode, 0, 0
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+
+static xtensa_opcode_encode_fn Opcode_set_ext_regs_encode_fns[] = {
+  Opcode_set_ext_regs_Slot_inst_encode, 0, 0, Opcode_set_ext_regs_Slot_gp_slot2_encode, 0, 0, Opcode_set_ext_regs_Slot_dot_slot2_encode, 0, 0, Opcode_set_ext_regs_Slot_pq_slot2_encode, 0, 0, 0, 0, 0, Opcode_set_ext_regs_Slot_smod_slot2_encode, 0, 0, Opcode_set_ext_regs_Slot_llr_slot2_encode, 0, 0, Opcode_set_ext_regs_Slot_dual_slot2_encode, 0, 0
+};
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+static xtensa_opcode_encode_fn Opcode_sac_ih_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_movcnd_6_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_mpyadd8_2cm_encode_fns[] = {
+  0, 0, 0, 0, Opcode_mpyadd8_2cm_Slot_gp_slot1_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, Opcode_mpyadd8_2cm_Slot_smod_slot1_encode, 0, 0, 0, 0, 0, 0, 0
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+static xtensa_opcode_encode_fn Opcode_mpyd8_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_mpypqxp_0_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_ext_2fifo_0_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_ext_2fifo_2_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_moveq128_0_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_moveq128_1_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_moveq128_2_encode_fns[] = {
+  Opcode_moveq128_2_Slot_inst_encode, 0, 0, Opcode_moveq128_2_Slot_gp_slot2_encode, 0, 0, Opcode_moveq128_2_Slot_dot_slot2_encode, 0, 0, Opcode_moveq128_2_Slot_pq_slot2_encode, 0, 0, 0, 0, 0, Opcode_moveq128_2_Slot_smod_slot2_encode, 0, 0, Opcode_moveq128_2_Slot_llr_slot2_encode, 0, 0, Opcode_moveq128_2_Slot_dual_slot2_encode, 0, 0
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+static xtensa_opcode_encode_fn Opcode_moveq128_3_encode_fns[] = {
+  Opcode_moveq128_3_Slot_inst_encode, 0, 0, Opcode_moveq128_3_Slot_gp_slot2_encode, 0, 0, Opcode_moveq128_3_Slot_dot_slot2_encode, 0, 0, Opcode_moveq128_3_Slot_pq_slot2_encode, 0, 0, 0, 0, 0, Opcode_moveq128_3_Slot_smod_slot2_encode, 0, 0, Opcode_moveq128_3_Slot_llr_slot2_encode, 0, 0, Opcode_moveq128_3_Slot_dual_slot2_encode, 0, 0
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+static xtensa_opcode_encode_fn Opcode_moveq128_4_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_moveq128_5_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_moveq32_0_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_1_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_3_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_4_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_5_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop128_2cmpq_0_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop128_2cmpq_1_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2cmpq_2_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2cmpq_3_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2m_0_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop128_2m_1_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2m_2_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2m_3_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2pq_0_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2pq_1_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop128_2pq_2_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop128_2pq_4_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop128_2pq_5_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop2x128_2pq_01_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop2x128_2pq_03_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop2x128_2pq_21_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_pop2x128_2pq_23_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop32_0_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_pop32_1_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_cmp8_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_cmp_i_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_ext_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_perm_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_redac2_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_redac4_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_redacs_encode_fns[] = {
+  Opcode_redacs_Slot_inst_encode, 0, 0, 0, 0, Opcode_redacs_Slot_gp_slot0_encode, 0, 0, 0, 0, 0, Opcode_redacs_Slot_pq_slot0_encode, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, Opcode_redacs_Slot_dual_slot0_encode
+};
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+static xtensa_opcode_encode_fn Opcode_sminclb_c_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_sminclb_r_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_stswapbm_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_subac_i2r_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_subac_r2i_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_subarx_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_subcm_encode_fns[] = {
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+static xtensa_opcode_encode_fn Opcode_rur_phasor_offset_encode_fns[] = {
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+
+static xtensa_opcode_encode_fn Opcode_wur_phasor_offset_encode_fns[] = {
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+};
+
+
+/* Opcode table.  */
+
+static xtensa_opcode_internal opcodes[] = {
+  { "excw", ICLASS_xt_iclass_excw,
+    0,
+    Opcode_excw_encode_fns, 0, 0 },
+  { "rfe", ICLASS_xt_iclass_rfe,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_rfe_encode_fns, 0, 0 },
+  { "rfde", ICLASS_xt_iclass_rfde,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_rfde_encode_fns, 0, 0 },
+  { "syscall", ICLASS_xt_iclass_syscall,
+    0,
+    Opcode_syscall_encode_fns, 0, 0 },
+  { "simcall", ICLASS_xt_iclass_simcall,
+    0,
+    Opcode_simcall_encode_fns, 0, 0 },
+  { "call12", ICLASS_xt_iclass_call12,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_call12_encode_fns, 0, 0 },
+  { "call8", ICLASS_xt_iclass_call8,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_call8_encode_fns, 0, 0 },
+  { "call4", ICLASS_xt_iclass_call4,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_call4_encode_fns, 0, 0 },
+  { "callx12", ICLASS_xt_iclass_callx12,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_callx12_encode_fns, 0, 0 },
+  { "callx8", ICLASS_xt_iclass_callx8,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_callx8_encode_fns, 0, 0 },
+  { "callx4", ICLASS_xt_iclass_callx4,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_callx4_encode_fns, 0, 0 },
+  { "entry", ICLASS_xt_iclass_entry,
+    0,
+    Opcode_entry_encode_fns, 0, 0 },
+  { "movsp", ICLASS_xt_iclass_movsp,
+    0,
+    Opcode_movsp_encode_fns, 0, 0 },
+  { "rotw", ICLASS_xt_iclass_rotw,
+    0,
+    Opcode_rotw_encode_fns, 0, 0 },
+  { "retw", ICLASS_xt_iclass_retw,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_retw_encode_fns, 0, 0 },
+  { "retw.n", ICLASS_xt_iclass_retw,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_retw_n_encode_fns, 0, 0 },
+  { "rfwo", ICLASS_xt_iclass_rfwou,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_rfwo_encode_fns, 0, 0 },
+  { "rfwu", ICLASS_xt_iclass_rfwou,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_rfwu_encode_fns, 0, 0 },
+  { "l32e", ICLASS_xt_iclass_l32e,
+    0,
+    Opcode_l32e_encode_fns, 0, 0 },
+  { "s32e", ICLASS_xt_iclass_s32e,
+    0,
+    Opcode_s32e_encode_fns, 0, 0 },
+  { "rsr.windowbase", ICLASS_xt_iclass_rsr_windowbase,
+    0,
+    Opcode_rsr_windowbase_encode_fns, 0, 0 },
+  { "wsr.windowbase", ICLASS_xt_iclass_wsr_windowbase,
+    0,
+    Opcode_wsr_windowbase_encode_fns, 0, 0 },
+  { "xsr.windowbase", ICLASS_xt_iclass_xsr_windowbase,
+    0,
+    Opcode_xsr_windowbase_encode_fns, 0, 0 },
+  { "rsr.windowstart", ICLASS_xt_iclass_rsr_windowstart,
+    0,
+    Opcode_rsr_windowstart_encode_fns, 0, 0 },
+  { "wsr.windowstart", ICLASS_xt_iclass_wsr_windowstart,
+    0,
+    Opcode_wsr_windowstart_encode_fns, 0, 0 },
+  { "xsr.windowstart", ICLASS_xt_iclass_xsr_windowstart,
+    0,
+    Opcode_xsr_windowstart_encode_fns, 0, 0 },
+  { "add.n", ICLASS_xt_iclass_add_n,
+    0,
+    Opcode_add_n_encode_fns, 0, 0 },
+  { "addi.n", ICLASS_xt_iclass_addi_n,
+    0,
+    Opcode_addi_n_encode_fns, 0, 0 },
+  { "beqz.n", ICLASS_xt_iclass_bz6,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_beqz_n_encode_fns, 0, 0 },
+  { "bnez.n", ICLASS_xt_iclass_bz6,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bnez_n_encode_fns, 0, 0 },
+  { "ill.n", ICLASS_xt_iclass_ill_n,
+    0,
+    Opcode_ill_n_encode_fns, 0, 0 },
+  { "l32i.n", ICLASS_xt_iclass_loadi4,
+    0,
+    Opcode_l32i_n_encode_fns, 0, 0 },
+  { "mov.n", ICLASS_xt_iclass_mov_n,
+    0,
+    Opcode_mov_n_encode_fns, 0, 0 },
+  { "movi.n", ICLASS_xt_iclass_movi_n,
+    0,
+    Opcode_movi_n_encode_fns, 0, 0 },
+  { "nop.n", ICLASS_xt_iclass_nopn,
+    0,
+    Opcode_nop_n_encode_fns, 0, 0 },
+  { "ret.n", ICLASS_xt_iclass_retn,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_ret_n_encode_fns, 0, 0 },
+  { "s32i.n", ICLASS_xt_iclass_storei4,
+    0,
+    Opcode_s32i_n_encode_fns, 0, 0 },
+  { "rur.threadptr", ICLASS_rur_threadptr,
+    0,
+    Opcode_rur_threadptr_encode_fns, 0, 0 },
+  { "wur.threadptr", ICLASS_wur_threadptr,
+    0,
+    Opcode_wur_threadptr_encode_fns, 0, 0 },
+  { "addi", ICLASS_xt_iclass_addi,
+    0,
+    Opcode_addi_encode_fns, 0, 0 },
+  { "addmi", ICLASS_xt_iclass_addmi,
+    0,
+    Opcode_addmi_encode_fns, 0, 0 },
+  { "add", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_add_encode_fns, 0, 0 },
+  { "sub", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_sub_encode_fns, 0, 0 },
+  { "addx2", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_addx2_encode_fns, 0, 0 },
+  { "addx4", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_addx4_encode_fns, 0, 0 },
+  { "addx8", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_addx8_encode_fns, 0, 0 },
+  { "subx2", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_subx2_encode_fns, 0, 0 },
+  { "subx4", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_subx4_encode_fns, 0, 0 },
+  { "subx8", ICLASS_xt_iclass_addsub,
+    0,
+    Opcode_subx8_encode_fns, 0, 0 },
+  { "and", ICLASS_xt_iclass_bit,
+    0,
+    Opcode_and_encode_fns, 0, 0 },
+  { "or", ICLASS_xt_iclass_bit,
+    0,
+    Opcode_or_encode_fns, 0, 0 },
+  { "xor", ICLASS_xt_iclass_bit,
+    0,
+    Opcode_xor_encode_fns, 0, 0 },
+  { "beqi", ICLASS_xt_iclass_bsi8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_beqi_encode_fns, 0, 0 },
+  { "bnei", ICLASS_xt_iclass_bsi8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bnei_encode_fns, 0, 0 },
+  { "bgei", ICLASS_xt_iclass_bsi8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bgei_encode_fns, 0, 0 },
+  { "blti", ICLASS_xt_iclass_bsi8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_blti_encode_fns, 0, 0 },
+  { "bbci", ICLASS_xt_iclass_bsi8b,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bbci_encode_fns, 0, 0 },
+  { "bbsi", ICLASS_xt_iclass_bsi8b,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bbsi_encode_fns, 0, 0 },
+  { "bgeui", ICLASS_xt_iclass_bsi8u,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bgeui_encode_fns, 0, 0 },
+  { "bltui", ICLASS_xt_iclass_bsi8u,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bltui_encode_fns, 0, 0 },
+  { "beq", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_beq_encode_fns, 0, 0 },
+  { "bne", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bne_encode_fns, 0, 0 },
+  { "bge", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bge_encode_fns, 0, 0 },
+  { "blt", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_blt_encode_fns, 0, 0 },
+  { "bgeu", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bgeu_encode_fns, 0, 0 },
+  { "bltu", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bltu_encode_fns, 0, 0 },
+  { "bany", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bany_encode_fns, 0, 0 },
+  { "bnone", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bnone_encode_fns, 0, 0 },
+  { "ball", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_ball_encode_fns, 0, 0 },
+  { "bnall", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bnall_encode_fns, 0, 0 },
+  { "bbc", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bbc_encode_fns, 0, 0 },
+  { "bbs", ICLASS_xt_iclass_bst8,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bbs_encode_fns, 0, 0 },
+  { "beqz", ICLASS_xt_iclass_bsz12,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_beqz_encode_fns, 0, 0 },
+  { "bnez", ICLASS_xt_iclass_bsz12,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bnez_encode_fns, 0, 0 },
+  { "bgez", ICLASS_xt_iclass_bsz12,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bgez_encode_fns, 0, 0 },
+  { "bltz", ICLASS_xt_iclass_bsz12,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bltz_encode_fns, 0, 0 },
+  { "call0", ICLASS_xt_iclass_call0,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_call0_encode_fns, 0, 0 },
+  { "callx0", ICLASS_xt_iclass_callx0,
+    XTENSA_OPCODE_IS_CALL,
+    Opcode_callx0_encode_fns, 0, 0 },
+  { "extui", ICLASS_xt_iclass_exti,
+    0,
+    Opcode_extui_encode_fns, 0, 0 },
+  { "ill", ICLASS_xt_iclass_ill,
+    0,
+    Opcode_ill_encode_fns, 0, 0 },
+  { "j", ICLASS_xt_iclass_jump,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_j_encode_fns, 0, 0 },
+  { "jx", ICLASS_xt_iclass_jumpx,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_jx_encode_fns, 0, 0 },
+  { "l16ui", ICLASS_xt_iclass_l16ui,
+    0,
+    Opcode_l16ui_encode_fns, 0, 0 },
+  { "l16si", ICLASS_xt_iclass_l16si,
+    0,
+    Opcode_l16si_encode_fns, 0, 0 },
+  { "l32i", ICLASS_xt_iclass_l32i,
+    0,
+    Opcode_l32i_encode_fns, 0, 0 },
+  { "l32r", ICLASS_xt_iclass_l32r,
+    0,
+    Opcode_l32r_encode_fns, 0, 0 },
+  { "l8ui", ICLASS_xt_iclass_l8i,
+    0,
+    Opcode_l8ui_encode_fns, 0, 0 },
+  { "loop", ICLASS_xt_iclass_loop,
+    XTENSA_OPCODE_IS_LOOP,
+    Opcode_loop_encode_fns, 0, 0 },
+  { "loopnez", ICLASS_xt_iclass_loopz,
+    XTENSA_OPCODE_IS_LOOP,
+    Opcode_loopnez_encode_fns, 0, 0 },
+  { "loopgtz", ICLASS_xt_iclass_loopz,
+    XTENSA_OPCODE_IS_LOOP,
+    Opcode_loopgtz_encode_fns, 0, 0 },
+  { "movi", ICLASS_xt_iclass_movi,
+    0,
+    Opcode_movi_encode_fns, 0, 0 },
+  { "moveqz", ICLASS_xt_iclass_movz,
+    0,
+    Opcode_moveqz_encode_fns, 0, 0 },
+  { "movnez", ICLASS_xt_iclass_movz,
+    0,
+    Opcode_movnez_encode_fns, 0, 0 },
+  { "movltz", ICLASS_xt_iclass_movz,
+    0,
+    Opcode_movltz_encode_fns, 0, 0 },
+  { "movgez", ICLASS_xt_iclass_movz,
+    0,
+    Opcode_movgez_encode_fns, 0, 0 },
+  { "neg", ICLASS_xt_iclass_neg,
+    0,
+    Opcode_neg_encode_fns, 0, 0 },
+  { "abs", ICLASS_xt_iclass_neg,
+    0,
+    Opcode_abs_encode_fns, 0, 0 },
+  { "nop", ICLASS_xt_iclass_nop,
+    0,
+    Opcode_nop_encode_fns, 0, 0 },
+  { "ret", ICLASS_xt_iclass_return,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_ret_encode_fns, 0, 0 },
+  { "s16i", ICLASS_xt_iclass_s16i,
+    0,
+    Opcode_s16i_encode_fns, 0, 0 },
+  { "s32i", ICLASS_xt_iclass_s32i,
+    0,
+    Opcode_s32i_encode_fns, 0, 0 },
+  { "s8i", ICLASS_xt_iclass_s8i,
+    0,
+    Opcode_s8i_encode_fns, 0, 0 },
+  { "ssr", ICLASS_xt_iclass_sar,
+    0,
+    Opcode_ssr_encode_fns, 0, 0 },
+  { "ssl", ICLASS_xt_iclass_sar,
+    0,
+    Opcode_ssl_encode_fns, 0, 0 },
+  { "ssa8l", ICLASS_xt_iclass_sar,
+    0,
+    Opcode_ssa8l_encode_fns, 0, 0 },
+  { "ssa8b", ICLASS_xt_iclass_sar,
+    0,
+    Opcode_ssa8b_encode_fns, 0, 0 },
+  { "ssai", ICLASS_xt_iclass_sari,
+    0,
+    Opcode_ssai_encode_fns, 0, 0 },
+  { "sll", ICLASS_xt_iclass_shifts,
+    0,
+    Opcode_sll_encode_fns, 0, 0 },
+  { "src", ICLASS_xt_iclass_shiftst,
+    0,
+    Opcode_src_encode_fns, 0, 0 },
+  { "srl", ICLASS_xt_iclass_shiftt,
+    0,
+    Opcode_srl_encode_fns, 0, 0 },
+  { "sra", ICLASS_xt_iclass_shiftt,
+    0,
+    Opcode_sra_encode_fns, 0, 0 },
+  { "slli", ICLASS_xt_iclass_slli,
+    0,
+    Opcode_slli_encode_fns, 0, 0 },
+  { "srai", ICLASS_xt_iclass_srai,
+    0,
+    Opcode_srai_encode_fns, 0, 0 },
+  { "srli", ICLASS_xt_iclass_srli,
+    0,
+    Opcode_srli_encode_fns, 0, 0 },
+  { "memw", ICLASS_xt_iclass_memw,
+    0,
+    Opcode_memw_encode_fns, 0, 0 },
+  { "extw", ICLASS_xt_iclass_extw,
+    0,
+    Opcode_extw_encode_fns, 0, 0 },
+  { "isync", ICLASS_xt_iclass_isync,
+    0,
+    Opcode_isync_encode_fns, 0, 0 },
+  { "rsync", ICLASS_xt_iclass_sync,
+    0,
+    Opcode_rsync_encode_fns, 0, 0 },
+  { "esync", ICLASS_xt_iclass_sync,
+    0,
+    Opcode_esync_encode_fns, 0, 0 },
+  { "dsync", ICLASS_xt_iclass_sync,
+    0,
+    Opcode_dsync_encode_fns, 0, 0 },
+  { "rsil", ICLASS_xt_iclass_rsil,
+    0,
+    Opcode_rsil_encode_fns, 0, 0 },
+  { "rsr.lend", ICLASS_xt_iclass_rsr_lend,
+    0,
+    Opcode_rsr_lend_encode_fns, 0, 0 },
+  { "wsr.lend", ICLASS_xt_iclass_wsr_lend,
+    0,
+    Opcode_wsr_lend_encode_fns, 0, 0 },
+  { "xsr.lend", ICLASS_xt_iclass_xsr_lend,
+    0,
+    Opcode_xsr_lend_encode_fns, 0, 0 },
+  { "rsr.lcount", ICLASS_xt_iclass_rsr_lcount,
+    0,
+    Opcode_rsr_lcount_encode_fns, 0, 0 },
+  { "wsr.lcount", ICLASS_xt_iclass_wsr_lcount,
+    0,
+    Opcode_wsr_lcount_encode_fns, 0, 0 },
+  { "xsr.lcount", ICLASS_xt_iclass_xsr_lcount,
+    0,
+    Opcode_xsr_lcount_encode_fns, 0, 0 },
+  { "rsr.lbeg", ICLASS_xt_iclass_rsr_lbeg,
+    0,
+    Opcode_rsr_lbeg_encode_fns, 0, 0 },
+  { "wsr.lbeg", ICLASS_xt_iclass_wsr_lbeg,
+    0,
+    Opcode_wsr_lbeg_encode_fns, 0, 0 },
+  { "xsr.lbeg", ICLASS_xt_iclass_xsr_lbeg,
+    0,
+    Opcode_xsr_lbeg_encode_fns, 0, 0 },
+  { "rsr.sar", ICLASS_xt_iclass_rsr_sar,
+    0,
+    Opcode_rsr_sar_encode_fns, 0, 0 },
+  { "wsr.sar", ICLASS_xt_iclass_wsr_sar,
+    0,
+    Opcode_wsr_sar_encode_fns, 0, 0 },
+  { "xsr.sar", ICLASS_xt_iclass_xsr_sar,
+    0,
+    Opcode_xsr_sar_encode_fns, 0, 0 },
+  { "rsr.litbase", ICLASS_xt_iclass_rsr_litbase,
+    0,
+    Opcode_rsr_litbase_encode_fns, 0, 0 },
+  { "wsr.litbase", ICLASS_xt_iclass_wsr_litbase,
+    0,
+    Opcode_wsr_litbase_encode_fns, 0, 0 },
+  { "xsr.litbase", ICLASS_xt_iclass_xsr_litbase,
+    0,
+    Opcode_xsr_litbase_encode_fns, 0, 0 },
+  { "rsr.176", ICLASS_xt_iclass_rsr_176,
+    0,
+    Opcode_rsr_176_encode_fns, 0, 0 },
+  { "wsr.176", ICLASS_xt_iclass_wsr_176,
+    0,
+    Opcode_wsr_176_encode_fns, 0, 0 },
+  { "rsr.208", ICLASS_xt_iclass_rsr_208,
+    0,
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+  { "rsr.ps", ICLASS_xt_iclass_rsr_ps,
+    0,
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+  { "wsr.ps", ICLASS_xt_iclass_wsr_ps,
+    0,
+    Opcode_wsr_ps_encode_fns, 0, 0 },
+  { "xsr.ps", ICLASS_xt_iclass_xsr_ps,
+    0,
+    Opcode_xsr_ps_encode_fns, 0, 0 },
+  { "rsr.epc1", ICLASS_xt_iclass_rsr_epc1,
+    0,
+    Opcode_rsr_epc1_encode_fns, 0, 0 },
+  { "wsr.epc1", ICLASS_xt_iclass_wsr_epc1,
+    0,
+    Opcode_wsr_epc1_encode_fns, 0, 0 },
+  { "xsr.epc1", ICLASS_xt_iclass_xsr_epc1,
+    0,
+    Opcode_xsr_epc1_encode_fns, 0, 0 },
+  { "rsr.excsave1", ICLASS_xt_iclass_rsr_excsave1,
+    0,
+    Opcode_rsr_excsave1_encode_fns, 0, 0 },
+  { "wsr.excsave1", ICLASS_xt_iclass_wsr_excsave1,
+    0,
+    Opcode_wsr_excsave1_encode_fns, 0, 0 },
+  { "xsr.excsave1", ICLASS_xt_iclass_xsr_excsave1,
+    0,
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+  { "rsr.epc2", ICLASS_xt_iclass_rsr_epc2,
+    0,
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+  { "wsr.epc2", ICLASS_xt_iclass_wsr_epc2,
+    0,
+    Opcode_wsr_epc2_encode_fns, 0, 0 },
+  { "xsr.epc2", ICLASS_xt_iclass_xsr_epc2,
+    0,
+    Opcode_xsr_epc2_encode_fns, 0, 0 },
+  { "rsr.excsave2", ICLASS_xt_iclass_rsr_excsave2,
+    0,
+    Opcode_rsr_excsave2_encode_fns, 0, 0 },
+  { "wsr.excsave2", ICLASS_xt_iclass_wsr_excsave2,
+    0,
+    Opcode_wsr_excsave2_encode_fns, 0, 0 },
+  { "xsr.excsave2", ICLASS_xt_iclass_xsr_excsave2,
+    0,
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+  { "rsr.epc3", ICLASS_xt_iclass_rsr_epc3,
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+  { "wsr.epc3", ICLASS_xt_iclass_wsr_epc3,
+    0,
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+  { "xsr.epc3", ICLASS_xt_iclass_xsr_epc3,
+    0,
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+  { "rsr.excsave3", ICLASS_xt_iclass_rsr_excsave3,
+    0,
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+  { "wsr.excsave3", ICLASS_xt_iclass_wsr_excsave3,
+    0,
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+  { "xsr.excsave3", ICLASS_xt_iclass_xsr_excsave3,
+    0,
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+    0,
+    Opcode_rsr_epc4_encode_fns, 0, 0 },
+  { "wsr.epc4", ICLASS_xt_iclass_wsr_epc4,
+    0,
+    Opcode_wsr_epc4_encode_fns, 0, 0 },
+  { "xsr.epc4", ICLASS_xt_iclass_xsr_epc4,
+    0,
+    Opcode_xsr_epc4_encode_fns, 0, 0 },
+  { "rsr.excsave4", ICLASS_xt_iclass_rsr_excsave4,
+    0,
+    Opcode_rsr_excsave4_encode_fns, 0, 0 },
+  { "wsr.excsave4", ICLASS_xt_iclass_wsr_excsave4,
+    0,
+    Opcode_wsr_excsave4_encode_fns, 0, 0 },
+  { "xsr.excsave4", ICLASS_xt_iclass_xsr_excsave4,
+    0,
+    Opcode_xsr_excsave4_encode_fns, 0, 0 },
+  { "rsr.epc5", ICLASS_xt_iclass_rsr_epc5,
+    0,
+    Opcode_rsr_epc5_encode_fns, 0, 0 },
+  { "wsr.epc5", ICLASS_xt_iclass_wsr_epc5,
+    0,
+    Opcode_wsr_epc5_encode_fns, 0, 0 },
+  { "xsr.epc5", ICLASS_xt_iclass_xsr_epc5,
+    0,
+    Opcode_xsr_epc5_encode_fns, 0, 0 },
+  { "rsr.excsave5", ICLASS_xt_iclass_rsr_excsave5,
+    0,
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+  { "wsr.excsave5", ICLASS_xt_iclass_wsr_excsave5,
+    0,
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+  { "xsr.excsave5", ICLASS_xt_iclass_xsr_excsave5,
+    0,
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+  { "rsr.epc6", ICLASS_xt_iclass_rsr_epc6,
+    0,
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+  { "wsr.epc6", ICLASS_xt_iclass_wsr_epc6,
+    0,
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+  { "xsr.epc6", ICLASS_xt_iclass_xsr_epc6,
+    0,
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+  { "rsr.excsave6", ICLASS_xt_iclass_rsr_excsave6,
+    0,
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+  { "wsr.excsave6", ICLASS_xt_iclass_wsr_excsave6,
+    0,
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+    0,
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+  { "rsr.excvaddr", ICLASS_xt_iclass_rsr_excvaddr,
+    0,
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+  { "wsr.excvaddr", ICLASS_xt_iclass_wsr_excvaddr,
+    0,
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+  { "xsr.excvaddr", ICLASS_xt_iclass_xsr_excvaddr,
+    0,
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+  { "rsr.depc", ICLASS_xt_iclass_rsr_depc,
+    0,
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+  { "wsr.depc", ICLASS_xt_iclass_wsr_depc,
+    0,
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+  { "xsr.depc", ICLASS_xt_iclass_xsr_depc,
+    0,
+    Opcode_xsr_depc_encode_fns, 0, 0 },
+  { "rsr.exccause", ICLASS_xt_iclass_rsr_exccause,
+    0,
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+  { "wsr.exccause", ICLASS_xt_iclass_wsr_exccause,
+    0,
+    Opcode_wsr_exccause_encode_fns, 0, 0 },
+  { "xsr.exccause", ICLASS_xt_iclass_xsr_exccause,
+    0,
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+  { "rsr.prid", ICLASS_xt_iclass_rsr_prid,
+    0,
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+  { "rsr.vecbase", ICLASS_xt_iclass_rsr_vecbase,
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+  { "wsr.vecbase", ICLASS_xt_iclass_wsr_vecbase,
+    0,
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+  { "xsr.vecbase", ICLASS_xt_iclass_xsr_vecbase,
+    0,
+    Opcode_xsr_vecbase_encode_fns, 0, 0 },
+  { "mul16u", ICLASS_xt_mul16,
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+    0,
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+    XTENSA_OPCODE_IS_JUMP,
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+  { "waiti", ICLASS_xt_iclass_wait,
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+  { "wsr.intclear", ICLASS_xt_iclass_wsr_intclear,
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+  { "rsr.intenable", ICLASS_xt_iclass_rsr_intenable,
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+  { "wsr.intenable", ICLASS_xt_iclass_wsr_intenable,
+    0,
+    Opcode_wsr_intenable_encode_fns, 0, 0 },
+  { "xsr.intenable", ICLASS_xt_iclass_xsr_intenable,
+    0,
+    Opcode_xsr_intenable_encode_fns, 0, 0 },
+  { "break", ICLASS_xt_iclass_break,
+    0,
+    Opcode_break_encode_fns, 0, 0 },
+  { "break.n", ICLASS_xt_iclass_break_n,
+    0,
+    Opcode_break_n_encode_fns, 0, 0 },
+  { "rsr.dbreaka0", ICLASS_xt_iclass_rsr_dbreaka0,
+    0,
+    Opcode_rsr_dbreaka0_encode_fns, 0, 0 },
+  { "wsr.dbreaka0", ICLASS_xt_iclass_wsr_dbreaka0,
+    0,
+    Opcode_wsr_dbreaka0_encode_fns, 0, 0 },
+  { "xsr.dbreaka0", ICLASS_xt_iclass_xsr_dbreaka0,
+    0,
+    Opcode_xsr_dbreaka0_encode_fns, 0, 0 },
+  { "rsr.dbreakc0", ICLASS_xt_iclass_rsr_dbreakc0,
+    0,
+    Opcode_rsr_dbreakc0_encode_fns, 0, 0 },
+  { "wsr.dbreakc0", ICLASS_xt_iclass_wsr_dbreakc0,
+    0,
+    Opcode_wsr_dbreakc0_encode_fns, 0, 0 },
+  { "xsr.dbreakc0", ICLASS_xt_iclass_xsr_dbreakc0,
+    0,
+    Opcode_xsr_dbreakc0_encode_fns, 0, 0 },
+  { "rsr.dbreaka1", ICLASS_xt_iclass_rsr_dbreaka1,
+    0,
+    Opcode_rsr_dbreaka1_encode_fns, 0, 0 },
+  { "wsr.dbreaka1", ICLASS_xt_iclass_wsr_dbreaka1,
+    0,
+    Opcode_wsr_dbreaka1_encode_fns, 0, 0 },
+  { "xsr.dbreaka1", ICLASS_xt_iclass_xsr_dbreaka1,
+    0,
+    Opcode_xsr_dbreaka1_encode_fns, 0, 0 },
+  { "rsr.dbreakc1", ICLASS_xt_iclass_rsr_dbreakc1,
+    0,
+    Opcode_rsr_dbreakc1_encode_fns, 0, 0 },
+  { "wsr.dbreakc1", ICLASS_xt_iclass_wsr_dbreakc1,
+    0,
+    Opcode_wsr_dbreakc1_encode_fns, 0, 0 },
+  { "xsr.dbreakc1", ICLASS_xt_iclass_xsr_dbreakc1,
+    0,
+    Opcode_xsr_dbreakc1_encode_fns, 0, 0 },
+  { "rsr.ibreaka0", ICLASS_xt_iclass_rsr_ibreaka0,
+    0,
+    Opcode_rsr_ibreaka0_encode_fns, 0, 0 },
+  { "wsr.ibreaka0", ICLASS_xt_iclass_wsr_ibreaka0,
+    0,
+    Opcode_wsr_ibreaka0_encode_fns, 0, 0 },
+  { "xsr.ibreaka0", ICLASS_xt_iclass_xsr_ibreaka0,
+    0,
+    Opcode_xsr_ibreaka0_encode_fns, 0, 0 },
+  { "rsr.ibreaka1", ICLASS_xt_iclass_rsr_ibreaka1,
+    0,
+    Opcode_rsr_ibreaka1_encode_fns, 0, 0 },
+  { "wsr.ibreaka1", ICLASS_xt_iclass_wsr_ibreaka1,
+    0,
+    Opcode_wsr_ibreaka1_encode_fns, 0, 0 },
+  { "xsr.ibreaka1", ICLASS_xt_iclass_xsr_ibreaka1,
+    0,
+    Opcode_xsr_ibreaka1_encode_fns, 0, 0 },
+  { "rsr.ibreakenable", ICLASS_xt_iclass_rsr_ibreakenable,
+    0,
+    Opcode_rsr_ibreakenable_encode_fns, 0, 0 },
+  { "wsr.ibreakenable", ICLASS_xt_iclass_wsr_ibreakenable,
+    0,
+    Opcode_wsr_ibreakenable_encode_fns, 0, 0 },
+  { "xsr.ibreakenable", ICLASS_xt_iclass_xsr_ibreakenable,
+    0,
+    Opcode_xsr_ibreakenable_encode_fns, 0, 0 },
+  { "rsr.debugcause", ICLASS_xt_iclass_rsr_debugcause,
+    0,
+    Opcode_rsr_debugcause_encode_fns, 0, 0 },
+  { "wsr.debugcause", ICLASS_xt_iclass_wsr_debugcause,
+    0,
+    Opcode_wsr_debugcause_encode_fns, 0, 0 },
+  { "xsr.debugcause", ICLASS_xt_iclass_xsr_debugcause,
+    0,
+    Opcode_xsr_debugcause_encode_fns, 0, 0 },
+  { "rsr.icount", ICLASS_xt_iclass_rsr_icount,
+    0,
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+  { "wsr.icount", ICLASS_xt_iclass_wsr_icount,
+    0,
+    Opcode_wsr_icount_encode_fns, 0, 0 },
+  { "xsr.icount", ICLASS_xt_iclass_xsr_icount,
+    0,
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+  { "rsr.icountlevel", ICLASS_xt_iclass_rsr_icountlevel,
+    0,
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+  { "wsr.icountlevel", ICLASS_xt_iclass_wsr_icountlevel,
+    0,
+    Opcode_wsr_icountlevel_encode_fns, 0, 0 },
+  { "xsr.icountlevel", ICLASS_xt_iclass_xsr_icountlevel,
+    0,
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+  { "rsr.ddr", ICLASS_xt_iclass_rsr_ddr,
+    0,
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+  { "wsr.ddr", ICLASS_xt_iclass_wsr_ddr,
+    0,
+    Opcode_wsr_ddr_encode_fns, 0, 0 },
+  { "xsr.ddr", ICLASS_xt_iclass_xsr_ddr,
+    0,
+    Opcode_xsr_ddr_encode_fns, 0, 0 },
+  { "rfdo", ICLASS_xt_iclass_rfdo,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_rfdo_encode_fns, 0, 0 },
+  { "rfdd", ICLASS_xt_iclass_rfdd,
+    XTENSA_OPCODE_IS_JUMP,
+    Opcode_rfdd_encode_fns, 0, 0 },
+  { "wsr.mmid", ICLASS_xt_iclass_wsr_mmid,
+    0,
+    Opcode_wsr_mmid_encode_fns, 0, 0 },
+  { "andb", ICLASS_xt_iclass_bbool1,
+    0,
+    Opcode_andb_encode_fns, 0, 0 },
+  { "andbc", ICLASS_xt_iclass_bbool1,
+    0,
+    Opcode_andbc_encode_fns, 0, 0 },
+  { "orb", ICLASS_xt_iclass_bbool1,
+    0,
+    Opcode_orb_encode_fns, 0, 0 },
+  { "orbc", ICLASS_xt_iclass_bbool1,
+    0,
+    Opcode_orbc_encode_fns, 0, 0 },
+  { "xorb", ICLASS_xt_iclass_bbool1,
+    0,
+    Opcode_xorb_encode_fns, 0, 0 },
+  { "any4", ICLASS_xt_iclass_bbool4,
+    0,
+    Opcode_any4_encode_fns, 0, 0 },
+  { "all4", ICLASS_xt_iclass_bbool4,
+    0,
+    Opcode_all4_encode_fns, 0, 0 },
+  { "any8", ICLASS_xt_iclass_bbool8,
+    0,
+    Opcode_any8_encode_fns, 0, 0 },
+  { "all8", ICLASS_xt_iclass_bbool8,
+    0,
+    Opcode_all8_encode_fns, 0, 0 },
+  { "bf", ICLASS_xt_iclass_bbranch,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bf_encode_fns, 0, 0 },
+  { "bt", ICLASS_xt_iclass_bbranch,
+    XTENSA_OPCODE_IS_BRANCH,
+    Opcode_bt_encode_fns, 0, 0 },
+  { "movf", ICLASS_xt_iclass_bmove,
+    0,
+    Opcode_movf_encode_fns, 0, 0 },
+  { "movt", ICLASS_xt_iclass_bmove,
+    0,
+    Opcode_movt_encode_fns, 0, 0 },
+  { "rsr.br", ICLASS_xt_iclass_RSR_BR,
+    0,
+    Opcode_rsr_br_encode_fns, 0, 0 },
+  { "wsr.br", ICLASS_xt_iclass_WSR_BR,
+    0,
+    Opcode_wsr_br_encode_fns, 0, 0 },
+  { "xsr.br", ICLASS_xt_iclass_XSR_BR,
+    0,
+    Opcode_xsr_br_encode_fns, 0, 0 },
+  { "rsr.ccount", ICLASS_xt_iclass_rsr_ccount,
+    0,
+    Opcode_rsr_ccount_encode_fns, 0, 0 },
+  { "wsr.ccount", ICLASS_xt_iclass_wsr_ccount,
+    0,
+    Opcode_wsr_ccount_encode_fns, 0, 0 },
+  { "xsr.ccount", ICLASS_xt_iclass_xsr_ccount,
+    0,
+    Opcode_xsr_ccount_encode_fns, 0, 0 },
+  { "rsr.ccompare0", ICLASS_xt_iclass_rsr_ccompare0,
+    0,
+    Opcode_rsr_ccompare0_encode_fns, 0, 0 },
+  { "wsr.ccompare0", ICLASS_xt_iclass_wsr_ccompare0,
+    0,
+    Opcode_wsr_ccompare0_encode_fns, 0, 0 },
+  { "xsr.ccompare0", ICLASS_xt_iclass_xsr_ccompare0,
+    0,
+    Opcode_xsr_ccompare0_encode_fns, 0, 0 },
+  { "rsr.ccompare1", ICLASS_xt_iclass_rsr_ccompare1,
+    0,
+    Opcode_rsr_ccompare1_encode_fns, 0, 0 },
+  { "wsr.ccompare1", ICLASS_xt_iclass_wsr_ccompare1,
+    0,
+    Opcode_wsr_ccompare1_encode_fns, 0, 0 },
+  { "xsr.ccompare1", ICLASS_xt_iclass_xsr_ccompare1,
+    0,
+    Opcode_xsr_ccompare1_encode_fns, 0, 0 },
+  { "ipf", ICLASS_xt_iclass_icache,
+    0,
+    Opcode_ipf_encode_fns, 0, 0 },
+  { "ihi", ICLASS_xt_iclass_icache,
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+  { "ipfl", ICLASS_xt_iclass_icache_lock,
+    0,
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+  { "ihu", ICLASS_xt_iclass_icache_lock,
+    0,
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+  { "iiu", ICLASS_xt_iclass_icache_lock,
+    0,
+    Opcode_iiu_encode_fns, 0, 0 },
+  { "iii", ICLASS_xt_iclass_icache_inv,
+    0,
+    Opcode_iii_encode_fns, 0, 0 },
+  { "lict", ICLASS_xt_iclass_licx,
+    0,
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+  { "licw", ICLASS_xt_iclass_licx,
+    0,
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+  { "sict", ICLASS_xt_iclass_sicx,
+    0,
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+  { "sicw", ICLASS_xt_iclass_sicx,
+    0,
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+  { "dhwb", ICLASS_xt_iclass_dcache,
+    0,
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+  { "dhwbi", ICLASS_xt_iclass_dcache,
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+  { "diwb", ICLASS_xt_iclass_dcache_ind,
+    0,
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+  { "diwbi", ICLASS_xt_iclass_dcache_ind,
+    0,
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+  { "dhi", ICLASS_xt_iclass_dcache_inv,
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+  { "dpfw", ICLASS_xt_iclass_dpf,
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+  { "dpfro", ICLASS_xt_iclass_dpf,
+    0,
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+  { "dpfwo", ICLASS_xt_iclass_dpf,
+    0,
+    Opcode_dpfwo_encode_fns, 0, 0 },
+  { "dpfl", ICLASS_xt_iclass_dcache_lock,
+    0,
+    Opcode_dpfl_encode_fns, 0, 0 },
+  { "dhu", ICLASS_xt_iclass_dcache_lock,
+    0,
+    Opcode_dhu_encode_fns, 0, 0 },
+  { "diu", ICLASS_xt_iclass_dcache_lock,
+    0,
+    Opcode_diu_encode_fns, 0, 0 },
+  { "sdct", ICLASS_xt_iclass_sdct,
+    0,
+    Opcode_sdct_encode_fns, 0, 0 },
+  { "ldct", ICLASS_xt_iclass_ldct,
+    0,
+    Opcode_ldct_encode_fns, 0, 0 },
+  { "idtlb", ICLASS_xt_iclass_idtlb,
+    0,
+    Opcode_idtlb_encode_fns, 0, 0 },
+  { "pdtlb", ICLASS_xt_iclass_rdtlb,
+    0,
+    Opcode_pdtlb_encode_fns, 0, 0 },
+  { "rdtlb0", ICLASS_xt_iclass_rdtlb,
+    0,
+    Opcode_rdtlb0_encode_fns, 0, 0 },
+  { "rdtlb1", ICLASS_xt_iclass_rdtlb,
+    0,
+    Opcode_rdtlb1_encode_fns, 0, 0 },
+  { "wdtlb", ICLASS_xt_iclass_wdtlb,
+    0,
+    Opcode_wdtlb_encode_fns, 0, 0 },
+  { "iitlb", ICLASS_xt_iclass_iitlb,
+    0,
+    Opcode_iitlb_encode_fns, 0, 0 },
+  { "pitlb", ICLASS_xt_iclass_ritlb,
+    0,
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+  { "ritlb0", ICLASS_xt_iclass_ritlb,
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+  { "ritlb1", ICLASS_xt_iclass_ritlb,
+    0,
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+  { "witlb", ICLASS_xt_iclass_witlb,
+    0,
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+  { "rsr.cpenable", ICLASS_xt_iclass_rsr_cpenable,
+    0,
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+  { "wsr.cpenable", ICLASS_xt_iclass_wsr_cpenable,
+    0,
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+  { "xsr.cpenable", ICLASS_xt_iclass_xsr_cpenable,
+    0,
+    Opcode_xsr_cpenable_encode_fns, 0, 0 },
+  { "clamps", ICLASS_xt_iclass_clamp,
+    0,
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+  { "min", ICLASS_xt_iclass_minmax,
+    0,
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+    0,
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+  { "minu", ICLASS_xt_iclass_minmax,
+    0,
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+  { "maxu", ICLASS_xt_iclass_minmax,
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+  { "nsa", ICLASS_xt_iclass_nsa,
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+  { "nsau", ICLASS_xt_iclass_nsa,
+    0,
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+  { "sext", ICLASS_xt_iclass_sx,
+    0,
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+  { "l32ai", ICLASS_xt_iclass_l32ai,
+    0,
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+  { "s32ri", ICLASS_xt_iclass_s32ri,
+    0,
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+  { "s32c1i", ICLASS_xt_iclass_s32c1i,
+    0,
+    Opcode_s32c1i_encode_fns, 0, 0 },
+  { "rsr.scompare1", ICLASS_xt_iclass_rsr_scompare1,
+    0,
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+  { "wsr.scompare1", ICLASS_xt_iclass_wsr_scompare1,
+    0,
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+  { "xsr.scompare1", ICLASS_xt_iclass_xsr_scompare1,
+    0,
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+  { "rsr.atomctl", ICLASS_xt_iclass_rsr_atomctl,
+    0,
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+  { "wsr.atomctl", ICLASS_xt_iclass_wsr_atomctl,
+    0,
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+  { "xsr.atomctl", ICLASS_xt_iclass_xsr_atomctl,
+    0,
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+  { "rer", ICLASS_xt_iclass_rer,
+    0,
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+  { "wer", ICLASS_xt_iclass_wer,
+    0,
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+  { "rur.fcr", ICLASS_rur_fcr,
+    0,
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+  { "wur.fcr", ICLASS_wur_fcr,
+    0,
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+  { "rur.fsr", ICLASS_rur_fsr,
+    0,
+    Opcode_rur_fsr_encode_fns, 0, 0 },
+  { "wur.fsr", ICLASS_wur_fsr,
+    0,
+    Opcode_wur_fsr_encode_fns, 0, 0 },
+  { "add.s", ICLASS_fp,
+    0,
+    Opcode_add_s_encode_fns, 0, 0 },
+  { "sub.s", ICLASS_fp,
+    0,
+    Opcode_sub_s_encode_fns, 0, 0 },
+  { "mul.s", ICLASS_fp,
+    0,
+    Opcode_mul_s_encode_fns, 0, 0 },
+  { "madd.s", ICLASS_fp_mac,
+    0,
+    Opcode_madd_s_encode_fns, 0, 0 },
+  { "msub.s", ICLASS_fp_mac,
+    0,
+    Opcode_msub_s_encode_fns, 0, 0 },
+  { "movf.s", ICLASS_fp_cmov,
+    0,
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+  { "movt.s", ICLASS_fp_cmov,
+    0,
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+  { "moveqz.s", ICLASS_fp_mov,
+    0,
+    Opcode_moveqz_s_encode_fns, 0, 0 },
+  { "movnez.s", ICLASS_fp_mov,
+    0,
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+  { "movltz.s", ICLASS_fp_mov,
+    0,
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+  { "movgez.s", ICLASS_fp_mov,
+    0,
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+  { "abs.s", ICLASS_fp_mov2,
+    0,
+    Opcode_abs_s_encode_fns, 0, 0 },
+  { "mov.s", ICLASS_fp_mov2,
+    0,
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+  { "neg.s", ICLASS_fp_mov2,
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+  { "un.s", ICLASS_fp_cmp,
+    0,
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+  { "oeq.s", ICLASS_fp_cmp,
+    0,
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+  { "olt.s", ICLASS_fp_cmp,
+    0,
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+  { "ult.s", ICLASS_fp_cmp,
+    0,
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+  { "ole.s", ICLASS_fp_cmp,
+    0,
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+  { "ule.s", ICLASS_fp_cmp,
+    0,
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+  { "float.s", ICLASS_fp_float,
+    0,
+    Opcode_float_s_encode_fns, 0, 0 },
+  { "ufloat.s", ICLASS_fp_float,
+    0,
+    Opcode_ufloat_s_encode_fns, 0, 0 },
+  { "round.s", ICLASS_fp_int,
+    0,
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+  { "ceil.s", ICLASS_fp_int,
+    0,
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+  { "floor.s", ICLASS_fp_int,
+    0,
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+  { "trunc.s", ICLASS_fp_int,
+    0,
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+  { "utrunc.s", ICLASS_fp_int,
+    0,
+    Opcode_utrunc_s_encode_fns, 0, 0 },
+  { "rfr", ICLASS_fp_rfr,
+    0,
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+  { "wfr", ICLASS_fp_wfr,
+    0,
+    Opcode_wfr_encode_fns, 0, 0 },
+  { "lsi", ICLASS_fp_lsi,
+    0,
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+  { "lsiu", ICLASS_fp_lsiu,
+    0,
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+  { "lsx", ICLASS_fp_lsx,
+    0,
+    Opcode_lsx_encode_fns, 0, 0 },
+  { "lsxu", ICLASS_fp_lsxu,
+    0,
+    Opcode_lsxu_encode_fns, 0, 0 },
+  { "ssi", ICLASS_fp_ssi,
+    0,
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+  { "ssiu", ICLASS_fp_ssiu,
+    0,
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+  { "ssx", ICLASS_fp_ssx,
+    0,
+    Opcode_ssx_encode_fns, 0, 0 },
+  { "ssxu", ICLASS_fp_ssxu,
+    0,
+    Opcode_ssxu_encode_fns, 0, 0 },
+  { "get_argmax", ICLASS_iclass_GET_ARGMAX,
+    0,
+    Opcode_get_argmax_encode_fns, 0, 0 },
+  { "get_hsar", ICLASS_iclass_GET_HSAR,
+    0,
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+  { "get_hsar2sar", ICLASS_iclass_GET_HSAR2SAR,
+    0,
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+  { "get_interp_ext_n", ICLASS_iclass_GET_INTERP_EXT_N,
+    0,
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+  { "get_interp_ext_l", ICLASS_iclass_GET_INTERP_EXT_L,
+    0,
+    Opcode_get_interp_ext_l_encode_fns, 0, 0 },
+  { "get_llr_buf", ICLASS_iclass_GET_LLR_BUF,
+    0,
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+  { "get_llr_pos", ICLASS_iclass_GET_LLR_POS,
+    0,
+    Opcode_get_llr_pos_encode_fns, 0, 0 },
+  { "get_max", ICLASS_iclass_GET_MAX,
+    0,
+    Opcode_get_max_encode_fns, 0, 0 },
+  { "get_nco", ICLASS_iclass_GET_NCO,
+    0,
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+  { "get_perm_reg", ICLASS_iclass_GET_PERM_REG,
+    0,
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+  { "get_phasor_n", ICLASS_iclass_GET_PHASOR_N,
+    0,
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+  { "get_phasor_offset", ICLASS_iclass_GET_PHASOR_OFFSET,
+    0,
+    Opcode_get_phasor_offset_encode_fns, 0, 0 },
+  { "get_sar", ICLASS_iclass_GET_SAR,
+    0,
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+  { "get_scale_reg", ICLASS_iclass_GET_SCALE_REG,
+    0,
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+  { "get_smod_buf", ICLASS_iclass_GET_SMOD_BUF,
+    0,
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+  { "get_smod_offset_table", ICLASS_iclass_GET_SMOD_OFFSET_TABLE,
+    0,
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+  { "get_smod_pos", ICLASS_iclass_GET_SMOD_POS,
+    0,
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+  { "get_sov", ICLASS_iclass_GET_SOV,
+    0,
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+  { "get_wght", ICLASS_iclass_GET_WGHT,
+    0,
+    Opcode_get_wght_encode_fns, 0, 0 },
+  { "set_argmax", ICLASS_iclass_SET_ARGMAX,
+    0,
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+  { "set_ext_regs", ICLASS_iclass_SET_EXT_REGS,
+    0,
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+  { "set_hsar", ICLASS_iclass_SET_HSAR,
+    0,
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+  { "set_llr_buf", ICLASS_iclass_SET_LLR_BUF,
+    0,
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+  { "set_llr_pos", ICLASS_iclass_SET_LLR_POS,
+    0,
+    Opcode_set_llr_pos_encode_fns, 0, 0 },
+  { "set_max", ICLASS_iclass_SET_MAX,
+    0,
+    Opcode_set_max_encode_fns, 0, 0 },
+  { "set_nco", ICLASS_iclass_SET_NCO,
+    0,
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+  { "set_perm_reg", ICLASS_iclass_SET_PERM_REG,
+    0,
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+  { "set_phasor_n", ICLASS_iclass_SET_PHASOR_N,
+    0,
+    Opcode_set_phasor_n_encode_fns, 0, 0 },
+  { "set_phasor_offset", ICLASS_iclass_SET_PHASOR_OFFSET,
+    0,
+    Opcode_set_phasor_offset_encode_fns, 0, 0 },
+  { "set_sar", ICLASS_iclass_SET_SAR,
+    0,
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+  { "set_scale_reg", ICLASS_iclass_SET_SCALE_REG,
+    0,
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+  { "set_smod_buf", ICLASS_iclass_SET_SMOD_BUF,
+    0,
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+  { "set_smod_offset_table", ICLASS_iclass_SET_SMOD_OFFSET_TABLE,
+    0,
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+  { "set_smod_pos", ICLASS_iclass_SET_SMOD_POS,
+    0,
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+  { "set_sov", ICLASS_iclass_SET_SOV,
+    0,
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+  { "lac2x64_0", ICLASS_iclass_LAC2X64_0,
+    0,
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+  { "lac2x64_1", ICLASS_iclass_LAC2X64_1,
+    0,
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+  { "lac2x64_2", ICLASS_iclass_LAC2X64_2,
+    0,
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+  { "lac2x64_3", ICLASS_iclass_LAC2X64_3,
+    0,
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+  { "lac32_r", ICLASS_iclass_LAC32_R,
+    0,
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+  { "lac_ih", ICLASS_iclass_LAC_IH,
+    0,
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+  { "lac_il", ICLASS_iclass_LAC_IL,
+    0,
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+  { "lac_rh", ICLASS_iclass_LAC_RH,
+    0,
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+  { "lac_rl", ICLASS_iclass_LAC_RL,
+    0,
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+  { "lcm", ICLASS_iclass_LCM,
+    0,
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+  { "lcm_pinc", ICLASS_iclass_LCM_PINC,
+    0,
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+  { "lcm_pinc_x", ICLASS_iclass_LCM_PINC_X,
+    0,
+    Opcode_lcm_pinc_x_encode_fns, 0, 0 },
+  { "lcm_u", ICLASS_iclass_LCM_U,
+    0,
+    Opcode_lcm_u_encode_fns, 0, 0 },
+  { "lcm_x", ICLASS_iclass_LCM_X,
+    0,
+    Opcode_lcm_x_encode_fns, 0, 0 },
+  { "lcm_xu", ICLASS_iclass_LCM_XU,
+    0,
+    Opcode_lcm_xu_encode_fns, 0, 0 },
+  { "lp", ICLASS_iclass_LP,
+    0,
+    Opcode_lp_encode_fns, 0, 0 },
+  { "lp_x", ICLASS_iclass_LP_X,
+    0,
+    Opcode_lp_x_encode_fns, 0, 0 },
+  { "lq", ICLASS_iclass_LQ,
+    0,
+    Opcode_lq_encode_fns, 0, 0 },
+  { "lq_x", ICLASS_iclass_LQ_X,
+    0,
+    Opcode_lq_x_encode_fns, 0, 0 },
+  { "lut0", ICLASS_iclass_LUT0,
+    0,
+    Opcode_lut0_encode_fns, 0, 0 },
+  { "lut1", ICLASS_iclass_LUT1,
+    0,
+    Opcode_lut1_encode_fns, 0, 0 },
+  { "lut2", ICLASS_iclass_LUT2,
+    0,
+    Opcode_lut2_encode_fns, 0, 0 },
+  { "lut3", ICLASS_iclass_LUT3,
+    0,
+    Opcode_lut3_encode_fns, 0, 0 },
+  { "sac2x32", ICLASS_iclass_SAC2X32,
+    0,
+    Opcode_sac2x32_encode_fns, 0, 0 },
+  { "sac2x64_0", ICLASS_iclass_SAC2X64_0,
+    0,
+    Opcode_sac2x64_0_encode_fns, 0, 0 },
+  { "sac2x64_1", ICLASS_iclass_SAC2X64_1,
+    0,
+    Opcode_sac2x64_1_encode_fns, 0, 0 },
+  { "sac2x64_2", ICLASS_iclass_SAC2X64_2,
+    0,
+    Opcode_sac2x64_2_encode_fns, 0, 0 },
+  { "sac2x64_3", ICLASS_iclass_SAC2X64_3,
+    0,
+    Opcode_sac2x64_3_encode_fns, 0, 0 },
+  { "sac32_r", ICLASS_iclass_SAC32_R,
+    0,
+    Opcode_sac32_r_encode_fns, 0, 0 },
+  { "sac_ih", ICLASS_iclass_SAC_IH,
+    0,
+    Opcode_sac_ih_encode_fns, 0, 0 },
+  { "sac_il", ICLASS_iclass_SAC_IL,
+    0,
+    Opcode_sac_il_encode_fns, 0, 0 },
+  { "sac_rh", ICLASS_iclass_SAC_RH,
+    0,
+    Opcode_sac_rh_encode_fns, 0, 0 },
+  { "sac_rl", ICLASS_iclass_SAC_RL,
+    0,
+    Opcode_sac_rl_encode_fns, 0, 0 },
+  { "scm", ICLASS_iclass_SCM,
+    0,
+    Opcode_scm_encode_fns, 0, 0 },
+  { "scm_pinc", ICLASS_iclass_SCM_PINC,
+    0,
+    Opcode_scm_pinc_encode_fns, 0, 0 },
+  { "scm_pinc_x", ICLASS_iclass_SCM_PINC_X,
+    0,
+    Opcode_scm_pinc_x_encode_fns, 0, 0 },
+  { "scm_u", ICLASS_iclass_SCM_U,
+    0,
+    Opcode_scm_u_encode_fns, 0, 0 },
+  { "scm_x", ICLASS_iclass_SCM_X,
+    0,
+    Opcode_scm_x_encode_fns, 0, 0 },
+  { "scm_xu", ICLASS_iclass_SCM_XU,
+    0,
+    Opcode_scm_xu_encode_fns, 0, 0 },
+  { "store_p", ICLASS_iclass_STORE_P,
+    0,
+    Opcode_store_p_encode_fns, 0, 0 },
+  { "store_q", ICLASS_iclass_STORE_Q,
+    0,
+    Opcode_store_q_encode_fns, 0, 0 },
+  { "ar2cm_dup", ICLASS_iclass_AR2CM_DUP,
+    0,
+    Opcode_ar2cm_dup_encode_fns, 0, 0 },
+  { "ar2cm_ln", ICLASS_iclass_AR2CM_LN,
+    0,
+    Opcode_ar2cm_ln_encode_fns, 0, 0 },
+  { "ar2cm_ln_i", ICLASS_iclass_AR2CM_LN_I,
+    0,
+    Opcode_ar2cm_ln_i_encode_fns, 0, 0 },
+  { "ar2cm_ln_r", ICLASS_iclass_AR2CM_LN_R,
+    0,
+    Opcode_ar2cm_ln_r_encode_fns, 0, 0 },
+  { "ar2pq_ln", ICLASS_iclass_AR2PQ_LN,
+    0,
+    Opcode_ar2pq_ln_encode_fns, 0, 0 },
+  { "ar2sar_dup", ICLASS_iclass_AR2SAR_DUP,
+    0,
+    Opcode_ar2sar_dup_encode_fns, 0, 0 },
+  { "clrac", ICLASS_iclass_CLRAC,
+    0,
+    Opcode_clrac_encode_fns, 0, 0 },
+  { "clrcm", ICLASS_iclass_CLRCM,
+    0,
+    Opcode_clrcm_encode_fns, 0, 0 },
+  { "cm2ar_ln", ICLASS_iclass_CM2AR_LN,
+    0,
+    Opcode_cm2ar_ln_encode_fns, 0, 0 },
+  { "cm2ar_ln_i", ICLASS_iclass_CM2AR_LN_I,
+    0,
+    Opcode_cm2ar_ln_i_encode_fns, 0, 0 },
+  { "cm2ar_ln_r", ICLASS_iclass_CM2AR_LN_R,
+    0,
+    Opcode_cm2ar_ln_r_encode_fns, 0, 0 },
+  { "comb_ar", ICLASS_iclass_COMB_AR,
+    0,
+    Opcode_comb_ar_encode_fns, 0, 0 },
+  { "conj", ICLASS_iclass_CONJ,
+    0,
+    Opcode_conj_encode_fns, 0, 0 },
+  { "mov2ac32_i", ICLASS_iclass_MOV2AC32_I,
+    0,
+    Opcode_mov2ac32_i_encode_fns, 0, 0 },
+  { "mov2ac32_r", ICLASS_iclass_MOV2AC32_R,
+    0,
+    Opcode_mov2ac32_r_encode_fns, 0, 0 },
+  { "mov2cm2pq", ICLASS_iclass_MOV2CM2PQ,
+    0,
+    Opcode_mov2cm2pq_encode_fns, 0, 0 },
+  { "movac", ICLASS_iclass_MOVAC,
+    0,
+    Opcode_movac_encode_fns, 0, 0 },
+  { "movac_i", ICLASS_iclass_MOVAC_I,
+    0,
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+  { "movac_i2r", ICLASS_iclass_MOVAC_I2R,
+    0,
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+  { "movac_r", ICLASS_iclass_MOVAC_R,
+    0,
+    Opcode_movac_r_encode_fns, 0, 0 },
+  { "movac_r2i", ICLASS_iclass_MOVAC_R2I,
+    0,
+    Opcode_movac_r2i_encode_fns, 0, 0 },
+  { "movar2", ICLASS_iclass_MOVAR2,
+    0,
+    Opcode_movar2_encode_fns, 0, 0 },
+  { "movcm", ICLASS_iclass_MOVCM,
+    0,
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+  { "movcm2pq", ICLASS_iclass_MOVCM2PQ,
+    0,
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+  { "movcnd_0", ICLASS_iclass_MOVCND_0,
+    0,
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+  { "movcnd_1", ICLASS_iclass_MOVCND_1,
+    0,
+    Opcode_movcnd_1_encode_fns, 0, 0 },
+  { "movcnd_2", ICLASS_iclass_MOVCND_2,
+    0,
+    Opcode_movcnd_2_encode_fns, 0, 0 },
+  { "movcnd_3", ICLASS_iclass_MOVCND_3,
+    0,
+    Opcode_movcnd_3_encode_fns, 0, 0 },
+  { "movcnd_4", ICLASS_iclass_MOVCND_4,
+    0,
+    Opcode_movcnd_4_encode_fns, 0, 0 },
+  { "movcnd_5", ICLASS_iclass_MOVCND_5,
+    0,
+    Opcode_movcnd_5_encode_fns, 0, 0 },
+  { "movcnd_6", ICLASS_iclass_MOVCND_6,
+    0,
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+  { "movcnd_7", ICLASS_iclass_MOVCND_7,
+    0,
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+  { "movcnd8_0", ICLASS_iclass_MOVCND8_0,
+    0,
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+  { "movcnd8_1", ICLASS_iclass_MOVCND8_1,
+    0,
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+  { "movcnd8_2", ICLASS_iclass_MOVCND8_2,
+    0,
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+  { "movcnd8_3", ICLASS_iclass_MOVCND8_3,
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+  { "movcnd8_4", ICLASS_iclass_MOVCND8_4,
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+  { "movcnd8_5", ICLASS_iclass_MOVCND8_5,
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+  { "movcnd8_6", ICLASS_iclass_MOVCND8_6,
+    0,
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+  { "movcnd8_7", ICLASS_iclass_MOVCND8_7,
+    0,
+    Opcode_movcnd8_7_encode_fns, 0, 0 },
+  { "mov_i", ICLASS_iclass_MOV_I,
+    0,
+    Opcode_mov_i_encode_fns, 0, 0 },
+  { "movpq2pq", ICLASS_iclass_MOVPQ2PQ,
+    0,
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+  { "mov_r", ICLASS_iclass_MOV_R,
+    0,
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+  { "negcm", ICLASS_iclass_NEGCM,
+    0,
+    Opcode_negcm_encode_fns, 0, 0 },
+  { "pop16llr_1", ICLASS_iclass_POP16LLR_1,
+    0,
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+  { "pq2cm", ICLASS_iclass_PQ2CM,
+    0,
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+  { "swapac_r", ICLASS_iclass_SWAPAC_R,
+    0,
+    Opcode_swapac_r_encode_fns, 0, 0 },
+  { "swapac_ri", ICLASS_iclass_SWAPAC_RI,
+    0,
+    Opcode_swapac_ri_encode_fns, 0, 0 },
+  { "swapb", ICLASS_iclass_SWAPB,
+    0,
+    Opcode_swapb_encode_fns, 0, 0 },
+  { "add2ac", ICLASS_iclass_ADD2AC,
+    0,
+    Opcode_add2ac_encode_fns, 0, 0 },
+  { "addac", ICLASS_iclass_ADDAC,
+    0,
+    Opcode_addac_encode_fns, 0, 0 },
+  { "cdot", ICLASS_iclass_CDOT,
+    0,
+    Opcode_cdot_encode_fns, 0, 0 },
+  { "cdotac", ICLASS_iclass_CDOTAC,
+    0,
+    Opcode_cdotac_encode_fns, 0, 0 },
+  { "cdotacs", ICLASS_iclass_CDOTACS,
+    0,
+    Opcode_cdotacs_encode_fns, 0, 0 },
+  { "cmac", ICLASS_iclass_CMAC,
+    0,
+    Opcode_cmac_encode_fns, 0, 0 },
+  { "cmacs", ICLASS_iclass_CMACS,
+    0,
+    Opcode_cmacs_encode_fns, 0, 0 },
+  { "cmpy", ICLASS_iclass_CMPY,
+    0,
+    Opcode_cmpy_encode_fns, 0, 0 },
+  { "cmpy2cm", ICLASS_iclass_CMPY2CM,
+    0,
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+  { "cmpy2pq", ICLASS_iclass_CMPY2PQ,
+    0,
+    Opcode_cmpy2pq_encode_fns, 0, 0 },
+  { "cmpys", ICLASS_iclass_CMPYS,
+    0,
+    Opcode_cmpys_encode_fns, 0, 0 },
+  { "cmpyxp2pq", ICLASS_iclass_CMPYXP2PQ,
+    0,
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+  { "comb32", ICLASS_iclass_COMB32,
+    0,
+    Opcode_comb32_encode_fns, 0, 0 },
+  { "dot", ICLASS_iclass_DOT,
+    0,
+    Opcode_dot_encode_fns, 0, 0 },
+  { "dotac", ICLASS_iclass_DOTAC,
+    0,
+    Opcode_dotac_encode_fns, 0, 0 },
+  { "dotacs", ICLASS_iclass_DOTACS,
+    0,
+    Opcode_dotacs_encode_fns, 0, 0 },
+  { "lin_int", ICLASS_iclass_LIN_INT,
+    0,
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+  { "llrpre1", ICLASS_iclass_LLRPRE1,
+    0,
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+  { "llrpre2", ICLASS_iclass_LLRPRE2,
+    0,
+    Opcode_llrpre2_encode_fns, 0, 0 },
+  { "mac", ICLASS_iclass_MAC,
+    0,
+    Opcode_mac_encode_fns, 0, 0 },
+  { "mac8", ICLASS_iclass_MAC8,
+    0,
+    Opcode_mac8_encode_fns, 0, 0 },
+  { "macd8", ICLASS_iclass_MACD8,
+    0,
+    Opcode_macd8_encode_fns, 0, 0 },
+  { "macpqxp_0", ICLASS_iclass_MACPQXP_0,
+    0,
+    Opcode_macpqxp_0_encode_fns, 0, 0 },
+  { "macpqxp_1", ICLASS_iclass_MACPQXP_1,
+    0,
+    Opcode_macpqxp_1_encode_fns, 0, 0 },
+  { "macpqxp_2", ICLASS_iclass_MACPQXP_2,
+    0,
+    Opcode_macpqxp_2_encode_fns, 0, 0 },
+  { "macpqxp_3", ICLASS_iclass_MACPQXP_3,
+    0,
+    Opcode_macpqxp_3_encode_fns, 0, 0 },
+  { "macs", ICLASS_iclass_MACS,
+    0,
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+  { "macxp2_0", ICLASS_iclass_MACXP2_0,
+    0,
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+  { "macxp2_1", ICLASS_iclass_MACXP2_1,
+    0,
+    Opcode_macxp2_1_encode_fns, 0, 0 },
+  { "macxp_0", ICLASS_iclass_MACXP_0,
+    0,
+    Opcode_macxp_0_encode_fns, 0, 0 },
+  { "macxp_1", ICLASS_iclass_MACXP_1,
+    0,
+    Opcode_macxp_1_encode_fns, 0, 0 },
+  { "macxp_2", ICLASS_iclass_MACXP_2,
+    0,
+    Opcode_macxp_2_encode_fns, 0, 0 },
+  { "macxp_3", ICLASS_iclass_MACXP_3,
+    0,
+    Opcode_macxp_3_encode_fns, 0, 0 },
+  { "mov2ac", ICLASS_iclass_MOV2AC,
+    0,
+    Opcode_mov2ac_encode_fns, 0, 0 },
+  { "mpy", ICLASS_iclass_MPY,
+    0,
+    Opcode_mpy_encode_fns, 0, 0 },
+  { "mpy2cm", ICLASS_iclass_MPY2CM,
+    0,
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+  { "mpy2pq", ICLASS_iclass_MPY2PQ,
+    0,
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+  { "mpy8", ICLASS_iclass_MPY8,
+    0,
+    Opcode_mpy8_encode_fns, 0, 0 },
+  { "mpyadd8_2cm", ICLASS_iclass_MPYADD8_2CM,
+    0,
+    Opcode_mpyadd8_2cm_encode_fns, 0, 0 },
+  { "mpyd8", ICLASS_iclass_MPYD8,
+    0,
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+  { "mpypqxp_0", ICLASS_iclass_MPYPQXP_0,
+    0,
+    Opcode_mpypqxp_0_encode_fns, 0, 0 },
+  { "mpypqxp_1", ICLASS_iclass_MPYPQXP_1,
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+  { "mpypqxp_2", ICLASS_iclass_MPYPQXP_2,
+    0,
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+  { "mpypqxp_3", ICLASS_iclass_MPYPQXP_3,
+    0,
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+  { "mpys", ICLASS_iclass_MPYS,
+    0,
+    Opcode_mpys_encode_fns, 0, 0 },
+  { "mpyxp2pq", ICLASS_iclass_MPYXP2PQ,
+    0,
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+  { "mpyxp2_0", ICLASS_iclass_MPYXP2_0,
+    0,
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+  { "mpyxp2_1", ICLASS_iclass_MPYXP2_1,
+    0,
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+  { "mpyxp_0", ICLASS_iclass_MPYXP_0,
+    0,
+    Opcode_mpyxp_0_encode_fns, 0, 0 },
+  { "mpyxp_1", ICLASS_iclass_MPYXP_1,
+    0,
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+  { "mpyxp_2", ICLASS_iclass_MPYXP_2,
+    0,
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+  { "mpyxp_3", ICLASS_iclass_MPYXP_3,
+    0,
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+  { "normacd", ICLASS_iclass_NORMACD,
+    0,
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+  { "normacpq_i", ICLASS_iclass_NORMACPQ_I,
+    0,
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+  { "normacpq_r", ICLASS_iclass_NORMACPQ_R,
+    0,
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+  { "normd", ICLASS_iclass_NORMD,
+    0,
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+  { "normpypq_i", ICLASS_iclass_NORMPYPQ_I,
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+  { "normpypq_r", ICLASS_iclass_NORMPYPQ_R,
+    0,
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+  { "rcmac", ICLASS_iclass_RCMAC,
+    0,
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+  { "rcmpy", ICLASS_iclass_RCMPY,
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+    0,
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+  { "rfir", ICLASS_iclass_RFIR,
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+  { "rfira", ICLASS_iclass_RFIRA,
+    0,
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+  { "rfird", ICLASS_iclass_RFIRD,
+    0,
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+  { "rfirda", ICLASS_iclass_RFIRDA,
+    0,
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+  { "rmac", ICLASS_iclass_RMAC,
+    0,
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+  { "rmpy", ICLASS_iclass_RMPY,
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+  { "rmpy2cm", ICLASS_iclass_RMPY2CM,
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+  { "smod_align", ICLASS_iclass_SMOD_ALIGN,
+    0,
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+  { "smod_scr", ICLASS_iclass_SMOD_SCR,
+    0,
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+  { "sub2ac", ICLASS_iclass_SUB2AC,
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+  { "wght32", ICLASS_iclass_WGHT32,
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+  { "clrtiep", ICLASS_iclass_CLRTIEP,
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+  { "ext_2fifo_0", ICLASS_iclass_EXT_2FIFO_0,
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+  { "ext_r2fifo_1", ICLASS_iclass_EXT_R2FIFO_1,
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+  { "lut", ICLASS_iclass_LUT,
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+  { "lut_iext", ICLASS_iclass_LUT_IEXT,
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+  { "moveq128_0", ICLASS_iclass_MOVEQ128_0,
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+  { "moveq128_3", ICLASS_iclass_MOVEQ128_3,
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+  { "moveq32_1", ICLASS_iclass_MOVEQ32_1,
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+    0,
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+    0,
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+  { "pop32_2", ICLASS_iclass_POP32_2,
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+  { "push32", ICLASS_iclass_PUSH32,
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+  { "addac_i2r", ICLASS_iclass_ADDAC_I2R,
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+  { "addac_r2i", ICLASS_iclass_ADDAC_R2I,
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+  { "addar2", ICLASS_iclass_ADDAR2,
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+  { "addwrp", ICLASS_iclass_ADDWRP,
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+  { "and128", ICLASS_iclass_AND128,
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+  { "asl", ICLASS_iclass_ASL,
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+  { "aslacm", ICLASS_iclass_ASLACM,
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+  { "asr", ICLASS_iclass_ASR,
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+  { "asrac", ICLASS_iclass_ASRAC,
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+  { "bitfext", ICLASS_iclass_BITFEXT,
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+  { "ext", ICLASS_iclass_EXT,
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+  { "ext32_i", ICLASS_iclass_EXT32_I,
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+  { "ext32_r", ICLASS_iclass_EXT32_R,
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+  { "extui4", ICLASS_iclass_EXTUI4,
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+  { "min8", ICLASS_iclass_MIN8,
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+  { "redacs", ICLASS_iclass_REDACS,
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+  { "sminclb_c", ICLASS_iclass_SMINCLB_C,
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+};
+
+enum xtensa_opcode_id {
+  OPCODE_EXCW,
+  OPCODE_RFE,
+  OPCODE_RFDE,
+  OPCODE_SYSCALL,
+  OPCODE_SIMCALL,
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+  OPCODE_RSR_EPC4,
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+  OPCODE_XSR_EPC4,
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+  OPCODE_RFIRA,
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+  OPCODE_WRTBSIGQM,
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+  OPCODE_WUR_LLR_BUF_18,
+  OPCODE_RUR_LLR_BUF_19,
+  OPCODE_WUR_LLR_BUF_19,
+  OPCODE_RUR_LLR_BUF_20,
+  OPCODE_WUR_LLR_BUF_20,
+  OPCODE_RUR_LLR_BUF_21,
+  OPCODE_WUR_LLR_BUF_21,
+  OPCODE_RUR_LLR_BUF_22,
+  OPCODE_WUR_LLR_BUF_22,
+  OPCODE_RUR_LLR_BUF_23,
+  OPCODE_WUR_LLR_BUF_23,
+  OPCODE_RUR_SMOD_BUF_0,
+  OPCODE_WUR_SMOD_BUF_0,
+  OPCODE_RUR_SMOD_BUF_1,
+  OPCODE_WUR_SMOD_BUF_1,
+  OPCODE_RUR_SMOD_BUF_2,
+  OPCODE_WUR_SMOD_BUF_2,
+  OPCODE_RUR_SMOD_BUF_3,
+  OPCODE_WUR_SMOD_BUF_3,
+  OPCODE_RUR_SMOD_BUF_4,
+  OPCODE_WUR_SMOD_BUF_4,
+  OPCODE_RUR_SMOD_BUF_5,
+  OPCODE_WUR_SMOD_BUF_5,
+  OPCODE_RUR_SMOD_BUF_6,
+  OPCODE_WUR_SMOD_BUF_6,
+  OPCODE_RUR_SMOD_BUF_7,
+  OPCODE_WUR_SMOD_BUF_7,
+  OPCODE_RUR_WEIGHT_REG,
+  OPCODE_WUR_WEIGHT_REG,
+  OPCODE_RUR_SCALE_REG,
+  OPCODE_WUR_SCALE_REG,
+  OPCODE_RUR_LLR_POS,
+  OPCODE_WUR_LLR_POS,
+  OPCODE_RUR_SMOD_POS,
+  OPCODE_WUR_SMOD_POS,
+  OPCODE_RUR_PERM_REG,
+  OPCODE_WUR_PERM_REG,
+  OPCODE_RUR_SMOD_OFFSET_TABLE_0,
+  OPCODE_WUR_SMOD_OFFSET_TABLE_0,
+  OPCODE_RUR_SMOD_OFFSET_TABLE_1,
+  OPCODE_WUR_SMOD_OFFSET_TABLE_1,
+  OPCODE_RUR_SMOD_OFFSET_TABLE_2,
+  OPCODE_WUR_SMOD_OFFSET_TABLE_2,
+  OPCODE_RUR_SMOD_OFFSET_TABLE_3,
+  OPCODE_WUR_SMOD_OFFSET_TABLE_3,
+  OPCODE_RUR_PHASOR_N,
+  OPCODE_WUR_PHASOR_N,
+  OPCODE_RUR_PHASOR_OFFSET,
+  OPCODE_WUR_PHASOR_OFFSET
+};
+
+
+/* Slot-specific opcode decode functions.  */
+
+static int
+Slot_inst_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2021_Slot_inst_get (insn))
+    {
+    case 3:
+      if (Field_sa4_Slot_inst_get (insn) == 0 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LCM_PINC_X;
+      if (Field_sa4_Slot_inst_get (insn) == 1 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_SCM_PINC_X;
+      break;
+    case 4:
+      if (Field_sa4_Slot_inst_get (insn) == 0 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LCM_X;
+      if (Field_sa4_Slot_inst_get (insn) == 1 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_SCM_X;
+      break;
+    case 5:
+      if (Field_sa4_Slot_inst_get (insn) == 0 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LCM_XU;
+      if (Field_sa4_Slot_inst_get (insn) == 1 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_SCM_XU;
+      break;
+    case 6:
+      if (Field_sa4_Slot_inst_get (insn) == 0 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LP_X;
+      break;
+    case 7:
+      if (Field_sa4_Slot_inst_get (insn) == 0 &&
+	  Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LQ_X;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2035_Slot_inst_get (insn) == 2 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2047_Slot_inst_get (insn) == 0)
+    return OPCODE_LQ;
+  switch (Field_dsp340050b49a6c_fld2037_Slot_inst_get (insn))
+    {
+    case 0:
+      if (Field_sae4_Slot_inst_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LCM_PINC;
+      break;
+    case 1:
+      if (Field_sae4_Slot_inst_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LCM_U;
+      break;
+    case 2:
+      if (Field_sae4_Slot_inst_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LP;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2048_Slot_inst_get (insn))
+    {
+    case 0:
+      if (Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LAC2X32;
+      break;
+    case 1:
+      if (Field_sae4_Slot_inst_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+	  Field_op0_Slot_inst_get (insn) == 0)
+	return OPCODE_LAC32_R;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2082inst_Slot_inst_get (insn) == 0 &&
+      Field_r2_Slot_inst_get (insn) == 1 &&
+      Field_bbi4_Slot_inst_get (insn) == 0 &&
+      Field_op0_Slot_inst_get (insn) == 3)
+    return OPCODE_LAC_IH;
+  if (Field_dsp340050b49a6c_fld2083inst_Slot_inst_get (insn) == 1 &&
+      Field_r2_Slot_inst_get (insn) == 1 &&
+      Field_bbi4_Slot_inst_get (insn) == 0 &&
+      Field_op0_Slot_inst_get (insn) == 3)
+    return OPCODE_LAC_IL;
+  if (Field_dsp340050b49a6c_fld2084inst_Slot_inst_get (insn) == 2 &&
+      Field_r2_Slot_inst_get (insn) == 1 &&
+      Field_bbi4_Slot_inst_get (insn) == 0 &&
+      Field_op0_Slot_inst_get (insn) == 3)
+    return OPCODE_LAC_RH;
+  switch (Field_dsp340050b49a6c_fld2085inst_Slot_inst_get (insn))
+    {
+    case 3:
+      if (Field_r2_Slot_inst_get (insn) == 1 &&
+	  Field_bbi4_Slot_inst_get (insn) == 0 &&
+	  Field_op0_Slot_inst_get (insn) == 3)
+	return OPCODE_LAC2X64_1;
+      break;
+    case 19:
+      if (Field_r2_Slot_inst_get (insn) == 1 &&
+	  Field_bbi4_Slot_inst_get (insn) == 0 &&
+	  Field_op0_Slot_inst_get (insn) == 3)
+	return OPCODE_LAC2X64_2;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2086inst_Slot_inst_get (insn) == 2 &&
+      Field_r2_Slot_inst_get (insn) == 1 &&
+      Field_bbi4_Slot_inst_get (insn) == 0 &&
+      Field_op0_Slot_inst_get (insn) == 3 &&
+      Field_dsp340050b49a6c_fld3634_Slot_inst_get (insn) == 0)
+    return OPCODE_LAC_RL;
+  if (Field_dsp340050b49a6c_fld2088inst_Slot_inst_get (insn) == 3 &&
+      Field_r2_Slot_inst_get (insn) == 1 &&
+      Field_bbi4_Slot_inst_get (insn) == 0 &&
+      Field_op0_Slot_inst_get (insn) == 3 &&
+      Field_dsp340050b49a6c_fld3633inst_Slot_inst_get (insn) == 0)
+    return OPCODE_LAC2X64_3;
+  if (Field_dsp340050b49a6c_fld2089inst_Slot_inst_get (insn) == 1 &&
+      Field_r2_Slot_inst_get (insn) == 1 &&
+      Field_bbi4_Slot_inst_get (insn) == 0 &&
+      Field_op0_Slot_inst_get (insn) == 3 &&
+      Field_dsp340050b49a6c_fld3631inst_Slot_inst_get (insn) == 0)
+    return OPCODE_LAC2X64_0;
+  if (Field_dsp340050b49a6c_fld2090inst_Slot_inst_get (insn) == 1 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_PQ2CM;
+  if (Field_dsp340050b49a6c_fld2091inst_Slot_inst_get (insn) == 10 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_AR2CM_DUP;
+  if (Field_dsp340050b49a6c_fld2092inst_Slot_inst_get (insn) == 88 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_CLRTIEP;
+  if (Field_dsp340050b49a6c_fld2094inst_Slot_inst_get (insn) == 89 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld2095inst_Slot_inst_get (insn) == 90 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SETTIEP;
+  if (Field_dsp340050b49a6c_fld2096inst_Slot_inst_get (insn) == 182 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2098inst_Slot_inst_get (insn) == 183 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2099inst_Slot_inst_get (insn) == 92 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_WRTBSIGQM;
+  if (Field_dsp340050b49a6c_fld2100inst_Slot_inst_get (insn) == 186 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld2101inst_Slot_inst_get (insn) == 187 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_MAX;
+  if (Field_dsp340050b49a6c_fld2102inst_Slot_inst_get (insn) == 188 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld2103inst_Slot_inst_get (insn) == 189 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_NCO;
+  if (Field_dsp340050b49a6c_fld2104inst_Slot_inst_get (insn) == 190 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld2105inst_Slot_inst_get (insn) == 191 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld2106inst_Slot_inst_get (insn) == 18 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_PUSH128_PQ;
+  if (Field_dsp340050b49a6c_fld2107inst_Slot_inst_get (insn) == 152 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2PQ_0;
+  if (Field_dsp340050b49a6c_fld2108inst_Slot_inst_get (insn) == 153 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2PQ_2;
+  if (Field_dsp340050b49a6c_fld2109inst_Slot_inst_get (insn) == 154 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2PQ_3;
+  if (Field_dsp340050b49a6c_fld2110inst_Slot_inst_get (insn) == 155 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2PQ_5;
+  if (Field_dsp340050b49a6c_fld2111inst_Slot_inst_get (insn) == 156 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2PQ_4;
+  if (Field_dsp340050b49a6c_fld2112inst_Slot_inst_get (insn) == 301 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_LLR_POS;
+  if (Field_dsp340050b49a6c_fld2113inst_Slot_inst_get (insn) == 317 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_PHASOR_OFFSET;
+  if (Field_dsp340050b49a6c_fld2114inst_Slot_inst_get (insn) == 302 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_PHASOR_N;
+  if (Field_dsp340050b49a6c_fld2115inst_Slot_inst_get (insn) == 303 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld2116inst_Slot_inst_get (insn) == 318 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld2117inst_Slot_inst_get (insn) == 319 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_SOV;
+  if (Field_dsp340050b49a6c_fld2118inst_Slot_inst_get (insn) == 208 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2PQ_1;
+  if (Field_dsp340050b49a6c_fld2119inst_Slot_inst_get (insn) == 417 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_WGHT;
+  if (Field_dsp340050b49a6c_fld2120inst_Slot_inst_get (insn) == 6913 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ128_0;
+  if (Field_dsp340050b49a6c_fld2122inst_Slot_inst_get (insn) == 6929 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ128_1;
+  if (Field_dsp340050b49a6c_fld2123inst_Slot_inst_get (insn) == 6945 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ128_2;
+  if (Field_dsp340050b49a6c_fld2124inst_Slot_inst_get (insn) == 6961 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ128_5;
+  if (Field_dsp340050b49a6c_fld2125inst_Slot_inst_get (insn) == 6977 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ128_3;
+  if (Field_dsp340050b49a6c_fld2126inst_Slot_inst_get (insn) == 6993 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ32_0;
+  if (Field_dsp340050b49a6c_fld2127inst_Slot_inst_get (insn) == 7009 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ32_1;
+  if (Field_dsp340050b49a6c_fld2128inst_Slot_inst_get (insn) == 7025 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ32_2;
+  if (Field_dsp340050b49a6c_fld2129inst_Slot_inst_get (insn) == 1761 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2035_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ128_4;
+  if (Field_dsp340050b49a6c_fld2131inst_Slot_inst_get (insn) == 1777 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2035_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVEQ32_3;
+  if (Field_dsp340050b49a6c_fld2132inst_Slot_inst_get (insn) == 105 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3659inst_Slot_inst_get (insn) == 0)
+    return OPCODE_WRTBSIGQ;
+  if (Field_dsp340050b49a6c_fld2133inst_Slot_inst_get (insn) == 53 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3660inst_Slot_inst_get (insn) == 0)
+    return OPCODE_WRTSIGQ;
+  if (Field_dsp340050b49a6c_fld2134inst_Slot_inst_get (insn) == 53 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2050_Slot_inst_get (insn) == 0)
+    return OPCODE_CLRAC;
+  if (Field_dsp340050b49a6c_fld2136inst_Slot_inst_get (insn) == 55 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2050_Slot_inst_get (insn) == 0)
+    return OPCODE_POP16LLR_1;
+  if (Field_dsp340050b49a6c_fld2137inst_Slot_inst_get (insn) == 34 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_WRTIEP;
+  if (Field_dsp340050b49a6c_fld2138inst_Slot_inst_get (insn) == 560 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2139inst_Slot_inst_get (insn) == 561 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2140inst_Slot_inst_get (insn) == 562 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld2141inst_Slot_inst_get (insn) == 563 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_03;
+  if (Field_dsp340050b49a6c_fld2142inst_Slot_inst_get (insn) == 564 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2143inst_Slot_inst_get (insn) == 565 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_21;
+  if (Field_dsp340050b49a6c_fld2144inst_Slot_inst_get (insn) == 283 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2047_Slot_inst_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_23;
+  if (Field_dsp340050b49a6c_fld2145inst_Slot_inst_get (insn) == 71 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2037_Slot_inst_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_01;
+  if (Field_dsp340050b49a6c_fld2146inst_Slot_inst_get (insn) == 21 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3649inst_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2147inst_Slot_inst_get (insn) == 13 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3650inst_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2149inst_Slot_inst_get (insn) == 5 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3627inst_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld2151inst_Slot_inst_get (insn) == 5 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3657inst_Slot_inst_get (insn) == 0)
+    return OPCODE_PUSH2X128_PQ;
+  if (Field_dsp340050b49a6c_fld2153inst_Slot_inst_get (insn) == 1 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3635inst_Slot_inst_get (insn) == 0)
+    return OPCODE_AR2CM_LN;
+  if (Field_dsp340050b49a6c_fld2154inst_Slot_inst_get (insn) == 3 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3636inst_Slot_inst_get (insn) == 0)
+    return OPCODE_AR2CM_LN_I;
+  if (Field_dsp340050b49a6c_fld2155inst_Slot_inst_get (insn) == 3 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3637inst_Slot_inst_get (insn) == 0)
+    return OPCODE_AR2CM_LN_R;
+  if (Field_dsp340050b49a6c_fld2156inst_Slot_inst_get (insn) == 3 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_LCM;
+  if (Field_dsp340050b49a6c_fld2157inst_Slot_inst_get (insn) == 19 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld2158inst_Slot_inst_get (insn) == 27 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2159inst_Slot_inst_get (insn) == 51 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOV_I;
+  if (Field_dsp340050b49a6c_fld2160inst_Slot_inst_get (insn) == 59 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_EXT_REGS;
+  if (Field_dsp340050b49a6c_fld2161inst_Slot_inst_get (insn) == 83 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOV_R;
+  if (Field_dsp340050b49a6c_fld2162inst_Slot_inst_get (insn) == 171 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_ASRAC;
+  if (Field_dsp340050b49a6c_fld2163inst_Slot_inst_get (insn) == 187 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_CLB_R;
+  if (Field_dsp340050b49a6c_fld2164inst_Slot_inst_get (insn) == 227 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_CLB_C;
+  if (Field_dsp340050b49a6c_fld2165inst_Slot_inst_get (insn) == 235 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MINCLB_C;
+  if (Field_dsp340050b49a6c_fld2166inst_Slot_inst_get (insn) == 243 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MINCLB_R;
+  if (Field_dsp340050b49a6c_fld2167inst_Slot_inst_get (insn) == 251 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SMINCLB_C;
+  if (Field_dsp340050b49a6c_fld2168inst_Slot_inst_get (insn) == 147 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld2169inst_Slot_inst_get (insn) == 310 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld2171inst_Slot_inst_get (insn) == 599 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVAC;
+  if (Field_dsp340050b49a6c_fld2172inst_Slot_inst_get (insn) == 631 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVAC_I2R;
+  if (Field_dsp340050b49a6c_fld2173inst_Slot_inst_get (insn) == 358 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld2174inst_Slot_inst_get (insn) == 711 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVAC_R2I;
+  if (Field_dsp340050b49a6c_fld2175inst_Slot_inst_get (insn) == 5944 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_ADDAC_I2R;
+  if (Field_dsp340050b49a6c_fld2177inst_Slot_inst_get (insn) == 5945 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_ADDAC_R2I;
+  if (Field_dsp340050b49a6c_fld2178inst_Slot_inst_get (insn) == 5946 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_REDAC;
+  if (Field_dsp340050b49a6c_fld2179inst_Slot_inst_get (insn) == 5947 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_REDAC4;
+  if (Field_dsp340050b49a6c_fld2180inst_Slot_inst_get (insn) == 5948 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_REDAC2;
+  if (Field_dsp340050b49a6c_fld2181inst_Slot_inst_get (insn) == 5949 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_REDACS;
+  if (Field_dsp340050b49a6c_fld2182inst_Slot_inst_get (insn) == 5950 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SUBAC_I2R;
+  if (Field_dsp340050b49a6c_fld2183inst_Slot_inst_get (insn) == 5951 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SUBAC_R2I;
+  if (Field_dsp340050b49a6c_fld2184inst_Slot_inst_get (insn) == 374 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3642inst_Slot_inst_get (insn) == 0)
+    return OPCODE_SWAPAC_RI;
+  if (Field_dsp340050b49a6c_fld2185inst_Slot_inst_get (insn) == 3000 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_L;
+  if (Field_dsp340050b49a6c_fld2186inst_Slot_inst_get (insn) == 3001 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_N;
+  if (Field_dsp340050b49a6c_fld2187inst_Slot_inst_get (insn) == 3002 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_LLR_POS;
+  if (Field_dsp340050b49a6c_fld2188inst_Slot_inst_get (insn) == 3003 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_PHASOR_OFFSET;
+  if (Field_dsp340050b49a6c_fld2189inst_Slot_inst_get (insn) == 3004 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_PHASOR_N;
+  if (Field_dsp340050b49a6c_fld2190inst_Slot_inst_get (insn) == 3005 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld2191inst_Slot_inst_get (insn) == 3006 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld2192inst_Slot_inst_get (insn) == 3007 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_SOV;
+  if (Field_dsp340050b49a6c_fld2193inst_Slot_inst_get (insn) == 211 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3662inst_Slot_inst_get (insn) == 0)
+    return OPCODE_SMINCLB_R;
+  if (Field_dsp340050b49a6c_fld2194inst_Slot_inst_get (insn) == 3504 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_GET_WGHT;
+  if (Field_dsp340050b49a6c_fld2195inst_Slot_inst_get (insn) == 3505 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2196inst_Slot_inst_get (insn) == 3506 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2197inst_Slot_inst_get (insn) == 3507 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2198inst_Slot_inst_get (insn) == 3508 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2199inst_Slot_inst_get (insn) == 3509 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_MAX;
+  if (Field_dsp340050b49a6c_fld2200inst_Slot_inst_get (insn) == 3510 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_NCO;
+  if (Field_dsp340050b49a6c_fld2201inst_Slot_inst_get (insn) == 3511 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld2202inst_Slot_inst_get (insn) == 878 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2254_Slot_inst_get (insn) == 0)
+    return OPCODE_RDTIEP;
+  if (Field_dsp340050b49a6c_fld2203inst_Slot_inst_get (insn) == 879 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2254_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld2204inst_Slot_inst_get (insn) == 123 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3656inst_Slot_inst_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2205inst_Slot_inst_get (insn) == 3 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_MOVCM2PQ;
+  if (Field_dsp340050b49a6c_fld2206inst_Slot_inst_get (insn) == 7 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_QREADY;
+  if (Field_dsp340050b49a6c_fld2207inst_Slot_inst_get (insn) == 19 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT32_I;
+  if (Field_dsp340050b49a6c_fld2208inst_Slot_inst_get (insn) == 23 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_2;
+  if (Field_dsp340050b49a6c_fld2209inst_Slot_inst_get (insn) == 27 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_3;
+  if (Field_dsp340050b49a6c_fld2210inst_Slot_inst_get (insn) == 31 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_0;
+  if (Field_dsp340050b49a6c_fld2211inst_Slot_inst_get (insn) == 35 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT32_R;
+  if (Field_dsp340050b49a6c_fld2212inst_Slot_inst_get (insn) == 39 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_1;
+  if (Field_dsp340050b49a6c_fld2213inst_Slot_inst_get (insn) == 23 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3647inst_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_2;
+  if (Field_dsp340050b49a6c_fld2214inst_Slot_inst_get (insn) == 27 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3648inst_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_3;
+  if (Field_dsp340050b49a6c_fld2215inst_Slot_inst_get (insn) == 31 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3630inst_Slot_inst_get (insn) == 0)
+    return OPCODE_SET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld2216inst_Slot_inst_get (insn) == 7 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3644inst_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_0;
+  if (Field_dsp340050b49a6c_fld2217inst_Slot_inst_get (insn) == 7 &&
+      Field_sae4_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 3 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3645inst_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_1;
+  if (Field_dsp340050b49a6c_fld2218inst_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2021_Slot_inst_get (insn) == 6 &&
+      Field_sa4_Slot_inst_get (insn) == 1 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT;
+  if (Field_dsp340050b49a6c_fld2219inst_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2021_Slot_inst_get (insn) == 6 &&
+      Field_sa4_Slot_inst_get (insn) == 1 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_EXT_R;
+  if (Field_dsp340050b49a6c_fld2220inst_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2021_Slot_inst_get (insn) == 7 &&
+      Field_sa4_Slot_inst_get (insn) == 1 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_PUSH128_M;
+  if (Field_dsp340050b49a6c_fld2221inst_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2021_Slot_inst_get (insn) == 7 &&
+      Field_sa4_Slot_inst_get (insn) == 1 &&
+      Field_sae4_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 4 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC2X64_0;
+  if (Field_dsp340050b49a6c_fld2222inst_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC2X32;
+  if (Field_dsp340050b49a6c_fld2223inst_Slot_inst_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC32_R;
+  if (Field_dsp340050b49a6c_fld2224inst_Slot_inst_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SCM_PINC;
+  if (Field_dsp340050b49a6c_fld2225inst_Slot_inst_get (insn) == 5 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_LUT0;
+  if (Field_dsp340050b49a6c_fld2226inst_Slot_inst_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_LUT1;
+  if (Field_dsp340050b49a6c_fld2227inst_Slot_inst_get (insn) == 4 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SCM_U;
+  if (Field_dsp340050b49a6c_fld2228inst_Slot_inst_get (insn) == 9 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_LUT2;
+  if (Field_dsp340050b49a6c_fld2229inst_Slot_inst_get (insn) == 11 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SCM;
+  if (Field_dsp340050b49a6c_fld2230inst_Slot_inst_get (insn) == 12 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_LUT3;
+  if (Field_dsp340050b49a6c_fld2231inst_Slot_inst_get (insn) == 14 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_STORE_P;
+  if (Field_dsp340050b49a6c_fld2232inst_Slot_inst_get (insn) == 14 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC_IH;
+  if (Field_dsp340050b49a6c_fld2234inst_Slot_inst_get (insn) == 15 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC_IL;
+  if (Field_dsp340050b49a6c_fld2235inst_Slot_inst_get (insn) == 16 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_COMB_AR;
+  if (Field_dsp340050b49a6c_fld2236inst_Slot_inst_get (insn) == 18 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_STSWAPBM;
+  if (Field_dsp340050b49a6c_fld2237inst_Slot_inst_get (insn) == 18 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC_RH;
+  if (Field_dsp340050b49a6c_fld2238inst_Slot_inst_get (insn) == 35 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC2X64_1;
+  if (Field_dsp340050b49a6c_fld2239inst_Slot_inst_get (insn) == 39 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC2X64_2;
+  if (Field_dsp340050b49a6c_fld2240inst_Slot_inst_get (insn) == 20 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC_RL;
+  if (Field_dsp340050b49a6c_fld2241inst_Slot_inst_get (insn) == 41 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_SAC2X64_3;
+  if (Field_dsp340050b49a6c_fld2242inst_Slot_inst_get (insn) == 45 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3661inst_Slot_inst_get (insn) == 0)
+    return OPCODE_ASLACM;
+  if (Field_dsp340050b49a6c_fld2243inst_Slot_inst_get (insn) == 21 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_STSWAPBMU;
+  if (Field_dsp340050b49a6c_fld2244inst_Slot_inst_get (insn) == 92 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld2245inst_Slot_inst_get (insn) == 93 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_CM2AR_LN_I;
+  if (Field_dsp340050b49a6c_fld2246inst_Slot_inst_get (insn) == 47 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3638inst_Slot_inst_get (insn) == 0)
+    return OPCODE_CM2AR_LN_R;
+  if (Field_dsp340050b49a6c_fld2247inst_Slot_inst_get (insn) == 24 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0)
+    return OPCODE_STORE_Q;
+  if (Field_dsp340050b49a6c_fld2248inst_Slot_inst_get (insn) == 50 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3651inst_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2M_0;
+  if (Field_dsp340050b49a6c_fld2249inst_Slot_inst_get (insn) == 51 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3655inst_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2M_3;
+  if (Field_dsp340050b49a6c_fld2250inst_Slot_inst_get (insn) == 26 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3653inst_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2M_1;
+  if (Field_dsp340050b49a6c_fld2251inst_Slot_inst_get (insn) == 216 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3658inst_Slot_inst_get (insn) == 0)
+    return OPCODE_PUSH32;
+  if (Field_dsp340050b49a6c_fld2252inst_Slot_inst_get (insn) == 217 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3643inst_Slot_inst_get (insn) == 0)
+    return OPCODE_SWAPB;
+  if (Field_dsp340050b49a6c_fld2253inst_Slot_inst_get (insn) == 109 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3639inst_Slot_inst_get (insn) == 0)
+    return OPCODE_MOV2AC32_I;
+  if (Field_dsp340050b49a6c_fld2255inst_Slot_inst_get (insn) == 55 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3640inst_Slot_inst_get (insn) == 0)
+    return OPCODE_MOV2AC32_R;
+  if (Field_dsp340050b49a6c_fld2257inst_Slot_inst_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld2019_Slot_inst_get (insn) == 6 &&
+      Field_op0_Slot_inst_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3654inst_Slot_inst_get (insn) == 0)
+    return OPCODE_POP128_2M_2;
+  switch (Field_op0_Slot_inst_get (insn))
+    {
+    case 0:
+      switch (Field_op1_Slot_inst_get (insn))
+	{
+	case 0:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      switch (Field_r_Slot_inst_get (insn))
+		{
+		case 0:
+		  switch (Field_m_Slot_inst_get (insn))
+		    {
+		    case 0:
+		      if (Field_s_Slot_inst_get (insn) == 0 &&
+			  Field_n_Slot_inst_get (insn) == 0)
+			return OPCODE_ILL;
+		      break;
+		    case 2:
+		      switch (Field_n_Slot_inst_get (insn))
+			{
+			case 0:
+			  return OPCODE_RET;
+			case 1:
+			  return OPCODE_RETW;
+			case 2:
+			  return OPCODE_JX;
+			}
+		      break;
+		    case 3:
+		      switch (Field_n_Slot_inst_get (insn))
+			{
+			case 0:
+			  return OPCODE_CALLX0;
+			case 1:
+			  return OPCODE_CALLX4;
+			case 2:
+			  return OPCODE_CALLX8;
+			case 3:
+			  return OPCODE_CALLX12;
+			}
+		      break;
+		    }
+		  break;
+		case 1:
+		  return OPCODE_MOVSP;
+		case 2:
+		  if (Field_s_Slot_inst_get (insn) == 0)
+		    {
+		      switch (Field_t_Slot_inst_get (insn))
+			{
+			case 0:
+			  return OPCODE_ISYNC;
+			case 1:
+			  return OPCODE_RSYNC;
+			case 2:
+			  return OPCODE_ESYNC;
+			case 3:
+			  return OPCODE_DSYNC;
+			case 8:
+			  return OPCODE_EXCW;
+			case 12:
+			  return OPCODE_MEMW;
+			case 13:
+			  return OPCODE_EXTW;
+			case 15:
+			  return OPCODE_NOP;
+			}
+		    }
+		  break;
+		case 3:
+		  switch (Field_t_Slot_inst_get (insn))
+		    {
+		    case 0:
+		      switch (Field_s_Slot_inst_get (insn))
+			{
+			case 0:
+			  return OPCODE_RFE;
+			case 2:
+			  return OPCODE_RFDE;
+			case 4:
+			  return OPCODE_RFWO;
+			case 5:
+			  return OPCODE_RFWU;
+			}
+		      break;
+		    case 1:
+		      return OPCODE_RFI;
+		    }
+		  break;
+		case 4:
+		  return OPCODE_BREAK;
+		case 5:
+		  switch (Field_s_Slot_inst_get (insn))
+		    {
+		    case 0:
+		      if (Field_t_Slot_inst_get (insn) == 0)
+			return OPCODE_SYSCALL;
+		      break;
+		    case 1:
+		      if (Field_t_Slot_inst_get (insn) == 0)
+			return OPCODE_SIMCALL;
+		      break;
+		    }
+		  break;
+		case 6:
+		  return OPCODE_RSIL;
+		case 7:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_WAITI;
+		  break;
+		case 8:
+		  return OPCODE_ANY4;
+		case 9:
+		  return OPCODE_ALL4;
+		case 10:
+		  return OPCODE_ANY8;
+		case 11:
+		  return OPCODE_ALL8;
+		}
+	      break;
+	    case 1:
+	      return OPCODE_AND;
+	    case 2:
+	      return OPCODE_OR;
+	    case 3:
+	      return OPCODE_XOR;
+	    case 4:
+	      switch (Field_r_Slot_inst_get (insn))
+		{
+		case 0:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_SSR;
+		  break;
+		case 1:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_SSL;
+		  break;
+		case 2:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_SSA8L;
+		  break;
+		case 3:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_SSA8B;
+		  break;
+		case 4:
+		  if (Field_thi3_Slot_inst_get (insn) == 0)
+		    return OPCODE_SSAI;
+		  break;
+		case 6:
+		  return OPCODE_RER;
+		case 7:
+		  return OPCODE_WER;
+		case 8:
+		  if (Field_s_Slot_inst_get (insn) == 0)
+		    return OPCODE_ROTW;
+		  break;
+		case 14:
+		  return OPCODE_NSA;
+		case 15:
+		  return OPCODE_NSAU;
+		}
+	      break;
+	    case 5:
+	      switch (Field_r_Slot_inst_get (insn))
+		{
+		case 3:
+		  return OPCODE_RITLB0;
+		case 4:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_IITLB;
+		  break;
+		case 5:
+		  return OPCODE_PITLB;
+		case 6:
+		  return OPCODE_WITLB;
+		case 7:
+		  return OPCODE_RITLB1;
+		case 11:
+		  return OPCODE_RDTLB0;
+		case 12:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_IDTLB;
+		  break;
+		case 13:
+		  return OPCODE_PDTLB;
+		case 14:
+		  return OPCODE_WDTLB;
+		case 15:
+		  return OPCODE_RDTLB1;
+		}
+	      break;
+	    case 6:
+	      switch (Field_s_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_NEG;
+		case 1:
+		  return OPCODE_ABS;
+		}
+	      break;
+	    case 8:
+	      return OPCODE_ADD;
+	    case 9:
+	      return OPCODE_ADDX2;
+	    case 10:
+	      return OPCODE_ADDX4;
+	    case 11:
+	      return OPCODE_ADDX8;
+	    case 12:
+	      return OPCODE_SUB;
+	    case 13:
+	      return OPCODE_SUBX2;
+	    case 14:
+	      return OPCODE_SUBX4;
+	    case 15:
+	      return OPCODE_SUBX8;
+	    }
+	  break;
+	case 1:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 0:
+	    case 1:
+	      return OPCODE_SLLI;
+	    case 2:
+	    case 3:
+	      return OPCODE_SRAI;
+	    case 4:
+	      return OPCODE_SRLI;
+	    case 6:
+	      switch (Field_sr_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_XSR_LBEG;
+		case 1:
+		  return OPCODE_XSR_LEND;
+		case 2:
+		  return OPCODE_XSR_LCOUNT;
+		case 3:
+		  return OPCODE_XSR_SAR;
+		case 4:
+		  return OPCODE_XSR_BR;
+		case 5:
+		  return OPCODE_XSR_LITBASE;
+		case 12:
+		  return OPCODE_XSR_SCOMPARE1;
+		case 72:
+		  return OPCODE_XSR_WINDOWBASE;
+		case 73:
+		  return OPCODE_XSR_WINDOWSTART;
+		case 96:
+		  return OPCODE_XSR_IBREAKENABLE;
+		case 99:
+		  return OPCODE_XSR_ATOMCTL;
+		case 104:
+		  return OPCODE_XSR_DDR;
+		case 128:
+		  return OPCODE_XSR_IBREAKA0;
+		case 129:
+		  return OPCODE_XSR_IBREAKA1;
+		case 144:
+		  return OPCODE_XSR_DBREAKA0;
+		case 145:
+		  return OPCODE_XSR_DBREAKA1;
+		case 160:
+		  return OPCODE_XSR_DBREAKC0;
+		case 161:
+		  return OPCODE_XSR_DBREAKC1;
+		case 177:
+		  return OPCODE_XSR_EPC1;
+		case 178:
+		  return OPCODE_XSR_EPC2;
+		case 179:
+		  return OPCODE_XSR_EPC3;
+		case 180:
+		  return OPCODE_XSR_EPC4;
+		case 181:
+		  return OPCODE_XSR_EPC5;
+		case 182:
+		  return OPCODE_XSR_EPC6;
+		case 192:
+		  return OPCODE_XSR_DEPC;
+		case 194:
+		  return OPCODE_XSR_EPS2;
+		case 195:
+		  return OPCODE_XSR_EPS3;
+		case 196:
+		  return OPCODE_XSR_EPS4;
+		case 197:
+		  return OPCODE_XSR_EPS5;
+		case 198:
+		  return OPCODE_XSR_EPS6;
+		case 209:
+		  return OPCODE_XSR_EXCSAVE1;
+		case 210:
+		  return OPCODE_XSR_EXCSAVE2;
+		case 211:
+		  return OPCODE_XSR_EXCSAVE3;
+		case 212:
+		  return OPCODE_XSR_EXCSAVE4;
+		case 213:
+		  return OPCODE_XSR_EXCSAVE5;
+		case 214:
+		  return OPCODE_XSR_EXCSAVE6;
+		case 224:
+		  return OPCODE_XSR_CPENABLE;
+		case 228:
+		  return OPCODE_XSR_INTENABLE;
+		case 230:
+		  return OPCODE_XSR_PS;
+		case 231:
+		  return OPCODE_XSR_VECBASE;
+		case 232:
+		  return OPCODE_XSR_EXCCAUSE;
+		case 233:
+		  return OPCODE_XSR_DEBUGCAUSE;
+		case 234:
+		  return OPCODE_XSR_CCOUNT;
+		case 236:
+		  return OPCODE_XSR_ICOUNT;
+		case 237:
+		  return OPCODE_XSR_ICOUNTLEVEL;
+		case 238:
+		  return OPCODE_XSR_EXCVADDR;
+		case 240:
+		  return OPCODE_XSR_CCOMPARE0;
+		case 241:
+		  return OPCODE_XSR_CCOMPARE1;
+		}
+	      break;
+	    case 8:
+	      return OPCODE_SRC;
+	    case 9:
+	      if (Field_s_Slot_inst_get (insn) == 0)
+		return OPCODE_SRL;
+	      break;
+	    case 10:
+	      if (Field_t_Slot_inst_get (insn) == 0)
+		return OPCODE_SLL;
+	      break;
+	    case 11:
+	      if (Field_s_Slot_inst_get (insn) == 0)
+		return OPCODE_SRA;
+	      break;
+	    case 12:
+	      return OPCODE_MUL16U;
+	    case 13:
+	      return OPCODE_MUL16S;
+	    case 15:
+	      switch (Field_r_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_LICT;
+		case 1:
+		  return OPCODE_SICT;
+		case 2:
+		  return OPCODE_LICW;
+		case 3:
+		  return OPCODE_SICW;
+		case 8:
+		  return OPCODE_LDCT;
+		case 9:
+		  return OPCODE_SDCT;
+		case 14:
+		  if (Field_t_Slot_inst_get (insn) == 0)
+		    return OPCODE_RFDO;
+		  if (Field_t_Slot_inst_get (insn) == 1)
+		    return OPCODE_RFDD;
+		  break;
+		}
+	      break;
+	    }
+	  break;
+	case 2:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_ANDB;
+	    case 1:
+	      return OPCODE_ANDBC;
+	    case 2:
+	      return OPCODE_ORB;
+	    case 3:
+	      return OPCODE_ORBC;
+	    case 4:
+	      return OPCODE_XORB;
+	    }
+	  break;
+	case 3:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      switch (Field_sr_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_RSR_LBEG;
+		case 1:
+		  return OPCODE_RSR_LEND;
+		case 2:
+		  return OPCODE_RSR_LCOUNT;
+		case 3:
+		  return OPCODE_RSR_SAR;
+		case 4:
+		  return OPCODE_RSR_BR;
+		case 5:
+		  return OPCODE_RSR_LITBASE;
+		case 12:
+		  return OPCODE_RSR_SCOMPARE1;
+		case 72:
+		  return OPCODE_RSR_WINDOWBASE;
+		case 73:
+		  return OPCODE_RSR_WINDOWSTART;
+		case 96:
+		  return OPCODE_RSR_IBREAKENABLE;
+		case 99:
+		  return OPCODE_RSR_ATOMCTL;
+		case 104:
+		  return OPCODE_RSR_DDR;
+		case 128:
+		  return OPCODE_RSR_IBREAKA0;
+		case 129:
+		  return OPCODE_RSR_IBREAKA1;
+		case 144:
+		  return OPCODE_RSR_DBREAKA0;
+		case 145:
+		  return OPCODE_RSR_DBREAKA1;
+		case 160:
+		  return OPCODE_RSR_DBREAKC0;
+		case 161:
+		  return OPCODE_RSR_DBREAKC1;
+		case 176:
+		  return OPCODE_RSR_176;
+		case 177:
+		  return OPCODE_RSR_EPC1;
+		case 178:
+		  return OPCODE_RSR_EPC2;
+		case 179:
+		  return OPCODE_RSR_EPC3;
+		case 180:
+		  return OPCODE_RSR_EPC4;
+		case 181:
+		  return OPCODE_RSR_EPC5;
+		case 182:
+		  return OPCODE_RSR_EPC6;
+		case 192:
+		  return OPCODE_RSR_DEPC;
+		case 194:
+		  return OPCODE_RSR_EPS2;
+		case 195:
+		  return OPCODE_RSR_EPS3;
+		case 196:
+		  return OPCODE_RSR_EPS4;
+		case 197:
+		  return OPCODE_RSR_EPS5;
+		case 198:
+		  return OPCODE_RSR_EPS6;
+		case 208:
+		  return OPCODE_RSR_208;
+		case 209:
+		  return OPCODE_RSR_EXCSAVE1;
+		case 210:
+		  return OPCODE_RSR_EXCSAVE2;
+		case 211:
+		  return OPCODE_RSR_EXCSAVE3;
+		case 212:
+		  return OPCODE_RSR_EXCSAVE4;
+		case 213:
+		  return OPCODE_RSR_EXCSAVE5;
+		case 214:
+		  return OPCODE_RSR_EXCSAVE6;
+		case 224:
+		  return OPCODE_RSR_CPENABLE;
+		case 226:
+		  return OPCODE_RSR_INTERRUPT;
+		case 228:
+		  return OPCODE_RSR_INTENABLE;
+		case 230:
+		  return OPCODE_RSR_PS;
+		case 231:
+		  return OPCODE_RSR_VECBASE;
+		case 232:
+		  return OPCODE_RSR_EXCCAUSE;
+		case 233:
+		  return OPCODE_RSR_DEBUGCAUSE;
+		case 234:
+		  return OPCODE_RSR_CCOUNT;
+		case 235:
+		  return OPCODE_RSR_PRID;
+		case 236:
+		  return OPCODE_RSR_ICOUNT;
+		case 237:
+		  return OPCODE_RSR_ICOUNTLEVEL;
+		case 238:
+		  return OPCODE_RSR_EXCVADDR;
+		case 240:
+		  return OPCODE_RSR_CCOMPARE0;
+		case 241:
+		  return OPCODE_RSR_CCOMPARE1;
+		}
+	      break;
+	    case 1:
+	      switch (Field_sr_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_WSR_LBEG;
+		case 1:
+		  return OPCODE_WSR_LEND;
+		case 2:
+		  return OPCODE_WSR_LCOUNT;
+		case 3:
+		  return OPCODE_WSR_SAR;
+		case 4:
+		  return OPCODE_WSR_BR;
+		case 5:
+		  return OPCODE_WSR_LITBASE;
+		case 12:
+		  return OPCODE_WSR_SCOMPARE1;
+		case 72:
+		  return OPCODE_WSR_WINDOWBASE;
+		case 73:
+		  return OPCODE_WSR_WINDOWSTART;
+		case 89:
+		  return OPCODE_WSR_MMID;
+		case 96:
+		  return OPCODE_WSR_IBREAKENABLE;
+		case 99:
+		  return OPCODE_WSR_ATOMCTL;
+		case 104:
+		  return OPCODE_WSR_DDR;
+		case 128:
+		  return OPCODE_WSR_IBREAKA0;
+		case 129:
+		  return OPCODE_WSR_IBREAKA1;
+		case 144:
+		  return OPCODE_WSR_DBREAKA0;
+		case 145:
+		  return OPCODE_WSR_DBREAKA1;
+		case 160:
+		  return OPCODE_WSR_DBREAKC0;
+		case 161:
+		  return OPCODE_WSR_DBREAKC1;
+		case 176:
+		  return OPCODE_WSR_176;
+		case 177:
+		  return OPCODE_WSR_EPC1;
+		case 178:
+		  return OPCODE_WSR_EPC2;
+		case 179:
+		  return OPCODE_WSR_EPC3;
+		case 180:
+		  return OPCODE_WSR_EPC4;
+		case 181:
+		  return OPCODE_WSR_EPC5;
+		case 182:
+		  return OPCODE_WSR_EPC6;
+		case 192:
+		  return OPCODE_WSR_DEPC;
+		case 194:
+		  return OPCODE_WSR_EPS2;
+		case 195:
+		  return OPCODE_WSR_EPS3;
+		case 196:
+		  return OPCODE_WSR_EPS4;
+		case 197:
+		  return OPCODE_WSR_EPS5;
+		case 198:
+		  return OPCODE_WSR_EPS6;
+		case 209:
+		  return OPCODE_WSR_EXCSAVE1;
+		case 210:
+		  return OPCODE_WSR_EXCSAVE2;
+		case 211:
+		  return OPCODE_WSR_EXCSAVE3;
+		case 212:
+		  return OPCODE_WSR_EXCSAVE4;
+		case 213:
+		  return OPCODE_WSR_EXCSAVE5;
+		case 214:
+		  return OPCODE_WSR_EXCSAVE6;
+		case 224:
+		  return OPCODE_WSR_CPENABLE;
+		case 226:
+		  return OPCODE_WSR_INTSET;
+		case 227:
+		  return OPCODE_WSR_INTCLEAR;
+		case 228:
+		  return OPCODE_WSR_INTENABLE;
+		case 230:
+		  return OPCODE_WSR_PS;
+		case 231:
+		  return OPCODE_WSR_VECBASE;
+		case 232:
+		  return OPCODE_WSR_EXCCAUSE;
+		case 233:
+		  return OPCODE_WSR_DEBUGCAUSE;
+		case 234:
+		  return OPCODE_WSR_CCOUNT;
+		case 236:
+		  return OPCODE_WSR_ICOUNT;
+		case 237:
+		  return OPCODE_WSR_ICOUNTLEVEL;
+		case 238:
+		  return OPCODE_WSR_EXCVADDR;
+		case 240:
+		  return OPCODE_WSR_CCOMPARE0;
+		case 241:
+		  return OPCODE_WSR_CCOMPARE1;
+		}
+	      break;
+	    case 2:
+	      return OPCODE_SEXT;
+	    case 3:
+	      return OPCODE_CLAMPS;
+	    case 4:
+	      return OPCODE_MIN;
+	    case 5:
+	      return OPCODE_MAX;
+	    case 6:
+	      return OPCODE_MINU;
+	    case 7:
+	      return OPCODE_MAXU;
+	    case 8:
+	      return OPCODE_MOVEQZ;
+	    case 9:
+	      return OPCODE_MOVNEZ;
+	    case 10:
+	      return OPCODE_MOVLTZ;
+	    case 11:
+	      return OPCODE_MOVGEZ;
+	    case 12:
+	      return OPCODE_MOVF;
+	    case 13:
+	      return OPCODE_MOVT;
+	    case 14:
+	      switch (Field_st_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_RUR_EXPSTATE;
+		case 1:
+		  return OPCODE_RUR_SOV;
+		case 2:
+		  return OPCODE_RUR_SAT_MODE;
+		case 3:
+		  return OPCODE_RUR_SAR0;
+		case 4:
+		  return OPCODE_RUR_SAR1;
+		case 5:
+		  return OPCODE_RUR_SAR2;
+		case 6:
+		  return OPCODE_RUR_SAR3;
+		case 7:
+		  return OPCODE_RUR_HSAR0;
+		case 8:
+		  return OPCODE_RUR_HSAR1;
+		case 9:
+		  return OPCODE_RUR_HSAR2;
+		case 10:
+		  return OPCODE_RUR_HSAR3;
+		case 11:
+		  return OPCODE_RUR_MAX_REG_0;
+		case 12:
+		  return OPCODE_RUR_MAX_REG_1;
+		case 13:
+		  return OPCODE_RUR_MAX_REG_2;
+		case 14:
+		  return OPCODE_RUR_MAX_REG_3;
+		case 15:
+		  return OPCODE_RUR_ARG_MAX_REG_0;
+		case 16:
+		  return OPCODE_RUR_ARG_MAX_REG_1;
+		case 17:
+		  return OPCODE_RUR_ARG_MAX_REG_2;
+		case 18:
+		  return OPCODE_RUR_ARG_MAX_REG_3;
+		case 19:
+		  return OPCODE_RUR_NCO_COUNTER_0;
+		case 20:
+		  return OPCODE_RUR_NCO_COUNTER_1;
+		case 21:
+		  return OPCODE_RUR_NCO_COUNTER_2;
+		case 22:
+		  return OPCODE_RUR_NCO_COUNTER_3;
+		case 23:
+		  return OPCODE_RUR_INTERP_EXT_N;
+		case 24:
+		  return OPCODE_RUR_INTERP_EXT_L;
+		case 25:
+		  return OPCODE_RUR_LLR_BUF_0;
+		case 26:
+		  return OPCODE_RUR_LLR_BUF_1;
+		case 27:
+		  return OPCODE_RUR_LLR_BUF_2;
+		case 28:
+		  return OPCODE_RUR_LLR_BUF_3;
+		case 29:
+		  return OPCODE_RUR_LLR_BUF_4;
+		case 30:
+		  return OPCODE_RUR_LLR_BUF_5;
+		case 31:
+		  return OPCODE_RUR_LLR_BUF_6;
+		case 32:
+		  return OPCODE_RUR_LLR_BUF_7;
+		case 33:
+		  return OPCODE_RUR_LLR_BUF_8;
+		case 34:
+		  return OPCODE_RUR_LLR_BUF_9;
+		case 35:
+		  return OPCODE_RUR_LLR_BUF_10;
+		case 36:
+		  return OPCODE_RUR_LLR_BUF_11;
+		case 37:
+		  return OPCODE_RUR_LLR_BUF_12;
+		case 38:
+		  return OPCODE_RUR_LLR_BUF_13;
+		case 39:
+		  return OPCODE_RUR_LLR_BUF_14;
+		case 40:
+		  return OPCODE_RUR_LLR_BUF_15;
+		case 41:
+		  return OPCODE_RUR_LLR_BUF_16;
+		case 42:
+		  return OPCODE_RUR_LLR_BUF_17;
+		case 43:
+		  return OPCODE_RUR_LLR_BUF_18;
+		case 44:
+		  return OPCODE_RUR_LLR_BUF_19;
+		case 45:
+		  return OPCODE_RUR_LLR_BUF_20;
+		case 46:
+		  return OPCODE_RUR_LLR_BUF_21;
+		case 47:
+		  return OPCODE_RUR_LLR_BUF_22;
+		case 48:
+		  return OPCODE_RUR_LLR_BUF_23;
+		case 49:
+		  return OPCODE_RUR_SMOD_BUF_0;
+		case 50:
+		  return OPCODE_RUR_SMOD_BUF_1;
+		case 51:
+		  return OPCODE_RUR_SMOD_BUF_2;
+		case 52:
+		  return OPCODE_RUR_SMOD_BUF_3;
+		case 53:
+		  return OPCODE_RUR_SMOD_BUF_4;
+		case 54:
+		  return OPCODE_RUR_SMOD_BUF_5;
+		case 55:
+		  return OPCODE_RUR_SMOD_BUF_6;
+		case 56:
+		  return OPCODE_RUR_SMOD_BUF_7;
+		case 57:
+		  return OPCODE_RUR_WEIGHT_REG;
+		case 58:
+		  return OPCODE_RUR_SCALE_REG;
+		case 59:
+		  return OPCODE_RUR_LLR_POS;
+		case 60:
+		  return OPCODE_RUR_SMOD_POS;
+		case 61:
+		  return OPCODE_RUR_PERM_REG;
+		case 62:
+		  return OPCODE_RUR_SMOD_OFFSET_TABLE_0;
+		case 63:
+		  return OPCODE_RUR_SMOD_OFFSET_TABLE_1;
+		case 64:
+		  return OPCODE_RUR_SMOD_OFFSET_TABLE_2;
+		case 65:
+		  return OPCODE_RUR_SMOD_OFFSET_TABLE_3;
+		case 66:
+		  return OPCODE_RUR_PHASOR_N;
+		case 67:
+		  return OPCODE_RUR_PHASOR_OFFSET;
+		case 231:
+		  return OPCODE_RUR_THREADPTR;
+		case 232:
+		  return OPCODE_RUR_FCR;
+		case 233:
+		  return OPCODE_RUR_FSR;
+		}
+	      break;
+	    case 15:
+	      switch (Field_sr_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_WUR_EXPSTATE;
+		case 1:
+		  return OPCODE_WUR_SOV;
+		case 2:
+		  return OPCODE_WUR_SAT_MODE;
+		case 3:
+		  return OPCODE_WUR_SAR0;
+		case 4:
+		  return OPCODE_WUR_SAR1;
+		case 5:
+		  return OPCODE_WUR_SAR2;
+		case 6:
+		  return OPCODE_WUR_SAR3;
+		case 7:
+		  return OPCODE_WUR_HSAR0;
+		case 8:
+		  return OPCODE_WUR_HSAR1;
+		case 9:
+		  return OPCODE_WUR_HSAR2;
+		case 10:
+		  return OPCODE_WUR_HSAR3;
+		case 11:
+		  return OPCODE_WUR_MAX_REG_0;
+		case 12:
+		  return OPCODE_WUR_MAX_REG_1;
+		case 13:
+		  return OPCODE_WUR_MAX_REG_2;
+		case 14:
+		  return OPCODE_WUR_MAX_REG_3;
+		case 15:
+		  return OPCODE_WUR_ARG_MAX_REG_0;
+		case 16:
+		  return OPCODE_WUR_ARG_MAX_REG_1;
+		case 17:
+		  return OPCODE_WUR_ARG_MAX_REG_2;
+		case 18:
+		  return OPCODE_WUR_ARG_MAX_REG_3;
+		case 19:
+		  return OPCODE_WUR_NCO_COUNTER_0;
+		case 20:
+		  return OPCODE_WUR_NCO_COUNTER_1;
+		case 21:
+		  return OPCODE_WUR_NCO_COUNTER_2;
+		case 22:
+		  return OPCODE_WUR_NCO_COUNTER_3;
+		case 23:
+		  return OPCODE_WUR_INTERP_EXT_N;
+		case 24:
+		  return OPCODE_WUR_INTERP_EXT_L;
+		case 25:
+		  return OPCODE_WUR_LLR_BUF_0;
+		case 26:
+		  return OPCODE_WUR_LLR_BUF_1;
+		case 27:
+		  return OPCODE_WUR_LLR_BUF_2;
+		case 28:
+		  return OPCODE_WUR_LLR_BUF_3;
+		case 29:
+		  return OPCODE_WUR_LLR_BUF_4;
+		case 30:
+		  return OPCODE_WUR_LLR_BUF_5;
+		case 31:
+		  return OPCODE_WUR_LLR_BUF_6;
+		case 32:
+		  return OPCODE_WUR_LLR_BUF_7;
+		case 33:
+		  return OPCODE_WUR_LLR_BUF_8;
+		case 34:
+		  return OPCODE_WUR_LLR_BUF_9;
+		case 35:
+		  return OPCODE_WUR_LLR_BUF_10;
+		case 36:
+		  return OPCODE_WUR_LLR_BUF_11;
+		case 37:
+		  return OPCODE_WUR_LLR_BUF_12;
+		case 38:
+		  return OPCODE_WUR_LLR_BUF_13;
+		case 39:
+		  return OPCODE_WUR_LLR_BUF_14;
+		case 40:
+		  return OPCODE_WUR_LLR_BUF_15;
+		case 41:
+		  return OPCODE_WUR_LLR_BUF_16;
+		case 42:
+		  return OPCODE_WUR_LLR_BUF_17;
+		case 43:
+		  return OPCODE_WUR_LLR_BUF_18;
+		case 44:
+		  return OPCODE_WUR_LLR_BUF_19;
+		case 45:
+		  return OPCODE_WUR_LLR_BUF_20;
+		case 46:
+		  return OPCODE_WUR_LLR_BUF_21;
+		case 47:
+		  return OPCODE_WUR_LLR_BUF_22;
+		case 48:
+		  return OPCODE_WUR_LLR_BUF_23;
+		case 49:
+		  return OPCODE_WUR_SMOD_BUF_0;
+		case 50:
+		  return OPCODE_WUR_SMOD_BUF_1;
+		case 51:
+		  return OPCODE_WUR_SMOD_BUF_2;
+		case 52:
+		  return OPCODE_WUR_SMOD_BUF_3;
+		case 53:
+		  return OPCODE_WUR_SMOD_BUF_4;
+		case 54:
+		  return OPCODE_WUR_SMOD_BUF_5;
+		case 55:
+		  return OPCODE_WUR_SMOD_BUF_6;
+		case 56:
+		  return OPCODE_WUR_SMOD_BUF_7;
+		case 57:
+		  return OPCODE_WUR_WEIGHT_REG;
+		case 58:
+		  return OPCODE_WUR_SCALE_REG;
+		case 59:
+		  return OPCODE_WUR_LLR_POS;
+		case 60:
+		  return OPCODE_WUR_SMOD_POS;
+		case 61:
+		  return OPCODE_WUR_PERM_REG;
+		case 62:
+		  return OPCODE_WUR_SMOD_OFFSET_TABLE_0;
+		case 63:
+		  return OPCODE_WUR_SMOD_OFFSET_TABLE_1;
+		case 64:
+		  return OPCODE_WUR_SMOD_OFFSET_TABLE_2;
+		case 65:
+		  return OPCODE_WUR_SMOD_OFFSET_TABLE_3;
+		case 66:
+		  return OPCODE_WUR_PHASOR_N;
+		case 67:
+		  return OPCODE_WUR_PHASOR_OFFSET;
+		case 231:
+		  return OPCODE_WUR_THREADPTR;
+		case 232:
+		  return OPCODE_WUR_FCR;
+		case 233:
+		  return OPCODE_WUR_FSR;
+		}
+	      break;
+	    }
+	  break;
+	case 4:
+	case 5:
+	  return OPCODE_EXTUI;
+	case 8:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_LSX;
+	    case 1:
+	      return OPCODE_LSXU;
+	    case 4:
+	      return OPCODE_SSX;
+	    case 5:
+	      return OPCODE_SSXU;
+	    }
+	  break;
+	case 9:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_L32E;
+	    case 4:
+	      return OPCODE_S32E;
+	    }
+	  break;
+	case 10:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_ADD_S;
+	    case 1:
+	      return OPCODE_SUB_S;
+	    case 2:
+	      return OPCODE_MUL_S;
+	    case 4:
+	      return OPCODE_MADD_S;
+	    case 5:
+	      return OPCODE_MSUB_S;
+	    case 8:
+	      return OPCODE_ROUND_S;
+	    case 9:
+	      return OPCODE_TRUNC_S;
+	    case 10:
+	      return OPCODE_FLOOR_S;
+	    case 11:
+	      return OPCODE_CEIL_S;
+	    case 12:
+	      return OPCODE_FLOAT_S;
+	    case 13:
+	      return OPCODE_UFLOAT_S;
+	    case 14:
+	      return OPCODE_UTRUNC_S;
+	    case 15:
+	      switch (Field_t_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_MOV_S;
+		case 1:
+		  return OPCODE_ABS_S;
+		case 4:
+		  return OPCODE_RFR;
+		case 5:
+		  return OPCODE_WFR;
+		case 6:
+		  return OPCODE_NEG_S;
+		}
+	      break;
+	    }
+	  break;
+	case 11:
+	  switch (Field_op2_Slot_inst_get (insn))
+	    {
+	    case 1:
+	      return OPCODE_UN_S;
+	    case 2:
+	      return OPCODE_OEQ_S;
+	    case 3:
+	      return OPCODE_UEQ_S;
+	    case 4:
+	      return OPCODE_OLT_S;
+	    case 5:
+	      return OPCODE_ULT_S;
+	    case 6:
+	      return OPCODE_OLE_S;
+	    case 7:
+	      return OPCODE_ULE_S;
+	    case 8:
+	      return OPCODE_MOVEQZ_S;
+	    case 9:
+	      return OPCODE_MOVNEZ_S;
+	    case 10:
+	      return OPCODE_MOVLTZ_S;
+	    case 11:
+	      return OPCODE_MOVGEZ_S;
+	    case 12:
+	      return OPCODE_MOVF_S;
+	    case 13:
+	      return OPCODE_MOVT_S;
+	    }
+	  break;
+	}
+      break;
+    case 1:
+      return OPCODE_L32R;
+    case 2:
+      switch (Field_r_Slot_inst_get (insn))
+	{
+	case 0:
+	  return OPCODE_L8UI;
+	case 1:
+	  return OPCODE_L16UI;
+	case 2:
+	  return OPCODE_L32I;
+	case 4:
+	  return OPCODE_S8I;
+	case 5:
+	  return OPCODE_S16I;
+	case 6:
+	  return OPCODE_S32I;
+	case 7:
+	  switch (Field_t_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_DPFR;
+	    case 1:
+	      return OPCODE_DPFW;
+	    case 2:
+	      return OPCODE_DPFRO;
+	    case 3:
+	      return OPCODE_DPFWO;
+	    case 4:
+	      return OPCODE_DHWB;
+	    case 5:
+	      return OPCODE_DHWBI;
+	    case 6:
+	      return OPCODE_DHI;
+	    case 7:
+	      return OPCODE_DII;
+	    case 8:
+	      switch (Field_op1_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_DPFL;
+		case 2:
+		  return OPCODE_DHU;
+		case 3:
+		  return OPCODE_DIU;
+		case 4:
+		  return OPCODE_DIWB;
+		case 5:
+		  return OPCODE_DIWBI;
+		}
+	      break;
+	    case 12:
+	      return OPCODE_IPF;
+	    case 13:
+	      switch (Field_op1_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_IPFL;
+		case 2:
+		  return OPCODE_IHU;
+		case 3:
+		  return OPCODE_IIU;
+		}
+	      break;
+	    case 14:
+	      return OPCODE_IHI;
+	    case 15:
+	      return OPCODE_III;
+	    }
+	  break;
+	case 9:
+	  return OPCODE_L16SI;
+	case 10:
+	  return OPCODE_MOVI;
+	case 11:
+	  return OPCODE_L32AI;
+	case 12:
+	  return OPCODE_ADDI;
+	case 13:
+	  return OPCODE_ADDMI;
+	case 14:
+	  return OPCODE_S32C1I;
+	case 15:
+	  return OPCODE_S32RI;
+	}
+      break;
+    case 3:
+      switch (Field_r_Slot_inst_get (insn))
+	{
+	case 0:
+	  return OPCODE_LSI;
+	case 4:
+	  return OPCODE_SSI;
+	case 8:
+	  return OPCODE_LSIU;
+	case 12:
+	  return OPCODE_SSIU;
+	}
+      break;
+    case 5:
+      switch (Field_n_Slot_inst_get (insn))
+	{
+	case 0:
+	  return OPCODE_CALL0;
+	case 1:
+	  return OPCODE_CALL4;
+	case 2:
+	  return OPCODE_CALL8;
+	case 3:
+	  return OPCODE_CALL12;
+	}
+      break;
+    case 6:
+      switch (Field_n_Slot_inst_get (insn))
+	{
+	case 0:
+	  return OPCODE_J;
+	case 1:
+	  switch (Field_m_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_BEQZ;
+	    case 1:
+	      return OPCODE_BNEZ;
+	    case 2:
+	      return OPCODE_BLTZ;
+	    case 3:
+	      return OPCODE_BGEZ;
+	    }
+	  break;
+	case 2:
+	  switch (Field_m_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_BEQI;
+	    case 1:
+	      return OPCODE_BNEI;
+	    case 2:
+	      return OPCODE_BLTI;
+	    case 3:
+	      return OPCODE_BGEI;
+	    }
+	  break;
+	case 3:
+	  switch (Field_m_Slot_inst_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_ENTRY;
+	    case 1:
+	      switch (Field_r_Slot_inst_get (insn))
+		{
+		case 0:
+		  return OPCODE_BF;
+		case 1:
+		  return OPCODE_BT;
+		case 8:
+		  return OPCODE_LOOP;
+		case 9:
+		  return OPCODE_LOOPNEZ;
+		case 10:
+		  return OPCODE_LOOPGTZ;
+		}
+	      break;
+	    case 2:
+	      return OPCODE_BLTUI;
+	    case 3:
+	      return OPCODE_BGEUI;
+	    }
+	  break;
+	}
+      break;
+    case 7:
+      switch (Field_r_Slot_inst_get (insn))
+	{
+	case 0:
+	  return OPCODE_BNONE;
+	case 1:
+	  return OPCODE_BEQ;
+	case 2:
+	  return OPCODE_BLT;
+	case 3:
+	  return OPCODE_BLTU;
+	case 4:
+	  return OPCODE_BALL;
+	case 5:
+	  return OPCODE_BBC;
+	case 6:
+	case 7:
+	  return OPCODE_BBCI;
+	case 8:
+	  return OPCODE_BANY;
+	case 9:
+	  return OPCODE_BNE;
+	case 10:
+	  return OPCODE_BGE;
+	case 11:
+	  return OPCODE_BGEU;
+	case 12:
+	  return OPCODE_BNALL;
+	case 13:
+	  return OPCODE_BBS;
+	case 14:
+	case 15:
+	  return OPCODE_BBSI;
+	}
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_inst16b_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_op0_Slot_inst16b_get (insn))
+    {
+    case 12:
+      switch (Field_i_Slot_inst16b_get (insn))
+	{
+	case 0:
+	  return OPCODE_MOVI_N;
+	case 1:
+	  switch (Field_z_Slot_inst16b_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_BEQZ_N;
+	    case 1:
+	      return OPCODE_BNEZ_N;
+	    }
+	  break;
+	}
+      break;
+    case 13:
+      switch (Field_r_Slot_inst16b_get (insn))
+	{
+	case 0:
+	  return OPCODE_MOV_N;
+	case 15:
+	  switch (Field_t_Slot_inst16b_get (insn))
+	    {
+	    case 0:
+	      return OPCODE_RET_N;
+	    case 1:
+	      return OPCODE_RETW_N;
+	    case 2:
+	      return OPCODE_BREAK_N;
+	    case 3:
+	      if (Field_s_Slot_inst16b_get (insn) == 0)
+		return OPCODE_NOP_N;
+	      break;
+	    case 6:
+	      if (Field_s_Slot_inst16b_get (insn) == 0)
+		return OPCODE_ILL_N;
+	      break;
+	    }
+	  break;
+	}
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_inst16a_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_op0_Slot_inst16a_get (insn))
+    {
+    case 8:
+      return OPCODE_L32I_N;
+    case 9:
+      return OPCODE_S32I_N;
+    case 10:
+      return OPCODE_ADD_N;
+    case 11:
+      return OPCODE_ADDI_N;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_gp_slot2_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2258gp_slot2_Slot_gp_slot2_get (insn))
+    {
+    case 22:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVI_N;
+      break;
+    case 24:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_AR2PQ_LN;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2259gp_slot2_Slot_gp_slot2_get (insn) == 46 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_AR2CM_LN;
+  switch (Field_dsp340050b49a6c_fld2260gp_slot2_Slot_gp_slot2_get (insn))
+    {
+    case 185:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_ADDAR2;
+      break;
+    case 187:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOV_N;
+      break;
+    case 189:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVPQ2PQ;
+      break;
+    case 191:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_PUSH128_PQ;
+      break;
+    case 200:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_PUSH32;
+      break;
+    case 201:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_SET_EXT_REGS;
+      break;
+    case 202:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_SUBARX;
+      break;
+    case 204:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_WRTIEP;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2261gp_slot2_Slot_gp_slot2_get (insn))
+    {
+    case 1624:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_CLRTIEP;
+      break;
+    case 1625:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_SETTIEP;
+      break;
+    case 1626:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_WRTBSIGQM;
+      break;
+    case 1631:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2044_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_1;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2262gp_slot2_Slot_gp_slot2_get (insn))
+    {
+    case 3254:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_01;
+      break;
+    case 3255:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_03;
+      break;
+    case 3256:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_AR2SAR_DUP;
+      break;
+    case 3257:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_21;
+      break;
+    case 3258:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_23;
+      break;
+    case 3259:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_WRTSIGQ;
+      break;
+    case 3260:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_WRTBSIGQ;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2263gp_slot2_Slot_gp_slot2_get (insn))
+    {
+    case 52176:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_0;
+      break;
+    case 52177:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_2;
+      break;
+    case 52178:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_3;
+      break;
+    case 52179:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_0;
+      break;
+    case 52180:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_4;
+      break;
+    case 52181:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_1;
+      break;
+    case 52182:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_2;
+      break;
+    case 52183:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_3;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2264gp_slot2_Slot_gp_slot2_get (insn) == 13046 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2302_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_5;
+  if (Field_dsp340050b49a6c_fld2266gp_slot2_Slot_gp_slot2_get (insn) == 13047 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2302_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2267gp_slot2_Slot_gp_slot2_get (insn) == 1640 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_0;
+  if (Field_dsp340050b49a6c_fld2268gp_slot2_Slot_gp_slot2_get (insn) == 1641 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_1;
+  if (Field_dsp340050b49a6c_fld2269gp_slot2_Slot_gp_slot2_get (insn) == 1642 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_2;
+  if (Field_dsp340050b49a6c_fld2270gp_slot2_Slot_gp_slot2_get (insn) == 1643 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_4;
+  if (Field_dsp340050b49a6c_fld2271gp_slot2_Slot_gp_slot2_get (insn) == 822 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2305_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_3;
+  if (Field_dsp340050b49a6c_fld2273gp_slot2_Slot_gp_slot2_get (insn) == 823 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2305_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_5;
+  if (Field_dsp340050b49a6c_fld2274gp_slot2_Slot_gp_slot2_get (insn) == 103 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2056_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_PUSH2X128_PQ;
+  if (Field_dsp340050b49a6c_fld2275gp_slot2_Slot_gp_slot2_get (insn) == 52 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld2277gp_slot2_Slot_gp_slot2_get (insn) == 106 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_1;
+  if (Field_dsp340050b49a6c_fld2278gp_slot2_Slot_gp_slot2_get (insn) == 107 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_3;
+  if (Field_dsp340050b49a6c_fld2279gp_slot2_Slot_gp_slot2_get (insn) == 108 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_2;
+  if (Field_dsp340050b49a6c_fld2280gp_slot2_Slot_gp_slot2_get (insn) == 109 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_PQ2CM;
+  if (Field_dsp340050b49a6c_fld2281gp_slot2_Slot_gp_slot2_get (insn) == 220 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ABS;
+  if (Field_dsp340050b49a6c_fld2282gp_slot2_Slot_gp_slot2_get (insn) == 221 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld2283gp_slot2_Slot_gp_slot2_get (insn) == 222 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld2284gp_slot2_Slot_gp_slot2_get (insn) == 3343 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2286gp_slot2_Slot_gp_slot2_get (insn) == 3359 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_GET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2287gp_slot2_Slot_gp_slot2_get (insn) == 3375 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld2288gp_slot2_Slot_gp_slot2_get (insn) == 3391 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_GET_NCO;
+  if (Field_dsp340050b49a6c_fld2289gp_slot2_Slot_gp_slot2_get (insn) == 3407 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld2290gp_slot2_Slot_gp_slot2_get (insn) == 3423 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld2291gp_slot2_Slot_gp_slot2_get (insn) == 3439 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2292gp_slot2_Slot_gp_slot2_get (insn) == 3455 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2293gp_slot2_Slot_gp_slot2_get (insn) == 3471 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_GET_MAX;
+  if (Field_dsp340050b49a6c_fld2294gp_slot2_Slot_gp_slot2_get (insn) == 3487 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2295gp_slot2_Slot_gp_slot2_get (insn) == 3503 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2296gp_slot2_Slot_gp_slot2_get (insn) == 3519 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2297gp_slot2_Slot_gp_slot2_get (insn) == 3535 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld2298gp_slot2_Slot_gp_slot2_get (insn) == 3551 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2299gp_slot2_Slot_gp_slot2_get (insn) == 3567 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2300gp_slot2_Slot_gp_slot2_get (insn) == 3583 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2301gp_slot2_Slot_gp_slot2_get (insn) == 56 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2272_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_0;
+  if (Field_dsp340050b49a6c_fld2303gp_slot2_Slot_gp_slot2_get (insn) == 57 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3671gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2304gp_slot2_Slot_gp_slot2_get (insn) == 29 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3674gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_RDTIEP;
+  if (Field_dsp340050b49a6c_fld2306gp_slot2_Slot_gp_slot2_get (insn) == 120 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_QREADY;
+  if (Field_dsp340050b49a6c_fld2308gp_slot2_Slot_gp_slot2_get (insn) == 242 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_AR2CM_DUP;
+  if (Field_dsp340050b49a6c_fld2309gp_slot2_Slot_gp_slot2_get (insn) == 243 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SWAPB;
+  if (Field_dsp340050b49a6c_fld2310gp_slot2_Slot_gp_slot2_get (insn) == 61 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3667gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_MOVAR2;
+  if (Field_dsp340050b49a6c_fld2312gp_slot2_Slot_gp_slot2_get (insn) == 31 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2386_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SLL;
+  if (Field_dsp340050b49a6c_fld2314gp_slot2_Slot_gp_slot2_get (insn) == 16 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ADD32;
+  if (Field_dsp340050b49a6c_fld2316gp_slot2_Slot_gp_slot2_get (insn) == 17 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ADDCM;
+  if (Field_dsp340050b49a6c_fld2317gp_slot2_Slot_gp_slot2_get (insn) == 18 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ADDWRP;
+  if (Field_dsp340050b49a6c_fld2318gp_slot2_Slot_gp_slot2_get (insn) == 19 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ASR;
+  if (Field_dsp340050b49a6c_fld2319gp_slot2_Slot_gp_slot2_get (insn) == 20 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_AND128;
+  if (Field_dsp340050b49a6c_fld2320gp_slot2_Slot_gp_slot2_get (insn) == 21 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_EXTUI4;
+  if (Field_dsp340050b49a6c_fld2321gp_slot2_Slot_gp_slot2_get (insn) == 22 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_LUT;
+  if (Field_dsp340050b49a6c_fld2322gp_slot2_Slot_gp_slot2_get (insn) == 23 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_LUT_IEXT;
+  if (Field_dsp340050b49a6c_fld2323gp_slot2_Slot_gp_slot2_get (insn) == 24 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ASL;
+  if (Field_dsp340050b49a6c_fld2324gp_slot2_Slot_gp_slot2_get (insn) == 25 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_LUT_REXT;
+  if (Field_dsp340050b49a6c_fld2325gp_slot2_Slot_gp_slot2_get (insn) == 26 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_MAX8;
+  if (Field_dsp340050b49a6c_fld2326gp_slot2_Slot_gp_slot2_get (insn) == 27 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_MEAN32;
+  if (Field_dsp340050b49a6c_fld2327gp_slot2_Slot_gp_slot2_get (insn) == 28 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_MEAN;
+  if (Field_dsp340050b49a6c_fld2328gp_slot2_Slot_gp_slot2_get (insn) == 29 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_MIN8;
+  if (Field_dsp340050b49a6c_fld2329gp_slot2_Slot_gp_slot2_get (insn) == 30 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_OR128;
+  if (Field_dsp340050b49a6c_fld2330gp_slot2_Slot_gp_slot2_get (insn) == 31 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SUB32;
+  if (Field_dsp340050b49a6c_fld2331gp_slot2_Slot_gp_slot2_get (insn) == 0 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_ASL32;
+  if (Field_dsp340050b49a6c_fld2332gp_slot2_Slot_gp_slot2_get (insn) == 1 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_ASR32;
+  if (Field_dsp340050b49a6c_fld2333gp_slot2_Slot_gp_slot2_get (insn) == 2 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOV2CM2PQ;
+  if (Field_dsp340050b49a6c_fld2334gp_slot2_Slot_gp_slot2_get (insn) == 3 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_2;
+  if (Field_dsp340050b49a6c_fld2335gp_slot2_Slot_gp_slot2_get (insn) == 4 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_0;
+  if (Field_dsp340050b49a6c_fld2336gp_slot2_Slot_gp_slot2_get (insn) == 5 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_3;
+  if (Field_dsp340050b49a6c_fld2337gp_slot2_Slot_gp_slot2_get (insn) == 6 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_4;
+  if (Field_dsp340050b49a6c_fld2338gp_slot2_Slot_gp_slot2_get (insn) == 7 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_5;
+  if (Field_dsp340050b49a6c_fld2339gp_slot2_Slot_gp_slot2_get (insn) == 8 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_1;
+  if (Field_dsp340050b49a6c_fld2340gp_slot2_Slot_gp_slot2_get (insn) == 9 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_6;
+  if (Field_dsp340050b49a6c_fld2341gp_slot2_Slot_gp_slot2_get (insn) == 10 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_7;
+  if (Field_dsp340050b49a6c_fld2342gp_slot2_Slot_gp_slot2_get (insn) == 11 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_1;
+  if (Field_dsp340050b49a6c_fld2343gp_slot2_Slot_gp_slot2_get (insn) == 12 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_0;
+  if (Field_dsp340050b49a6c_fld2344gp_slot2_Slot_gp_slot2_get (insn) == 13 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_2;
+  if (Field_dsp340050b49a6c_fld2345gp_slot2_Slot_gp_slot2_get (insn) == 14 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_3;
+  if (Field_dsp340050b49a6c_fld2346gp_slot2_Slot_gp_slot2_get (insn) == 15 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_4;
+  if (Field_dsp340050b49a6c_fld2347gp_slot2_Slot_gp_slot2_get (insn) == 16 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_ASLM;
+  if (Field_dsp340050b49a6c_fld2348gp_slot2_Slot_gp_slot2_get (insn) == 17 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_ASRM;
+  if (Field_dsp340050b49a6c_fld2349gp_slot2_Slot_gp_slot2_get (insn) == 18 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_CMP8;
+  if (Field_dsp340050b49a6c_fld2350gp_slot2_Slot_gp_slot2_get (insn) == 19 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_LSLM;
+  if (Field_dsp340050b49a6c_fld2351gp_slot2_Slot_gp_slot2_get (insn) == 20 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_CMP_I;
+  if (Field_dsp340050b49a6c_fld2352gp_slot2_Slot_gp_slot2_get (insn) == 21 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_LSRM;
+  if (Field_dsp340050b49a6c_fld2353gp_slot2_Slot_gp_slot2_get (insn) == 262 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_ABS8;
+  if (Field_dsp340050b49a6c_fld2354gp_slot2_Slot_gp_slot2_get (insn) == 263 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld2355gp_slot2_Slot_gp_slot2_get (insn) == 278 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_LUT_PHASOR;
+  if (Field_dsp340050b49a6c_fld2356gp_slot2_Slot_gp_slot2_get (insn) == 279 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_NOT128;
+  if (Field_dsp340050b49a6c_fld2357gp_slot2_Slot_gp_slot2_get (insn) == 294 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2358gp_slot2_Slot_gp_slot2_get (insn) == 295 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1)
+    return OPCODE_TRANS;
+  if (Field_dsp340050b49a6c_fld2359gp_slot2_Slot_gp_slot2_get (insn) == 2102 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2384_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2361gp_slot2_Slot_gp_slot2_get (insn) == 2103 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2384_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SET_HSAR;
+  if (Field_dsp340050b49a6c_fld2362gp_slot2_Slot_gp_slot2_get (insn) == 1179 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3663gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SET_MAX;
+  if (Field_dsp340050b49a6c_fld2364gp_slot2_Slot_gp_slot2_get (insn) == 667 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3664gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SET_NCO;
+  if (Field_dsp340050b49a6c_fld2366gp_slot2_Slot_gp_slot2_get (insn) == 411 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3665gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld2368gp_slot2_Slot_gp_slot2_get (insn) == 43 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3670gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_NCO_UPDATE;
+  if (Field_dsp340050b49a6c_fld2369gp_slot2_Slot_gp_slot2_get (insn) == 27 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3668gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld2370gp_slot2_Slot_gp_slot2_get (insn) == 6 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2032_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_CMP_R;
+  if (Field_dsp340050b49a6c_fld2371gp_slot2_Slot_gp_slot2_get (insn) == 11 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3675gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ADD16;
+  if (Field_dsp340050b49a6c_fld2372gp_slot2_Slot_gp_slot2_get (insn) == 15 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3669gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_LUT_WRITE;
+  if (Field_dsp340050b49a6c_fld2373gp_slot2_Slot_gp_slot2_get (insn) == 0 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2)
+    return OPCODE_MOVCND_5;
+  if (Field_dsp340050b49a6c_fld2374gp_slot2_Slot_gp_slot2_get (insn) == 1 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2)
+    return OPCODE_MOVCND_6;
+  if (Field_dsp340050b49a6c_fld2375gp_slot2_Slot_gp_slot2_get (insn) == 2 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2)
+    return OPCODE_MOVCND_7;
+  if (Field_dsp340050b49a6c_fld2376gp_slot2_Slot_gp_slot2_get (insn) == 12 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2313_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_MOVCM2PQ;
+  if (Field_dsp340050b49a6c_fld2378gp_slot2_Slot_gp_slot2_get (insn) == 13 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3676gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ARGMAX8;
+  if (Field_dsp340050b49a6c_fld2379gp_slot2_Slot_gp_slot2_get (insn) == 7 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3673gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld2381gp_slot2_Slot_gp_slot2_get (insn) == 1 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3666_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_PERM;
+  if (Field_dsp340050b49a6c_fld2383gp_slot2_Slot_gp_slot2_get (insn) == 1 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3678gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_ASLM32;
+  if (Field_dsp340050b49a6c_fld2385gp_slot2_Slot_gp_slot2_get (insn) == 8 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2313_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SUBCM;
+  if (Field_dsp340050b49a6c_fld2387gp_slot2_Slot_gp_slot2_get (insn) == 9 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2313_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SUBMEAN;
+  if (Field_dsp340050b49a6c_fld2388gp_slot2_Slot_gp_slot2_get (insn) == 5 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3679gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_SUBWRP;
+  if (Field_dsp340050b49a6c_fld2389gp_slot2_Slot_gp_slot2_get (insn) == 3 &&
+      Field_op0_s3_Slot_gp_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3680gp_slot2_Slot_gp_slot2_get (insn) == 0)
+    return OPCODE_XOR128;
+  if (Field_op0_s3_Slot_gp_slot2_get (insn) == 3)
+    return OPCODE_EXTUI;
+  switch (Field_sae_Slot_gp_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_ADD;
+      break;
+    case 1:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_ADDI_N;
+      break;
+    case 2:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_AND;
+      break;
+    case 3:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVGEZ;
+      break;
+    case 4:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_LUT_AR;
+      break;
+    case 5:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVLTZ;
+      break;
+    case 6:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVNEZ;
+      break;
+    case 7:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_OR;
+      break;
+    case 8:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_MOVEQZ;
+      break;
+    case 9:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_SUB;
+      break;
+    case 10:
+      if (Field_op0_s3_Slot_gp_slot2_get (insn) == 0)
+	return OPCODE_XOR;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_gp_slot0_decode (const xtensa_insnbuf insn)
+{
+  if (Field_dsp340050b49a6c_fld2407gp_slot0_Slot_gp_slot0_get (insn) == 0 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC2X32;
+  if (Field_dsp340050b49a6c_fld2409gp_slot0_Slot_gp_slot0_get (insn) == 1 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC32_R;
+  if (Field_dsp340050b49a6c_fld2410gp_slot0_Slot_gp_slot0_get (insn) == 2 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC_IH;
+  if (Field_dsp340050b49a6c_fld2411gp_slot0_Slot_gp_slot0_get (insn) == 3 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC_RH;
+  if (Field_dsp340050b49a6c_fld2412gp_slot0_Slot_gp_slot0_get (insn) == 10 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC_RL;
+  if (Field_dsp340050b49a6c_fld2413gp_slot0_Slot_gp_slot0_get (insn) == 11 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_0;
+  if (Field_dsp340050b49a6c_fld2415gp_slot0_Slot_gp_slot0_get (insn) == 27 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_1;
+  if (Field_dsp340050b49a6c_fld2416gp_slot0_Slot_gp_slot0_get (insn) == 4 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC_IL;
+  if (Field_dsp340050b49a6c_fld2417gp_slot0_Slot_gp_slot0_get (insn) == 5 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_2;
+  switch (Field_dsp340050b49a6c_fld2418gp_slot0_Slot_gp_slot0_get (insn))
+    {
+    case 21:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_AR2CM_DUP;
+      break;
+    case 53:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_MOV_N;
+      break;
+    case 85:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_NSA;
+      break;
+    case 117:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_PUSH32;
+      break;
+    case 149:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_NSAU;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2419gp_slot0_Slot_gp_slot0_get (insn) == 362 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld2420gp_slot0_Slot_gp_slot0_get (insn) == 1452 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_ANY8;
+  if (Field_dsp340050b49a6c_fld2422gp_slot0_Slot_gp_slot0_get (insn) == 1453 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld2423gp_slot0_Slot_gp_slot0_get (insn) == 2908 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2424gp_slot0_Slot_gp_slot0_get (insn) == 2909 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld2425gp_slot0_Slot_gp_slot0_get (insn) == 2910 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld2426gp_slot0_Slot_gp_slot0_get (insn) == 2911 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld2427gp_slot0_Slot_gp_slot0_get (insn) == 852 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_ANY4;
+  if (Field_dsp340050b49a6c_fld2429gp_slot0_Slot_gp_slot0_get (insn) == 3412 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld2430gp_slot0_Slot_gp_slot0_get (insn) == 3413 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2431gp_slot0_Slot_gp_slot0_get (insn) == 3414 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2432gp_slot0_Slot_gp_slot0_get (insn) == 3415 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2433gp_slot0_Slot_gp_slot0_get (insn) == 3416 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2434gp_slot0_Slot_gp_slot0_get (insn) == 3417 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld2435gp_slot0_Slot_gp_slot0_get (insn) == 1709 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_s8_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2436gp_slot0_Slot_gp_slot0_get (insn) == 855 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3690gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2437gp_slot0_Slot_gp_slot0_get (insn) == 1960 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SSAI;
+  switch (Field_dsp340050b49a6c_fld2438gp_slot0_Slot_gp_slot0_get (insn))
+    {
+    case 3922:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_LLR_POS;
+      break;
+    case 3923:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_PHASOR_OFFSET;
+      break;
+    case 3924:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_PERM_REG;
+      break;
+    case 3925:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_SCALE_REG;
+      break;
+    case 3926:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_SMOD_POS;
+      break;
+    case 3927:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_SOV;
+      break;
+    case 3928:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_PHASOR_N;
+      break;
+    case 3929:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SET_WGHT;
+      break;
+    case 3930:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SSA8B;
+      break;
+    case 3931:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SSL;
+      break;
+    case 3932:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SSA8L;
+      break;
+    case 3933:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_SSR;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2439gp_slot0_Slot_gp_slot0_get (insn) == 3934 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3695gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CLRAC;
+  if (Field_dsp340050b49a6c_fld2440gp_slot0_Slot_gp_slot0_get (insn) == 3935 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3695gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP16LLR_1;
+  if (Field_dsp340050b49a6c_fld2441gp_slot0_Slot_gp_slot0_get (insn) == 3 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3693gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_3;
+  switch (Field_dsp340050b49a6c_fld2443gp_slot0_Slot_gp_slot0_get (insn))
+    {
+    case 3:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_AR2CM_LN;
+      break;
+    case 7:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+	return OPCODE_AR2CM_LN_I;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2444gp_slot0_Slot_gp_slot0_get (insn) == 7 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2067_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_AR2CM_LN_R;
+  switch (Field_dsp340050b49a6c_fld2445_Slot_gp_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_SAC2X32;
+      break;
+    case 1:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_SAC32_R;
+      break;
+    case 2:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_SCM_PINC;
+      break;
+    case 3:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_SRAI;
+      break;
+    case 4:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_SCM_U;
+      break;
+    case 8:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_SLLI;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2447gp_slot0_Slot_gp_slot0_get (insn) == 7 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3688gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_BEQZ_N;
+  if (Field_dsp340050b49a6c_fld2448_Slot_gp_slot0_get (insn) == 7 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3703gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_ASLACM;
+  if (Field_dsp340050b49a6c_fld2449gp_slot0_Slot_gp_slot0_get (insn) == 7 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3689gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_BNEZ_N;
+  if (Field_dsp340050b49a6c_fld2451gp_slot0_Slot_gp_slot0_get (insn) == 8 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LCM_PINC;
+  if (Field_dsp340050b49a6c_fld2452gp_slot0_Slot_gp_slot0_get (insn) == 9 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LCM_U;
+  if (Field_dsp340050b49a6c_fld2453gp_slot0_Slot_gp_slot0_get (insn) == 18 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_LCM;
+  if (Field_dsp340050b49a6c_fld2454gp_slot0_Slot_gp_slot0_get (insn) == 259 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_ABS;
+  if (Field_dsp340050b49a6c_fld2455gp_slot0_Slot_gp_slot0_get (insn) == 267 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2456gp_slot0_Slot_gp_slot0_get (insn) == 291 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MOV_I;
+  if (Field_dsp340050b49a6c_fld2457gp_slot0_Slot_gp_slot0_get (insn) == 299 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld2458gp_slot0_Slot_gp_slot0_get (insn) == 323 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MOV_R;
+  if (Field_dsp340050b49a6c_fld2459gp_slot0_Slot_gp_slot0_get (insn) == 331 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld2460gp_slot0_Slot_gp_slot0_get (insn) == 355 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SRL;
+  if (Field_dsp340050b49a6c_fld2461gp_slot0_Slot_gp_slot0_get (insn) == 715 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CLB_C;
+  switch (Field_dsp340050b49a6c_fld2462_Slot_gp_slot0_get (insn))
+    {
+    case 21:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_EXT;
+      break;
+    case 23:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_EXT_R;
+      break;
+    case 33:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_MOVI_N;
+      break;
+    case 35:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_PUSH128_M;
+      break;
+    case 46:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_0;
+      break;
+    case 47:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_1;
+      break;
+    case 50:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_2;
+      break;
+    case 52:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_3;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2463gp_slot0_Slot_gp_slot0_get (insn) == 731 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CLB_R;
+  if (Field_dsp340050b49a6c_fld2464gp_slot0_Slot_gp_slot0_get (insn) == 387 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld2465gp_slot0_Slot_gp_slot0_get (insn) == 779 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MINCLB_C;
+  if (Field_dsp340050b49a6c_fld2466gp_slot0_Slot_gp_slot0_get (insn) == 795 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SMINCLB_R;
+  if (Field_dsp340050b49a6c_fld2467gp_slot0_Slot_gp_slot0_get (insn) == 835 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MINCLB_R;
+  if (Field_dsp340050b49a6c_fld2468gp_slot0_Slot_gp_slot0_get (insn) == 13571 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_ADDAC_I2R;
+  if (Field_dsp340050b49a6c_fld2470gp_slot0_Slot_gp_slot0_get (insn) == 13587 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_ADDAC_R2I;
+  if (Field_dsp340050b49a6c_fld2471gp_slot0_Slot_gp_slot0_get (insn) == 13603 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_REDAC;
+  if (Field_dsp340050b49a6c_fld2472gp_slot0_Slot_gp_slot0_get (insn) == 13619 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_REDACS;
+  if (Field_dsp340050b49a6c_fld2473gp_slot0_Slot_gp_slot0_get (insn) == 13635 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_REDAC2;
+  if (Field_dsp340050b49a6c_fld2474gp_slot0_Slot_gp_slot0_get (insn) == 13651 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SUBAC_I2R;
+  if (Field_dsp340050b49a6c_fld2475gp_slot0_Slot_gp_slot0_get (insn) == 6835 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3695gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SUBAC_R2I;
+  if (Field_dsp340050b49a6c_fld2477gp_slot0_Slot_gp_slot0_get (insn) == 1715 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3705gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_REDAC4;
+  if (Field_dsp340050b49a6c_fld2479gp_slot0_Slot_gp_slot0_get (insn) == 6667 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_L;
+  if (Field_dsp340050b49a6c_fld2480gp_slot0_Slot_gp_slot0_get (insn) == 6683 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_N;
+  if (Field_dsp340050b49a6c_fld2481gp_slot0_Slot_gp_slot0_get (insn) == 6699 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_LLR_POS;
+  if (Field_dsp340050b49a6c_fld2482gp_slot0_Slot_gp_slot0_get (insn) == 6715 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_PHASOR_OFFSET;
+  if (Field_dsp340050b49a6c_fld2483gp_slot0_Slot_gp_slot0_get (insn) == 6731 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_PERM_REG;
+  if (Field_dsp340050b49a6c_fld2484gp_slot0_Slot_gp_slot0_get (insn) == 6747 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld2485gp_slot0_Slot_gp_slot0_get (insn) == 6763 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld2486gp_slot0_Slot_gp_slot0_get (insn) == 6779 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_SOV;
+  if (Field_dsp340050b49a6c_fld2487gp_slot0_Slot_gp_slot0_get (insn) == 6795 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_PHASOR_N;
+  if (Field_dsp340050b49a6c_fld2488gp_slot0_Slot_gp_slot0_get (insn) == 6811 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_GET_WGHT;
+  if (Field_dsp340050b49a6c_fld2489gp_slot0_Slot_gp_slot0_get (insn) == 6827 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2490gp_slot0_Slot_gp_slot0_get (insn) == 6843 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2491gp_slot0_Slot_gp_slot0_get (insn) == 6859 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2492gp_slot0_Slot_gp_slot0_get (insn) == 6875 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2493gp_slot0_Slot_gp_slot0_get (insn) == 6891 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld2494gp_slot0_Slot_gp_slot0_get (insn) == 6907 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld2495gp_slot0_Slot_gp_slot0_get (insn) == 115 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3706gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SMINCLB_C;
+  if (Field_dsp340050b49a6c_fld2496gp_slot0_Slot_gp_slot0_get (insn) == 137 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_s8_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld2497gp_slot0_Slot_gp_slot0_get (insn) == 277 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT32_I;
+  if (Field_dsp340050b49a6c_fld2498gp_slot0_Slot_gp_slot0_get (insn) == 285 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_2;
+  if (Field_dsp340050b49a6c_fld2499gp_slot0_Slot_gp_slot0_get (insn) == 305 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT32_R;
+  if (Field_dsp340050b49a6c_fld2500gp_slot0_Slot_gp_slot0_get (insn) == 309 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_3;
+  if (Field_dsp340050b49a6c_fld2501gp_slot0_Slot_gp_slot0_get (insn) == 313 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_0;
+  if (Field_dsp340050b49a6c_fld2502gp_slot0_Slot_gp_slot0_get (insn) == 317 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_1;
+  if (Field_dsp340050b49a6c_fld2503gp_slot0_Slot_gp_slot0_get (insn) == 337 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_0;
+  if (Field_dsp340050b49a6c_fld2504gp_slot0_Slot_gp_slot0_get (insn) == 341 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_2;
+  if (Field_dsp340050b49a6c_fld2505gp_slot0_Slot_gp_slot0_get (insn) == 173 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2036_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_3;
+  if (Field_dsp340050b49a6c_fld2506gp_slot0_Slot_gp_slot0_get (insn) == 93 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3692gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld2507gp_slot0_Slot_gp_slot0_get (insn) == 29 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3700gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_1;
+  if (Field_dsp340050b49a6c_fld2508gp_slot0_Slot_gp_slot0_get (insn) == 9 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2058_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld2509gp_slot0_Slot_gp_slot0_get (insn) == 11 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2058_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN_I;
+  if (Field_dsp340050b49a6c_fld2510gp_slot0_Slot_gp_slot0_get (insn) == 7 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3696gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN_R;
+  if (Field_dsp340050b49a6c_fld2512gp_slot0_Slot_gp_slot0_get (insn) == 6 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_SAC_IL;
+  if (Field_dsp340050b49a6c_fld2514gp_slot0_Slot_gp_slot0_get (insn) == 7 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_SAC_RH;
+  if (Field_dsp340050b49a6c_fld2515gp_slot0_Slot_gp_slot0_get (insn) == 10 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_SAC_RL;
+  if (Field_dsp340050b49a6c_fld2516gp_slot0_Slot_gp_slot0_get (insn) == 16 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_SAC_IH;
+  if (Field_dsp340050b49a6c_fld2517gp_slot0_Slot_gp_slot0_get (insn) == 204 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_POP128_2M_0;
+  if (Field_dsp340050b49a6c_fld2518gp_slot0_Slot_gp_slot0_get (insn) == 205 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_POP128_2M_1;
+  if (Field_dsp340050b49a6c_fld2519gp_slot0_Slot_gp_slot0_get (insn) == 206 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_POP128_2M_2;
+  if (Field_dsp340050b49a6c_fld2520gp_slot0_Slot_gp_slot0_get (insn) == 207 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_POP128_2M_3;
+  if (Field_dsp340050b49a6c_fld2521gp_slot0_Slot_gp_slot0_get (insn) == 212 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2530_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_ASRAC;
+  if (Field_dsp340050b49a6c_fld2523gp_slot0_Slot_gp_slot0_get (insn) == 213 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3698gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MOVAC;
+  if (Field_dsp340050b49a6c_fld2524gp_slot0_Slot_gp_slot0_get (insn) == 107 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3699gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SWAPAC_RI;
+  if (Field_dsp340050b49a6c_fld2526gp_slot0_Slot_gp_slot0_get (insn) == 432 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+    return OPCODE_SLL;
+  if (Field_dsp340050b49a6c_fld2527gp_slot0_Slot_gp_slot0_get (insn) == 433 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2036_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MOV2AC32_I;
+  if (Field_dsp340050b49a6c_fld2528gp_slot0_Slot_gp_slot0_get (insn) == 217 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3697gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_MOV2AC32_R;
+  if (Field_dsp340050b49a6c_fld2529gp_slot0_Slot_gp_slot0_get (insn) == 109 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3702gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld2531gp_slot0_Slot_gp_slot0_get (insn) == 55 &&
+      Field_op0_s5_Slot_gp_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3691gp_slot0_Slot_gp_slot0_get (insn) == 0)
+    return OPCODE_SET_LLR_BUF;
+  if (Field_op0_s5_Slot_gp_slot0_get (insn) == 3)
+    return OPCODE_EXTUI;
+  switch (Field_sae_Slot_gp_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_MOVNEZ;
+      break;
+    case 1:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_MOVT;
+      break;
+    case 2:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_OR;
+      break;
+    case 3:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SCM;
+      break;
+    case 4:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_ORB;
+      break;
+    case 5:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SCM_PINC_X;
+      break;
+    case 8:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_S32I_N;
+      break;
+    case 9:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SCM_XU;
+      break;
+    case 10:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_ADD;
+      break;
+    case 11:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_ADDX2;
+      break;
+    case 12:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_ADDI_N;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SCM_X;
+      break;
+    case 13:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_ADDX4;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SEXT;
+      break;
+    case 14:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_ADDX8;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SRC;
+      break;
+    case 15:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_AND;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SRLI;
+      break;
+    case 18:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SUB;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_ANDB;
+      break;
+    case 19:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_L32I_N;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SUBX8;
+      break;
+    case 20:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SUBX2;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_CLAMPS;
+      break;
+    case 21:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_XOR;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_LCM_PINC_X;
+      break;
+    case 22:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_XORB;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_LCM_X;
+      break;
+    case 23:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_LCM_XU;
+      break;
+    case 24:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 2)
+	return OPCODE_SUBX4;
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_COMB_AR;
+      break;
+    case 25:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_MAX;
+      break;
+    case 26:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_MAXU;
+      break;
+    case 27:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_MINU;
+      break;
+    case 28:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_MIN;
+      break;
+    case 29:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_MOVEQZ;
+      break;
+    case 30:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_MOVGEZ;
+      break;
+    case 31:
+      if (Field_op0_s5_Slot_gp_slot0_get (insn) == 1)
+	return OPCODE_MOVLTZ;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_dot_slot0_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2068_Slot_dot_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 0)
+	return OPCODE_ADD;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 5)
+	return OPCODE_SUB;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 1)
+	return OPCODE_AND;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 3)
+	return OPCODE_OR;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 2)
+	return OPCODE_LCM_X;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 4)
+	return OPCODE_SCM_X;
+      break;
+    case 1:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 0)
+	return OPCODE_ADDI_N;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 5)
+	return OPCODE_XOR;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 1)
+	return OPCODE_LCM;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 2)
+	return OPCODE_LCM_XU;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 3)
+	return OPCODE_SCM;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 4)
+	return OPCODE_SCM_XU;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2666dot_slot0_Slot_dot_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+	return OPCODE_EXT;
+      break;
+    case 1:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+	return OPCODE_EXT_R;
+      break;
+    case 2:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+	return OPCODE_MOVI_N;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2667dot_slot0_Slot_dot_slot0_get (insn) == 6 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+    return OPCODE_AR2CM_LN;
+  switch (Field_dsp340050b49a6c_fld2668dot_slot0_Slot_dot_slot0_get (insn))
+    {
+    case 16:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_EXT_2FIFO_1;
+      break;
+    case 17:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_EXT_2FIFO_2;
+      break;
+    case 18:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_EXT_2FIFO_3;
+      break;
+    case 19:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_EXT_R2FIFO_2;
+      break;
+    case 20:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_EXT_R2FIFO_0;
+      break;
+    case 21:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_EXT_R2FIFO_3;
+      break;
+    case 22:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_MOV_N;
+      break;
+    case 23:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_PUSH32;
+      break;
+    case 24:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+	return OPCODE_EXT_R2FIFO_1;
+      break;
+    case 27:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+	  Field_dsp340050b49a6c_fld2047_Slot_dot_slot0_get (insn) == 0)
+	return OPCODE_SMINCLB_R;
+      break;
+    case 28:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+	return OPCODE_AR2CM_DUP;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+	  Field_dsp340050b49a6c_fld2047_Slot_dot_slot0_get (insn) == 0)
+	return OPCODE_MINCLB_C;
+      break;
+    case 29:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+	  Field_t_Slot_dot_slot0_get (insn) == 0)
+	return OPCODE_SET_PERM_REG;
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+	return OPCODE_EXT32_I;
+      break;
+    case 30:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+	return OPCODE_EXT32_R;
+      break;
+    case 31:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 6)
+	return OPCODE_EXT_2FIFO_0;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2669dot_slot0_Slot_dot_slot0_get (insn) == 0 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld2671dot_slot0_Slot_dot_slot0_get (insn) == 4 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld2672dot_slot0_Slot_dot_slot0_get (insn) == 5 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_MOV_I;
+  if (Field_dsp340050b49a6c_fld2673dot_slot0_Slot_dot_slot0_get (insn) == 6 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_MOV_R;
+  if (Field_dsp340050b49a6c_fld2674dot_slot0_Slot_dot_slot0_get (insn) == 7 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld2675dot_slot0_Slot_dot_slot0_get (insn) == 8 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2676dot_slot0_Slot_dot_slot0_get (insn) == 9 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld2677dot_slot0_Slot_dot_slot0_get (insn) == 10 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld2678dot_slot0_Slot_dot_slot0_get (insn) == 11 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld2679dot_slot0_Slot_dot_slot0_get (insn) == 27 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld2680dot_slot0_Slot_dot_slot0_get (insn) == 43 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld2681dot_slot0_Slot_dot_slot0_get (insn) == 59 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2682dot_slot0_Slot_dot_slot0_get (insn) == 75 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2683dot_slot0_Slot_dot_slot0_get (insn) == 91 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2684dot_slot0_Slot_dot_slot0_get (insn) == 107 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld2685dot_slot0_Slot_dot_slot0_get (insn) == 123 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2686dot_slot0_Slot_dot_slot0_get (insn) == 43 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3736_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2688dot_slot0_Slot_dot_slot0_get (insn) == 59 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3735dot_slot0_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2689dot_slot0_Slot_dot_slot0_get (insn) == 12 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_r_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2690dot_slot0_Slot_dot_slot0_get (insn) == 13 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_GET_PERM_REG;
+  if (Field_dsp340050b49a6c_fld2692dot_slot0_Slot_dot_slot0_get (insn) == 29 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2693dot_slot0_Slot_dot_slot0_get (insn) == 29 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld2705dot_slot0_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2695dot_slot0_Slot_dot_slot0_get (insn) == 29 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3741dot_slot0_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2697dot_slot0_Slot_dot_slot0_get (insn) == 29 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3738dot_slot0_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld2699dot_slot0_Slot_dot_slot0_get (insn) == 7 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3740dot_slot0_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2700dot_slot0_Slot_dot_slot0_get (insn) == 50 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_CLB_C;
+  if (Field_dsp340050b49a6c_fld2701dot_slot0_Slot_dot_slot0_get (insn) == 51 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_MINCLB_R;
+  if (Field_dsp340050b49a6c_fld2702dot_slot0_Slot_dot_slot0_get (insn) == 52 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_CLB_R;
+  if (Field_dsp340050b49a6c_fld2703dot_slot0_Slot_dot_slot0_get (insn) == 53 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7)
+    return OPCODE_SMINCLB_C;
+  if (Field_dsp340050b49a6c_fld2704dot_slot0_Slot_dot_slot0_get (insn) == 15 &&
+      Field_op0_s8_Slot_dot_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3739dot_slot0_Slot_dot_slot0_get (insn) == 0)
+    return OPCODE_CLRAC;
+  switch (Field_dsp340050b49a6c_fld2705dot_slot0_Slot_dot_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 8 &&
+	  Field_dsp340050b49a6c_fld3737dot_slot0_Slot_dot_slot0_get (insn) == 0)
+	return OPCODE_SLL;
+      break;
+    case 1:
+      if (Field_op0_s8_Slot_dot_slot0_get (insn) == 8 &&
+	  Field_dsp340050b49a6c_fld3742dot_slot0_Slot_dot_slot0_get (insn) == 0)
+	return OPCODE_PUSH128;
+      break;
+    }
+  switch (Field_op0_s8_Slot_dot_slot0_get (insn))
+    {
+    case 9:
+      return OPCODE_LCM_U;
+    case 10:
+      return OPCODE_SCM_U;
+    case 11:
+      return OPCODE_SLLI;
+    case 12:
+      return OPCODE_SRAI;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_pq_slot2_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2706pq_slot2_Slot_pq_slot2_get (insn))
+    {
+    case 44:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_AR2CM_LN;
+      break;
+    case 47:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld3752pq_slot2_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_CLRTIEP;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2707pq_slot2_Slot_pq_slot2_get (insn))
+    {
+    case 180:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_ADDAR2;
+      break;
+    case 181:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_PUSH128_PQ;
+      break;
+    case 182:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_PUSH32;
+      break;
+    case 183:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_SET_EXT_REGS;
+      break;
+    case 184:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOV_N;
+      break;
+    case 185:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_SUBARX;
+      break;
+    case 186:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_WRTIEP;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2708pq_slot2_Slot_pq_slot2_get (insn))
+    {
+    case 1496:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_SETTIEP;
+      break;
+    case 1497:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_WRTBSIGQM;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2709pq_slot2_Slot_pq_slot2_get (insn))
+    {
+    case 2996:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_AR2SAR_DUP;
+      break;
+    case 2997:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_WRTSIGQ;
+      break;
+    case 2999:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+	  Field_s_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_5;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2710pq_slot2_Slot_pq_slot2_get (insn))
+    {
+    case 47968:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_0;
+      break;
+    case 47969:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_1;
+      break;
+    case 47970:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_2;
+      break;
+    case 47971:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_0;
+      break;
+    case 47972:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_3;
+      break;
+    case 47973:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_1;
+      break;
+    case 47974:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_2;
+      break;
+    case 47975:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_3;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2711pq_slot2_Slot_pq_slot2_get (insn) == 11994 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3745pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_4;
+  if (Field_dsp340050b49a6c_fld2713pq_slot2_Slot_pq_slot2_get (insn) == 11995 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3745pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2714pq_slot2_Slot_pq_slot2_get (insn) == 375 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2819_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_WRTBSIGQ;
+  if (Field_dsp340050b49a6c_fld2715pq_slot2_Slot_pq_slot2_get (insn) == 52 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld2717pq_slot2_Slot_pq_slot2_get (insn) == 212 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ABS;
+  if (Field_dsp340050b49a6c_fld2718pq_slot2_Slot_pq_slot2_get (insn) == 213 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld2719pq_slot2_Slot_pq_slot2_get (insn) == 3334 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2721pq_slot2_Slot_pq_slot2_get (insn) == 3335 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_GET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2722pq_slot2_Slot_pq_slot2_get (insn) == 3350 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld2723pq_slot2_Slot_pq_slot2_get (insn) == 3351 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld2724pq_slot2_Slot_pq_slot2_get (insn) == 3366 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld2725pq_slot2_Slot_pq_slot2_get (insn) == 3367 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2726pq_slot2_Slot_pq_slot2_get (insn) == 3382 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2727pq_slot2_Slot_pq_slot2_get (insn) == 3383 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2728pq_slot2_Slot_pq_slot2_get (insn) == 3398 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_GET_MAX;
+  if (Field_dsp340050b49a6c_fld2729pq_slot2_Slot_pq_slot2_get (insn) == 3399 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2730pq_slot2_Slot_pq_slot2_get (insn) == 3414 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld2731pq_slot2_Slot_pq_slot2_get (insn) == 3415 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2732pq_slot2_Slot_pq_slot2_get (insn) == 3430 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2733pq_slot2_Slot_pq_slot2_get (insn) == 3431 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2734pq_slot2_Slot_pq_slot2_get (insn) == 3446 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2735pq_slot2_Slot_pq_slot2_get (insn) == 3447 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2736pq_slot2_Slot_pq_slot2_get (insn) == 438 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2819_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_GET_NCO;
+  if (Field_dsp340050b49a6c_fld2738pq_slot2_Slot_pq_slot2_get (insn) == 439 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2819_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_RDTIEP;
+  if (Field_dsp340050b49a6c_fld2739pq_slot2_Slot_pq_slot2_get (insn) == 27 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3744pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld2741pq_slot2_Slot_pq_slot2_get (insn) == 112 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_PQ2CM;
+  if (Field_dsp340050b49a6c_fld2742pq_slot2_Slot_pq_slot2_get (insn) == 113 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_QREADY;
+  if (Field_dsp340050b49a6c_fld2743pq_slot2_Slot_pq_slot2_get (insn) == 114 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3750pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_AR2CM_DUP;
+  if (Field_dsp340050b49a6c_fld2746pq_slot2_Slot_pq_slot2_get (insn) == 115 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3750pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SWAPB;
+  if (Field_dsp340050b49a6c_fld2747pq_slot2_Slot_pq_slot2_get (insn) == 29 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2819_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_MOVAR2;
+  if (Field_dsp340050b49a6c_fld2748pq_slot2_Slot_pq_slot2_get (insn) == 16 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ADD32;
+  if (Field_dsp340050b49a6c_fld2750pq_slot2_Slot_pq_slot2_get (insn) == 17 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ADDCM;
+  if (Field_dsp340050b49a6c_fld2751pq_slot2_Slot_pq_slot2_get (insn) == 18 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ADDWRP;
+  if (Field_dsp340050b49a6c_fld2752pq_slot2_Slot_pq_slot2_get (insn) == 19 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ASR;
+  if (Field_dsp340050b49a6c_fld2753pq_slot2_Slot_pq_slot2_get (insn) == 20 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_AND128;
+  if (Field_dsp340050b49a6c_fld2754pq_slot2_Slot_pq_slot2_get (insn) == 21 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_EXTUI4;
+  if (Field_dsp340050b49a6c_fld2755pq_slot2_Slot_pq_slot2_get (insn) == 22 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_LUT;
+  if (Field_dsp340050b49a6c_fld2756pq_slot2_Slot_pq_slot2_get (insn) == 23 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_LUT_IEXT;
+  if (Field_dsp340050b49a6c_fld2757pq_slot2_Slot_pq_slot2_get (insn) == 24 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ASL;
+  if (Field_dsp340050b49a6c_fld2758pq_slot2_Slot_pq_slot2_get (insn) == 25 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_LUT_REXT;
+  if (Field_dsp340050b49a6c_fld2759pq_slot2_Slot_pq_slot2_get (insn) == 26 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_MAX8;
+  if (Field_dsp340050b49a6c_fld2760pq_slot2_Slot_pq_slot2_get (insn) == 27 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_MEAN32;
+  if (Field_dsp340050b49a6c_fld2761pq_slot2_Slot_pq_slot2_get (insn) == 28 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_MEAN;
+  if (Field_dsp340050b49a6c_fld2762pq_slot2_Slot_pq_slot2_get (insn) == 29 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_MIN8;
+  if (Field_dsp340050b49a6c_fld2763pq_slot2_Slot_pq_slot2_get (insn) == 30 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_OR128;
+  if (Field_dsp340050b49a6c_fld2764pq_slot2_Slot_pq_slot2_get (insn) == 31 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SUB32;
+  if (Field_dsp340050b49a6c_fld2765pq_slot2_Slot_pq_slot2_get (insn) == 0 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_ASL32;
+  if (Field_dsp340050b49a6c_fld2766pq_slot2_Slot_pq_slot2_get (insn) == 1 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_ASR32;
+  if (Field_dsp340050b49a6c_fld2767pq_slot2_Slot_pq_slot2_get (insn) == 2 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_0;
+  if (Field_dsp340050b49a6c_fld2768pq_slot2_Slot_pq_slot2_get (insn) == 3 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_3;
+  if (Field_dsp340050b49a6c_fld2769pq_slot2_Slot_pq_slot2_get (insn) == 4 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_1;
+  if (Field_dsp340050b49a6c_fld2770pq_slot2_Slot_pq_slot2_get (insn) == 5 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_4;
+  if (Field_dsp340050b49a6c_fld2771pq_slot2_Slot_pq_slot2_get (insn) == 6 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_5;
+  if (Field_dsp340050b49a6c_fld2772pq_slot2_Slot_pq_slot2_get (insn) == 7 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_6;
+  if (Field_dsp340050b49a6c_fld2773pq_slot2_Slot_pq_slot2_get (insn) == 8 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_2;
+  if (Field_dsp340050b49a6c_fld2774pq_slot2_Slot_pq_slot2_get (insn) == 9 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_7;
+  if (Field_dsp340050b49a6c_fld2775pq_slot2_Slot_pq_slot2_get (insn) == 10 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_0;
+  if (Field_dsp340050b49a6c_fld2776pq_slot2_Slot_pq_slot2_get (insn) == 11 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_2;
+  if (Field_dsp340050b49a6c_fld2777pq_slot2_Slot_pq_slot2_get (insn) == 12 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_1;
+  if (Field_dsp340050b49a6c_fld2778pq_slot2_Slot_pq_slot2_get (insn) == 13 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_3;
+  if (Field_dsp340050b49a6c_fld2779pq_slot2_Slot_pq_slot2_get (insn) == 14 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_4;
+  if (Field_dsp340050b49a6c_fld2780pq_slot2_Slot_pq_slot2_get (insn) == 15 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_5;
+  if (Field_dsp340050b49a6c_fld2781pq_slot2_Slot_pq_slot2_get (insn) == 16 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_ASLM;
+  if (Field_dsp340050b49a6c_fld2782pq_slot2_Slot_pq_slot2_get (insn) == 17 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_ASRM;
+  if (Field_dsp340050b49a6c_fld2783pq_slot2_Slot_pq_slot2_get (insn) == 18 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_CMP8;
+  if (Field_dsp340050b49a6c_fld2784pq_slot2_Slot_pq_slot2_get (insn) == 19 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_LSLM;
+  if (Field_dsp340050b49a6c_fld2785pq_slot2_Slot_pq_slot2_get (insn) == 20 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_CMP_I;
+  if (Field_dsp340050b49a6c_fld2786pq_slot2_Slot_pq_slot2_get (insn) == 21 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_LSRM;
+  if (Field_dsp340050b49a6c_fld2787pq_slot2_Slot_pq_slot2_get (insn) == 262 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_ABS8;
+  if (Field_dsp340050b49a6c_fld2788pq_slot2_Slot_pq_slot2_get (insn) == 263 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld2789pq_slot2_Slot_pq_slot2_get (insn) == 278 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_LUT_PHASOR;
+  if (Field_dsp340050b49a6c_fld2790pq_slot2_Slot_pq_slot2_get (insn) == 279 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_NOT128;
+  if (Field_dsp340050b49a6c_fld2791pq_slot2_Slot_pq_slot2_get (insn) == 294 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2792pq_slot2_Slot_pq_slot2_get (insn) == 295 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1)
+    return OPCODE_TRANS;
+  if (Field_dsp340050b49a6c_fld2793pq_slot2_Slot_pq_slot2_get (insn) == 2102 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2817_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2795pq_slot2_Slot_pq_slot2_get (insn) == 2103 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2817_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SET_HSAR;
+  if (Field_dsp340050b49a6c_fld2796pq_slot2_Slot_pq_slot2_get (insn) == 1179 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3746pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SET_MAX;
+  if (Field_dsp340050b49a6c_fld2798pq_slot2_Slot_pq_slot2_get (insn) == 667 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3747pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SET_NCO;
+  if (Field_dsp340050b49a6c_fld2801pq_slot2_Slot_pq_slot2_get (insn) == 411 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3749pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld2803pq_slot2_Slot_pq_slot2_get (insn) == 43 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3754pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_NCO_UPDATE;
+  if (Field_dsp340050b49a6c_fld2805pq_slot2_Slot_pq_slot2_get (insn) == 27 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3751pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld2806pq_slot2_Slot_pq_slot2_get (insn) == 12 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2025_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_CMP_R;
+  if (Field_dsp340050b49a6c_fld2807pq_slot2_Slot_pq_slot2_get (insn) == 13 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3756pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld2808pq_slot2_Slot_pq_slot2_get (insn) == 11 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3757pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ADD16;
+  if (Field_dsp340050b49a6c_fld2809pq_slot2_Slot_pq_slot2_get (insn) == 15 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3753pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_LUT_WRITE;
+  if (Field_dsp340050b49a6c_fld2810pq_slot2_Slot_pq_slot2_get (insn) == 0 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2)
+    return OPCODE_MOVCND_6;
+  if (Field_dsp340050b49a6c_fld2811pq_slot2_Slot_pq_slot2_get (insn) == 1 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2)
+    return OPCODE_MOVCND_7;
+  if (Field_dsp340050b49a6c_fld2812pq_slot2_Slot_pq_slot2_get (insn) == 1 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3748_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_PERM;
+  if (Field_dsp340050b49a6c_fld2814pq_slot2_Slot_pq_slot2_get (insn) == 1 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3758pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ASLM32;
+  if (Field_dsp340050b49a6c_fld2816pq_slot2_Slot_pq_slot2_get (insn) == 1 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2 &&
+      Field_imm7_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_ARGMAX8;
+  if (Field_dsp340050b49a6c_fld2818pq_slot2_Slot_pq_slot2_get (insn) == 8 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2737_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SUBCM;
+  if (Field_dsp340050b49a6c_fld2820pq_slot2_Slot_pq_slot2_get (insn) == 9 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2737_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SUBMEAN;
+  if (Field_dsp340050b49a6c_fld2821pq_slot2_Slot_pq_slot2_get (insn) == 5 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3759pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_SUBWRP;
+  if (Field_dsp340050b49a6c_fld2823pq_slot2_Slot_pq_slot2_get (insn) == 3 &&
+      Field_op0_s9_Slot_pq_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3760pq_slot2_Slot_pq_slot2_get (insn) == 0)
+    return OPCODE_XOR128;
+  if (Field_op0_s9_Slot_pq_slot2_get (insn) == 3)
+    return OPCODE_EXTUI;
+  switch (Field_sae_Slot_pq_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_ADD;
+      break;
+    case 1:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_ADDI_N;
+      break;
+    case 2:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_AND;
+      break;
+    case 3:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVGEZ;
+      break;
+    case 4:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_LUT_AR;
+      break;
+    case 5:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVLTZ;
+      break;
+    case 6:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVNEZ;
+      break;
+    case 7:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_OR;
+      break;
+    case 8:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVEQZ;
+      break;
+    case 9:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_SUB;
+      break;
+    case 10:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_XOR;
+      break;
+    case 12:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2817_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_MOVI_N;
+      break;
+    case 15:
+      if (Field_op0_s9_Slot_pq_slot2_get (insn) == 0 &&
+	  Field_t_Slot_pq_slot2_get (insn) == 0)
+	return OPCODE_SLL;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_pq_slot0_decode (const xtensa_insnbuf insn)
+{
+  if (Field_dsp340050b49a6c_fld2827pq_slot0_Slot_pq_slot0_get (insn) == 0 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC2X32;
+  if (Field_dsp340050b49a6c_fld2829pq_slot0_Slot_pq_slot0_get (insn) == 1 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC32_R;
+  if (Field_dsp340050b49a6c_fld2830pq_slot0_Slot_pq_slot0_get (insn) == 2 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC_IH;
+  if (Field_dsp340050b49a6c_fld2831pq_slot0_Slot_pq_slot0_get (insn) == 3 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC_RH;
+  if (Field_dsp340050b49a6c_fld2832pq_slot0_Slot_pq_slot0_get (insn) == 10 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC_RL;
+  if (Field_dsp340050b49a6c_fld2833pq_slot0_Slot_pq_slot0_get (insn) == 11 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_0;
+  if (Field_dsp340050b49a6c_fld2835pq_slot0_Slot_pq_slot0_get (insn) == 27 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_1;
+  if (Field_dsp340050b49a6c_fld2836pq_slot0_Slot_pq_slot0_get (insn) == 4 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC_IL;
+  if (Field_dsp340050b49a6c_fld2837pq_slot0_Slot_pq_slot0_get (insn) == 5 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_2;
+  switch (Field_dsp340050b49a6c_fld2838pq_slot0_Slot_pq_slot0_get (insn))
+    {
+    case 21:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_AR2CM_DUP;
+      break;
+    case 53:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_MOV_N;
+      break;
+    case 85:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_NSA;
+      break;
+    case 117:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_PUSH32;
+      break;
+    case 149:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_NSAU;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2839pq_slot0_Slot_pq_slot0_get (insn) == 362 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld2840pq_slot0_Slot_pq_slot0_get (insn) == 1452 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_ANY8;
+  if (Field_dsp340050b49a6c_fld2842pq_slot0_Slot_pq_slot0_get (insn) == 1453 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld2843pq_slot0_Slot_pq_slot0_get (insn) == 2908 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2844pq_slot0_Slot_pq_slot0_get (insn) == 2909 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld2845pq_slot0_Slot_pq_slot0_get (insn) == 2910 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld2846pq_slot0_Slot_pq_slot0_get (insn) == 2911 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld2847pq_slot0_Slot_pq_slot0_get (insn) == 852 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_ANY4;
+  if (Field_dsp340050b49a6c_fld2849pq_slot0_Slot_pq_slot0_get (insn) == 3412 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld2850pq_slot0_Slot_pq_slot0_get (insn) == 3413 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2851pq_slot0_Slot_pq_slot0_get (insn) == 3414 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2852pq_slot0_Slot_pq_slot0_get (insn) == 3415 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2853pq_slot0_Slot_pq_slot0_get (insn) == 3416 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2854pq_slot0_Slot_pq_slot0_get (insn) == 3417 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld2855pq_slot0_Slot_pq_slot0_get (insn) == 1709 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_s8_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2856pq_slot0_Slot_pq_slot0_get (insn) == 855 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3765pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2857pq_slot0_Slot_pq_slot0_get (insn) == 1960 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SSAI;
+  switch (Field_dsp340050b49a6c_fld2858pq_slot0_Slot_pq_slot0_get (insn))
+    {
+    case 3922:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_LLR_POS;
+      break;
+    case 3923:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_PHASOR_OFFSET;
+      break;
+    case 3924:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_PERM_REG;
+      break;
+    case 3925:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_SCALE_REG;
+      break;
+    case 3926:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_SMOD_POS;
+      break;
+    case 3927:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_SOV;
+      break;
+    case 3928:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_PHASOR_N;
+      break;
+    case 3929:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SET_WGHT;
+      break;
+    case 3930:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SSA8B;
+      break;
+    case 3931:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SSL;
+      break;
+    case 3932:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SSA8L;
+      break;
+    case 3933:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_SSR;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2859pq_slot0_Slot_pq_slot0_get (insn) == 3934 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2940_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CLRAC;
+  if (Field_dsp340050b49a6c_fld2860pq_slot0_Slot_pq_slot0_get (insn) == 3935 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2940_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP16LLR_1;
+  if (Field_dsp340050b49a6c_fld2861pq_slot0_Slot_pq_slot0_get (insn) == 3 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3768pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LAC2X64_3;
+  switch (Field_dsp340050b49a6c_fld2863pq_slot0_Slot_pq_slot0_get (insn))
+    {
+    case 3:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_AR2CM_LN;
+      break;
+    case 7:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_AR2CM_LN_I;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2864pq_slot0_Slot_pq_slot0_get (insn) == 7 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2069_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_AR2CM_LN_R;
+  switch (Field_dsp340050b49a6c_fld2865_Slot_pq_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_SAC2X32;
+      break;
+    case 1:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_SAC32_R;
+      break;
+    case 2:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_SCM_PINC;
+      break;
+    case 3:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_SRAI;
+      break;
+    case 4:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_SCM_U;
+      break;
+    case 8:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_SLLI;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2867pq_slot0_Slot_pq_slot0_get (insn) == 7 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3763pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_BEQZ_N;
+  if (Field_dsp340050b49a6c_fld2869pq_slot0_Slot_pq_slot0_get (insn) == 7 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3764pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_BNEZ_N;
+  if (Field_dsp340050b49a6c_fld2871pq_slot0_Slot_pq_slot0_get (insn) == 8 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LCM_PINC;
+  if (Field_dsp340050b49a6c_fld2872pq_slot0_Slot_pq_slot0_get (insn) == 9 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LCM_U;
+  if (Field_dsp340050b49a6c_fld2873pq_slot0_Slot_pq_slot0_get (insn) == 18 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_LCM;
+  if (Field_dsp340050b49a6c_fld2874pq_slot0_Slot_pq_slot0_get (insn) == 259 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_ABS;
+  if (Field_dsp340050b49a6c_fld2875pq_slot0_Slot_pq_slot0_get (insn) == 267 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2876pq_slot0_Slot_pq_slot0_get (insn) == 291 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MOV_I;
+  if (Field_dsp340050b49a6c_fld2877pq_slot0_Slot_pq_slot0_get (insn) == 299 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld2878pq_slot0_Slot_pq_slot0_get (insn) == 323 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MOV_R;
+  if (Field_dsp340050b49a6c_fld2879pq_slot0_Slot_pq_slot0_get (insn) == 331 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld2880pq_slot0_Slot_pq_slot0_get (insn) == 355 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SRL;
+  if (Field_dsp340050b49a6c_fld2881pq_slot0_Slot_pq_slot0_get (insn) == 715 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CLB_C;
+  switch (Field_dsp340050b49a6c_fld2882_Slot_pq_slot0_get (insn))
+    {
+    case 21:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_EXT;
+      break;
+    case 23:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_EXT_R;
+      break;
+    case 33:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_MOVI_N;
+      break;
+    case 35:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_PUSH128_M;
+      break;
+    case 52:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_0;
+      break;
+    case 53:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_2;
+      break;
+    case 54:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_3;
+      break;
+    case 56:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SAC2X64_1;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2883pq_slot0_Slot_pq_slot0_get (insn) == 731 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CLB_R;
+  if (Field_dsp340050b49a6c_fld2884pq_slot0_Slot_pq_slot0_get (insn) == 387 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld2885pq_slot0_Slot_pq_slot0_get (insn) == 779 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MINCLB_C;
+  if (Field_dsp340050b49a6c_fld2886pq_slot0_Slot_pq_slot0_get (insn) == 795 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SMINCLB_R;
+  if (Field_dsp340050b49a6c_fld2887pq_slot0_Slot_pq_slot0_get (insn) == 835 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MINCLB_R;
+  if (Field_dsp340050b49a6c_fld2888pq_slot0_Slot_pq_slot0_get (insn) == 13571 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_ADDAC_I2R;
+  if (Field_dsp340050b49a6c_fld2890pq_slot0_Slot_pq_slot0_get (insn) == 13587 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_ADDAC_R2I;
+  if (Field_dsp340050b49a6c_fld2891pq_slot0_Slot_pq_slot0_get (insn) == 13603 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_REDAC;
+  if (Field_dsp340050b49a6c_fld2892pq_slot0_Slot_pq_slot0_get (insn) == 13619 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_REDACS;
+  if (Field_dsp340050b49a6c_fld2893pq_slot0_Slot_pq_slot0_get (insn) == 13635 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_REDAC2;
+  if (Field_dsp340050b49a6c_fld2894pq_slot0_Slot_pq_slot0_get (insn) == 13651 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SUBAC_I2R;
+  if (Field_dsp340050b49a6c_fld2895pq_slot0_Slot_pq_slot0_get (insn) == 6835 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2940_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SUBAC_R2I;
+  if (Field_dsp340050b49a6c_fld2897pq_slot0_Slot_pq_slot0_get (insn) == 1715 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3779pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_REDAC4;
+  if (Field_dsp340050b49a6c_fld2899pq_slot0_Slot_pq_slot0_get (insn) == 6667 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_L;
+  if (Field_dsp340050b49a6c_fld2900pq_slot0_Slot_pq_slot0_get (insn) == 6683 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_N;
+  if (Field_dsp340050b49a6c_fld2901pq_slot0_Slot_pq_slot0_get (insn) == 6699 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_LLR_POS;
+  if (Field_dsp340050b49a6c_fld2902pq_slot0_Slot_pq_slot0_get (insn) == 6715 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_PHASOR_OFFSET;
+  if (Field_dsp340050b49a6c_fld2903pq_slot0_Slot_pq_slot0_get (insn) == 6731 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_PERM_REG;
+  if (Field_dsp340050b49a6c_fld2904pq_slot0_Slot_pq_slot0_get (insn) == 6747 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld2905pq_slot0_Slot_pq_slot0_get (insn) == 6763 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld2906pq_slot0_Slot_pq_slot0_get (insn) == 6779 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_SOV;
+  if (Field_dsp340050b49a6c_fld2907pq_slot0_Slot_pq_slot0_get (insn) == 6795 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_PHASOR_N;
+  if (Field_dsp340050b49a6c_fld2908pq_slot0_Slot_pq_slot0_get (insn) == 6811 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_GET_WGHT;
+  if (Field_dsp340050b49a6c_fld2909pq_slot0_Slot_pq_slot0_get (insn) == 6827 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2910pq_slot0_Slot_pq_slot0_get (insn) == 6843 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2911pq_slot0_Slot_pq_slot0_get (insn) == 6859 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2912pq_slot0_Slot_pq_slot0_get (insn) == 6875 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2913pq_slot0_Slot_pq_slot0_get (insn) == 6891 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld2914pq_slot0_Slot_pq_slot0_get (insn) == 6907 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld2915pq_slot0_Slot_pq_slot0_get (insn) == 115 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3780pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SMINCLB_C;
+  if (Field_dsp340050b49a6c_fld2916pq_slot0_Slot_pq_slot0_get (insn) == 137 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_s8_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld2917pq_slot0_Slot_pq_slot0_get (insn) == 277 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT32_I;
+  if (Field_dsp340050b49a6c_fld2918pq_slot0_Slot_pq_slot0_get (insn) == 285 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_2;
+  if (Field_dsp340050b49a6c_fld2919pq_slot0_Slot_pq_slot0_get (insn) == 305 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT32_R;
+  if (Field_dsp340050b49a6c_fld2920pq_slot0_Slot_pq_slot0_get (insn) == 309 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_3;
+  if (Field_dsp340050b49a6c_fld2921pq_slot0_Slot_pq_slot0_get (insn) == 313 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_0;
+  if (Field_dsp340050b49a6c_fld2922pq_slot0_Slot_pq_slot0_get (insn) == 317 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_1;
+  if (Field_dsp340050b49a6c_fld2923pq_slot0_Slot_pq_slot0_get (insn) == 337 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_0;
+  if (Field_dsp340050b49a6c_fld2924pq_slot0_Slot_pq_slot0_get (insn) == 341 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_2;
+  if (Field_dsp340050b49a6c_fld2925pq_slot0_Slot_pq_slot0_get (insn) == 173 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2036_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_R2FIFO_3;
+  if (Field_dsp340050b49a6c_fld2926pq_slot0_Slot_pq_slot0_get (insn) == 93 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3767pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld2927pq_slot0_Slot_pq_slot0_get (insn) == 29 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3773pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_1;
+  if (Field_dsp340050b49a6c_fld2928pq_slot0_Slot_pq_slot0_get (insn) == 9 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2059_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld2929pq_slot0_Slot_pq_slot0_get (insn) == 11 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2059_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN_I;
+  if (Field_dsp340050b49a6c_fld2930pq_slot0_Slot_pq_slot0_get (insn) == 7 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3769pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN_R;
+  if (Field_dsp340050b49a6c_fld2932pq_slot0_Slot_pq_slot0_get (insn) == 6 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+    return OPCODE_SAC_IL;
+  if (Field_dsp340050b49a6c_fld2934pq_slot0_Slot_pq_slot0_get (insn) == 7 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+    return OPCODE_SAC_RH;
+  if (Field_dsp340050b49a6c_fld2935pq_slot0_Slot_pq_slot0_get (insn) == 10 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+    return OPCODE_SAC_RL;
+  if (Field_dsp340050b49a6c_fld2936pq_slot0_Slot_pq_slot0_get (insn) == 16 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+    return OPCODE_SAC_IH;
+  if (Field_dsp340050b49a6c_fld2937pq_slot0_Slot_pq_slot0_get (insn) == 220 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+    return OPCODE_ASLACM;
+  if (Field_dsp340050b49a6c_fld2939pq_slot0_Slot_pq_slot0_get (insn) == 442 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3772_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_ASRAC;
+  if (Field_dsp340050b49a6c_fld2941pq_slot0_Slot_pq_slot0_get (insn) == 443 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3771pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SWAPAC_RI;
+  if (Field_dsp340050b49a6c_fld2942pq_slot0_Slot_pq_slot0_get (insn) == 111 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3766pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MOVAC;
+  if (Field_dsp340050b49a6c_fld2943pq_slot0_Slot_pq_slot0_get (insn) == 114 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3775pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_2M_0;
+  if (Field_dsp340050b49a6c_fld2945pq_slot0_Slot_pq_slot0_get (insn) == 115 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3775pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_POP128_2M_3;
+  if (Field_dsp340050b49a6c_fld2946pq_slot0_Slot_pq_slot0_get (insn) == 496 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+    return OPCODE_SLL;
+  if (Field_dsp340050b49a6c_fld2947pq_slot0_Slot_pq_slot0_get (insn) == 497 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2036_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MOV2AC32_I;
+  if (Field_dsp340050b49a6c_fld2948pq_slot0_Slot_pq_slot0_get (insn) == 249 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3770pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_MOV2AC32_R;
+  if (Field_dsp340050b49a6c_fld2949pq_slot0_Slot_pq_slot0_get (insn) == 125 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3778pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld2950pq_slot0_Slot_pq_slot0_get (insn) == 63 &&
+      Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3766pq_slot0_Slot_pq_slot0_get (insn) == 0)
+    return OPCODE_SET_LLR_BUF;
+  if (Field_op0_s11_Slot_pq_slot0_get (insn) == 3)
+    return OPCODE_EXTUI;
+  switch (Field_sae_Slot_pq_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_MOVNEZ;
+      break;
+    case 1:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_MOVT;
+      break;
+    case 2:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_OR;
+      break;
+    case 3:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SCM;
+      break;
+    case 4:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_ORB;
+      break;
+    case 5:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SCM_PINC_X;
+      break;
+    case 8:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_S32I_N;
+      break;
+    case 9:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SCM_XU;
+      break;
+    case 10:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_ADD;
+      break;
+    case 11:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_ADDX2;
+      break;
+    case 12:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_ADDI_N;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SCM_X;
+      break;
+    case 13:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_ADDX4;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SEXT;
+      break;
+    case 14:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_ADDX8;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SRC;
+      break;
+    case 15:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_AND;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SRLI;
+      break;
+    case 18:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_ANDB;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_STORE_P;
+      break;
+    case 19:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_L32I_N;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SUBX2;
+      break;
+    case 20:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_CLAMPS;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_STORE_Q;
+      break;
+    case 21:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SUBX4;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_LCM_PINC_X;
+      break;
+    case 22:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SUBX8;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_LCM_X;
+      break;
+    case 23:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_XOR;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_LCM_XU;
+      break;
+    case 24:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_SUB;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_COMB_AR;
+      break;
+    case 25:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2)
+	return OPCODE_XORB;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_MAX;
+      break;
+    case 26:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_MAXU;
+      break;
+    case 27:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_MINU;
+      break;
+    case 28:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_MIN;
+      break;
+    case 29:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_MOVEQZ;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3776pq_slot0_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_POP128_2M_1;
+      break;
+    case 30:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_MOVGEZ;
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3777pq_slot0_Slot_pq_slot0_get (insn) == 0)
+	return OPCODE_POP128_2M_2;
+      break;
+    case 31:
+      if (Field_op0_s11_Slot_pq_slot0_get (insn) == 1)
+	return OPCODE_MOVLTZ;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_acc2_slot0_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2047_Slot_acc2_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3795acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_NEG;
+      break;
+    case 1:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld2039_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_PUSH128;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2056_Slot_acc2_slot0_get (insn) == 0 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1)
+    return OPCODE_MOVCM2PQ;
+  if (Field_dsp340050b49a6c_fld2973acc2_slot0_Slot_acc2_slot0_get (insn) == 0 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_MOVI_N;
+  if (Field_dsp340050b49a6c_fld2974acc2_slot0_Slot_acc2_slot0_get (insn) == 40 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_PUSH2X128_PQ;
+  switch (Field_dsp340050b49a6c_fld2975acc2_slot0_Slot_acc2_slot0_get (insn))
+    {
+    case 82:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_2PQ_1;
+      break;
+    case 83:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_2PQ_4;
+      break;
+    case 84:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_2PQ_2;
+      break;
+    case 85:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_2PQ_5;
+      break;
+    case 88:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_2PQ_3;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2976acc2_slot0_Slot_acc2_slot0_get (insn))
+    {
+    case 172:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_CLRCM;
+      break;
+    case 173:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_0;
+      break;
+    case 174:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_1;
+      break;
+    case 175:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_2;
+      break;
+    case 178:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_3;
+      break;
+    case 179:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_01;
+      break;
+    case 180:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP128_4;
+      break;
+    case 181:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_03;
+      break;
+    case 182:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_21;
+      break;
+    case 183:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_POP2X128_2PQ_23;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2977acc2_slot0_Slot_acc2_slot0_get (insn) == 46 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3797_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2980acc2_slot0_Slot_acc2_slot0_get (insn) == 47 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3796acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2981acc2_slot0_Slot_acc2_slot0_get (insn) == 3 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3800acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_POP128_2PQ_0;
+  if (Field_dsp340050b49a6c_fld2982acc2_slot0_Slot_acc2_slot0_get (insn) == 24 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3801acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2984acc2_slot0_Slot_acc2_slot0_get (insn) == 25 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3801acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2985acc2_slot0_Slot_acc2_slot0_get (insn) == 13 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3802acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2987acc2_slot0_Slot_acc2_slot0_get (insn) == 7 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3803acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2989acc2_slot0_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3798acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2990acc2_slot0_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3799acc2_slot0_Slot_acc2_slot0_get (insn) == 0)
+    return OPCODE_NEGCM;
+  switch (Field_op0_s14_Slot_acc2_slot0_get (insn))
+    {
+    case 3:
+      return OPCODE_ADD;
+    case 4:
+      return OPCODE_ADDI_N;
+    case 5:
+      return OPCODE_LCM_X;
+    case 6:
+      return OPCODE_LCM_XU;
+    case 7:
+      return OPCODE_SCM_X;
+    case 8:
+      return OPCODE_SCM_XU;
+    case 9:
+      return OPCODE_SUB;
+    }
+  switch (Field_r_Slot_acc2_slot0_get (insn))
+    {
+    case 8:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_MOV_N;
+      break;
+    case 9:
+      if (Field_op0_s14_Slot_acc2_slot0_get (insn) == 0)
+	return OPCODE_PUSH128_PQ;
+      break;
+    }
+  if (Field_t_Slot_acc2_slot0_get (insn) == 2 &&
+      Field_op0_s14_Slot_acc2_slot0_get (insn) == 1)
+    return OPCODE_CONJ;
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_smod_slot0_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld3119smod_slot0_Slot_smod_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_LCM_PINC;
+      break;
+    case 1:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_LCM_U;
+      break;
+    case 2:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_SCM_PINC;
+      break;
+    case 3:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_SRAI;
+      break;
+    case 4:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_SCM_U;
+      break;
+    case 8:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_SLLI;
+      break;
+    case 13:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld3841smod_slot0_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_PUSH128;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3120smod_slot0_Slot_smod_slot0_get (insn))
+    {
+    case 76:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_AR2CM_LN;
+      break;
+    case 77:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_AR2CM_LN_I;
+      break;
+    case 78:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_AR2CM_LN_R;
+      break;
+    case 79:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_BEQZ_N;
+      break;
+    case 82:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_BNEZ_N;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3121smod_slot0_Slot_smod_slot0_get (insn))
+    {
+    case 40:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_MOVI_N;
+      break;
+    case 47:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2049_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_POP128_2M_3;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3122smod_slot0_Slot_smod_slot0_get (insn))
+    {
+    case 332:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_AR2CM_DUP;
+      break;
+    case 333:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_MOV_N;
+      break;
+    case 334:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_NSA;
+      break;
+    case 335:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_NSAU;
+      break;
+    case 371:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_PUSH32;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3123smod_slot0_Slot_smod_slot0_get (insn) == 84 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld3125smod_slot0_Slot_smod_slot0_get (insn) == 85 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_CM2AR_LN_R;
+  if (Field_dsp340050b49a6c_fld3126smod_slot0_Slot_smod_slot0_get (insn) == 344 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_ABS;
+  if (Field_dsp340050b49a6c_fld3127smod_slot0_Slot_smod_slot0_get (insn) == 345 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld3128smod_slot0_Slot_smod_slot0_get (insn) == 346 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld3129smod_slot0_Slot_smod_slot0_get (insn) == 347 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_MOV_R;
+  if (Field_dsp340050b49a6c_fld3130smod_slot0_Slot_smod_slot0_get (insn) == 348 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_MOV_I;
+  if (Field_dsp340050b49a6c_fld3131smod_slot0_Slot_smod_slot0_get (insn) == 349 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld3132smod_slot0_Slot_smod_slot0_get (insn) == 350 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld3133smod_slot0_Slot_smod_slot0_get (insn) == 351 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld3134smod_slot0_Slot_smod_slot0_get (insn) == 88 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_CM2AR_LN_I;
+  if (Field_dsp340050b49a6c_fld3135smod_slot0_Slot_smod_slot0_get (insn) == 356 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_SRL;
+  if (Field_dsp340050b49a6c_fld3136smod_slot0_Slot_smod_slot0_get (insn) == 5637 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld3137smod_slot0_Slot_smod_slot0_get (insn) == 5653 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld3138smod_slot0_Slot_smod_slot0_get (insn) == 5669 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld3139smod_slot0_Slot_smod_slot0_get (insn) == 5685 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld3140smod_slot0_Slot_smod_slot0_get (insn) == 5701 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld3141smod_slot0_Slot_smod_slot0_get (insn) == 5717 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld3142smod_slot0_Slot_smod_slot0_get (insn) == 5733 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld3143smod_slot0_Slot_smod_slot0_get (insn) == 5749 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld3144smod_slot0_Slot_smod_slot0_get (insn) == 5765 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld3145smod_slot0_Slot_smod_slot0_get (insn) == 5781 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld3146smod_slot0_Slot_smod_slot0_get (insn) == 2901 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3150_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld3148smod_slot0_Slot_smod_slot0_get (insn) == 1461 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_imm6_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld3149smod_slot0_Slot_smod_slot0_get (insn) == 355 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3834_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_ANY8;
+  if (Field_dsp340050b49a6c_fld3152smod_slot0_Slot_smod_slot0_get (insn) == 363 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3834_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_GET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld3153smod_slot0_Slot_smod_slot0_get (insn) == 89 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3834_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_GET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld3155smod_slot0_Slot_smod_slot0_get (insn) == 91 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3833smod_slot0_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_ANY4;
+  if (Field_dsp340050b49a6c_fld3156smod_slot0_Slot_smod_slot0_get (insn) == 184 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_2M_0;
+  if (Field_dsp340050b49a6c_fld3157smod_slot0_Slot_smod_slot0_get (insn) == 185 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_2M_1;
+  if (Field_dsp340050b49a6c_fld3158smod_slot0_Slot_smod_slot0_get (insn) == 186 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP128_2M_2;
+  if (Field_dsp340050b49a6c_fld3159smod_slot0_Slot_smod_slot0_get (insn) == 3000 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_SSAI;
+  switch (Field_dsp340050b49a6c_fld3160smod_slot0_Slot_smod_slot0_get (insn))
+    {
+    case 6002:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_LLR_POS;
+      break;
+    case 6003:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_PHASOR_OFFSET;
+      break;
+    case 6004:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_PERM_REG;
+      break;
+    case 6005:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_SCALE_REG;
+      break;
+    case 6006:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_SMOD_POS;
+      break;
+    case 6007:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_SOV;
+      break;
+    case 6008:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_PHASOR_N;
+      break;
+    case 6009:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SET_WGHT;
+      break;
+    case 6010:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SSA8B;
+      break;
+    case 6011:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SSL;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3161smod_slot0_Slot_smod_slot0_get (insn) == 3006 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3832smod_slot0_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_SSA8L;
+  if (Field_dsp340050b49a6c_fld3164smod_slot0_Slot_smod_slot0_get (insn) == 3007 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3832smod_slot0_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_SSR;
+  if (Field_dsp340050b49a6c_fld3165smod_slot0_Slot_smod_slot0_get (insn) == 400 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_SLL;
+  if (Field_dsp340050b49a6c_fld3166smod_slot0_Slot_smod_slot0_get (insn) == 3208 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_SET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld3168smod_slot0_Slot_smod_slot0_get (insn) == 6418 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_PERM_REG;
+  if (Field_dsp340050b49a6c_fld3170smod_slot0_Slot_smod_slot0_get (insn) == 6419 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld3171smod_slot0_Slot_smod_slot0_get (insn) == 6420 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_PHASOR_N;
+  if (Field_dsp340050b49a6c_fld3172smod_slot0_Slot_smod_slot0_get (insn) == 6421 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld3173smod_slot0_Slot_smod_slot0_get (insn) == 6422 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_SOV;
+  if (Field_dsp340050b49a6c_fld3174smod_slot0_Slot_smod_slot0_get (insn) == 6423 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_WGHT;
+  if (Field_dsp340050b49a6c_fld3175smod_slot0_Slot_smod_slot0_get (insn) == 6424 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_GET_PHASOR_OFFSET;
+  if (Field_dsp340050b49a6c_fld3176smod_slot0_Slot_smod_slot0_get (insn) == 6425 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld3177smod_slot0_Slot_smod_slot0_get (insn) == 6426 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld3178smod_slot0_Slot_smod_slot0_get (insn) == 6427 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld3179smod_slot0_Slot_smod_slot0_get (insn) == 6428 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld3180smod_slot0_Slot_smod_slot0_get (insn) == 6429 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld3181smod_slot0_Slot_smod_slot0_get (insn) == 3215 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_s8_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld3182smod_slot0_Slot_smod_slot0_get (insn) == 201 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_sas_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_L;
+  if (Field_dsp340050b49a6c_fld3184smod_slot0_Slot_smod_slot0_get (insn) == 101 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3836smod_slot0_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_GET_INTERP_EXT_N;
+  if (Field_dsp340050b49a6c_fld3186smod_slot0_Slot_smod_slot0_get (insn) == 51 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3837smod_slot0_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_GET_LLR_POS;
+  if (Field_dsp340050b49a6c_fld3188smod_slot0_Slot_smod_slot0_get (insn) == 7 &&
+      Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3838smod_slot0_Slot_smod_slot0_get (insn) == 0)
+    return OPCODE_SET_LLR_BUF;
+  if (Field_op0_s17_Slot_smod_slot0_get (insn) == 2)
+    return OPCODE_EXTUI;
+  switch (Field_sae_Slot_smod_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_MOVLTZ;
+      break;
+    case 1:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_MOVNEZ;
+      break;
+    case 2:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_MOVT;
+      break;
+    case 3:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SCM;
+      break;
+    case 4:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_OR;
+      break;
+    case 5:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SCM_PINC_X;
+      break;
+    case 6:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SCM_X;
+      break;
+    case 7:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SCM_XU;
+      break;
+    case 8:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_ORB;
+      break;
+    case 9:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SEXT;
+      break;
+    case 10:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_ADD;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SRC;
+      break;
+    case 11:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SUB;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_ADDX2;
+      break;
+    case 12:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_ADDI_N;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SRLI;
+      break;
+    case 13:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_ADDX4;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SUBX2;
+      break;
+    case 14:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_ADDX8;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SUBX4;
+      break;
+    case 15:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_SUBX8;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_AND;
+      break;
+    case 16:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_S32I_N;
+      break;
+    case 17:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_XOR;
+      break;
+    case 18:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_ANDB;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1)
+	return OPCODE_XORB;
+      break;
+    case 19:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_L32I_N;
+      break;
+    case 20:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_CLAMPS;
+      break;
+    case 21:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_LCM;
+      break;
+    case 22:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_LCM_PINC_X;
+      break;
+    case 23:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_LCM_X;
+      break;
+    case 24:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_COMB_AR;
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld3842smod_slot0_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_PUSH128_M;
+      break;
+    case 25:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_LCM_XU;
+      break;
+    case 26:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_MAX;
+      break;
+    case 27:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_MIN;
+      break;
+    case 28:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_MAXU;
+      break;
+    case 29:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_MINU;
+      break;
+    case 30:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_MOVEQZ;
+      break;
+    case 31:
+      if (Field_op0_s17_Slot_smod_slot0_get (insn) == 0)
+	return OPCODE_MOVGEZ;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_llr_slot0_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2071_Slot_llr_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 4)
+	return OPCODE_S32I_N;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 0)
+	return OPCODE_ADD;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 6)
+	return OPCODE_SUB;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 1)
+	return OPCODE_AND;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 2)
+	return OPCODE_LCM;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 3)
+	return OPCODE_LCM_XU;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 5)
+	return OPCODE_SCM_X;
+      break;
+    case 1:
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 0)
+	return OPCODE_ADDI_N;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 1)
+	return OPCODE_L32I_N;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 3)
+	return OPCODE_OR;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 6)
+	return OPCODE_XOR;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+	  Field_dsp340050b49a6c_fld3881llr_slot0_Slot_llr_slot0_get (insn) == 0)
+	return OPCODE_GET_LLR_BUF;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 2)
+	return OPCODE_LCM_X;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 4)
+	return OPCODE_SCM;
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 5)
+	return OPCODE_SCM_XU;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3258llr_slot0_Slot_llr_slot0_get (insn) == 0 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_MOVI_N;
+  if (Field_dsp340050b49a6c_fld3259llr_slot0_Slot_llr_slot0_get (insn) == 2 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_AR2CM_LN;
+  switch (Field_dsp340050b49a6c_fld3260llr_slot0_Slot_llr_slot0_get (insn))
+    {
+    case 12:
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+	return OPCODE_AR2CM_DUP;
+      break;
+    case 13:
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+	return OPCODE_MOV_N;
+      break;
+    case 14:
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+	return OPCODE_PUSH128_PQ;
+      break;
+    case 15:
+      if (Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+	return OPCODE_PUSH32;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3261llr_slot0_Slot_llr_slot0_get (insn) == 4 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld3263llr_slot0_Slot_llr_slot0_get (insn) == 20 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld3264llr_slot0_Slot_llr_slot0_get (insn) == 21 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_MOV_I;
+  if (Field_dsp340050b49a6c_fld3265llr_slot0_Slot_llr_slot0_get (insn) == 22 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_MOV_R;
+  if (Field_dsp340050b49a6c_fld3266llr_slot0_Slot_llr_slot0_get (insn) == 23 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld3267llr_slot0_Slot_llr_slot0_get (insn) == 24 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld3268llr_slot0_Slot_llr_slot0_get (insn) == 25 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld3269llr_slot0_Slot_llr_slot0_get (insn) == 26 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld3270llr_slot0_Slot_llr_slot0_get (insn) == 43 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_SET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld3272llr_slot0_Slot_llr_slot0_get (insn) == 283 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_LLR_POS;
+  if (Field_dsp340050b49a6c_fld3274llr_slot0_Slot_llr_slot0_get (insn) == 315 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_PERM_REG;
+  if (Field_dsp340050b49a6c_fld3275llr_slot0_Slot_llr_slot0_get (insn) == 347 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld3276llr_slot0_Slot_llr_slot0_get (insn) == 379 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_WGHT;
+  if (Field_dsp340050b49a6c_fld3277llr_slot0_Slot_llr_slot0_get (insn) == 411 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld3278llr_slot0_Slot_llr_slot0_get (insn) == 443 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld3279llr_slot0_Slot_llr_slot0_get (insn) == 475 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld3280llr_slot0_Slot_llr_slot0_get (insn) == 507 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld3281llr_slot0_Slot_llr_slot0_get (insn) == 44 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld3282llr_slot0_Slot_llr_slot0_get (insn) == 269 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld3283llr_slot0_Slot_llr_slot0_get (insn) == 301 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld3284llr_slot0_Slot_llr_slot0_get (insn) == 173 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld2041_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld3286llr_slot0_Slot_llr_slot0_get (insn) == 109 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3879llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld3288llr_slot0_Slot_llr_slot0_get (insn) == 30 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld2056_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld3289llr_slot0_Slot_llr_slot0_get (insn) == 135 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld3291llr_slot0_Slot_llr_slot0_get (insn) == 286 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld3292llr_slot0_Slot_llr_slot0_get (insn) == 287 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld3293llr_slot0_Slot_llr_slot0_get (insn) == 302 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld3294llr_slot0_Slot_llr_slot0_get (insn) == 303 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld3295llr_slot0_Slot_llr_slot0_get (insn) == 318 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld3296llr_slot0_Slot_llr_slot0_get (insn) == 319 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld3297llr_slot0_Slot_llr_slot0_get (insn) == 334 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld3298llr_slot0_Slot_llr_slot0_get (insn) == 335 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld3299llr_slot0_Slot_llr_slot0_get (insn) == 175 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld2047_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld3300llr_slot0_Slot_llr_slot0_get (insn) == 95 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3893llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld3302llr_slot0_Slot_llr_slot0_get (insn) == 31 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 7 &&
+      Field_dsp340050b49a6c_fld3883llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld3303llr_slot0_Slot_llr_slot0_get (insn) == 0 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8)
+    return OPCODE_SLL;
+  if (Field_dsp340050b49a6c_fld3304llr_slot0_Slot_llr_slot0_get (insn) == 1 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+      Field_dsp340050b49a6c_fld3887llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_SET_PERM_REG;
+  if (Field_dsp340050b49a6c_fld3305llr_slot0_Slot_llr_slot0_get (insn) == 17 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+      Field_dsp340050b49a6c_fld3887llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld3306llr_slot0_Slot_llr_slot0_get (insn) == 17 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+      Field_dsp340050b49a6c_fld3890llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_SET_WGHT;
+  if (Field_dsp340050b49a6c_fld3308llr_slot0_Slot_llr_slot0_get (insn) == 17 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+      Field_dsp340050b49a6c_fld3892llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_POP16LLR_1;
+  if (Field_dsp340050b49a6c_fld3310llr_slot0_Slot_llr_slot0_get (insn) == 1 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+      Field_dsp340050b49a6c_fld3888llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_SET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld3311llr_slot0_Slot_llr_slot0_get (insn) == 1 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+      Field_r_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_PUSH2X128_PQ;
+  if (Field_dsp340050b49a6c_fld3312llr_slot0_Slot_llr_slot0_get (insn) == 1 &&
+      Field_op0_s20_Slot_llr_slot0_get (insn) == 8 &&
+      Field_dsp340050b49a6c_fld3885llr_slot0_Slot_llr_slot0_get (insn) == 0)
+    return OPCODE_SET_LLR_POS;
+  switch (Field_op0_s20_Slot_llr_slot0_get (insn))
+    {
+    case 9:
+      return OPCODE_LCM_U;
+    case 10:
+      return OPCODE_SCM_U;
+    case 11:
+      return OPCODE_SLLI;
+    case 12:
+      return OPCODE_SRAI;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_dual_slot2_decode (const xtensa_insnbuf insn)
+{
+  if (Field_dsp340050b49a6c_fld2044_Slot_dual_slot2_get (insn) == 0 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+    return OPCODE_EXTUI;
+  if (Field_dsp340050b49a6c_fld2056_Slot_dual_slot2_get (insn) == 5 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3923dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_CLRTIEP;
+  if (Field_dsp340050b49a6c_fld3313dual_slot2_Slot_dual_slot2_get (insn) == 1 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BEQI;
+  if (Field_dsp340050b49a6c_fld3314_Slot_dual_slot2_get (insn) == 1 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3904dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BNEZ;
+  if (Field_dsp340050b49a6c_fld3315dual_slot2_Slot_dual_slot2_get (insn) == 17 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BLTUI;
+  if (Field_dsp340050b49a6c_fld3316dual_slot2_Slot_dual_slot2_get (insn) == 33 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BNEI;
+  if (Field_dsp340050b49a6c_fld3317dual_slot2_Slot_dual_slot2_get (insn) == 769 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ADD32;
+  switch (Field_dsp340050b49a6c_fld3318_Slot_dual_slot2_get (insn))
+    {
+    case 2:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_BEQZ;
+      break;
+    case 4:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_BGEZ;
+      break;
+    case 6:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+	  Field_s_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_ASRM;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3319dual_slot2_Slot_dual_slot2_get (insn) == 785 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ADDCM;
+  if (Field_dsp340050b49a6c_fld3320dual_slot2_Slot_dual_slot2_get (insn) == 801 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ADDWRP;
+  if (Field_dsp340050b49a6c_fld3321dual_slot2_Slot_dual_slot2_get (insn) == 817 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ASR;
+  if (Field_dsp340050b49a6c_fld3322dual_slot2_Slot_dual_slot2_get (insn) == 833 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_AND128;
+  if (Field_dsp340050b49a6c_fld3323dual_slot2_Slot_dual_slot2_get (insn) == 849 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_EXTUI4;
+  if (Field_dsp340050b49a6c_fld3324dual_slot2_Slot_dual_slot2_get (insn) == 865 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_LUT;
+  if (Field_dsp340050b49a6c_fld3325dual_slot2_Slot_dual_slot2_get (insn) == 881 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_LUT_IEXT;
+  if (Field_dsp340050b49a6c_fld3326dual_slot2_Slot_dual_slot2_get (insn) == 897 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ASL;
+  if (Field_dsp340050b49a6c_fld3327dual_slot2_Slot_dual_slot2_get (insn) == 913 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_LUT_REXT;
+  if (Field_dsp340050b49a6c_fld3328dual_slot2_Slot_dual_slot2_get (insn) == 929 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MAX8;
+  if (Field_dsp340050b49a6c_fld3329dual_slot2_Slot_dual_slot2_get (insn) == 945 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MEAN32;
+  if (Field_dsp340050b49a6c_fld3330dual_slot2_Slot_dual_slot2_get (insn) == 961 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MEAN;
+  if (Field_dsp340050b49a6c_fld3331dual_slot2_Slot_dual_slot2_get (insn) == 977 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MIN8;
+  if (Field_dsp340050b49a6c_fld3332dual_slot2_Slot_dual_slot2_get (insn) == 993 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_OR128;
+  if (Field_dsp340050b49a6c_fld3333dual_slot2_Slot_dual_slot2_get (insn) == 1009 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SUB32;
+  if (Field_dsp340050b49a6c_fld3334dual_slot2_Slot_dual_slot2_get (insn) == 2 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BGEI;
+  if (Field_dsp340050b49a6c_fld3335dual_slot2_Slot_dual_slot2_get (insn) == 3 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SUBCM;
+  if (Field_dsp340050b49a6c_fld3336dual_slot2_Slot_dual_slot2_get (insn) == 19 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_XOR128;
+  if (Field_dsp340050b49a6c_fld3337dual_slot2_Slot_dual_slot2_get (insn) == 560 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ABS8;
+  if (Field_dsp340050b49a6c_fld3339dual_slot2_Slot_dual_slot2_get (insn) == 561 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld3340dual_slot2_Slot_dual_slot2_get (insn) == 562 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_LUT_PHASOR;
+  if (Field_dsp340050b49a6c_fld3341dual_slot2_Slot_dual_slot2_get (insn) == 563 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_NCO_UPDATE;
+  if (Field_dsp340050b49a6c_fld3342dual_slot2_Slot_dual_slot2_get (insn) == 525 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_LUT_WRITE;
+  if (Field_dsp340050b49a6c_fld3345dual_slot2_Slot_dual_slot2_get (insn) == 9268 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld3347dual_slot2_Slot_dual_slot2_get (insn) == 9269 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SET_MAX;
+  if (Field_dsp340050b49a6c_fld3348dual_slot2_Slot_dual_slot2_get (insn) == 9270 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SET_NCO;
+  switch (Field_dsp340050b49a6c_fld3349dual_slot2_Slot_dual_slot2_get (insn))
+    {
+    case 132151:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_1;
+      break;
+    case 136247:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_2;
+      break;
+    case 140343:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_3;
+      break;
+    case 144439:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_0;
+      break;
+    case 148535:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_4;
+      break;
+    case 152631:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_1;
+      break;
+    case 156727:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_2;
+      break;
+    case 160823:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_3;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3350dual_slot2_Slot_dual_slot2_get (insn) == 42039 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3907dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_5;
+  if (Field_dsp340050b49a6c_fld3353dual_slot2_Slot_dual_slot2_get (insn) == 46135 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3907dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld3354dual_slot2_Slot_dual_slot2_get (insn) == 2381 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_s4_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld3356dual_slot2_Slot_dual_slot2_get (insn) == 1229 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3924dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_0;
+  if (Field_dsp340050b49a6c_fld3358dual_slot2_Slot_dual_slot2_get (insn) == 333 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3918dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SET_HSAR;
+  if (Field_dsp340050b49a6c_fld3360dual_slot2_Slot_dual_slot2_get (insn) == 568 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld3361dual_slot2_Slot_dual_slot2_get (insn) == 569 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld3362dual_slot2_Slot_dual_slot2_get (insn) == 570 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_NOT128;
+  if (Field_dsp340050b49a6c_fld3363dual_slot2_Slot_dual_slot2_get (insn) == 8251 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_CLRCM;
+  switch (Field_dsp340050b49a6c_fld3364_Slot_dual_slot2_get (insn))
+    {
+    case 52:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_ADD;
+      break;
+    case 53:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_ADDX2;
+      break;
+    case 54:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_ADDX4;
+      break;
+    case 55:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_ADDX8;
+      break;
+    case 56:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_ADDI_N;
+      break;
+    case 57:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_AND;
+      break;
+    case 58:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_ANDB;
+      break;
+    case 59:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_LUT_AR;
+      break;
+    case 60:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_CLAMPS;
+      break;
+    case 61:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MAX;
+      break;
+    case 62:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MAXU;
+      break;
+    case 63:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MIN;
+      break;
+    case 112:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MINU;
+      break;
+    case 113:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MOVEQZ;
+      break;
+    case 114:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MOVGEZ;
+      break;
+    case 115:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MOVT;
+      break;
+    case 116:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MOVLTZ;
+      break;
+    case 117:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_OR;
+      break;
+    case 118:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_ORB;
+      break;
+    case 119:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SEXT;
+      break;
+    case 120:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_MOVNEZ;
+      break;
+    case 121:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SRC;
+      break;
+    case 122:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SRLI;
+      break;
+    case 123:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SUBX2;
+      break;
+    case 124:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SUB;
+      break;
+    case 125:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SUBX4;
+      break;
+    case 126:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SUBX8;
+      break;
+    case 127:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_XOR;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3365dual_slot2_Slot_dual_slot2_get (insn) == 8507 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_GET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld3366dual_slot2_Slot_dual_slot2_get (insn) == 8763 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld3367dual_slot2_Slot_dual_slot2_get (insn) == 9019 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_GET_NCO;
+  if (Field_dsp340050b49a6c_fld3368dual_slot2_Slot_dual_slot2_get (insn) == 9275 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld3369dual_slot2_Slot_dual_slot2_get (insn) == 9531 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld3370dual_slot2_Slot_dual_slot2_get (insn) == 9787 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld3371dual_slot2_Slot_dual_slot2_get (insn) == 10043 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld3372dual_slot2_Slot_dual_slot2_get (insn) == 10299 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_GET_MAX;
+  if (Field_dsp340050b49a6c_fld3373dual_slot2_Slot_dual_slot2_get (insn) == 10555 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld3374dual_slot2_Slot_dual_slot2_get (insn) == 10811 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld3375dual_slot2_Slot_dual_slot2_get (insn) == 11067 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld3376dual_slot2_Slot_dual_slot2_get (insn) == 11323 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld3377dual_slot2_Slot_dual_slot2_get (insn) == 11579 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld3378dual_slot2_Slot_dual_slot2_get (insn) == 11835 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld3379dual_slot2_Slot_dual_slot2_get (insn) == 12091 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld3380dual_slot2_Slot_dual_slot2_get (insn) == 572 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_TRANS;
+  if (Field_dsp340050b49a6c_fld3381dual_slot2_Slot_dual_slot2_get (insn) == 573 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2046_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld3382dual_slot2_Slot_dual_slot2_get (insn) == 287 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3928dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_RDTIEP;
+  if (Field_dsp340050b49a6c_fld3384dual_slot2_Slot_dual_slot2_get (insn) == 771 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOVAR2;
+  if (Field_dsp340050b49a6c_fld3385dual_slot2_Slot_dual_slot2_get (insn) == 787 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SLL;
+  if (Field_dsp340050b49a6c_fld3386dual_slot2_Slot_dual_slot2_get (insn) == 803 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SWAPB;
+  switch (Field_dsp340050b49a6c_fld3387dual_slot2_Slot_dual_slot2_get (insn))
+    {
+    case 13059:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_SSA8L;
+      break;
+    case 13075:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_SSL;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3388dual_slot2_Slot_dual_slot2_get (insn) == 6547 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3913dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SSR;
+  if (Field_dsp340050b49a6c_fld3390dual_slot2_Slot_dual_slot2_get (insn) == 3283 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2049_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_WRTBSIGQ;
+  if (Field_dsp340050b49a6c_fld3392dual_slot2_Slot_dual_slot2_get (insn) == 1651 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3900_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_WRTSIGQ;
+  if (Field_dsp340050b49a6c_fld3394dual_slot2_Slot_dual_slot2_get (insn) == 211 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3920dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_AR2SAR_DUP;
+  if (Field_dsp340050b49a6c_fld3396dual_slot2_Slot_dual_slot2_get (insn) == 115 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3909dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SSA8B;
+  if (Field_dsp340050b49a6c_fld3397dual_slot2_Slot_dual_slot2_get (insn) == 19 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3919dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_AR2CM_DUP;
+  if (Field_dsp340050b49a6c_fld3399dual_slot2_Slot_dual_slot2_get (insn) == 19 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3931dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ARGMAX8;
+  if (Field_dsp340050b49a6c_fld3401dual_slot2_Slot_dual_slot2_get (insn) == 33 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3934dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SUBMEAN;
+  if (Field_dsp340050b49a6c_fld3403dual_slot2_Slot_dual_slot2_get (insn) == 41 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3922dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_PQ2CM;
+  if (Field_dsp340050b49a6c_fld3404dual_slot2_Slot_dual_slot2_get (insn) == 25 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3910dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SSAI;
+  if (Field_dsp340050b49a6c_fld3406dual_slot2_Slot_dual_slot2_get (insn) == 9 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3935dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SUBWRP;
+  if (Field_dsp340050b49a6c_fld3407_Slot_dual_slot2_get (insn) == 1 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3905dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOVI;
+  if (Field_dsp340050b49a6c_fld3408dual_slot2_Slot_dual_slot2_get (insn) == 1 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3901dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BGEUI;
+  if (Field_dsp340050b49a6c_fld3410_Slot_dual_slot2_get (insn) == 3 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3929dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SETTIEP;
+  if (Field_dsp340050b49a6c_fld3411dual_slot2_Slot_dual_slot2_get (insn) == 5 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3933dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ASLM32;
+  if (Field_dsp340050b49a6c_fld3412dual_slot2_Slot_dual_slot2_get (insn) == 18 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3927dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_QREADY;
+  if (Field_dsp340050b49a6c_fld3413dual_slot2_Slot_dual_slot2_get (insn) == 19 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3930dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_WRTBSIGQM;
+  if (Field_dsp340050b49a6c_fld3414dual_slot2_Slot_dual_slot2_get (insn) == 1 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_ADDMI;
+  if (Field_dsp340050b49a6c_fld3415dual_slot2_Slot_dual_slot2_get (insn) == 17 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BALL;
+  if (Field_dsp340050b49a6c_fld3416dual_slot2_Slot_dual_slot2_get (insn) == 33 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BANY;
+  if (Field_dsp340050b49a6c_fld3417dual_slot2_Slot_dual_slot2_get (insn) == 49 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BBC;
+  if (Field_dsp340050b49a6c_fld3418dual_slot2_Slot_dual_slot2_get (insn) == 1 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BBCI;
+  if (Field_dsp340050b49a6c_fld3419dual_slot2_Slot_dual_slot2_get (insn) == 18 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BBS;
+  if (Field_dsp340050b49a6c_fld3420dual_slot2_Slot_dual_slot2_get (insn) == 19 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BGE;
+  if (Field_dsp340050b49a6c_fld3421dual_slot2_Slot_dual_slot2_get (insn) == 34 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BEQ;
+  if (Field_dsp340050b49a6c_fld3422dual_slot2_Slot_dual_slot2_get (insn) == 35 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BGEU;
+  if (Field_dsp340050b49a6c_fld3423dual_slot2_Slot_dual_slot2_get (insn) == 50 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BLT;
+  if (Field_dsp340050b49a6c_fld3424dual_slot2_Slot_dual_slot2_get (insn) == 51 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BLTU;
+  if (Field_dsp340050b49a6c_fld3425dual_slot2_Slot_dual_slot2_get (insn) == 2 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BBSI;
+  if (Field_dsp340050b49a6c_fld3426dual_slot2_Slot_dual_slot2_get (insn) == 6 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BNALL;
+  if (Field_dsp340050b49a6c_fld3427dual_slot2_Slot_dual_slot2_get (insn) == 7 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_ASL32;
+  if (Field_dsp340050b49a6c_fld3428dual_slot2_Slot_dual_slot2_get (insn) == 23 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_ASR32;
+  if (Field_dsp340050b49a6c_fld3429dual_slot2_Slot_dual_slot2_get (insn) == 39 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_0;
+  if (Field_dsp340050b49a6c_fld3430dual_slot2_Slot_dual_slot2_get (insn) == 55 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_3;
+  if (Field_dsp340050b49a6c_fld3431dual_slot2_Slot_dual_slot2_get (insn) == 71 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_1;
+  if (Field_dsp340050b49a6c_fld3432dual_slot2_Slot_dual_slot2_get (insn) == 87 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_4;
+  if (Field_dsp340050b49a6c_fld3433dual_slot2_Slot_dual_slot2_get (insn) == 103 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_5;
+  if (Field_dsp340050b49a6c_fld3434dual_slot2_Slot_dual_slot2_get (insn) == 119 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_6;
+  if (Field_dsp340050b49a6c_fld3435dual_slot2_Slot_dual_slot2_get (insn) == 135 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_2;
+  if (Field_dsp340050b49a6c_fld3436dual_slot2_Slot_dual_slot2_get (insn) == 151 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND8_7;
+  if (Field_dsp340050b49a6c_fld3437dual_slot2_Slot_dual_slot2_get (insn) == 167 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_0;
+  if (Field_dsp340050b49a6c_fld3438dual_slot2_Slot_dual_slot2_get (insn) == 183 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_2;
+  if (Field_dsp340050b49a6c_fld3439dual_slot2_Slot_dual_slot2_get (insn) == 199 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_1;
+  if (Field_dsp340050b49a6c_fld3440dual_slot2_Slot_dual_slot2_get (insn) == 215 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_3;
+  if (Field_dsp340050b49a6c_fld3441dual_slot2_Slot_dual_slot2_get (insn) == 231 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_4;
+  if (Field_dsp340050b49a6c_fld3442dual_slot2_Slot_dual_slot2_get (insn) == 247 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_5;
+  if (Field_dsp340050b49a6c_fld3443dual_slot2_Slot_dual_slot2_get (insn) == 20 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BNE;
+  if (Field_dsp340050b49a6c_fld3444dual_slot2_Slot_dual_slot2_get (insn) == 261 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_6;
+  if (Field_dsp340050b49a6c_fld3445dual_slot2_Slot_dual_slot2_get (insn) == 277 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_PERM;
+  if (Field_dsp340050b49a6c_fld3446dual_slot2_Slot_dual_slot2_get (insn) == 1172 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_ADD16;
+  if (Field_dsp340050b49a6c_fld3448dual_slot2_Slot_dual_slot2_get (insn) == 2346 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3925dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld3450dual_slot2_Slot_dual_slot2_get (insn) == 2347 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2046_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ANY8;
+  if (Field_dsp340050b49a6c_fld3451dual_slot2_Slot_dual_slot2_get (insn) == 587 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3914dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ANY4;
+  switch (Field_dsp340050b49a6c_fld3453dual_slot2_Slot_dual_slot2_get (insn))
+    {
+    case 4869:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+	return OPCODE_NSA;
+      break;
+    case 4885:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+	return OPCODE_NSAU;
+      break;
+    case 4901:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+	return OPCODE_PUSH128_PQ;
+      break;
+    case 4917:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+	return OPCODE_SUBARX;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3454dual_slot2_Slot_dual_slot2_get (insn) == 2469 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3466_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_PUSH32;
+  if (Field_dsp340050b49a6c_fld3456dual_slot2_Slot_dual_slot2_get (insn) == 2485 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3466_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_WRTIEP;
+  if (Field_dsp340050b49a6c_fld3457dual_slot2_Slot_dual_slot2_get (insn) == 629 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3917dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SET_EXT_REGS;
+  if (Field_dsp340050b49a6c_fld3458dual_slot2_Slot_dual_slot2_get (insn) == 85 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3919dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ADDAR2;
+  if (Field_dsp340050b49a6c_fld3459dual_slot2_Slot_dual_slot2_get (insn) == 53 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3896dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOV_N;
+  if (Field_dsp340050b49a6c_fld3460dual_slot2_Slot_dual_slot2_get (insn) == 11 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3921dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_7;
+  if (Field_dsp340050b49a6c_fld3461dual_slot2_Slot_dual_slot2_get (insn) == 9 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2049_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BNONE;
+  if (Field_dsp340050b49a6c_fld3462dual_slot2_Slot_dual_slot2_get (insn) == 49 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3894dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_AR2CM_LN;
+  if (Field_dsp340050b49a6c_fld3464dual_slot2_Slot_dual_slot2_get (insn) == 53 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3894dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BEQZ_N;
+  if (Field_dsp340050b49a6c_fld3465dual_slot2_Slot_dual_slot2_get (insn) == 29 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3895dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BNEZ_N;
+  if (Field_dsp340050b49a6c_fld3467dual_slot2_Slot_dual_slot2_get (insn) == 1 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3899dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ADDI;
+  if (Field_dsp340050b49a6c_fld3468dual_slot2_Slot_dual_slot2_get (insn) == 3 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3897dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_MOVI_N;
+  switch (Field_dsp340050b49a6c_fld3469dual_slot2_Slot_dual_slot2_get (insn))
+    {
+    case 24:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SLLI;
+      break;
+    case 25:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+	return OPCODE_SRAI;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3470dual_slot2_Slot_dual_slot2_get (insn) == 80 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+    return OPCODE_ASLM;
+  if (Field_dsp340050b49a6c_fld3471dual_slot2_Slot_dual_slot2_get (insn) == 81 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+    return OPCODE_CMP8;
+  if (Field_dsp340050b49a6c_fld3472dual_slot2_Slot_dual_slot2_get (insn) == 82 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+    return OPCODE_CMP_I;
+  if (Field_dsp340050b49a6c_fld3473dual_slot2_Slot_dual_slot2_get (insn) == 83 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+    return OPCODE_LSRM;
+  if (Field_dsp340050b49a6c_fld3474dual_slot2_Slot_dual_slot2_get (insn) == 84 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2)
+    return OPCODE_CMP_R;
+  if (Field_dsp340050b49a6c_fld3475dual_slot2_Slot_dual_slot2_get (insn) == 325 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3898dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_ABS;
+  if (Field_dsp340050b49a6c_fld3477dual_slot2_Slot_dual_slot2_get (insn) == 341 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3898dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld3478dual_slot2_Slot_dual_slot2_get (insn) == 181 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3908dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_SRL;
+  if (Field_dsp340050b49a6c_fld3479dual_slot2_Slot_dual_slot2_get (insn) == 43 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3906dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld3480dual_slot2_Slot_dual_slot2_get (insn) == 22 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_s4_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_LSLM;
+  if (Field_dsp340050b49a6c_fld3481dual_slot2_Slot_dual_slot2_get (insn) == 23 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2046_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld3482dual_slot2_Slot_dual_slot2_get (insn) == 2 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3903dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_BLTZ;
+  if (Field_dsp340050b49a6c_fld3484dual_slot2_Slot_dual_slot2_get (insn) == 3 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3916dual_slot2_Slot_dual_slot2_get (insn) == 0)
+    return OPCODE_XORB;
+  if (Field_r_Slot_dual_slot2_get (insn) == 0 &&
+      Field_op0_s21_Slot_dual_slot2_get (insn) == 1)
+    return OPCODE_BITFINS;
+  switch (Field_t_Slot_dual_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_BITFEXT;
+      break;
+    case 8:
+      if (Field_op0_s21_Slot_dual_slot2_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld3314_Slot_dual_slot2_get (insn) == 0)
+	return OPCODE_BLTI;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_dual_slot0_decode (const xtensa_insnbuf insn)
+{
+  if (Field_dsp340050b49a6c_fld2056_Slot_dual_slot0_get (insn) == 3 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_imm8_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_MOVCM2PQ;
+  switch (Field_dsp340050b49a6c_fld2057_Slot_dual_slot0_get (insn))
+    {
+    case 2842:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_AR2CM_DUP;
+      break;
+    case 2843:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_MOV_N;
+      break;
+    case 2874:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_NSA;
+      break;
+    case 2906:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_NSAU;
+      break;
+    case 2970:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_PUSH128_PQ;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3487dual_slot0_Slot_dual_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BBCI;
+      break;
+    case 1:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BBSI;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3488dual_slot0_Slot_dual_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_EXTUI;
+      break;
+    case 3:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4 &&
+	  Field_sae_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_ULT_S;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3489dual_slot0_Slot_dual_slot0_get (insn))
+    {
+    case 2:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_BEQZ;
+      break;
+    case 3:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_BNEZ;
+      break;
+    case 4:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_BGEZ;
+      break;
+    case 5:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4 &&
+	  Field_dsp340050b49a6c_fld2079_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_ULE_S;
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_LSI;
+      break;
+    case 6:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_LSIU;
+      break;
+    case 7:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_MOVI;
+      break;
+    case 8:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_BLTZ;
+      break;
+    case 9:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SSI;
+      break;
+    case 10:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SSIU;
+      break;
+    case 14:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2037_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_LCM_U;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3490dual_slot0_Slot_dual_slot0_get (insn) == 88 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC32_R;
+  if (Field_dsp340050b49a6c_fld3491dual_slot0_Slot_dual_slot0_get (insn) == 177 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC_IH;
+  if (Field_dsp340050b49a6c_fld3492dual_slot0_Slot_dual_slot0_get (insn) == 185 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC_RL;
+  if (Field_dsp340050b49a6c_fld3493dual_slot0_Slot_dual_slot0_get (insn) == 178 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC_IL;
+  if (Field_dsp340050b49a6c_fld3494dual_slot0_Slot_dual_slot0_get (insn) == 355 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC2X64_0;
+  if (Field_dsp340050b49a6c_fld3496dual_slot0_Slot_dual_slot0_get (insn) == 371 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC2X64_2;
+  if (Field_dsp340050b49a6c_fld3497dual_slot0_Slot_dual_slot0_get (insn) == 362 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC2X64_1;
+  if (Field_dsp340050b49a6c_fld3498dual_slot0_Slot_dual_slot0_get (insn) == 363 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LAC2X64_3;
+  if (Field_dsp340050b49a6c_fld3499dual_slot0_Slot_dual_slot0_get (insn) == 5750 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld3500dual_slot0_Slot_dual_slot0_get (insn) == 11502 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_ANY4;
+  if (Field_dsp340050b49a6c_fld3502dual_slot0_Slot_dual_slot0_get (insn) == 23006 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_ANY8;
+  if (Field_dsp340050b49a6c_fld3504dual_slot0_Slot_dual_slot0_get (insn) == 23007 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld3505dual_slot0_Slot_dual_slot0_get (insn) == 11628 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_PUSH2X128_PQ;
+  switch (Field_dsp340050b49a6c_fld3506dual_slot0_Slot_dual_slot0_get (insn))
+    {
+    case 23258:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP128_2PQ_1;
+      break;
+    case 23259:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP128_2PQ_3;
+      break;
+    case 23260:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP128_2PQ_2;
+      break;
+    case 23261:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP128_2PQ_4;
+      break;
+    case 23262:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP128_2PQ_5;
+      break;
+    case 23263:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SSAI;
+      break;
+    case 23504:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP128_2PQ_0;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3507dual_slot0_Slot_dual_slot0_get (insn))
+    {
+    case 47010:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_01;
+      break;
+    case 47011:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_23;
+      break;
+    case 47012:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_03;
+      break;
+    case 47013:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_LLR_POS;
+      break;
+    case 47014:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_PERM_REG;
+      break;
+    case 47015:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_PHASOR_N;
+      break;
+    case 47016:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_21;
+      break;
+    case 47017:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_PHASOR_OFFSET;
+      break;
+    case 47018:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_SCALE_REG;
+      break;
+    case 47019:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_SOV;
+      break;
+    case 47020:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_SMOD_POS;
+      break;
+    case 47021:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SET_WGHT;
+      break;
+    case 47022:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SSA8B;
+      break;
+    case 47023:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SSA8L;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3508dual_slot0_Slot_dual_slot0_get (insn) == 47024 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld3509dual_slot0_Slot_dual_slot0_get (insn) == 47025 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld3510dual_slot0_Slot_dual_slot0_get (insn) == 47026 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld3511dual_slot0_Slot_dual_slot0_get (insn) == 47027 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld3512dual_slot0_Slot_dual_slot0_get (insn) == 47028 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld3513dual_slot0_Slot_dual_slot0_get (insn) == 47029 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld3514dual_slot0_Slot_dual_slot0_get (insn) == 47030 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld3515dual_slot0_Slot_dual_slot0_get (insn) == 47031 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld3516dual_slot0_Slot_dual_slot0_get (insn) == 47032 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld3517dual_slot0_Slot_dual_slot0_get (insn) == 47033 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld3518dual_slot0_Slot_dual_slot0_get (insn) == 23517 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_s8_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld3519dual_slot0_Slot_dual_slot0_get (insn) == 11759 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3939dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld3520dual_slot0_Slot_dual_slot0_get (insn) == 5942 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2056_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SSL;
+  if (Field_dsp340050b49a6c_fld3522dual_slot0_Slot_dual_slot0_get (insn) == 5943 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3950dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_POP16LLR_1;
+  if (Field_dsp340050b49a6c_fld3523dual_slot0_Slot_dual_slot0_get (insn) == 1501 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_bbi_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SSR;
+  if (Field_dsp340050b49a6c_fld3524dual_slot0_Slot_dual_slot0_get (insn) == 765 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3943dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_CLRAC;
+  if (Field_dsp340050b49a6c_fld3527dual_slot0_Slot_dual_slot0_get (insn) == 45 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2049_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_LAC_RH;
+  switch (Field_dsp340050b49a6c_fld3529dual_slot0_Slot_dual_slot0_get (insn))
+    {
+    case 707:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_AR2CM_LN;
+      break;
+    case 711:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_AR2CM_LN_I;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3530dual_slot0_Slot_dual_slot0_get (insn) == 359 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2072_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_AR2CM_LN_R;
+  switch (Field_dsp340050b49a6c_fld3531_Slot_dual_slot0_get (insn))
+    {
+    case 120:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SAC2X32;
+      break;
+    case 121:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SAC32_R;
+      break;
+    case 122:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SCM_PINC;
+      break;
+    case 123:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SLLI;
+      break;
+    case 124:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SCM_U;
+      break;
+    case 125:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_SRAI;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3532dual_slot0_Slot_dual_slot0_get (insn) == 183 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3602_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_BEQZ_N;
+  if (Field_dsp340050b49a6c_fld3533dual_slot0_Slot_dual_slot0_get (insn) == 95 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3936dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_BNEZ_N;
+  if (Field_dsp340050b49a6c_fld3535dual_slot0_Slot_dual_slot0_get (insn) == 48 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2066_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_LAC2X32;
+  if (Field_dsp340050b49a6c_fld3536dual_slot0_Slot_dual_slot0_get (insn) == 193 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2060_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_POP128_2M_0;
+  if (Field_dsp340050b49a6c_fld3537dual_slot0_Slot_dual_slot0_get (insn) == 197 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2060_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_POP128_2M_2;
+  if (Field_dsp340050b49a6c_fld3538dual_slot0_Slot_dual_slot0_get (insn) == 101 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3957dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_POP128_2M_3;
+  if (Field_dsp340050b49a6c_fld3539dual_slot0_Slot_dual_slot0_get (insn) == 25 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3954dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_POP128_2M_1;
+  if (Field_dsp340050b49a6c_fld3541dual_slot0_Slot_dual_slot0_get (insn) == 104 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LCM_PINC;
+  if (Field_dsp340050b49a6c_fld3542dual_slot0_Slot_dual_slot0_get (insn) == 105 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LP;
+  if (Field_dsp340050b49a6c_fld3543dual_slot0_Slot_dual_slot0_get (insn) == 106 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_LQ;
+  if (Field_dsp340050b49a6c_fld3544dual_slot0_Slot_dual_slot0_get (insn) == 3331 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_ABS;
+  if (Field_dsp340050b49a6c_fld3545dual_slot0_Slot_dual_slot0_get (insn) == 3339 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld3546dual_slot0_Slot_dual_slot0_get (insn) == 3347 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld3547dual_slot0_Slot_dual_slot0_get (insn) == 3355 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld3548dual_slot0_Slot_dual_slot0_get (insn) == 3363 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_MOV_I;
+  if (Field_dsp340050b49a6c_fld3549dual_slot0_Slot_dual_slot0_get (insn) == 3371 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_SRA;
+  if (Field_dsp340050b49a6c_fld3550dual_slot0_Slot_dual_slot0_get (insn) == 3379 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_SRL;
+  if (Field_dsp340050b49a6c_fld3551dual_slot0_Slot_dual_slot0_get (insn) == 6763 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_CLB_C;
+  switch (Field_dsp340050b49a6c_fld3552_Slot_dual_slot0_get (insn))
+    {
+    case 146:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_EXT;
+      break;
+    case 147:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_PUSH128_M;
+      break;
+    case 148:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_EXT_R;
+      break;
+    case 149:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SAC2X64_0;
+      break;
+    case 150:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SAC2X64_1;
+      break;
+    case 151:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SAC2X64_2;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3553dual_slot0_Slot_dual_slot0_get (insn) == 6779 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_CLB_R;
+  if (Field_dsp340050b49a6c_fld3554dual_slot0_Slot_dual_slot0_get (insn) == 3395 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_MOV_R;
+  if (Field_dsp340050b49a6c_fld3555dual_slot0_Slot_dual_slot0_get (insn) == 6795 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_MINCLB_C;
+  if (Field_dsp340050b49a6c_fld3556dual_slot0_Slot_dual_slot0_get (insn) == 6811 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_SMINCLB_C;
+  if (Field_dsp340050b49a6c_fld3557dual_slot0_Slot_dual_slot0_get (insn) == 6819 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_MINCLB_R;
+  if (Field_dsp340050b49a6c_fld3558dual_slot0_Slot_dual_slot0_get (insn) == 6835 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_SMINCLB_R;
+  if (Field_dsp340050b49a6c_fld3559dual_slot0_Slot_dual_slot0_get (insn) == 6827 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_SET_LLR_BUF;
+  if (Field_dsp340050b49a6c_fld3560dual_slot0_Slot_dual_slot0_get (insn) == 54555 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_INTERP_EXT_L;
+  if (Field_dsp340050b49a6c_fld3562dual_slot0_Slot_dual_slot0_get (insn) == 54587 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_INTERP_EXT_N;
+  if (Field_dsp340050b49a6c_fld3563dual_slot0_Slot_dual_slot0_get (insn) == 54619 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_LLR_POS;
+  if (Field_dsp340050b49a6c_fld3564dual_slot0_Slot_dual_slot0_get (insn) == 54651 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_PHASOR_N;
+  if (Field_dsp340050b49a6c_fld3565dual_slot0_Slot_dual_slot0_get (insn) == 54683 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_PERM_REG;
+  if (Field_dsp340050b49a6c_fld3566dual_slot0_Slot_dual_slot0_get (insn) == 54715 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_PHASOR_OFFSET;
+  if (Field_dsp340050b49a6c_fld3567dual_slot0_Slot_dual_slot0_get (insn) == 54747 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_SCALE_REG;
+  if (Field_dsp340050b49a6c_fld3568dual_slot0_Slot_dual_slot0_get (insn) == 54779 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_SMOD_POS;
+  if (Field_dsp340050b49a6c_fld3569dual_slot0_Slot_dual_slot0_get (insn) == 6851 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld3570dual_slot0_Slot_dual_slot0_get (insn) == 54795 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_SOV;
+  if (Field_dsp340050b49a6c_fld3571dual_slot0_Slot_dual_slot0_get (insn) == 54827 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld3572dual_slot0_Slot_dual_slot0_get (insn) == 54859 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld3573dual_slot0_Slot_dual_slot0_get (insn) == 54891 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld3574dual_slot0_Slot_dual_slot0_get (insn) == 54923 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld3575dual_slot0_Slot_dual_slot0_get (insn) == 54955 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_SET_SMOD_OFFSET_TABLE;
+  if (Field_dsp340050b49a6c_fld3576dual_slot0_Slot_dual_slot0_get (insn) == 109771 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_ADDAC_I2R;
+  if (Field_dsp340050b49a6c_fld3577dual_slot0_Slot_dual_slot0_get (insn) == 109803 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_ADDAC_R2I;
+  if (Field_dsp340050b49a6c_fld3578dual_slot0_Slot_dual_slot0_get (insn) == 110027 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_REDAC;
+  if (Field_dsp340050b49a6c_fld3579dual_slot0_Slot_dual_slot0_get (insn) == 110059 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_REDAC2;
+  if (Field_dsp340050b49a6c_fld3580dual_slot0_Slot_dual_slot0_get (insn) == 54803 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_GET_WGHT;
+  if (Field_dsp340050b49a6c_fld3581dual_slot0_Slot_dual_slot0_get (insn) == 54811 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3620dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_REDAC4;
+  if (Field_dsp340050b49a6c_fld3582dual_slot0_Slot_dual_slot0_get (insn) == 27419 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3959dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_REDACS;
+  if (Field_dsp340050b49a6c_fld3583dual_slot0_Slot_dual_slot0_get (insn) == 13723 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3960dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SUBAC_I2R;
+  switch (Field_dsp340050b49a6c_fld3584_Slot_dual_slot0_get (insn))
+    {
+    case 2:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3937dual_slot0_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BLTUI;
+      break;
+    case 3:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3552_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_ASLACM;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3585dual_slot0_Slot_dual_slot0_get (insn) == 6875 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3961dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SUBAC_R2I;
+  if (Field_dsp340050b49a6c_fld3587dual_slot0_Slot_dual_slot0_get (insn) == 1723 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3610_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld3588dual_slot0_Slot_dual_slot0_get (insn) == 219 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3938dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_NEG;
+  if (Field_dsp340050b49a6c_fld3589dual_slot0_Slot_dual_slot0_get (insn) == 106 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_s8_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_LCM;
+  if (Field_dsp340050b49a6c_fld3590dual_slot0_Slot_dual_slot0_get (insn) == 3331 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT32_I;
+  if (Field_dsp340050b49a6c_fld3591dual_slot0_Slot_dual_slot0_get (insn) == 3335 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT32_R;
+  if (Field_dsp340050b49a6c_fld3592dual_slot0_Slot_dual_slot0_get (insn) == 3339 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT_2FIFO_0;
+  if (Field_dsp340050b49a6c_fld3593dual_slot0_Slot_dual_slot0_get (insn) == 3343 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT_R2FIFO_0;
+  if (Field_dsp340050b49a6c_fld3594dual_slot0_Slot_dual_slot0_get (insn) == 3363 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT_2FIFO_1;
+  if (Field_dsp340050b49a6c_fld3595dual_slot0_Slot_dual_slot0_get (insn) == 3367 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT_R2FIFO_1;
+  if (Field_dsp340050b49a6c_fld3596dual_slot0_Slot_dual_slot0_get (insn) == 3371 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT_R2FIFO_2;
+  if (Field_dsp340050b49a6c_fld3597dual_slot0_Slot_dual_slot0_get (insn) == 3375 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+    return OPCODE_EXT_R2FIFO_3;
+  if (Field_dsp340050b49a6c_fld3598dual_slot0_Slot_dual_slot0_get (insn) == 851 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3951dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_2;
+  if (Field_dsp340050b49a6c_fld3599dual_slot0_Slot_dual_slot0_get (insn) == 855 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3941dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SET_SMOD_BUF;
+  if (Field_dsp340050b49a6c_fld3600dual_slot0_Slot_dual_slot0_get (insn) == 219 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3952dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_EXT_2FIFO_3;
+  if (Field_dsp340050b49a6c_fld3601dual_slot0_Slot_dual_slot0_get (insn) == 213 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3945dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  if (Field_dsp340050b49a6c_fld3603dual_slot0_Slot_dual_slot0_get (insn) == 215 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3945dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN_I;
+  if (Field_dsp340050b49a6c_fld3604dual_slot0_Slot_dual_slot0_get (insn) == 111 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3946dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_CM2AR_LN_R;
+  if (Field_dsp340050b49a6c_fld3606dual_slot0_Slot_dual_slot0_get (insn) == 5 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+    return OPCODE_ABS_S;
+  if (Field_dsp340050b49a6c_fld3607dual_slot0_Slot_dual_slot0_get (insn) == 21 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+    return OPCODE_MOV_S;
+  if (Field_dsp340050b49a6c_fld3608dual_slot0_Slot_dual_slot0_get (insn) == 37 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+    return OPCODE_NEG_S;
+  if (Field_dsp340050b49a6c_fld3609dual_slot0_Slot_dual_slot0_get (insn) == 106 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3620dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_MOVAC;
+  if (Field_dsp340050b49a6c_fld3611dual_slot0_Slot_dual_slot0_get (insn) == 107 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3620dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SWAPAC_RI;
+  if (Field_dsp340050b49a6c_fld3612dual_slot0_Slot_dual_slot0_get (insn) == 21 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3602_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_PUSH32;
+  if (Field_dsp340050b49a6c_fld3613dual_slot0_Slot_dual_slot0_get (insn) == 21 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3936dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_RFR;
+  if (Field_dsp340050b49a6c_fld3614dual_slot0_Slot_dual_slot0_get (insn) == 21 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2079_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SLL;
+  if (Field_dsp340050b49a6c_fld3615dual_slot0_Slot_dual_slot0_get (insn) == 21 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3958dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_ASRAC;
+  if (Field_dsp340050b49a6c_fld3616dual_slot0_Slot_dual_slot0_get (insn) == 21 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3947dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_MOV2AC32_I;
+  if (Field_dsp340050b49a6c_fld3618dual_slot0_Slot_dual_slot0_get (insn) == 21 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3949dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_MOV2AC32_R;
+  if (Field_dsp340050b49a6c_fld3619_Slot_dual_slot0_get (insn) == 1 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 4 &&
+      Field_dsp340050b49a6c_fld3940dual_slot0_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_FLOOR_S;
+  if (Field_dsp340050b49a6c_fld3620dual_slot0_Slot_dual_slot0_get (insn) == 1 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 3 &&
+      Field_dsp340050b49a6c_fld2048_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_L32I;
+  if (Field_dsp340050b49a6c_fld3621dual_slot0_Slot_dual_slot0_get (insn) == 42 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+    return OPCODE_SAC_IH;
+  if (Field_dsp340050b49a6c_fld3622dual_slot0_Slot_dual_slot0_get (insn) == 43 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+    return OPCODE_SAC_RH;
+  if (Field_dsp340050b49a6c_fld3623dual_slot0_Slot_dual_slot0_get (insn) == 44 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+    return OPCODE_SAC_IL;
+  if (Field_dsp340050b49a6c_fld3624dual_slot0_Slot_dual_slot0_get (insn) == 45 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+    return OPCODE_SAC_RL;
+  if (Field_dsp340050b49a6c_fld3625dual_slot0_Slot_dual_slot0_get (insn) == 38 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 4 &&
+      Field_dsp340050b49a6c_fld3602_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_MOVI_N;
+  if (Field_dsp340050b49a6c_fld3626dual_slot0_Slot_dual_slot0_get (insn) == 39 &&
+      Field_op0_s23_Slot_dual_slot0_get (insn) == 4 &&
+      Field_dsp340050b49a6c_fld3602_Slot_dual_slot0_get (insn) == 0)
+    return OPCODE_SAC2X64_3;
+  switch (Field_imm8_Slot_dual_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_ADDX4;
+      break;
+    case 1:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_ADDX8;
+      break;
+    case 2:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_AND;
+      break;
+    case 3:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_L32I_N;
+      break;
+    case 4:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_ANDB;
+      break;
+    case 5:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LCM_PINC_X;
+      break;
+    case 6:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LCM_X;
+      break;
+    case 7:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LCM_XU;
+      break;
+    case 8:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_CEIL_S;
+      break;
+    case 9:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LP_X;
+      break;
+    case 10:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LQ_X;
+      break;
+    case 11:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LUT0;
+      break;
+    case 12:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LSXU;
+      break;
+    case 13:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LUT1;
+      break;
+    case 14:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LUT2;
+      break;
+    case 15:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_LUT3;
+      break;
+    case 16:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_CLAMPS;
+      break;
+    case 17:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MADD_S;
+      break;
+    case 18:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MAX;
+      break;
+    case 19:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MINU;
+      break;
+    case 20:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MAXU;
+      break;
+    case 21:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVEQZ;
+      break;
+    case 22:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVEQZ_S;
+      break;
+    case 23:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVF_S;
+      break;
+    case 24:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MIN;
+      break;
+    case 25:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVGEZ;
+      break;
+    case 26:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVGEZ_S;
+      break;
+    case 27:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVLTZ_S;
+      break;
+    case 28:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVLTZ;
+      break;
+    case 29:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVNEZ;
+      break;
+    case 30:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVNEZ_S;
+      break;
+    case 31:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVT;
+      break;
+    case 32:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_COMB_AR;
+      break;
+    case 33:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MOVT_S;
+      break;
+    case 34:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MSUB_S;
+      break;
+    case 35:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_OLT_S;
+      break;
+    case 36:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_MUL_S;
+      break;
+    case 37:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_OR;
+      break;
+    case 38:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_ORB;
+      break;
+    case 39:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_ROUND_S;
+      break;
+    case 40:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_OEQ_S;
+      break;
+    case 41:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_S32I_N;
+      break;
+    case 46:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SCM;
+      break;
+    case 47:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SCM_PINC_X;
+      break;
+    case 48:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_OLE_S;
+      break;
+    case 49:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SCM_X;
+      break;
+    case 50:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SCM_XU;
+      break;
+    case 51:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SRLI;
+      break;
+    case 52:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SEXT;
+      break;
+    case 53:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SSX;
+      break;
+    case 54:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SSXU;
+      break;
+    case 55:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_STORE_P;
+      break;
+    case 56:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SRC;
+      break;
+    case 57:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_STORE_Q;
+      break;
+    case 58:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_STSWAPBM;
+      break;
+    case 59:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SUB;
+      break;
+    case 60:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_STSWAPBMU;
+      break;
+    case 61:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SUB_S;
+      break;
+    case 62:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SUBX2;
+      break;
+    case 63:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SUBX4;
+      break;
+    case 64:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_FLOAT_S;
+      break;
+    case 65:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_SUBX8;
+      break;
+    case 66:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_TRUNC_S;
+      break;
+    case 67:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_UN_S;
+      break;
+    case 68:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_UEQ_S;
+      break;
+    case 69:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_UTRUNC_S;
+      break;
+    case 70:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_XOR;
+      break;
+    case 71:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_XORB;
+      break;
+    case 72:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 4)
+	return OPCODE_UFLOAT_S;
+      break;
+    case 252:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_ADD;
+      break;
+    case 253:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_ADD_S;
+      break;
+    case 254:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_ADDI_N;
+      break;
+    case 255:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 1)
+	return OPCODE_ADDX2;
+      break;
+    }
+  if (Field_op0_s23_Slot_dual_slot0_get (insn) == 5)
+    return OPCODE_L32R;
+  switch (Field_r_Slot_dual_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_BNE;
+      break;
+    case 1:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_BNONE;
+      break;
+    case 2:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_L16SI;
+      break;
+    case 3:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_L8UI;
+      break;
+    case 4:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_ADDI;
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_L16UI;
+      break;
+    case 5:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BALL;
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_S16I;
+      break;
+    case 6:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BANY;
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_S32I;
+      break;
+    case 7:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BBC;
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 3)
+	return OPCODE_S8I;
+      break;
+    case 8:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_ADDMI;
+      break;
+    case 9:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BBS;
+      break;
+    case 10:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BEQ;
+      break;
+    case 11:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BGEU;
+      break;
+    case 12:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BGE;
+      break;
+    case 13:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BLT;
+      break;
+    case 14:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BLTU;
+      break;
+    case 15:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 0)
+	return OPCODE_BNALL;
+      break;
+    }
+  switch (Field_t_Slot_dual_slot0_get (insn))
+    {
+    case 0:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+	return OPCODE_BEQI;
+      break;
+    case 1:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+	return OPCODE_BGEI;
+      break;
+    case 2:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+	return OPCODE_BGEUI;
+      break;
+    case 3:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+	return OPCODE_BNEI;
+      break;
+    case 4:
+      if (Field_op0_s23_Slot_dual_slot0_get (insn) == 2)
+	return OPCODE_BLTI;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_gp_slot1_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2394gp_slot1_Slot_gp_slot1_get (insn))
+    {
+    case 0:
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 0)
+	return OPCODE_CMAC;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 1)
+	return OPCODE_CMPY;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 2)
+	return OPCODE_MAC;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 3)
+	return OPCODE_MACS;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 4)
+	return OPCODE_MACXP_1;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 5)
+	return OPCODE_MACXP_3;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 6)
+	return OPCODE_MPY8;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 7)
+	return OPCODE_MPYXP_0;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 8)
+	return OPCODE_MPYXP_2;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 9)
+	return OPCODE_NORMACD;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 10)
+	return OPCODE_RCMAC;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 11)
+	return OPCODE_RMAC;
+      break;
+    case 1:
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 0)
+	return OPCODE_CMACS;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 1)
+	return OPCODE_CMPYS;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 2)
+	return OPCODE_MAC8;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 3)
+	return OPCODE_MACXP_0;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 4)
+	return OPCODE_MACXP_2;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 5)
+	return OPCODE_MPY;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 6)
+	return OPCODE_MPYS;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 7)
+	return OPCODE_MPYXP_1;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 8)
+	return OPCODE_MPYXP_3;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 9)
+	return OPCODE_NORMD;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 10)
+	return OPCODE_RCMPY;
+      if (Field_op0_s4_Slot_gp_slot1_get (insn) == 11)
+	return OPCODE_RMPY;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2395gp_slot1_Slot_gp_slot1_get (insn) == 0 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12)
+    return OPCODE_ADD2AC;
+  if (Field_dsp340050b49a6c_fld2397gp_slot1_Slot_gp_slot1_get (insn) == 1 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12)
+    return OPCODE_MOV2AC;
+  if (Field_dsp340050b49a6c_fld2398gp_slot1_Slot_gp_slot1_get (insn) == 2 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12)
+    return OPCODE_SUB2AC;
+  if (Field_dsp340050b49a6c_fld2399gp_slot1_Slot_gp_slot1_get (insn) == 3 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12 &&
+      Field_dsp340050b49a6c_fld3681gp_slot1_Slot_gp_slot1_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2400gp_slot1_Slot_gp_slot1_get (insn) == 8 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12 &&
+      Field_dsp340050b49a6c_fld3683gp_slot1_Slot_gp_slot1_get (insn) == 0)
+    return OPCODE_NORMACPQ_I;
+  if (Field_dsp340050b49a6c_fld2402gp_slot1_Slot_gp_slot1_get (insn) == 9 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12 &&
+      Field_dsp340050b49a6c_fld3683gp_slot1_Slot_gp_slot1_get (insn) == 0)
+    return OPCODE_NORMACPQ_R;
+  if (Field_dsp340050b49a6c_fld2403gp_slot1_Slot_gp_slot1_get (insn) == 5 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12 &&
+      Field_dsp340050b49a6c_fld3684gp_slot1_Slot_gp_slot1_get (insn) == 0)
+    return OPCODE_NORMPYPQ_I;
+  if (Field_dsp340050b49a6c_fld2405gp_slot1_Slot_gp_slot1_get (insn) == 3 &&
+      Field_op0_s4_Slot_gp_slot1_get (insn) == 12 &&
+      Field_dsp340050b49a6c_fld3686gp_slot1_Slot_gp_slot1_get (insn) == 0)
+    return OPCODE_NORMPYPQ_R;
+  switch (Field_op0_s4_Slot_gp_slot1_get (insn))
+    {
+    case 13:
+      return OPCODE_CMPY2CM;
+    case 14:
+      return OPCODE_LIN_INT;
+    case 15:
+      return OPCODE_MPY2CM;
+    case 16:
+      return OPCODE_MPYADD8_2CM;
+    case 17:
+      return OPCODE_RCMPY2CM;
+    case 18:
+      return OPCODE_RMPY2CM;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_dot_slot2_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2049_Slot_dot_slot2_get (insn))
+    {
+    case 2:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+	  Field_t_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_OR128;
+      break;
+    case 3:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2029_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_PERM;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2532dot_slot2_Slot_dot_slot2_get (insn) == 0 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ADD32;
+  if (Field_dsp340050b49a6c_fld2533dot_slot2_Slot_dot_slot2_get (insn) == 1 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ADDCM;
+  if (Field_dsp340050b49a6c_fld2534dot_slot2_Slot_dot_slot2_get (insn) == 2 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ADDWRP;
+  if (Field_dsp340050b49a6c_fld2535dot_slot2_Slot_dot_slot2_get (insn) == 3 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ASR;
+  if (Field_dsp340050b49a6c_fld2536dot_slot2_Slot_dot_slot2_get (insn) == 4 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_AND128;
+  if (Field_dsp340050b49a6c_fld2537dot_slot2_Slot_dot_slot2_get (insn) == 5 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ASR32;
+  if (Field_dsp340050b49a6c_fld2538dot_slot2_Slot_dot_slot2_get (insn) == 6 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_EXTUI4;
+  if (Field_dsp340050b49a6c_fld2539dot_slot2_Slot_dot_slot2_get (insn) == 7 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_LUT;
+  if (Field_dsp340050b49a6c_fld2540dot_slot2_Slot_dot_slot2_get (insn) == 8 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ASL;
+  if (Field_dsp340050b49a6c_fld2541dot_slot2_Slot_dot_slot2_get (insn) == 9 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_LUT_IEXT;
+  if (Field_dsp340050b49a6c_fld2542dot_slot2_Slot_dot_slot2_get (insn) == 10 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_LUT_REXT;
+  if (Field_dsp340050b49a6c_fld2543dot_slot2_Slot_dot_slot2_get (insn) == 11 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MEAN;
+  if (Field_dsp340050b49a6c_fld2544dot_slot2_Slot_dot_slot2_get (insn) == 12 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MAX8;
+  if (Field_dsp340050b49a6c_fld2545dot_slot2_Slot_dot_slot2_get (insn) == 13 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MEAN32;
+  if (Field_dsp340050b49a6c_fld2546dot_slot2_Slot_dot_slot2_get (insn) == 14 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MIN8;
+  if (Field_dsp340050b49a6c_fld2547dot_slot2_Slot_dot_slot2_get (insn) == 15 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOV2CM2PQ;
+  if (Field_dsp340050b49a6c_fld2548dot_slot2_Slot_dot_slot2_get (insn) == 16 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ASL32;
+  if (Field_dsp340050b49a6c_fld2549dot_slot2_Slot_dot_slot2_get (insn) == 17 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_0;
+  if (Field_dsp340050b49a6c_fld2550dot_slot2_Slot_dot_slot2_get (insn) == 18 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_1;
+  if (Field_dsp340050b49a6c_fld2551dot_slot2_Slot_dot_slot2_get (insn) == 19 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_4;
+  if (Field_dsp340050b49a6c_fld2552dot_slot2_Slot_dot_slot2_get (insn) == 20 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_2;
+  if (Field_dsp340050b49a6c_fld2553dot_slot2_Slot_dot_slot2_get (insn) == 21 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_5;
+  if (Field_dsp340050b49a6c_fld2554dot_slot2_Slot_dot_slot2_get (insn) == 22 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_6;
+  if (Field_dsp340050b49a6c_fld2555dot_slot2_Slot_dot_slot2_get (insn) == 23 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_7;
+  if (Field_dsp340050b49a6c_fld2556dot_slot2_Slot_dot_slot2_get (insn) == 24 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_3;
+  if (Field_dsp340050b49a6c_fld2557dot_slot2_Slot_dot_slot2_get (insn) == 25 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_0;
+  if (Field_dsp340050b49a6c_fld2558dot_slot2_Slot_dot_slot2_get (insn) == 26 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_1;
+  if (Field_dsp340050b49a6c_fld2559dot_slot2_Slot_dot_slot2_get (insn) == 27 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_3;
+  if (Field_dsp340050b49a6c_fld2560dot_slot2_Slot_dot_slot2_get (insn) == 28 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_2;
+  if (Field_dsp340050b49a6c_fld2561dot_slot2_Slot_dot_slot2_get (insn) == 29 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_4;
+  if (Field_dsp340050b49a6c_fld2562dot_slot2_Slot_dot_slot2_get (insn) == 30 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_5;
+  if (Field_dsp340050b49a6c_fld2563dot_slot2_Slot_dot_slot2_get (insn) == 31 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_6;
+  if (Field_dsp340050b49a6c_fld2564dot_slot2_Slot_dot_slot2_get (insn) == 32 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ASLM;
+  if (Field_dsp340050b49a6c_fld2565dot_slot2_Slot_dot_slot2_get (insn) == 33 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ASRM;
+  if (Field_dsp340050b49a6c_fld2566dot_slot2_Slot_dot_slot2_get (insn) == 34 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_CMP8;
+  if (Field_dsp340050b49a6c_fld2567dot_slot2_Slot_dot_slot2_get (insn) == 35 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_LSRM;
+  if (Field_dsp340050b49a6c_fld2568dot_slot2_Slot_dot_slot2_get (insn) == 36 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_CMP_I;
+  if (Field_dsp340050b49a6c_fld2569dot_slot2_Slot_dot_slot2_get (insn) == 517 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ABS8;
+  if (Field_dsp340050b49a6c_fld2571dot_slot2_Slot_dot_slot2_get (insn) == 533 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld2572dot_slot2_Slot_dot_slot2_get (insn) == 549 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_LUT_PHASOR;
+  if (Field_dsp340050b49a6c_fld2573dot_slot2_Slot_dot_slot2_get (insn) == 565 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld2574dot_slot2_Slot_dot_slot2_get (insn) == 581 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld2575dot_slot2_Slot_dot_slot2_get (insn) == 597 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_NOT128;
+  if (Field_dsp340050b49a6c_fld2576dot_slot2_Slot_dot_slot2_get (insn) == 613 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_TRANS;
+  if (Field_dsp340050b49a6c_fld2577dot_slot2_Slot_dot_slot2_get (insn) == 629 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2578_Slot_dot_slot2_get (insn) == 0 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+    return OPCODE_LUT_AR;
+  if (Field_dsp340050b49a6c_fld2579dot_slot2_Slot_dot_slot2_get (insn) == 1653 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_GET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2580dot_slot2_Slot_dot_slot2_get (insn) == 2677 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld2581dot_slot2_Slot_dot_slot2_get (insn) == 3701 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_GET_NCO;
+  if (Field_dsp340050b49a6c_fld2582dot_slot2_Slot_dot_slot2_get (insn) == 4725 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld2583dot_slot2_Slot_dot_slot2_get (insn) == 5749 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld2584dot_slot2_Slot_dot_slot2_get (insn) == 6773 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2585dot_slot2_Slot_dot_slot2_get (insn) == 7797 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2586dot_slot2_Slot_dot_slot2_get (insn) == 8821 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_GET_MAX;
+  if (Field_dsp340050b49a6c_fld2587dot_slot2_Slot_dot_slot2_get (insn) == 9845 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2588dot_slot2_Slot_dot_slot2_get (insn) == 10869 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2589dot_slot2_Slot_dot_slot2_get (insn) == 11893 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2590dot_slot2_Slot_dot_slot2_get (insn) == 12917 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_4;
+  switch (Field_dsp340050b49a6c_fld2591dot_slot2_Slot_dot_slot2_get (insn))
+    {
+    case 221301:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_0;
+      break;
+    case 221557:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_2;
+      break;
+    case 221813:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_3;
+      break;
+    case 222069:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_0;
+      break;
+    case 222325:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_4;
+      break;
+    case 222581:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_1;
+      break;
+    case 222837:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_2;
+      break;
+    case 223093:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_3;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2592dot_slot2_Slot_dot_slot2_get (insn) == 55925 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3708dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_5;
+  if (Field_dsp340050b49a6c_fld2595dot_slot2_Slot_dot_slot2_get (insn) == 56181 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3708dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld2596dot_slot2_Slot_dot_slot2_get (insn) == 7797 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3724dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_1;
+  if (Field_dsp340050b49a6c_fld2598dot_slot2_Slot_dot_slot2_get (insn) == 645 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_NCO_UPDATE;
+  if (Field_dsp340050b49a6c_fld2599dot_slot2_Slot_dot_slot2_get (insn) == 2197 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3709dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_SET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld2601dot_slot2_Slot_dot_slot2_get (insn) == 2453 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3709dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_SET_NCO;
+  if (Field_dsp340050b49a6c_fld2602dot_slot2_Slot_dot_slot2_get (insn) == 1429 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3713dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld2604dot_slot2_Slot_dot_slot2_get (insn) == 341 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3710dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_SET_HSAR;
+  if (Field_dsp340050b49a6c_fld2606dot_slot2_Slot_dot_slot2_get (insn) == 181 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3711dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_SET_MAX;
+  if (Field_dsp340050b49a6c_fld2608dot_slot2_Slot_dot_slot2_get (insn) == 19 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_0;
+  if (Field_dsp340050b49a6c_fld2609dot_slot2_Slot_dot_slot2_get (insn) == 51 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_1;
+  if (Field_dsp340050b49a6c_fld2610dot_slot2_Slot_dot_slot2_get (insn) == 83 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_2;
+  if (Field_dsp340050b49a6c_fld2611dot_slot2_Slot_dot_slot2_get (insn) == 899 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_PUSH2X128_PQ;
+  if (Field_dsp340050b49a6c_fld2612_Slot_dot_slot2_get (insn) == 32 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+    return OPCODE_QREADY;
+  if (Field_dsp340050b49a6c_fld2613dot_slot2_Slot_dot_slot2_get (insn) == 1811 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_0;
+  switch (Field_dsp340050b49a6c_fld2614_Slot_dot_slot2_get (insn))
+    {
+    case 66:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_MOVPQ2PQ;
+      break;
+    case 67:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_SET_EXT_REGS;
+      break;
+    case 68:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_PUSH128_PQ;
+      break;
+    case 69:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_SUBARX;
+      break;
+    case 70:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_SWAPB;
+      break;
+    case 71:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_WRTIEP;
+      break;
+    case 72:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_PUSH32;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2615dot_slot2_Slot_dot_slot2_get (insn) == 1819 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_3;
+  if (Field_dsp340050b49a6c_fld2616dot_slot2_Slot_dot_slot2_get (insn) == 1827 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_1;
+  if (Field_dsp340050b49a6c_fld2617dot_slot2_Slot_dot_slot2_get (insn) == 1835 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_4;
+  if (Field_dsp340050b49a6c_fld2618dot_slot2_Slot_dot_slot2_get (insn) == 1843 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_5;
+  if (Field_dsp340050b49a6c_fld2619dot_slot2_Slot_dot_slot2_get (insn) == 3702 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld2620dot_slot2_Slot_dot_slot2_get (insn) == 3703 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2621dot_slot2_Slot_dot_slot2_get (insn) == 1859 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_2;
+  if (Field_dsp340050b49a6c_fld2622dot_slot2_Slot_dot_slot2_get (insn) == 1867 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2047_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2623dot_slot2_Slot_dot_slot2_get (insn) == 939 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3727dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld2624dot_slot2_Slot_dot_slot2_get (insn) == 475 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3729dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_RDTIEP;
+  if (Field_dsp340050b49a6c_fld2625_Slot_dot_slot2_get (insn) == 19 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3731dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_SETTIEP;
+  if (Field_dsp340050b49a6c_fld2626dot_slot2_Slot_dot_slot2_get (insn) == 51 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3715_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_3;
+  if (Field_dsp340050b49a6c_fld2628dot_slot2_Slot_dot_slot2_get (insn) == 51 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3722_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_PQ2CM;
+  if (Field_dsp340050b49a6c_fld2630dot_slot2_Slot_dot_slot2_get (insn) == 10 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2032_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_CMP_R;
+  if (Field_dsp340050b49a6c_fld2632dot_slot2_Slot_dot_slot2_get (insn) == 11 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_t_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ADD16;
+  if (Field_dsp340050b49a6c_fld2633dot_slot2_Slot_dot_slot2_get (insn) == 6 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3733dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_LSLM;
+  if (Field_dsp340050b49a6c_fld2635dot_slot2_Slot_dot_slot2_get (insn) == 7 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3719dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  switch (Field_dsp340050b49a6c_fld2636dot_slot2_Slot_dot_slot2_get (insn))
+    {
+    case 1168:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_AR2SAR_DUP;
+      break;
+    case 1169:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_01;
+      break;
+    case 1170:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_03;
+      break;
+    case 1171:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+	return OPCODE_WRTBSIGQ;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2637dot_slot2_Slot_dot_slot2_get (insn) == 586 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3725dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_21;
+  if (Field_dsp340050b49a6c_fld2640dot_slot2_Slot_dot_slot2_get (insn) == 587 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3725dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_WRTSIGQ;
+  if (Field_dsp340050b49a6c_fld2641dot_slot2_Slot_dot_slot2_get (insn) == 147 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3726dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_23;
+  if (Field_dsp340050b49a6c_fld2642dot_slot2_Slot_dot_slot2_get (insn) == 74 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2605_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_CLRTIEP;
+  if (Field_dsp340050b49a6c_fld2643dot_slot2_Slot_dot_slot2_get (insn) == 75 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2605_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_WRTBSIGQM;
+  if (Field_dsp340050b49a6c_fld2644dot_slot2_Slot_dot_slot2_get (insn) == 4 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3732dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ADDAR2;
+  if (Field_dsp340050b49a6c_fld2645dot_slot2_Slot_dot_slot2_get (insn) == 4 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3714dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_AR2CM_DUP;
+  if (Field_dsp340050b49a6c_fld2646dot_slot2_Slot_dot_slot2_get (insn) == 4 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3721dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVAR2;
+  if (Field_dsp340050b49a6c_fld2647dot_slot2_Slot_dot_slot2_get (insn) == 16 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_7;
+  if (Field_dsp340050b49a6c_fld2648dot_slot2_Slot_dot_slot2_get (insn) == 17 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+    return OPCODE_SUB32;
+  if (Field_dsp340050b49a6c_fld2649dot_slot2_Slot_dot_slot2_get (insn) == 18 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+    return OPCODE_SUBCM;
+  if (Field_dsp340050b49a6c_fld2650dot_slot2_Slot_dot_slot2_get (insn) == 19 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+    return OPCODE_XOR128;
+  if (Field_dsp340050b49a6c_fld2651dot_slot2_Slot_dot_slot2_get (insn) == 20 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1)
+    return OPCODE_SUBMEAN;
+  if (Field_dsp340050b49a6c_fld2652dot_slot2_Slot_dot_slot2_get (insn) == 37 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3718_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ARGMAX8;
+  if (Field_dsp340050b49a6c_fld2654dot_slot2_Slot_dot_slot2_get (insn) == 53 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3728dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld2655dot_slot2_Slot_dot_slot2_get (insn) == 11 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2029_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_MOVCM2PQ;
+  if (Field_dsp340050b49a6c_fld2656dot_slot2_Slot_dot_slot2_get (insn) == 6 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3712_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_SUBWRP;
+  if (Field_dsp340050b49a6c_fld2657dot_slot2_Slot_dot_slot2_get (insn) == 7 &&
+      Field_op0_s6_Slot_dot_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2029_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_ASLM32;
+  switch (Field_dsp340050b49a6c_fld2658dot_slot2_Slot_dot_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3717dot_slot2_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_AR2PQ_LN;
+      break;
+    case 1:
+      if (Field_op0_s6_Slot_dot_slot2_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3716dot_slot2_Slot_dot_slot2_get (insn) == 0)
+	return OPCODE_AR2CM_LN;
+      break;
+    }
+  if (Field_op0_s6_Slot_dot_slot2_get (insn) == 3 &&
+      Field_dsp340050b49a6c_fld3723dot_slot2_Slot_dot_slot2_get (insn) == 0)
+    return OPCODE_LUT_WRITE;
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_dot_slot1_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_op0_s7_Slot_dot_slot1_get (insn))
+    {
+    case 0:
+      return OPCODE_CDOT;
+    case 1:
+      return OPCODE_CDOTAC;
+    case 2:
+      return OPCODE_CDOTACS;
+    case 3:
+      return OPCODE_DOT;
+    case 4:
+      return OPCODE_DOTAC;
+    case 5:
+      return OPCODE_DOTACS;
+    case 6:
+      return OPCODE_MACD8;
+    case 7:
+      return OPCODE_MACPQXP_0;
+    case 8:
+      return OPCODE_MACPQXP_1;
+    case 9:
+      return OPCODE_MACPQXP_2;
+    case 10:
+      return OPCODE_MACPQXP_3;
+    case 11:
+      return OPCODE_MACXP2_0;
+    case 12:
+      return OPCODE_MACXP2_1;
+    case 13:
+      return OPCODE_MPYD8;
+    case 14:
+      return OPCODE_MPYPQXP_0;
+    case 15:
+      return OPCODE_MPYPQXP_1;
+    case 16:
+      return OPCODE_MPYPQXP_2;
+    case 17:
+      return OPCODE_MPYPQXP_3;
+    case 18:
+      return OPCODE_MPYXP2_0;
+    case 19:
+      return OPCODE_MPYXP2_1;
+    case 20:
+      if (Field_dsp340050b49a6c_fld3734dot_slot1_Slot_dot_slot1_get (insn) == 0)
+	return OPCODE_NOP;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_pq_slot1_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2825pq_slot1_Slot_pq_slot1_get (insn))
+    {
+    case 0:
+      if (Field_op0_s10_Slot_pq_slot1_get (insn) == 0)
+	return OPCODE_CMPYXP2PQ;
+      break;
+    case 1:
+      if (Field_op0_s10_Slot_pq_slot1_get (insn) == 0)
+	return OPCODE_MPYXP2PQ;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2826pq_slot1_Slot_pq_slot1_get (insn) == 1 &&
+      Field_op0_s10_Slot_pq_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3761pq_slot1_Slot_pq_slot1_get (insn) == 0)
+    return OPCODE_NOP;
+  switch (Field_op0_s10_Slot_pq_slot1_get (insn))
+    {
+    case 1:
+      return OPCODE_CMPY2PQ;
+    case 2:
+      return OPCODE_MPY2PQ;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_acc2_slot2_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2045_Slot_acc2_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 0)
+	return OPCODE_ARGMAX8;
+      break;
+    case 2:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2046_Slot_acc2_slot2_get (insn) == 0)
+	return OPCODE_POP32_0;
+      break;
+    case 3:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2046_Slot_acc2_slot2_get (insn) == 0)
+	return OPCODE_POP32_3;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld2953acc2_slot2_Slot_acc2_slot2_get (insn))
+    {
+    case 2:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 0)
+	return OPCODE_PUSH128;
+      break;
+    case 3:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld3782acc2_slot2_Slot_acc2_slot2_get (insn) == 0)
+	return OPCODE_NOP;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2954acc2_slot2_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3786acc2_slot2_Slot_acc2_slot2_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld2955acc2_slot2_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3788acc2_slot2_Slot_acc2_slot2_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld2956acc2_slot2_Slot_acc2_slot2_get (insn) == 3 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld2957acc2_slot2_Slot_acc2_slot2_get (insn) == 19 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld2958acc2_slot2_Slot_acc2_slot2_get (insn) == 35 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld2959acc2_slot2_Slot_acc2_slot2_get (insn) == 51 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld2960acc2_slot2_Slot_acc2_slot2_get (insn) == 35 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3784acc2_slot2_Slot_acc2_slot2_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld2963acc2_slot2_Slot_acc2_slot2_get (insn) == 51 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3784acc2_slot2_Slot_acc2_slot2_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld2964acc2_slot2_Slot_acc2_slot2_get (insn) == 19 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3785acc2_slot2_Slot_acc2_slot2_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld2966acc2_slot2_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3783acc2_slot2_Slot_acc2_slot2_get (insn) == 0)
+    return OPCODE_NCO_UPDATE;
+  if (Field_dsp340050b49a6c_fld2967acc2_slot2_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_op0_s12_Slot_acc2_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2056_Slot_acc2_slot2_get (insn) == 0)
+    return OPCODE_NEGCM;
+  switch (Field_op0_s12_Slot_acc2_slot2_get (insn))
+    {
+    case 2:
+      if (Field_dsp340050b49a6c_fld2046_Slot_acc2_slot2_get (insn) == 0)
+	return OPCODE_PUSH32;
+      break;
+    case 3:
+      return OPCODE_ADD32;
+    case 4:
+      return OPCODE_ADDCM;
+    case 5:
+      return OPCODE_ASR;
+    case 6:
+      return OPCODE_LUT_IEXT;
+    case 7:
+      return OPCODE_PERM;
+    }
+  switch (Field_s_Slot_acc2_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 1)
+	return OPCODE_CONJ;
+      break;
+    case 1:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 1)
+	return OPCODE_LUT_PHASOR;
+      break;
+    case 2:
+      if (Field_op0_s12_Slot_acc2_slot2_get (insn) == 1)
+	return OPCODE_MOVCM;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_acc2_slot1_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2075_Slot_acc2_slot1_get (insn))
+    {
+    case 0:
+      if (Field_op0_s13_Slot_acc2_slot1_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2031_Slot_acc2_slot1_get (insn) == 0)
+	return OPCODE_RFIRD;
+      break;
+    case 1:
+      if (Field_op0_s13_Slot_acc2_slot1_get (insn) == 0 &&
+	  Field_dsp340050b49a6c_fld2031_Slot_acc2_slot1_get (insn) == 0)
+	return OPCODE_RFIRDA;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2968acc2_slot1_Slot_acc2_slot1_get (insn) == 1 &&
+      Field_op0_s13_Slot_acc2_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3793acc2_slot1_Slot_acc2_slot1_get (insn) == 0)
+    return OPCODE_SWAPAC_R;
+  if (Field_dsp340050b49a6c_fld2969acc2_slot1_Slot_acc2_slot1_get (insn) == 1 &&
+      Field_op0_s13_Slot_acc2_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3790acc2_slot1_Slot_acc2_slot1_get (insn) == 0)
+    return OPCODE_NOP;
+  switch (Field_op0_s13_Slot_acc2_slot1_get (insn))
+    {
+    case 1:
+      return OPCODE_LLRPRE1;
+    case 2:
+      return OPCODE_RFIR;
+    case 3:
+      return OPCODE_RFIRA;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_smod_slot2_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2049_Slot_smod_slot2_get (insn))
+    {
+    case 2:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+	  Field_t_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_OR128;
+      break;
+    case 3:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2029_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_PERM;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld2991smod_slot2_Slot_smod_slot2_get (insn) == 0 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ADD32;
+  if (Field_dsp340050b49a6c_fld2992smod_slot2_Slot_smod_slot2_get (insn) == 1 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ADDCM;
+  if (Field_dsp340050b49a6c_fld2993smod_slot2_Slot_smod_slot2_get (insn) == 2 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ADDWRP;
+  if (Field_dsp340050b49a6c_fld2994smod_slot2_Slot_smod_slot2_get (insn) == 3 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ASR;
+  if (Field_dsp340050b49a6c_fld2995smod_slot2_Slot_smod_slot2_get (insn) == 4 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_AND128;
+  if (Field_dsp340050b49a6c_fld2996smod_slot2_Slot_smod_slot2_get (insn) == 5 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ASR32;
+  if (Field_dsp340050b49a6c_fld2997smod_slot2_Slot_smod_slot2_get (insn) == 6 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_EXTUI4;
+  if (Field_dsp340050b49a6c_fld2998smod_slot2_Slot_smod_slot2_get (insn) == 7 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_LUT;
+  if (Field_dsp340050b49a6c_fld2999smod_slot2_Slot_smod_slot2_get (insn) == 8 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ASL;
+  if (Field_dsp340050b49a6c_fld3000smod_slot2_Slot_smod_slot2_get (insn) == 9 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_LUT_IEXT;
+  if (Field_dsp340050b49a6c_fld3001smod_slot2_Slot_smod_slot2_get (insn) == 10 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_LUT_REXT;
+  if (Field_dsp340050b49a6c_fld3002smod_slot2_Slot_smod_slot2_get (insn) == 11 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MEAN;
+  if (Field_dsp340050b49a6c_fld3003smod_slot2_Slot_smod_slot2_get (insn) == 12 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MAX8;
+  if (Field_dsp340050b49a6c_fld3004smod_slot2_Slot_smod_slot2_get (insn) == 13 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MEAN32;
+  if (Field_dsp340050b49a6c_fld3005smod_slot2_Slot_smod_slot2_get (insn) == 14 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MIN8;
+  if (Field_dsp340050b49a6c_fld3006smod_slot2_Slot_smod_slot2_get (insn) == 15 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOV2CM2PQ;
+  if (Field_dsp340050b49a6c_fld3007smod_slot2_Slot_smod_slot2_get (insn) == 16 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ASL32;
+  if (Field_dsp340050b49a6c_fld3008smod_slot2_Slot_smod_slot2_get (insn) == 17 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_0;
+  if (Field_dsp340050b49a6c_fld3009smod_slot2_Slot_smod_slot2_get (insn) == 18 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_1;
+  if (Field_dsp340050b49a6c_fld3010smod_slot2_Slot_smod_slot2_get (insn) == 19 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_4;
+  if (Field_dsp340050b49a6c_fld3011smod_slot2_Slot_smod_slot2_get (insn) == 20 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_2;
+  if (Field_dsp340050b49a6c_fld3012smod_slot2_Slot_smod_slot2_get (insn) == 21 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_5;
+  if (Field_dsp340050b49a6c_fld3013smod_slot2_Slot_smod_slot2_get (insn) == 22 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_6;
+  if (Field_dsp340050b49a6c_fld3014smod_slot2_Slot_smod_slot2_get (insn) == 23 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_7;
+  if (Field_dsp340050b49a6c_fld3015smod_slot2_Slot_smod_slot2_get (insn) == 24 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND8_3;
+  if (Field_dsp340050b49a6c_fld3016smod_slot2_Slot_smod_slot2_get (insn) == 25 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_0;
+  if (Field_dsp340050b49a6c_fld3017smod_slot2_Slot_smod_slot2_get (insn) == 26 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_1;
+  if (Field_dsp340050b49a6c_fld3018smod_slot2_Slot_smod_slot2_get (insn) == 27 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_3;
+  if (Field_dsp340050b49a6c_fld3019smod_slot2_Slot_smod_slot2_get (insn) == 28 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_2;
+  if (Field_dsp340050b49a6c_fld3020smod_slot2_Slot_smod_slot2_get (insn) == 29 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_4;
+  if (Field_dsp340050b49a6c_fld3021smod_slot2_Slot_smod_slot2_get (insn) == 30 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_5;
+  if (Field_dsp340050b49a6c_fld3022smod_slot2_Slot_smod_slot2_get (insn) == 31 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCND_6;
+  if (Field_dsp340050b49a6c_fld3023smod_slot2_Slot_smod_slot2_get (insn) == 32 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ASLM;
+  if (Field_dsp340050b49a6c_fld3024smod_slot2_Slot_smod_slot2_get (insn) == 33 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ASRM;
+  if (Field_dsp340050b49a6c_fld3025smod_slot2_Slot_smod_slot2_get (insn) == 34 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_CMP8;
+  if (Field_dsp340050b49a6c_fld3026smod_slot2_Slot_smod_slot2_get (insn) == 35 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_LSRM;
+  if (Field_dsp340050b49a6c_fld3027smod_slot2_Slot_smod_slot2_get (insn) == 36 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_CMP_I;
+  if (Field_dsp340050b49a6c_fld3028smod_slot2_Slot_smod_slot2_get (insn) == 517 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ABS8;
+  if (Field_dsp340050b49a6c_fld3030smod_slot2_Slot_smod_slot2_get (insn) == 533 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_CONJ;
+  if (Field_dsp340050b49a6c_fld3031smod_slot2_Slot_smod_slot2_get (insn) == 549 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_LUT_PHASOR;
+  if (Field_dsp340050b49a6c_fld3032smod_slot2_Slot_smod_slot2_get (insn) == 565 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld3033smod_slot2_Slot_smod_slot2_get (insn) == 581 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCM;
+  if (Field_dsp340050b49a6c_fld3034smod_slot2_Slot_smod_slot2_get (insn) == 597 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_NOT128;
+  if (Field_dsp340050b49a6c_fld3035smod_slot2_Slot_smod_slot2_get (insn) == 613 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_TRANS;
+  if (Field_dsp340050b49a6c_fld3036smod_slot2_Slot_smod_slot2_get (insn) == 1141 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_PUSH128;
+  switch (Field_dsp340050b49a6c_fld3038smod_slot2_Slot_smod_slot2_get (insn))
+    {
+    case 8565:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_SET_ARGMAX;
+      break;
+    case 9077:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_SET_HSAR;
+      break;
+    case 9589:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_SET_MAX;
+      break;
+    case 10101:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_SET_SAR;
+      break;
+    case 10613:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_SET_NCO;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3039smod_slot2_Slot_smod_slot2_get (insn))
+    {
+    case 11125:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_0;
+      break;
+    case 27509:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_2;
+      break;
+    case 43893:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_3;
+      break;
+    case 60277:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_0;
+      break;
+    case 76661:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ128_4;
+      break;
+    case 93045:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_1;
+      break;
+    case 109429:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_2;
+      break;
+    case 125813:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_MOVEQ32_3;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3040smod_slot2_Slot_smod_slot2_get (insn) == 43893 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3805smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_5;
+  if (Field_dsp340050b49a6c_fld3043smod_slot2_Slot_smod_slot2_get (insn) == 60277 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3805smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld3044smod_slot2_Slot_smod_slot2_get (insn) == 6005 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3819smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_1;
+  if (Field_dsp340050b49a6c_fld3046smod_slot2_Slot_smod_slot2_get (insn) == 645 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_NCO_UPDATE;
+  if (Field_dsp340050b49a6c_fld3047smod_slot2_Slot_smod_slot2_get (insn) == 661 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld3048_Slot_smod_slot2_get (insn) == 0 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+    return OPCODE_LUT_AR;
+  if (Field_dsp340050b49a6c_fld3049smod_slot2_Slot_smod_slot2_get (insn) == 1685 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld3050smod_slot2_Slot_smod_slot2_get (insn) == 2709 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_GET_MAX;
+  if (Field_dsp340050b49a6c_fld3051smod_slot2_Slot_smod_slot2_get (insn) == 3733 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld3052smod_slot2_Slot_smod_slot2_get (insn) == 4757 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_GET_NCO;
+  if (Field_dsp340050b49a6c_fld3053smod_slot2_Slot_smod_slot2_get (insn) == 5781 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld3054smod_slot2_Slot_smod_slot2_get (insn) == 6805 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld3055smod_slot2_Slot_smod_slot2_get (insn) == 7829 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld3056smod_slot2_Slot_smod_slot2_get (insn) == 4757 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3809smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld3058smod_slot2_Slot_smod_slot2_get (insn) == 5781 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3809smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_4;
+  if (Field_dsp340050b49a6c_fld3059smod_slot2_Slot_smod_slot2_get (insn) == 3733 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3821smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld3061smod_slot2_Slot_smod_slot2_get (insn) == 341 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3806smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_GET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld3063smod_slot2_Slot_smod_slot2_get (insn) == 181 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3807smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld3065smod_slot2_Slot_smod_slot2_get (insn) == 19 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_0;
+  if (Field_dsp340050b49a6c_fld3066smod_slot2_Slot_smod_slot2_get (insn) == 51 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_1;
+  if (Field_dsp340050b49a6c_fld3067smod_slot2_Slot_smod_slot2_get (insn) == 83 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_2;
+  if (Field_dsp340050b49a6c_fld3068smod_slot2_Slot_smod_slot2_get (insn) == 227 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_PUSH128_PQ;
+  if (Field_dsp340050b49a6c_fld3069smod_slot2_Slot_smod_slot2_get (insn) == 1803 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_0;
+  switch (Field_dsp340050b49a6c_fld3070_Slot_smod_slot2_get (insn))
+    {
+    case 66:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_MOVPQ2PQ;
+      break;
+    case 67:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_SUBARX;
+      break;
+    case 68:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_PUSH32;
+      break;
+    case 69:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_SWAPB;
+      break;
+    case 70:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_WRTIEP;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3071smod_slot2_Slot_smod_slot2_get (insn) == 1819 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_1;
+  if (Field_dsp340050b49a6c_fld3072smod_slot2_Slot_smod_slot2_get (insn) == 1835 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_2;
+  if (Field_dsp340050b49a6c_fld3073smod_slot2_Slot_smod_slot2_get (insn) == 1851 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_4;
+  if (Field_dsp340050b49a6c_fld3074smod_slot2_Slot_smod_slot2_get (insn) == 1867 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_3;
+  if (Field_dsp340050b49a6c_fld3075smod_slot2_Slot_smod_slot2_get (insn) == 1883 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2PQ_5;
+  if (Field_dsp340050b49a6c_fld3076smod_slot2_Slot_smod_slot2_get (insn) == 3798 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld3077smod_slot2_Slot_smod_slot2_get (insn) == 3799 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld3078smod_slot2_Slot_smod_slot2_get (insn) == 3830 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld3079smod_slot2_Slot_smod_slot2_get (insn) == 3831 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld3080smod_slot2_Slot_smod_slot2_get (insn) == 147 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP128_2CMPQ_3;
+  if (Field_dsp340050b49a6c_fld3081smod_slot2_Slot_smod_slot2_get (insn) == 179 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2056_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_PUSH2X128_PQ;
+  if (Field_dsp340050b49a6c_fld3082smod_slot2_Slot_smod_slot2_get (insn) == 115 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3824smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_RDTIEP;
+  if (Field_dsp340050b49a6c_fld3084smod_slot2_Slot_smod_slot2_get (insn) == 51 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3817_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_PQ2CM;
+  if (Field_dsp340050b49a6c_fld3085smod_slot2_Slot_smod_slot2_get (insn) == 10 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld2032_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_CMP_R;
+  if (Field_dsp340050b49a6c_fld3087smod_slot2_Slot_smod_slot2_get (insn) == 11 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_t_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ADD16;
+  if (Field_dsp340050b49a6c_fld3088smod_slot2_Slot_smod_slot2_get (insn) == 6 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3828smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_LSLM;
+  if (Field_dsp340050b49a6c_fld3090smod_slot2_Slot_smod_slot2_get (insn) == 7 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3814smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_CM2AR_LN;
+  switch (Field_dsp340050b49a6c_fld3091smod_slot2_Slot_smod_slot2_get (insn))
+    {
+    case 32:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_QREADY;
+      break;
+    case 36:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld2041_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_SET_EXT_REGS;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3092smod_slot2_Slot_smod_slot2_get (insn))
+    {
+    case 1136:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_AR2SAR_DUP;
+      break;
+    case 1137:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_01;
+      break;
+    case 1138:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_POP2X128_2PQ_03;
+      break;
+    case 1139:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+	return OPCODE_WRTBSIGQ;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3093smod_slot2_Slot_smod_slot2_get (insn) == 570 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3822smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_21;
+  if (Field_dsp340050b49a6c_fld3096smod_slot2_Slot_smod_slot2_get (insn) == 571 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3822smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_WRTSIGQ;
+  if (Field_dsp340050b49a6c_fld3097smod_slot2_Slot_smod_slot2_get (insn) == 143 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3823smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_POP2X128_2PQ_23;
+  if (Field_dsp340050b49a6c_fld3098smod_slot2_Slot_smod_slot2_get (insn) == 74 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3062_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_CLRTIEP;
+  if (Field_dsp340050b49a6c_fld3099smod_slot2_Slot_smod_slot2_get (insn) == 75 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3062_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_WRTBSIGQM;
+  if (Field_dsp340050b49a6c_fld3100smod_slot2_Slot_smod_slot2_get (insn) == 19 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3825smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_SETTIEP;
+  if (Field_dsp340050b49a6c_fld3101smod_slot2_Slot_smod_slot2_get (insn) == 4 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3826smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ADDAR2;
+  if (Field_dsp340050b49a6c_fld3102smod_slot2_Slot_smod_slot2_get (insn) == 4 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3810smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_AR2CM_DUP;
+  if (Field_dsp340050b49a6c_fld3104smod_slot2_Slot_smod_slot2_get (insn) == 4 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3816smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVAR2;
+  if (Field_dsp340050b49a6c_fld3105smod_slot2_Slot_smod_slot2_get (insn) == 16 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+    return OPCODE_MOVCND_7;
+  if (Field_dsp340050b49a6c_fld3106smod_slot2_Slot_smod_slot2_get (insn) == 17 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+    return OPCODE_SMOD_LUT;
+  if (Field_dsp340050b49a6c_fld3107smod_slot2_Slot_smod_slot2_get (insn) == 18 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+    return OPCODE_SUB32;
+  if (Field_dsp340050b49a6c_fld3108smod_slot2_Slot_smod_slot2_get (insn) == 19 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+    return OPCODE_SUBWRP;
+  if (Field_dsp340050b49a6c_fld3109smod_slot2_Slot_smod_slot2_get (insn) == 20 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+    return OPCODE_SUBCM;
+  if (Field_dsp340050b49a6c_fld3110smod_slot2_Slot_smod_slot2_get (insn) == 21 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1)
+    return OPCODE_XOR128;
+  if (Field_dsp340050b49a6c_fld3111smod_slot2_Slot_smod_slot2_get (insn) == 19 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2056_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_MOVCM2PQ;
+  if (Field_dsp340050b49a6c_fld3113smod_slot2_Slot_smod_slot2_get (insn) == 27 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3827smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ARGMAX8;
+  if (Field_dsp340050b49a6c_fld3114smod_slot2_Slot_smod_slot2_get (insn) == 6 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3808_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_SUBMEAN;
+  if (Field_dsp340050b49a6c_fld3115smod_slot2_Slot_smod_slot2_get (insn) == 7 &&
+      Field_op0_s15_Slot_smod_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2029_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_ASLM32;
+  switch (Field_dsp340050b49a6c_fld3116smod_slot2_Slot_smod_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3813smod_slot2_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_AR2PQ_LN;
+      break;
+    case 1:
+      if (Field_op0_s15_Slot_smod_slot2_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3812smod_slot2_Slot_smod_slot2_get (insn) == 0)
+	return OPCODE_AR2CM_LN;
+      break;
+    }
+  if (Field_op0_s15_Slot_smod_slot2_get (insn) == 3 &&
+      Field_dsp340050b49a6c_fld3818smod_slot2_Slot_smod_slot2_get (insn) == 0)
+    return OPCODE_LUT_WRITE;
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_smod_slot1_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2080_Slot_smod_slot1_get (insn))
+    {
+    case 0:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 0)
+	return OPCODE_CMPY2CM;
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 1)
+	return OPCODE_RMPY2CM;
+      break;
+    case 1:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 0)
+	return OPCODE_MPY2CM;
+      break;
+    case 2:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 0)
+	return OPCODE_MPYADD8_2CM;
+      break;
+    case 3:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 0)
+	return OPCODE_RCMPY2CM;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3117smod_slot1_Slot_smod_slot1_get (insn))
+    {
+    case 2:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 1)
+	return OPCODE_CMAC;
+      break;
+    case 3:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 1)
+	return OPCODE_MAC;
+      break;
+    case 4:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 1)
+	return OPCODE_CMPY;
+      break;
+    case 5:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 1)
+	return OPCODE_MPY;
+      break;
+    case 6:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 1)
+	return OPCODE_NORMACD;
+      break;
+    case 7:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 1)
+	return OPCODE_NORMD;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3118smod_slot1_Slot_smod_slot1_get (insn))
+    {
+    case 0:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3117smod_slot1_Slot_smod_slot1_get (insn) == 0)
+	return OPCODE_SMOD_SCR;
+      break;
+    case 1:
+      if (Field_op0_s16_Slot_smod_slot1_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3829smod_slot1_Slot_smod_slot1_get (insn) == 0)
+	return OPCODE_NOP;
+      break;
+    }
+  if (Field_op0_s16_Slot_smod_slot1_get (insn) == 3)
+    return OPCODE_SMOD_ALIGN;
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_llr_slot2_decode (const xtensa_insnbuf insn)
+{
+  switch (Field_dsp340050b49a6c_fld2046_Slot_llr_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+	return OPCODE_LUT_AR;
+      break;
+    case 2:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+	  Field_dsp340050b49a6c_fld3230_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_CM2AR_LN;
+      break;
+    }
+  switch (Field_dsp340050b49a6c_fld3191llr_slot2_Slot_llr_slot2_get (insn))
+    {
+    case 6:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_ABS8;
+      break;
+    case 7:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_CONJ;
+      break;
+    case 22:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_LUT_PHASOR;
+      break;
+    case 23:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_NOT128;
+      break;
+    case 38:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVCM;
+      break;
+    case 39:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_TRANS;
+      break;
+    case 70:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_NCO_UPDATE;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3192llr_slot2_Slot_llr_slot2_get (insn) == 54 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_CLRCM;
+  if (Field_dsp340050b49a6c_fld3193llr_slot2_Slot_llr_slot2_get (insn) == 55 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_GET_ARGMAX;
+  if (Field_dsp340050b49a6c_fld3194llr_slot2_Slot_llr_slot2_get (insn) == 310 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_GET_HSAR;
+  if (Field_dsp340050b49a6c_fld3195llr_slot2_Slot_llr_slot2_get (insn) == 311 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_GET_SAR;
+  if (Field_dsp340050b49a6c_fld3196llr_slot2_Slot_llr_slot2_get (insn) == 566 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_GET_HSAR2SAR;
+  if (Field_dsp340050b49a6c_fld3197llr_slot2_Slot_llr_slot2_get (insn) == 567 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_POP128_0;
+  if (Field_dsp340050b49a6c_fld3198llr_slot2_Slot_llr_slot2_get (insn) == 822 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_POP128_1;
+  if (Field_dsp340050b49a6c_fld3199llr_slot2_Slot_llr_slot2_get (insn) == 823 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_POP128_2;
+  if (Field_dsp340050b49a6c_fld3200llr_slot2_Slot_llr_slot2_get (insn) == 1078 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_GET_MAX;
+  if (Field_dsp340050b49a6c_fld3201llr_slot2_Slot_llr_slot2_get (insn) == 1079 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_POP128_3;
+  if (Field_dsp340050b49a6c_fld3202llr_slot2_Slot_llr_slot2_get (insn) == 1334 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+    return OPCODE_POP128_4;
+  switch (Field_dsp340050b49a6c_fld3203llr_slot2_Slot_llr_slot2_get (insn))
+    {
+    case 20535:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ128_0;
+      break;
+    case 20791:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ128_1;
+      break;
+    case 21047:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ128_2;
+      break;
+    case 21303:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ128_5;
+      break;
+    case 21559:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ128_3;
+      break;
+    case 21815:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ32_0;
+      break;
+    case 22071:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ32_1;
+      break;
+    case 22327:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_MOVEQ32_2;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3204llr_slot2_Slot_llr_slot2_get (insn) == 11319 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3844_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ128_4;
+  if (Field_dsp340050b49a6c_fld3205_Slot_llr_slot2_get (insn) == 7 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3847llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_SET_EXT_REGS;
+  switch (Field_dsp340050b49a6c_fld3206_Slot_llr_slot2_get (insn))
+    {
+    case 71:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld3225_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_SET_ARGMAX;
+      break;
+    case 327:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+	  Field_dsp340050b49a6c_fld3225_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_SET_NCO;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3207llr_slot2_Slot_llr_slot2_get (insn) == 11575 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3844_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_MOVEQ32_3;
+  if (Field_dsp340050b49a6c_fld3208llr_slot2_Slot_llr_slot2_get (insn) == 5943 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3843llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld3210llr_slot2_Slot_llr_slot2_get (insn) == 411 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3857llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_POP128_5;
+  if (Field_dsp340050b49a6c_fld3212_Slot_llr_slot2_get (insn) == 43 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3848llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_SET_HSAR;
+  if (Field_dsp340050b49a6c_fld3213llr_slot2_Slot_llr_slot2_get (insn) == 155 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3845llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_GET_NCO;
+  if (Field_dsp340050b49a6c_fld3214_Slot_llr_slot2_get (insn) == 1 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3863llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_QREADY;
+  if (Field_dsp340050b49a6c_fld3215llr_slot2_Slot_llr_slot2_get (insn) == 327 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3850llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_SET_SAR;
+  if (Field_dsp340050b49a6c_fld3216llr_slot2_Slot_llr_slot2_get (insn) == 27 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3849llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_SET_MAX;
+  if (Field_dsp340050b49a6c_fld3217_Slot_llr_slot2_get (insn) == 5 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3859llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_POP32_0;
+  if (Field_dsp340050b49a6c_fld3218llr_slot2_Slot_llr_slot2_get (insn) == 11 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3851llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_NEGCM;
+  if (Field_dsp340050b49a6c_fld3220llr_slot2_Slot_llr_slot2_get (insn) == 9 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3246_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_PUSH128;
+  if (Field_dsp340050b49a6c_fld3221llr_slot2_Slot_llr_slot2_get (insn) == 25 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld2046_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_POP32_1;
+  if (Field_dsp340050b49a6c_fld3222llr_slot2_Slot_llr_slot2_get (insn) == 25 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3860llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_POP32_2;
+  if (Field_dsp340050b49a6c_fld3224llr_slot2_Slot_llr_slot2_get (insn) == 25 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3861llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_POP32_3;
+  if (Field_dsp340050b49a6c_fld3226llr_slot2_Slot_llr_slot2_get (insn) == 25 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3864llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_RDTIEP;
+  if (Field_dsp340050b49a6c_fld3228llr_slot2_Slot_llr_slot2_get (insn) == 3 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3866llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_ADD16;
+  if (Field_dsp340050b49a6c_fld3231llr_slot2_Slot_llr_slot2_get (insn) == 7 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 1 &&
+      Field_dsp340050b49a6c_fld3856llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_LUT_WRITE;
+  if (Field_dsp340050b49a6c_fld3232llr_slot2_Slot_llr_slot2_get (insn) == 4 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+    return OPCODE_AR2CM_LN;
+  switch (Field_dsp340050b49a6c_fld3233_Slot_llr_slot2_get (insn))
+    {
+    case 2:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 4 &&
+	  Field_dsp340050b49a6c_fld2049_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_SUBWRP;
+      break;
+    case 3:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 4 &&
+	  Field_dsp340050b49a6c_fld2029_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ASLM32;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3234llr_slot2_Slot_llr_slot2_get (insn) == 20 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+    return OPCODE_AR2CM_DUP;
+  if (Field_dsp340050b49a6c_fld3235llr_slot2_Slot_llr_slot2_get (insn) == 133 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+    return OPCODE_SETTIEP;
+  if (Field_dsp340050b49a6c_fld3236_Slot_llr_slot2_get (insn) == 27 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2074_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_WRTIEP;
+  if (Field_dsp340050b49a6c_fld3237llr_slot2_Slot_llr_slot2_get (insn) == 149 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld2074_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_AR2SAR_DUP;
+  if (Field_dsp340050b49a6c_fld3238llr_slot2_Slot_llr_slot2_get (insn) == 85 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3862_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_WRTBSIGQ;
+  if (Field_dsp340050b49a6c_fld3240llr_slot2_Slot_llr_slot2_get (insn) == 53 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3847llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_WRTSIGQ;
+  if (Field_dsp340050b49a6c_fld3241llr_slot2_Slot_llr_slot2_get (insn) == 11 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3865llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_WRTBSIGQM;
+  if (Field_dsp340050b49a6c_fld3242llr_slot2_Slot_llr_slot2_get (insn) == 3 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3855llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_CLRTIEP;
+  switch (Field_dsp340050b49a6c_fld3243llr_slot2_Slot_llr_slot2_get (insn))
+    {
+    case 48:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+	return OPCODE_ADDAR2;
+      break;
+    case 49:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+	return OPCODE_MOVAR2;
+      break;
+    case 50:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+	return OPCODE_PUSH128_PQ;
+      break;
+    case 51:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+	return OPCODE_SUBARX;
+      break;
+    case 52:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+	return OPCODE_PUSH32;
+      break;
+    case 53:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 2)
+	return OPCODE_SWAPB;
+      break;
+    }
+  if (Field_dsp340050b49a6c_fld3244llr_slot2_Slot_llr_slot2_get (insn) == 1 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 2 &&
+      Field_dsp340050b49a6c_fld3853llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_PQ2CM;
+  if (Field_dsp340050b49a6c_fld3245llr_slot2_Slot_llr_slot2_get (insn) == 2 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 4 &&
+      Field_dsp340050b49a6c_fld3868_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_SUBMEAN;
+  if (Field_dsp340050b49a6c_fld3247llr_slot2_Slot_llr_slot2_get (insn) == 3 &&
+      Field_op0_s18_Slot_llr_slot2_get (insn) == 4 &&
+      Field_dsp340050b49a6c_fld3867llr_slot2_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_ARGMAX8;
+  if (Field_op0_s18_Slot_llr_slot2_get (insn) == 5 &&
+      Field_dsp340050b49a6c_fld2029_Slot_llr_slot2_get (insn) == 0)
+    return OPCODE_PERM;
+  switch (Field_s_Slot_llr_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_ASLM;
+      break;
+    case 1:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_ASRM;
+      break;
+    case 2:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_CMP8;
+      break;
+    case 3:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_LSLM;
+      break;
+    case 4:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_CMP_I;
+      break;
+    case 5:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_LSRM;
+      break;
+    case 8:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 1)
+	return OPCODE_CMP_R;
+      break;
+    }
+  switch (Field_t_Slot_llr_slot2_get (insn))
+    {
+    case 0:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_0;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ADD32;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 4)
+	return OPCODE_OR128;
+      break;
+    case 1:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_1;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ADDCM;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 4)
+	return OPCODE_SUB32;
+      break;
+    case 2:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_2;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ADDWRP;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 4)
+	return OPCODE_SUBCM;
+      break;
+    case 3:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_5;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ASL32;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 4)
+	return OPCODE_XOR128;
+      break;
+    case 4:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_3;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_AND128;
+      break;
+    case 5:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_6;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ASR;
+      break;
+    case 6:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_7;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ASR32;
+      break;
+    case 7:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_0;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_EXTUI4;
+      break;
+    case 8:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND8_4;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_ASL;
+      break;
+    case 9:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_1;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_LUT;
+      break;
+    case 10:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_2;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_LUT_IEXT;
+      break;
+    case 11:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_4;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_MAX8;
+      break;
+    case 12:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_3;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_LUT_REXT;
+      break;
+    case 13:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_5;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_MEAN;
+      break;
+    case 14:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_6;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_MEAN32;
+      break;
+    case 15:
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 3)
+	return OPCODE_MOVCND_7;
+      if (Field_op0_s18_Slot_llr_slot2_get (insn) == 0)
+	return OPCODE_MIN8;
+      break;
+    }
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_llr_slot1_decode (const xtensa_insnbuf insn)
+{
+  if (Field_dsp340050b49a6c_fld3248llr_slot1_Slot_llr_slot1_get (insn) == 0 &&
+      Field_op0_s19_Slot_llr_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3870_Slot_llr_slot1_get (insn) == 0)
+    return OPCODE_WGHT32;
+  if (Field_dsp340050b49a6c_fld3250llr_slot1_Slot_llr_slot1_get (insn) == 1 &&
+      Field_op0_s19_Slot_llr_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3869llr_slot1_Slot_llr_slot1_get (insn) == 0)
+    return OPCODE_NOP;
+  if (Field_dsp340050b49a6c_fld3251llr_slot1_Slot_llr_slot1_get (insn) == 2 &&
+      Field_op0_s19_Slot_llr_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3878llr_slot1_Slot_llr_slot1_get (insn) == 0)
+    return OPCODE_LLRPRE2;
+  if (Field_dsp340050b49a6c_fld3252llr_slot1_Slot_llr_slot1_get (insn) == 3 &&
+      Field_op0_s19_Slot_llr_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3875llr_slot1_Slot_llr_slot1_get (insn) == 0)
+    return OPCODE_MOVAC_R;
+  if (Field_dsp340050b49a6c_fld3253llr_slot1_Slot_llr_slot1_get (insn) == 1 &&
+      Field_op0_s19_Slot_llr_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3876llr_slot1_Slot_llr_slot1_get (insn) == 0)
+    return OPCODE_ADDAC;
+  if (Field_dsp340050b49a6c_fld3254llr_slot1_Slot_llr_slot1_get (insn) == 1 &&
+      Field_op0_s19_Slot_llr_slot1_get (insn) == 0 &&
+      Field_dsp340050b49a6c_fld3872llr_slot1_Slot_llr_slot1_get (insn) == 0)
+    return OPCODE_MOVAC_I;
+  if (Field_op0_s19_Slot_llr_slot1_get (insn) == 1)
+    return OPCODE_COMB32;
+  return XTENSA_UNDEFINED;
+}
+
+static int
+Slot_dual_slot1_decode (const xtensa_insnbuf insn)
+{
+  if (Field_op0_s22_Slot_dual_slot1_get (insn) == 0)
+    return OPCODE_NOP;
+  return XTENSA_UNDEFINED;
+}
+
+
+/* Instruction slots.  */
+
+static void
+Slot_x24_Format_inst_0_get (const xtensa_insnbuf insn,
+			    xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = (insn[0] & 0xffffff);
+}
+
+static void
+Slot_x24_Format_inst_0_set (xtensa_insnbuf insn,
+			    const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xffffff) | (slotbuf[0] & 0xffffff);
+}
+
+static void
+Slot_x16a_Format_inst16a_0_get (const xtensa_insnbuf insn,
+				xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = (insn[0] & 0xffff);
+}
+
+static void
+Slot_x16a_Format_inst16a_0_set (xtensa_insnbuf insn,
+				const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xffff) | (slotbuf[0] & 0xffff);
+}
+
+static void
+Slot_x16b_Format_inst16b_0_get (const xtensa_insnbuf insn,
+				xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = (insn[0] & 0xffff);
+}
+
+static void
+Slot_x16b_Format_inst16b_0_set (xtensa_insnbuf insn,
+				const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xffff) | (slotbuf[0] & 0xffff);
+}
+
+static void
+Slot_gp_Format_gp_slot2_43_get (const xtensa_insnbuf insn,
+			       xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[1] & 0x3ffff800) >> 11);
+}
+
+static void
+Slot_gp_Format_gp_slot2_43_set (xtensa_insnbuf insn,
+			       const xtensa_insnbuf slotbuf)
+{
+  insn[1] = (insn[1] & ~0x3ffff800) | ((slotbuf[0] & 0x7ffff) << 11);
+}
+
+static void
+Slot_gp_Format_gp_slot1_26_get (const xtensa_insnbuf insn,
+			       xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xfc000000) >> 26);
+  slotbuf[0] = (slotbuf[0] & ~0x1ffc0) | ((insn[1] & 0x7ff) << 6);
+}
+
+static void
+Slot_gp_Format_gp_slot1_26_set (xtensa_insnbuf insn,
+			       const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xfc000000) | ((slotbuf[0] & 0x3f) << 26);
+  insn[1] = (insn[1] & ~0x7ff) | ((slotbuf[0] & 0x1ffc0) >> 6);
+}
+
+static void
+Slot_gp_Format_gp_slot0_7_get (const xtensa_insnbuf insn,
+			       xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0x3ffff80) >> 7);
+}
+
+static void
+Slot_gp_Format_gp_slot0_7_set (xtensa_insnbuf insn,
+			       const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0x3ffff80) | ((slotbuf[0] & 0x7ffff) << 7);
+}
+
+static void
+Slot_dot_Format_dot_slot2_44_get (const xtensa_insnbuf insn,
+				 xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[1] & 0xfffff000) >> 12);
+}
+
+static void
+Slot_dot_Format_dot_slot2_44_set (xtensa_insnbuf insn,
+				 const xtensa_insnbuf slotbuf)
+{
+  insn[1] = (insn[1] & ~0xfffff000) | ((slotbuf[0] & 0xfffff) << 12);
+}
+
+static void
+Slot_dot_Format_dot_slot1_24_get (const xtensa_insnbuf insn,
+				 xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xff000000) >> 24);
+  slotbuf[0] = (slotbuf[0] & ~0xfff00) | ((insn[1] & 0xfff) << 8);
+}
+
+static void
+Slot_dot_Format_dot_slot1_24_set (xtensa_insnbuf insn,
+				 const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xff000000) | ((slotbuf[0] & 0xff) << 24);
+  insn[1] = (insn[1] & ~0xfff) | ((slotbuf[0] & 0xfff00) >> 8);
+}
+
+static void
+Slot_dot_Format_dot_slot0_7_get (const xtensa_insnbuf insn,
+				 xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xffff80) >> 7);
+}
+
+static void
+Slot_dot_Format_dot_slot0_7_set (xtensa_insnbuf insn,
+				 const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xffff80) | ((slotbuf[0] & 0x1ffff) << 7);
+}
+
+static void
+Slot_pq_Format_pq_slot2_40_get (const xtensa_insnbuf insn,
+			       xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[1] & 0x7ffff00) >> 8);
+}
+
+static void
+Slot_pq_Format_pq_slot2_40_set (xtensa_insnbuf insn,
+			       const xtensa_insnbuf slotbuf)
+{
+  insn[1] = (insn[1] & ~0x7ffff00) | ((slotbuf[0] & 0x7ffff) << 8);
+}
+
+static void
+Slot_pq_Format_pq_slot1_26_get (const xtensa_insnbuf insn,
+			       xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xfc000000) >> 26);
+  slotbuf[0] = (slotbuf[0] & ~0x3fc0) | ((insn[1] & 0xff) << 6);
+}
+
+static void
+Slot_pq_Format_pq_slot1_26_set (xtensa_insnbuf insn,
+			       const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xfc000000) | ((slotbuf[0] & 0x3f) << 26);
+  insn[1] = (insn[1] & ~0xff) | ((slotbuf[0] & 0x3fc0) >> 6);
+}
+
+static void
+Slot_pq_Format_pq_slot0_7_get (const xtensa_insnbuf insn,
+			       xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0x3ffff80) >> 7);
+}
+
+static void
+Slot_pq_Format_pq_slot0_7_set (xtensa_insnbuf insn,
+			       const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0x3ffff80) | ((slotbuf[0] & 0x7ffff) << 7);
+}
+
+static void
+Slot_acc2_Format_acc2_slot2_47_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[1] & 0x3fff8000) >> 15);
+}
+
+static void
+Slot_acc2_Format_acc2_slot2_47_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[1] = (insn[1] & ~0x3fff8000) | ((slotbuf[0] & 0x7fff) << 15);
+}
+
+static void
+Slot_acc2_Format_acc2_slot1_23_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xff800000) >> 23);
+  slotbuf[0] = (slotbuf[0] & ~0xfffe00) | ((insn[1] & 0x7fff) << 9);
+}
+
+static void
+Slot_acc2_Format_acc2_slot1_23_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xff800000) | ((slotbuf[0] & 0x1ff) << 23);
+  insn[1] = (insn[1] & ~0x7fff) | ((slotbuf[0] & 0xfffe00) >> 9);
+}
+
+static void
+Slot_acc2_Format_acc2_slot0_7_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0x7fff80) >> 7);
+}
+
+static void
+Slot_acc2_Format_acc2_slot0_7_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0x7fff80) | ((slotbuf[0] & 0xffff) << 7);
+}
+
+static void
+Slot_smod_Format_smod_slot2_42_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[1] & 0x3ffffc00) >> 10);
+}
+
+static void
+Slot_smod_Format_smod_slot2_42_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[1] = (insn[1] & ~0x3ffffc00) | ((slotbuf[0] & 0xfffff) << 10);
+}
+
+static void
+Slot_smod_Format_smod_slot1_26_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xfc000000) >> 26);
+  slotbuf[0] = (slotbuf[0] & ~0xffc0) | ((insn[1] & 0x3ff) << 6);
+}
+
+static void
+Slot_smod_Format_smod_slot1_26_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xfc000000) | ((slotbuf[0] & 0x3f) << 26);
+  insn[1] = (insn[1] & ~0x3ff) | ((slotbuf[0] & 0xffc0) >> 6);
+}
+
+static void
+Slot_smod_Format_smod_slot0_7_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0x3ffff80) >> 7);
+}
+
+static void
+Slot_smod_Format_smod_slot0_7_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0x3ffff80) | ((slotbuf[0] & 0x7ffff) << 7);
+}
+
+static void
+Slot_llr_Format_llr_slot2_44_get (const xtensa_insnbuf insn,
+				 xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[1] & 0x7ffff000) >> 12);
+}
+
+static void
+Slot_llr_Format_llr_slot2_44_set (xtensa_insnbuf insn,
+				 const xtensa_insnbuf slotbuf)
+{
+  insn[1] = (insn[1] & ~0x7ffff000) | ((slotbuf[0] & 0x7ffff) << 12);
+}
+
+static void
+Slot_llr_Format_llr_slot1_24_get (const xtensa_insnbuf insn,
+				 xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xff000000) >> 24);
+  slotbuf[0] = (slotbuf[0] & ~0xfff00) | ((insn[1] & 0xfff) << 8);
+}
+
+static void
+Slot_llr_Format_llr_slot1_24_set (xtensa_insnbuf insn,
+				 const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xff000000) | ((slotbuf[0] & 0xff) << 24);
+  insn[1] = (insn[1] & ~0xfff) | ((slotbuf[0] & 0xfff00) >> 8);
+}
+
+static void
+Slot_llr_Format_llr_slot0_7_get (const xtensa_insnbuf insn,
+				 xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0xffff80) >> 7);
+}
+
+static void
+Slot_llr_Format_llr_slot0_7_set (xtensa_insnbuf insn,
+				 const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0xffff80) | ((slotbuf[0] & 0x1ffff) << 7);
+}
+
+static void
+Slot_dual_Format_dual_slot2_31_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0x80000000) >> 31);
+  slotbuf[0] = (slotbuf[0] & ~0xfffffe) | ((insn[1] & 0x7fffff) << 1);
+}
+
+static void
+Slot_dual_Format_dual_slot2_31_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0x80000000) | ((slotbuf[0] & 0x1) << 31);
+  insn[1] = (insn[1] & ~0x7fffff) | ((slotbuf[0] & 0xfffffe) >> 1);
+}
+
+static void
+Slot_dual_Format_dual_slot1_30_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0x40000000) >> 30);
+}
+
+static void
+Slot_dual_Format_dual_slot1_30_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0x40000000) | ((slotbuf[0] & 0x1) << 30);
+}
+
+static void
+Slot_dual_Format_dual_slot0_7_get (const xtensa_insnbuf insn,
+				   xtensa_insnbuf slotbuf)
+{
+  slotbuf[1] = 0;
+  slotbuf[0] = ((insn[0] & 0x3fffff80) >> 7);
+}
+
+static void
+Slot_dual_Format_dual_slot0_7_set (xtensa_insnbuf insn,
+				   const xtensa_insnbuf slotbuf)
+{
+  insn[0] = (insn[0] & ~0x3fffff80) | ((slotbuf[0] & 0x7fffff) << 7);
+}
+
+static xtensa_get_field_fn
+Slot_inst_get_field_fns[] = {
+  Field_t_Slot_inst_get,
+  Field_bbi4_Slot_inst_get,
+  Field_bbi_Slot_inst_get,
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+  Field_t2_Slot_inst_get,
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+  Field_dsp340050b49a6c_fld2223inst_Slot_inst_get,
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+  Field_dsp340050b49a6c_fld3937dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3938dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3939dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3940dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3941dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3943dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3945dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3946dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3947dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3949dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3950dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3951dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3952dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3954dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3957dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3958dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3959dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3960dual_slot0_Slot_dual_slot0_set,
+  Field_dsp340050b49a6c_fld3961dual_slot0_Slot_dual_slot0_set,
+  Implicit_Field_set,
+  Implicit_Field_set,
+  Implicit_Field_set,
+  Implicit_Field_set,
+  Implicit_Field_set,
+  Implicit_Field_set,
+  Implicit_Field_set,
+  Implicit_Field_set
+};
+
+static xtensa_slot_internal slots[] = {
+  { "Inst", "x24", 0,
+    Slot_x24_Format_inst_0_get, Slot_x24_Format_inst_0_set,
+    Slot_inst_get_field_fns, Slot_inst_set_field_fns,
+    Slot_inst_decode, "nop" },
+  { "Inst16a", "x16a", 0,
+    Slot_x16a_Format_inst16a_0_get, Slot_x16a_Format_inst16a_0_set,
+    Slot_inst16a_get_field_fns, Slot_inst16a_set_field_fns,
+    Slot_inst16a_decode, "" },
+  { "Inst16b", "x16b", 0,
+    Slot_x16b_Format_inst16b_0_get, Slot_x16b_Format_inst16b_0_set,
+    Slot_inst16b_get_field_fns, Slot_inst16b_set_field_fns,
+    Slot_inst16b_decode, "nop.n" },
+  { "GP_slot2", "GP", 2,
+    Slot_gp_Format_gp_slot2_43_get, Slot_gp_Format_gp_slot2_43_set,
+    Slot_gp_slot2_get_field_fns, Slot_gp_slot2_set_field_fns,
+    Slot_gp_slot2_decode, "nop" },
+  { "GP_slot1", "GP", 1,
+    Slot_gp_Format_gp_slot1_26_get, Slot_gp_Format_gp_slot1_26_set,
+    Slot_gp_slot1_get_field_fns, Slot_gp_slot1_set_field_fns,
+    Slot_gp_slot1_decode, "nop" },
+  { "GP_slot0", "GP", 0,
+    Slot_gp_Format_gp_slot0_7_get, Slot_gp_Format_gp_slot0_7_set,
+    Slot_gp_slot0_get_field_fns, Slot_gp_slot0_set_field_fns,
+    Slot_gp_slot0_decode, "nop" },
+  { "DOT_slot2", "DOT", 2,
+    Slot_dot_Format_dot_slot2_44_get, Slot_dot_Format_dot_slot2_44_set,
+    Slot_dot_slot2_get_field_fns, Slot_dot_slot2_set_field_fns,
+    Slot_dot_slot2_decode, "nop" },
+  { "DOT_slot1", "DOT", 1,
+    Slot_dot_Format_dot_slot1_24_get, Slot_dot_Format_dot_slot1_24_set,
+    Slot_dot_slot1_get_field_fns, Slot_dot_slot1_set_field_fns,
+    Slot_dot_slot1_decode, "nop" },
+  { "DOT_slot0", "DOT", 0,
+    Slot_dot_Format_dot_slot0_7_get, Slot_dot_Format_dot_slot0_7_set,
+    Slot_dot_slot0_get_field_fns, Slot_dot_slot0_set_field_fns,
+    Slot_dot_slot0_decode, "nop" },
+  { "PQ_slot2", "PQ", 2,
+    Slot_pq_Format_pq_slot2_40_get, Slot_pq_Format_pq_slot2_40_set,
+    Slot_pq_slot2_get_field_fns, Slot_pq_slot2_set_field_fns,
+    Slot_pq_slot2_decode, "nop" },
+  { "PQ_slot1", "PQ", 1,
+    Slot_pq_Format_pq_slot1_26_get, Slot_pq_Format_pq_slot1_26_set,
+    Slot_pq_slot1_get_field_fns, Slot_pq_slot1_set_field_fns,
+    Slot_pq_slot1_decode, "nop" },
+  { "PQ_slot0", "PQ", 0,
+    Slot_pq_Format_pq_slot0_7_get, Slot_pq_Format_pq_slot0_7_set,
+    Slot_pq_slot0_get_field_fns, Slot_pq_slot0_set_field_fns,
+    Slot_pq_slot0_decode, "nop" },
+  { "ACC2_slot2", "ACC2", 2,
+    Slot_acc2_Format_acc2_slot2_47_get, Slot_acc2_Format_acc2_slot2_47_set,
+    Slot_acc2_slot2_get_field_fns, Slot_acc2_slot2_set_field_fns,
+    Slot_acc2_slot2_decode, "nop" },
+  { "ACC2_slot1", "ACC2", 1,
+    Slot_acc2_Format_acc2_slot1_23_get, Slot_acc2_Format_acc2_slot1_23_set,
+    Slot_acc2_slot1_get_field_fns, Slot_acc2_slot1_set_field_fns,
+    Slot_acc2_slot1_decode, "nop" },
+  { "ACC2_slot0", "ACC2", 0,
+    Slot_acc2_Format_acc2_slot0_7_get, Slot_acc2_Format_acc2_slot0_7_set,
+    Slot_acc2_slot0_get_field_fns, Slot_acc2_slot0_set_field_fns,
+    Slot_acc2_slot0_decode, "nop" },
+  { "SMOD_slot2", "SMOD", 2,
+    Slot_smod_Format_smod_slot2_42_get, Slot_smod_Format_smod_slot2_42_set,
+    Slot_smod_slot2_get_field_fns, Slot_smod_slot2_set_field_fns,
+    Slot_smod_slot2_decode, "nop" },
+  { "SMOD_slot1", "SMOD", 1,
+    Slot_smod_Format_smod_slot1_26_get, Slot_smod_Format_smod_slot1_26_set,
+    Slot_smod_slot1_get_field_fns, Slot_smod_slot1_set_field_fns,
+    Slot_smod_slot1_decode, "nop" },
+  { "SMOD_slot0", "SMOD", 0,
+    Slot_smod_Format_smod_slot0_7_get, Slot_smod_Format_smod_slot0_7_set,
+    Slot_smod_slot0_get_field_fns, Slot_smod_slot0_set_field_fns,
+    Slot_smod_slot0_decode, "nop" },
+  { "LLR_slot2", "LLR", 2,
+    Slot_llr_Format_llr_slot2_44_get, Slot_llr_Format_llr_slot2_44_set,
+    Slot_llr_slot2_get_field_fns, Slot_llr_slot2_set_field_fns,
+    Slot_llr_slot2_decode, "nop" },
+  { "LLR_slot1", "LLR", 1,
+    Slot_llr_Format_llr_slot1_24_get, Slot_llr_Format_llr_slot1_24_set,
+    Slot_llr_slot1_get_field_fns, Slot_llr_slot1_set_field_fns,
+    Slot_llr_slot1_decode, "nop" },
+  { "LLR_slot0", "LLR", 0,
+    Slot_llr_Format_llr_slot0_7_get, Slot_llr_Format_llr_slot0_7_set,
+    Slot_llr_slot0_get_field_fns, Slot_llr_slot0_set_field_fns,
+    Slot_llr_slot0_decode, "nop" },
+  { "DUAL_slot2", "DUAL", 2,
+    Slot_dual_Format_dual_slot2_31_get, Slot_dual_Format_dual_slot2_31_set,
+    Slot_dual_slot2_get_field_fns, Slot_dual_slot2_set_field_fns,
+    Slot_dual_slot2_decode, "nop" },
+  { "DUAL_slot1", "DUAL", 1,
+    Slot_dual_Format_dual_slot1_30_get, Slot_dual_Format_dual_slot1_30_set,
+    Slot_dual_slot1_get_field_fns, Slot_dual_slot1_set_field_fns,
+    Slot_dual_slot1_decode, "nop" },
+  { "DUAL_slot0", "DUAL", 0,
+    Slot_dual_Format_dual_slot0_7_get, Slot_dual_Format_dual_slot0_7_set,
+    Slot_dual_slot0_get_field_fns, Slot_dual_slot0_set_field_fns,
+    Slot_dual_slot0_decode, "nop" }
+};
+
+
+/* Instruction formats.  */
+
+static void
+Format_x24_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0;
+  insn[1] = 0;
+}
+
+static void
+Format_x16a_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0x8;
+  insn[1] = 0;
+}
+
+static void
+Format_x16b_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0xc;
+  insn[1] = 0;
+}
+
+static void
+Format_GP_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0xf;
+  insn[1] = 0;
+}
+
+static void
+Format_DOT_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0x1f;
+  insn[1] = 0;
+}
+
+static void
+Format_PQ_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0x2f;
+  insn[1] = 0;
+}
+
+static void
+Format_ACC2_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0x3f;
+  insn[1] = 0;
+}
+
+static void
+Format_SMOD_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0x4f;
+  insn[1] = 0;
+}
+
+static void
+Format_LLR_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0x5f;
+  insn[1] = 0;
+}
+
+static void
+Format_DUAL_encode (xtensa_insnbuf insn)
+{
+  insn[0] = 0x6f;
+  insn[1] = 0;
+}
+
+static int Format_x24_slots[] = { 0 };
+
+static int Format_x16a_slots[] = { 1 };
+
+static int Format_x16b_slots[] = { 2 };
+
+static int Format_GP_slots[] = { 5, 4, 3 };
+
+static int Format_DOT_slots[] = { 8, 7, 6 };
+
+static int Format_PQ_slots[] = { 11, 10, 9 };
+
+static int Format_ACC2_slots[] = { 14, 13, 12 };
+
+static int Format_SMOD_slots[] = { 17, 16, 15 };
+
+static int Format_LLR_slots[] = { 20, 19, 18 };
+
+static int Format_DUAL_slots[] = { 23, 22, 21 };
+
+static xtensa_format_internal formats[] = {
+  { "x24", 3, Format_x24_encode, 1, Format_x24_slots },
+  { "x16a", 2, Format_x16a_encode, 1, Format_x16a_slots },
+  { "x16b", 2, Format_x16b_encode, 1, Format_x16b_slots },
+  { "GP", 8, Format_GP_encode, 3, Format_GP_slots },
+  { "DOT", 8, Format_DOT_encode, 3, Format_DOT_slots },
+  { "PQ", 8, Format_PQ_encode, 3, Format_PQ_slots },
+  { "ACC2", 8, Format_ACC2_encode, 3, Format_ACC2_slots },
+  { "SMOD", 8, Format_SMOD_encode, 3, Format_SMOD_slots },
+  { "LLR", 8, Format_LLR_encode, 3, Format_LLR_slots },
+  { "DUAL", 8, Format_DUAL_encode, 3, Format_DUAL_slots }
+};
+
+
+static int
+format_decoder (const xtensa_insnbuf insn)
+{
+  if ((insn[0] & 0x8) == 0 && (insn[1] & 0) == 0)
+    return 0; /* x24 */
+  if ((insn[0] & 0xc) == 0x8 && (insn[1] & 0) == 0)
+    return 1; /* x16a */
+  if ((insn[0] & 0xe) == 0xc && (insn[1] & 0) == 0)
+    return 2; /* x16b */
+  if ((insn[0] & 0x7f) == 0xf && (insn[1] & 0) == 0)
+    return 3; /* GP */
+  if ((insn[0] & 0x7f) == 0x1f && (insn[1] & 0) == 0)
+    return 4; /* DOT */
+  if ((insn[0] & 0x7f) == 0x2f && (insn[1] & 0) == 0)
+    return 5; /* PQ */
+  if ((insn[0] & 0x7f) == 0x3f && (insn[1] & 0) == 0)
+    return 6; /* ACC2 */
+  if ((insn[0] & 0x7f) == 0x4f && (insn[1] & 0) == 0)
+    return 7; /* SMOD */
+  if ((insn[0] & 0x7f) == 0x5f && (insn[1] & 0) == 0)
+    return 8; /* LLR */
+  if ((insn[0] & 0x7f) == 0x6f && (insn[1] & 0) == 0)
+    return 9; /* DUAL */
+  return -1;
+}
+
+static int length_table[16] = {
+  3,
+  3,
+  3,
+  3,
+  3,
+  3,
+  3,
+  3,
+  2,
+  2,
+  2,
+  2,
+  2,
+  2,
+  -1,
+  8
+};
+
+static int
+length_decoder (const unsigned char *insn)
+{
+  int op0 = insn[0] & 0xf;
+  return length_table[op0];
+}
+
+
+/* Top-level ISA structure.  */
+
+xtensa_isa_internal xtensa_modules = {
+  0 /* little-endian */,
+  8 /* insn_size */, 0,
+  10, formats, format_decoder, length_decoder,
+  24, slots,
+  1733 /* num_fields */,
+  1828, operands,
+  747, iclasses,
+  839, opcodes, 0,
+  10, regfiles,
+  NUM_STATES, states, 0,
+  NUM_SYSREGS, sysregs, 0,
+  { MAX_SPECIAL_REG, MAX_USER_REG }, { 0, 0 },
+  95, interfaces, 0,
+  0, funcUnits, 0
+};
